JPS639773B2 - - Google Patents
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- JPS639773B2 JPS639773B2 JP20160982A JP20160982A JPS639773B2 JP S639773 B2 JPS639773 B2 JP S639773B2 JP 20160982 A JP20160982 A JP 20160982A JP 20160982 A JP20160982 A JP 20160982A JP S639773 B2 JPS639773 B2 JP S639773B2
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- JP
- Japan
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- circuit
- signal
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- voltage
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- 238000001514 detection method Methods 0.000 description 19
- 230000003321 amplification Effects 0.000 description 7
- 238000003199 nucleic acid amplification method Methods 0.000 description 7
- 238000010586 diagram Methods 0.000 description 6
- 239000003990 capacitor Substances 0.000 description 5
- 230000008878 coupling Effects 0.000 description 2
- 238000010168 coupling process Methods 0.000 description 2
- 238000005859 coupling reaction Methods 0.000 description 2
- 238000007796 conventional method Methods 0.000 description 1
- 230000003111 delayed effect Effects 0.000 description 1
- 230000006866 deterioration Effects 0.000 description 1
- 230000009365 direct transmission Effects 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04B—TRANSMISSION
- H04B1/00—Details of transmission systems, not covered by a single one of groups H04B3/00 - H04B13/00; Details of transmission systems not characterised by the medium used for transmission
- H04B1/06—Receivers
- H04B1/10—Means associated with receiver for limiting or suppressing noise or interference
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Noise Elimination (AREA)
Description
【発明の詳細な説明】
本発明は、歪軽減回路に関し、詳しくは受信対
象とする電波に外乱電波が混入して合成されるこ
とによつて生じる周波数信号の歪を軽減するよう
にした歪軽減回路に関する。
象とする電波に外乱電波が混入して合成されるこ
とによつて生じる周波数信号の歪を軽減するよう
にした歪軽減回路に関する。
従来から周波数変調（FM）放送受信機におい
て、直接の送信波と反射波とが同時に受信される
ことによつて、マルチパスが生じ、受信状態が悪
化する。特にステレオ放送の場合には、第１図の
検波出力波形で示すように、ひげ状のマルチパス
が生じて、受信状態が特に悪化する。すなわち、
ステレオ変調電波においては、直接波と反射波の
位相が、たとえば19kHzのステレオパイロツト信
号、左信号および右信号の和の信号（Ｌ＋Ｒ）、
左信号および右信号の差の信号（Ｌ−Ｒ）などの
周期で変化して合成される。そのため、フエイズ
モジユレーシヨン（PM）成分が生じ、これがひ
げ状のマルチパスとなる。このようなマルチパス
成分は、高い周波数成分を含むとともに、その包
絡線には低周波成分を含む。したがつてローパス
フイルタで前記マルチパスを除去することはでき
ない。
て、直接の送信波と反射波とが同時に受信される
ことによつて、マルチパスが生じ、受信状態が悪
化する。特にステレオ放送の場合には、第１図の
検波出力波形で示すように、ひげ状のマルチパス
が生じて、受信状態が特に悪化する。すなわち、
ステレオ変調電波においては、直接波と反射波の
位相が、たとえば19kHzのステレオパイロツト信
号、左信号および右信号の和の信号（Ｌ＋Ｒ）、
左信号および右信号の差の信号（Ｌ−Ｒ）などの
周期で変化して合成される。そのため、フエイズ
モジユレーシヨン（PM）成分が生じ、これがひ
げ状のマルチパスとなる。このようなマルチパス
成分は、高い周波数成分を含むとともに、その包
絡線には低周波成分を含む。したがつてローパス
フイルタで前記マルチパスを除去することはでき
ない。
このようなマルチパスノイズを除去するため
に、従来では自動車のイグニツシヨンノイズを切
るためのノイズキヤンセラーなどで対処していた
が、タイミングのずれや、切り残しなどがあつて
充分に対応することができなかつた。
に、従来では自動車のイグニツシヨンノイズを切
るためのノイズキヤンセラーなどで対処していた
が、タイミングのずれや、切り残しなどがあつて
充分に対応することができなかつた。
本発明は上述の技術的課題を解決してマルチパ
スなどの歪を軽減するようにした歪軽減回路を提
供することを目的とする。
スなどの歪を軽減するようにした歪軽減回路を提
供することを目的とする。
以下、図面によつて本発明の実施例を説明す
る。第２図は本発明の一実施例の回路図である。
この歪軽減回路１は、たとえばFMステレオ受信
機に備えられる。アンテナ２で受信された直接の
送信波と反射波とは、高周波増幅回路３、中間周
波増幅および検波回路４、結合コンデンサ５およ
び分圧抵抗６を介して本件歪軽減回路１に与えら
れ、この歪軽減回路１によつてマルチパス歪が軽
減される。
る。第２図は本発明の一実施例の回路図である。
この歪軽減回路１は、たとえばFMステレオ受信
機に備えられる。アンテナ２で受信された直接の
送信波と反射波とは、高周波増幅回路３、中間周
波増幅および検波回路４、結合コンデンサ５およ
び分圧抵抗６を介して本件歪軽減回路１に与えら
れ、この歪軽減回路１によつてマルチパス歪が軽
減される。
歪軽減回路１は遅延手段としてのローパスフイ
ルタ７を備える。このローパスフイルタ７は、抵
抗８およびコンデンサ９を含む。分圧抵抗６を介
してローパスフイルタ７に与えられる信号は、抵
抗８の抵抗値Ｒ１およびコンデンサ９の静電容量
Ｃ１で定まる時定数TD（＝C1×R1）だけ遅延し
て、出力端子１０に出力される。
ルタ７を備える。このローパスフイルタ７は、抵
抗８およびコンデンサ９を含む。分圧抵抗６を介
してローパスフイルタ７に与えられる信号は、抵
抗８の抵抗値Ｒ１およびコンデンサ９の静電容量
Ｃ１で定まる時定数TD（＝C1×R1）だけ遅延し
て、出力端子１０に出力される。
ローパスフイルタ７および出力端子１０間の接
続点１１、ならびに抵抗６およびローパスフイル
タ７間の接続点１２間には、帰還回路１３が接続
される。この帰還回路１３は、接続点１１から接
続点１２に向けて順に、バツフア１４、相互に逆
方向にダイオード１５，１６を接続した並列回路
およびコンデンサ１７を直列に接続してなる。
続点１１、ならびに抵抗６およびローパスフイル
タ７間の接続点１２間には、帰還回路１３が接続
される。この帰還回路１３は、接続点１１から接
続点１２に向けて順に、バツフア１４、相互に逆
方向にダイオード１５，１６を接続した並列回路
およびコンデンサ１７を直列に接続してなる。
このように構成された歪軽減回路１において、
マルチパスは時間あたりの電圧変化（dE／dT）
が大であるので、そのdE／dTが予め定められた
以下のものしか出力端子１０に出力されないこと
になる。すなわちダイオード１５，１６によるク
ランプ電圧をVDとすると、歪軽減回路１に与え
られた信号のdE／dTがVD／TD以下の成分はそ
のまま通過するが、VD／TDを超える成分は通
過を阻止される。
マルチパスは時間あたりの電圧変化（dE／dT）
が大であるので、そのdE／dTが予め定められた
以下のものしか出力端子１０に出力されないこと
になる。すなわちダイオード１５，１６によるク
ランプ電圧をVDとすると、歪軽減回路１に与え
られた信号のdE／dTがVD／TD以下の成分はそ
のまま通過するが、VD／TDを超える成分は通
過を阻止される。
ここで歪軽減回路１が上述のごとく動作する埋
由について説明する。分圧抵抗６の抵抗値をRi
とし、ダイオード１５，１６の等価順方向抵抗値
をRDとし、結合コンデンサ５の出力電圧をEiと
したときに、出力端子１０に出力される電圧Eo
は第１式で示される。
由について説明する。分圧抵抗６の抵抗値をRi
とし、ダイオード１５，１６の等価順方向抵抗値
をRDとし、結合コンデンサ５の出力電圧をEiと
したときに、出力端子１０に出力される電圧Eo
は第１式で示される。
Eo＝Ei・１／１＋jωR1・（１＋Ri／RD） ……(1)
なお第１式においてｊは虚数であり、ωは角周
波数である。第１式において抵抗値RDはダイオ
ード１５，１６の両端電圧がVD以下のときに無
限大である。また前記両端電圧がVDを超すと、
抵抗値RDは小となり、したがつてRi／RDが大
となつて、等価的に大きな時定数のフイルタとな
る。
波数である。第１式において抵抗値RDはダイオ
ード１５，１６の両端電圧がVD以下のときに無
限大である。また前記両端電圧がVDを超すと、
抵抗値RDは小となり、したがつてRi／RDが大
となつて、等価的に大きな時定数のフイルタとな
る。
次いで、第３図を参照して、歪軽減回路１の動
的動作を説明する。なお、第３図において第３図
ａは参考のために帰還回路１３を設けていないと
きの波形を示すものであり、第３図ｂは本発明に
従う歪軽減回路１による動作を説明するための波
形図である。また、実線で示す曲線は、接続点１
２における波形を示し、破線で示す曲線はバツフ
ア１４の出力波形を示す。
的動作を説明する。なお、第３図において第３図
ａは参考のために帰還回路１３を設けていないと
きの波形を示すものであり、第３図ｂは本発明に
従う歪軽減回路１による動作を説明するための波
形図である。また、実線で示す曲線は、接続点１
２における波形を示し、破線で示す曲線はバツフ
ア１４の出力波形を示す。
第３図ｂから明らかなように、バツフア１４の
出力波形に対して接続点１２の電圧波形が±VD
を超える成分すなわち第３図で示すマルチパス１
８がカツトされる。したがつて出力端子１０から
出力される信号は、マルチパスが大部分除去され
ていることになり、歪が軽減されることになる。
出力波形に対して接続点１２の電圧波形が±VD
を超える成分すなわち第３図で示すマルチパス１
８がカツトされる。したがつて出力端子１０から
出力される信号は、マルチパスが大部分除去され
ていることになり、歪が軽減されることになる。
本発明の他の実施例として、ローパスフイルタ
７に代えて他の遅延手段たとえば従来周知のノイ
ズキヤンセラを用いてもよい。
７に代えて他の遅延手段たとえば従来周知のノイ
ズキヤンセラを用いてもよい。
第４図を参照して、本発明の他の実施例では、
ノイズキヤンセラー２１およびローパスフイルタ
７によつて入力信号の遅延時間がさらに大とされ
てバツフア１４に与えられる。しかもバツフア１
４とダイオード１５，１６から成る並列回路との
間に、スイツチ１９が介在される。このスイツチ
１９は、中間周波増幅および検波回路４に関連し
て設けられたマルチパス検出回路２０によつてス
イツチング態様が変化される。すなわち、マルチ
パス検出回路２０によつてマルチパスが検出され
たときのみスイツチ１９は導通する。
ノイズキヤンセラー２１およびローパスフイルタ
７によつて入力信号の遅延時間がさらに大とされ
てバツフア１４に与えられる。しかもバツフア１
４とダイオード１５，１６から成る並列回路との
間に、スイツチ１９が介在される。このスイツチ
１９は、中間周波増幅および検波回路４に関連し
て設けられたマルチパス検出回路２０によつてス
イツチング態様が変化される。すなわち、マルチ
パス検出回路２０によつてマルチパスが検出され
たときのみスイツチ１９は導通する。
中間周波増幅および検波回路４は、３つの増幅
段２２ａ，２２ｂ，２２ｃを有し、各増幅段２２
ａ，２２ｂ，２２ｃからの信号は、マルチパス検
出回路２０における包絡線検波回路２３ａ，２３
ｂ，２３ｃによつて検波される。さらに各包絡線
検波回路２３ａ，２３ｂ，２３ｃの出力はライン
２４で合成されてマルチパス検出のために用いら
れる。
段２２ａ，２２ｂ，２２ｃを有し、各増幅段２２
ａ，２２ｂ，２２ｃからの信号は、マルチパス検
出回路２０における包絡線検波回路２３ａ，２３
ｂ，２３ｃによつて検波される。さらに各包絡線
検波回路２３ａ，２３ｂ，２３ｃの出力はライン
２４で合成されてマルチパス検出のために用いら
れる。
ライン２４からの信号はバンドパスフイルタ２
５およびハイパスフイルタ２６に与えられる。パ
ンドパスフイルタ２５は、57kHzの周波数を有す
る信号を波して通過させる。ハイパスフイルタ
２６は、70kHz以上の周波数を有する信号を波
して通過させる。バンドパスフイルタ２５および
ハイパスフイルタ２６からの信号は、検波回路２
７，２８にそれぞれ与えられて包絡線検波され
る。検波回路２７，２８からの出力は、減算回路
２９の入力端子３０，３１にそれぞれ与えられ
る。減算回路２９は、入力端子３０の電圧Ｖ３０
と、入力端子３１の電圧Ｖ３１との差（＝V30−
V31）を有する信号を、出力端子３２に導出す
る。この出力端子３２からの信号は、比較回路３
３の一方の入力端子３４に与えられる。比較回路
３３の他方の入力端子３５には、基準電圧Vrが
与えられる。比較回路３３は、入力端子３４の電
圧が入力端子３５の基準電圧Vr以上であるとき、
出力端子３６にハイレベルの信号を導出し、その
他の場合には出力端子３６はローレベルのままで
ある。出力端子３６からの信号は、ライン３７を
介して制御回路３８に与えられる。
５およびハイパスフイルタ２６に与えられる。パ
ンドパスフイルタ２５は、57kHzの周波数を有す
る信号を波して通過させる。ハイパスフイルタ
２６は、70kHz以上の周波数を有する信号を波
して通過させる。バンドパスフイルタ２５および
ハイパスフイルタ２６からの信号は、検波回路２
７，２８にそれぞれ与えられて包絡線検波され
る。検波回路２７，２８からの出力は、減算回路
２９の入力端子３０，３１にそれぞれ与えられ
る。減算回路２９は、入力端子３０の電圧Ｖ３０
と、入力端子３１の電圧Ｖ３１との差（＝V30−
V31）を有する信号を、出力端子３２に導出す
る。この出力端子３２からの信号は、比較回路３
３の一方の入力端子３４に与えられる。比較回路
３３の他方の入力端子３５には、基準電圧Vrが
与えられる。比較回路３３は、入力端子３４の電
圧が入力端子３５の基準電圧Vr以上であるとき、
出力端子３６にハイレベルの信号を導出し、その
他の場合には出力端子３６はローレベルのままで
ある。出力端子３６からの信号は、ライン３７を
介して制御回路３８に与えられる。
マルチパスが生じておらずしかもイグニシヨン
ノイズが生じていないときには、検波回路２７，
２８からの出力レベルはいずれも低い。したがつ
て減算回路２９の出力端子３２、したがつて比較
回路３３の一方の入力端子３４の電圧は、基準電
圧Vr未満である。そのため出力端子３６、した
がつてライン３７はローレベルである。そのため
スイツチ１９はスイツチング態様を変化せず、遮
断したままである。
ノイズが生じていないときには、検波回路２７，
２８からの出力レベルはいずれも低い。したがつ
て減算回路２９の出力端子３２、したがつて比較
回路３３の一方の入力端子３４の電圧は、基準電
圧Vr未満である。そのため出力端子３６、した
がつてライン３７はローレベルである。そのため
スイツチ１９はスイツチング態様を変化せず、遮
断したままである。
マルチパスが発生し、イグニシヨンノイズが生
じていないときには、検波回路２７の出力電圧は
高く、しかるに検波回路２８からの出力のレベル
は低い。したがつて減算回路２９の出力端子３２
から比較回路３３の入力端子３４に与えられる電
圧は、基準電圧Vrを超える。そのため比較回路
３３の出力端子３６からライン３７には、ハイレ
ベルの信号が導出される。そのため制御回路３８
はスイツチ１９を導通し、したがつて歪軽減回路
でマルチパスが除去される。
じていないときには、検波回路２７の出力電圧は
高く、しかるに検波回路２８からの出力のレベル
は低い。したがつて減算回路２９の出力端子３２
から比較回路３３の入力端子３４に与えられる電
圧は、基準電圧Vrを超える。そのため比較回路
３３の出力端子３６からライン３７には、ハイレ
ベルの信号が導出される。そのため制御回路３８
はスイツチ１９を導通し、したがつて歪軽減回路
でマルチパスが除去される。
マルチパスが生じておらず、イグニシヨンノイ
ズが生じているときには検波回路２７からの出力
レベルが小さく、しかるに検波回路２８からの出
力レベルは大きい。したがつて減算回路２９の出
力端子３２から比較回路３３の入力端子３４に与
えられる信号の電圧は基準電圧Vr未満であり、
出力端子３６、したがつてライン３７はローレベ
ルのままである。
ズが生じているときには検波回路２７からの出力
レベルが小さく、しかるに検波回路２８からの出
力レベルは大きい。したがつて減算回路２９の出
力端子３２から比較回路３３の入力端子３４に与
えられる信号の電圧は基準電圧Vr未満であり、
出力端子３６、したがつてライン３７はローレベ
ルのままである。
マルチパスが生じており、このとき同時にイグ
ニシヨンノイズを生じている場合において、マル
チパスの発生の程度が著しいときには、減算回路
２９の出力端子３２から比較回路３３の入力端子
３４に与えられる信号の電圧は基準電圧Vrを超
える。そのため比較回路３３の出力端子３６から
ライン３７にはハイレベルの信号が与えられる。
ニシヨンノイズを生じている場合において、マル
チパスの発生の程度が著しいときには、減算回路
２９の出力端子３２から比較回路３３の入力端子
３４に与えられる信号の電圧は基準電圧Vrを超
える。そのため比較回路３３の出力端子３６から
ライン３７にはハイレベルの信号が与えられる。
このようにして、マルチパスが生じたときのみ
にスイツチ１９が導通することにより、マルチパ
スが生じたときのみに歪軽減回路が動作して、直
接の送信波に対する影響が軽減される。
にスイツチ１９が導通することにより、マルチパ
スが生じたときのみに歪軽減回路が動作して、直
接の送信波に対する影響が軽減される。
なお、上述の実施例では受信対象をFM電波と
して説明したが、本発明は増幅変調（AM）放送
受信機におけるエンジンノイズなどの外乱電波に
よる歪を軽減するためにも用いられうる。
して説明したが、本発明は増幅変調（AM）放送
受信機におけるエンジンノイズなどの外乱電波に
よる歪を軽減するためにも用いられうる。
上述のごとく本発明によれば、時間あたりの電
圧変化が大である信号成分をカツトするようにし
たので、外乱電波によつて生じる歪を軽減するこ
とができる。
圧変化が大である信号成分をカツトするようにし
たので、外乱電波によつて生じる歪を軽減するこ
とができる。
第１図はマルチパスが生じている検波出力の波
形図、第２図は本発明の一実施例の回路図、第３
図は歪軽減回路１の動的動作を説明するための波
形図、第４図は本発明の他の実施例の回路図であ
る。 １……歪軽減回路、７……ローパスフイルタ、
１１，１２……接続点、１５，１６……ダイオー
ド、２１……ノイズキヤンセラー。
形図、第２図は本発明の一実施例の回路図、第３
図は歪軽減回路１の動的動作を説明するための波
形図、第４図は本発明の他の実施例の回路図であ
る。 １……歪軽減回路、７……ローパスフイルタ、
１１，１２……接続点、１５，１６……ダイオー
ド、２１……ノイズキヤンセラー。
Claims (1)
- 【特許請求の範囲】 １ 受信対象とする電波に外乱電波が混入して合
成されることによつて生じる周波数信号の歪を軽
減するようにした歪軽減回路であつて、 前記合成された信号を予め定めた時間だけ遅延
して出力する遅延手段、ならびに 前記遅延手段に与えられる前記合成された信号
が前記遅延手段の出力信号との間で予め設定した
電圧レベルを超えたときに前記遅延手段に与えら
れる合成された信号の電圧レベルを強制的に前記
設定した電圧レベルとする手段を含むことを特徴
とする歪軽減回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57201609A JPS5991733A (ja) | 1982-11-16 | 1982-11-16 | 歪軽減回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57201609A JPS5991733A (ja) | 1982-11-16 | 1982-11-16 | 歪軽減回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5991733A JPS5991733A (ja) | 1984-05-26 |
| JPS639773B2 true JPS639773B2 (ja) | 1988-03-02 |
Family
ID=16443891
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57201609A Granted JPS5991733A (ja) | 1982-11-16 | 1982-11-16 | 歪軽減回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5991733A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02102681U (ja) * | 1989-01-31 | 1990-08-15 | ||
| JPH0438672U (ja) * | 1990-07-31 | 1992-03-31 | ||
| JPH0438671U (ja) * | 1990-07-27 | 1992-03-31 |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02143944A (ja) * | 1988-11-24 | 1990-06-01 | Mitsubishi Electric Corp | ディスク記憶装置 |
Family Cites Families (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP5624731B2 (ja) * | 2009-04-30 | 2014-11-12 | 京楽産業．株式会社 | 遊技機、演出制御方法および演出制御プログラム |
| JP5242638B2 (ja) * | 2010-08-06 | 2013-07-24 | 京楽産業．株式会社 | ぱちんこ遊技機 |
| JP5461358B2 (ja) * | 2010-10-12 | 2014-04-02 | 株式会社ニューギン | 遊技機 |
-
1982
- 1982-11-16 JP JP57201609A patent/JPS5991733A/ja active Granted
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02102681U (ja) * | 1989-01-31 | 1990-08-15 | ||
| JPH0438671U (ja) * | 1990-07-27 | 1992-03-31 | ||
| JPH0438672U (ja) * | 1990-07-31 | 1992-03-31 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5991733A (ja) | 1984-05-26 |
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