JPS6381965A - 電子装置 - Google Patents

電子装置

Info

Publication number
JPS6381965A
JPS6381965A JP61225951A JP22595186A JPS6381965A JP S6381965 A JPS6381965 A JP S6381965A JP 61225951 A JP61225951 A JP 61225951A JP 22595186 A JP22595186 A JP 22595186A JP S6381965 A JPS6381965 A JP S6381965A
Authority
JP
Japan
Prior art keywords
tab
stress
package
section
pellet
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP61225951A
Other languages
English (en)
Inventor
Wataru Ohashi
亘 大橋
Fumiharu Nozawa
野澤 文春
Hideki Tsuya
津谷 英喜
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Hitachi Ltd
Original Assignee
Hitachi Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Hitachi Ltd filed Critical Hitachi Ltd
Priority to JP61225951A priority Critical patent/JPS6381965A/ja
Publication of JPS6381965A publication Critical patent/JPS6381965A/ja
Pending legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/4805Shape
    • H01L2224/4809Loop shape
    • H01L2224/48091Arched
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/481Disposition
    • H01L2224/48151Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
    • H01L2224/48221Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
    • H01L2224/48245Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic
    • H01L2224/48247Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being metallic connecting the wire to a bond pad of the item
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2224/00Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
    • H01L2224/01Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
    • H01L2224/42Wire connectors; Manufacturing methods related thereto
    • H01L2224/47Structure, shape, material or disposition of the wire connectors after the connecting process
    • H01L2224/48Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
    • H01L2224/484Connecting portions
    • H01L2224/48463Connecting portions the connecting portion on the bonding area of the semiconductor or solid-state body being a ball bond
    • H01L2224/48465Connecting portions the connecting portion on the bonding area of the semiconductor or solid-state body being a ball bond the other connecting portion not on the bonding area being a wedge bond, i.e. ball-to-wedge, regular stitch
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/15Details of package parts other than the semiconductor or other solid state devices to be connected
    • H01L2924/181Encapsulation

Landscapes

  • Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)
  • Lead Frames For Integrated Circuits (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、電子装置、特に、樹脂封止型パンケージにお
けるクラックの発生防止技術に関し、例えば、フラット
・プラスチック・パッケージを備えている半導体装置(
以下、PPPTCという。
)に利用して有効な技術に関する。
〔従来の技術〕
高密度実装を実現するための半導体装置として、ペレッ
トがボンディングされたタブの周囲にリードが四方に配
設されている樹脂封止型パフケージを備えているPPP
rCがある。
なお、PPPICを述べである例としては、株式会社工
業調査会発行rfc化実装技術」昭和55年1月10日
発行 P135〜P155、がある。
〔発明が解決しようとする問題点〕
しかし、このようなPPPICにおいては、ペレットを
形成しているシリコン、リードフレームを形成している
4270イや銅、およびパッケージを形成している樹脂
についての熱膨張係数が大きく異なるため、PPPIC
が温度サイクル試験、熱衝撃試験等を受けることにより
、パッケージと、ペレットおよびリードフレームのタブ
との接着界面に剥がれが生じ、その結果、樹脂パッケー
ジにクランクが発生し、耐湿性が低下するという問題点
があることが、本発明者によって明らかにされた。
本発明の目的は、樹脂封止型バフケージにおけるクラン
クの発生を防止することができる電子装置を提供するこ
とにある。
本発明の前記ならびにその他の目的と新規な特徴は、本
明細書の記述および添付図面から明らかになるであろう
〔問題点を解決するための手段〕
本願において開示される発明のうち代表的なものの概要
を説明すれば、次の通りである。
すなわち、パフケージに樹脂封止されるベレットの取付
部であるタブの外周縁に面取り部を下方すぼまりに形成
したものである。
〔作用〕 前記した手段によれば、温度サイクル試験等によりパッ
ケージ内部に応力が発生し、パッケージとベレットおよ
びタブとの間に剥離が生じたとしても、タブの外周縁に
面取り部が設けられているため、タブの外周縁に接して
いるパッケージ部分に応力が集中する現象が回避される
ことになる。
その結果、この応力集中によってパフケージに発生する
クランクは防止されることになる。
〔実施例〕
第1図は本発明の一実施例であるFPPICを示す可断
面図、第2図はその拡大部分断面図、第3図はその製造
途中を示す平面図、第4図はその作用を説明するための
パッケージ内部の応力分布図である。
本実施例において、PPPICIはリードフレーム2を
備えており、リードフレーム2はパンケージング以前に
は第3図に示されているように構成されている。すなわ
ち、リードフレーム2は交差部に略正方形の空所3が残
るように略十字形状に配設されている複数本のインナリ
ード4と、各インナリード4にそれぞれ一体的に連設さ
れている複数本のアウタリード5と、隣り合うアウタリ
ード5.5間に架設されているダム6と、一対のアウタ
リード5群に連設されている一対の外枠7と、空所3に
配されてこれよりも若干小さめの略正方形の平盤形状に
形成されているタブ8と、ダム6に四隅からそれぞれ突
設されてタブ8を吊持している保持部材9とを備えてい
る。
タブ8は略正方形の平板形状に形成されており、その外
周縁には面取り部10が後記するベレット搭載面(以下
、上面とする。)側から反対側の端面に行くにしたがっ
てすぼまるように全体にわたって形成されている。リー
ドフレーム2は打ち抜きプレス加工により形成される。
そこで、例えば、タブ8を打ち抜くプレス金型の刃を所
定の角度に傾斜させておくことにより、面取り部IOは
タブ8の打ち抜き加工と同時に形成される。また、タブ
8の外周縁部にエツチング加工を施しても面取り部10
が形成される。
本実施例においては、インナリード4群の外周縁にも同
様の面取り部11が全体にわたって形成タブ8上には集
積回路を作り込まれたベレット12が適当な手段により
ボンディングされており、ベレット12の電極パッド(
図示せず)には各インナリード4との間にワイヤ13が
それぞれボンディングされている。ベレット12の集積
回路は電極バッド、ワイヤ13、インナリード4および
アウタリード5を介して電気的に外部に引き出されるよ
うになっている。
そして、このPPPICIは樹脂を用いてトランスファ
成形法等により略正方形の平盤形状に一体成形されたパ
ッケージ14を備えており、このパッケージ14により
前記リードフレーム2の一部、ベレット12、ワイヤエ
3およびタブ8が非気密封止されている。すなわち、タ
ブ8等以外のアウタリード5群はパッケージ14の4側
面からそれぞれ突出され、そして、アウタリード5群は
パッケージ14の外部において下方向に屈曲された後、
水平外方向にさらに屈曲されている。ちなみに、パッケ
ージ14の成形後、前記外枠7および隣接するアウタリ
ード5.5間は切り落とされる。
次に作用を説明する。
前記構成にかかるPPPICは出荷前に抜き取り検査を
実施される。抜き取り検査としては温度サイクル試験や
熱衝撃試験を含む環境試験が実施される。
このように環境試験または実使用時に熱ストレスが前記
PPPICに加えられた場合、構成材料の熱膨張係数差
によりパッケージ14の内部に応力が発生する。
ところで、タブの外周縁が鋭い直角に形成されている場
合、第4図に示されているように、パッケージの内部応
力はタブ8°の裏面における外縁付近に集中する。但し
、パッケージのクランクはこの程度の応力集中では発生
しない、しかし、変型なる熱ストレスによる繰り返し応
力により、タブ下面とパフケージまたはタブとペレット
との界面に剥離が発生すると、前記応力集中箇所に過大
な応力が作用するため、そこにクランクが発生するとい
う問題点があることが、本発明者によって明らかにされ
た。
そして、4270イからなるリードフレームが使用され
ている場合、タブ下面とパッケージとの界面における剥
離、銅からなるリードフレームが使用されている場合、
ペレットとタブとの界面における剥離がそれぞれ発生し
たときに、タブ下端部の応力は大幅に増加し、パンケー
ジにクランクが発生する。特に、熱膨張係数がレジンと
略同−の銅からなるリードフレームが使用されている場
合でも、ペレットとタブとの鼻面における剥離が発生す
ると、タブ側面に接するレジンが開口し、過大な応力が
作用してクランクが発生する。
しかし、本実施例においては、タブ8の外周縁には面取
り部10が形成されているため、パッケージ14にクラ
ックが発生することはない、すなわち、熱ストレスによ
る繰り返し応力により、タブ下面とパッケージまたはタ
ブとペレットとの界面に剥離が発生しても、タブ8の外
周縁に面取り部10が形成されることによって応力が第
2図に矢印で示されているように分散されて集中しない
ため、この箇所に過大な応力が作用することばなく、そ
の結果、ここからクランクが発生する現象は防止される
ことになる。この応力の分散は面取り部10の傾斜角θ
が約45度に設定されている場合に最も良好に行われる
前記実施例によれば次の効果が得られる。
11+  タブの外周縁に下方すぼまりの面取り部を形
成することにより、熱ストレスに伴い発生する応力がタ
ブの外周縁に集中するのを防止することができるため、
タブの外周縁を起点とするパッケージにおけるクランク
の発生を防止することができる。
(2)前記(11により、パッケージクラックの発生を
防止することができるので、薄型でかつ小型パッケージ
からなる電子装置の集積密度および実装密度の高度化を
実現させることができる。
(3)  タブ外周縁の面取り部についての形成は、電
子装置の製造工程下におけるリードフレームの打ち抜き
プレス加工時に同時成形することができるため、作業性
の低下を抑制することができる。
以上本発明者によってなされた発明を実施例に基づき具
体的に説明したが、本発明は前記実施例に限定されるも
のではなく、その要旨を逸脱しない範囲で種々変更可能
であることはいうまでもない。
例えば、タブ外周縁の面取り部の形状は断面台形形状に
形成するに限らず、第5図に示されている面取り部10
のようにタブ外周面における下縁を部分的に切除してな
る形状等であってもよい。
また、ペレットに集中する応力を分散するには、ペレッ
トの端部に面取り部を形成することが望ましい。さらに
、応力はタブとペレットとの剥がれによっても発生する
ので、両者の接着性を強化することが望ましいのは言う
までもない。
以上の説明では主として本発明者によってなされた発明
をその背景となった利用分野である樹脂封止型のFPP
 I Cに通用した場合について説明したが、それに限
定されるものではな(、その他の樹脂封止型のパッケー
ジを備えたIC等の電子装置全般に通用することができ
る。
〔発明の効果〕
本願において開示される発明のうち代表的なものによっ
て得られる効果を簡単に説明すれば、次の通りである。
ベレット取付部であるタブの外周縁に面取り部を下方す
ぼまりに形成することにより、熱ストレスによって樹脂
封止パッケージの内部に発生する応力がタブの外周縁に
集中するのを防止することができるため、該コーナを起
点とするパッケージクランクの発生を防止することがで
きる。
【図面の簡単な説明】
第1図は本発明の一実施例であるPPP[Cを示す縦断
面図、 第2図はその拡大部分断面図、 第3図はその製造途中を示す平面図、 第4図はその作用を説明するためのパッケージ内部の応
力分布図、 第5図はその変形例を示す拡大部分断面図である。 1・・・PPPIC(電子装置)、2・・・リードフレ
ーム、3・・・空所、4・・・インナリード、5・・・
アウタリード、6・・・ダム、7・・・外枠、8・・・
タブ、9・・・保持部材、10.11・・・面取り部、
12・・・ペレット、13・・・ボンディングワイヤ、
14・・ ・パッケージ。 第  3  図 第  4  図 第  5  図

Claims (1)

  1. 【特許請求の範囲】 1、樹脂封止型パッケージを備えている電子装置であっ
    て、インナリードと対向するように配設されているタブ
    におけるペレット搭載面とは反対側の端面に面取り部が
    先方すぼまりに形成されていることを特徴とする電子装
    置。 2、面取り部が、その傾斜角を約45度に形成されてい
    ることを特徴とする特許請求の範囲第1項記載の電子装
    置。 3、面取り部が、タブのプレス加工と同時成形されてい
    ることを特徴とする特許請求の範囲第1項記載の電子装
    置。
JP61225951A 1986-09-26 1986-09-26 電子装置 Pending JPS6381965A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP61225951A JPS6381965A (ja) 1986-09-26 1986-09-26 電子装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP61225951A JPS6381965A (ja) 1986-09-26 1986-09-26 電子装置

Publications (1)

Publication Number Publication Date
JPS6381965A true JPS6381965A (ja) 1988-04-12

Family

ID=16837448

Family Applications (1)

Application Number Title Priority Date Filing Date
JP61225951A Pending JPS6381965A (ja) 1986-09-26 1986-09-26 電子装置

Country Status (1)

Country Link
JP (1) JPS6381965A (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0369248U (ja) * 1989-11-10 1991-07-09
US5233222A (en) * 1992-07-27 1993-08-03 Motorola, Inc. Semiconductor device having window-frame flag with tapered edge in opening

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0369248U (ja) * 1989-11-10 1991-07-09
US5233222A (en) * 1992-07-27 1993-08-03 Motorola, Inc. Semiconductor device having window-frame flag with tapered edge in opening

Similar Documents

Publication Publication Date Title
US6175149B1 (en) Mounting multiple semiconductor dies in a package
KR20040030514A (ko) 플라스틱 반도체 패키지
KR100242393B1 (ko) 반도체 패키지 및 제조방법
JP2006509371A (ja) 露出された集積回路装置を有するパッケージ
US4712127A (en) High reliability metal and resin container for a semiconductor device
JPS6381966A (ja) 電子装置
JPS6381965A (ja) 電子装置
JP2569008B2 (ja) 半導体装置
JP2539432B2 (ja) 樹脂封止型半導体装置
JPS63208255A (ja) 電子装置
JPH0418468B2 (ja)
JPS6354759A (ja) 電子装置
JPS63164250A (ja) 電子装置
JPS6223096Y2 (ja)
JPH079961B2 (ja) 樹脂封止形半導体装置
JPS63164254A (ja) 半導体装置
JPH05315540A (ja) 半導体装置
JPH0870087A (ja) リードフレーム
JPS6329960A (ja) 樹脂封止型半導体装置用リ−ドフレ−ム
JPS6352451A (ja) レジン封止型半導体装置
KR20240053158A (ko) 다이 본더 접착력 향상을 위한 리드 프레임 구조
KR200165742Y1 (ko) 반도체 패키지
JPH0419805Y2 (ja)
JPH0311754A (ja) 半導体装置
JPH03133161A (ja) 半導体装置