JPS6337739A - デイジタル伝送装置用評価方式および装置 - Google Patents
デイジタル伝送装置用評価方式および装置Info
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- JPS6337739A JPS6337739A JP18133086A JP18133086A JPS6337739A JP S6337739 A JPS6337739 A JP S6337739A JP 18133086 A JP18133086 A JP 18133086A JP 18133086 A JP18133086 A JP 18133086A JP S6337739 A JPS6337739 A JP S6337739A
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- 230000004044 response Effects 0.000 claims description 4
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Landscapes
- Detection And Prevention Of Errors In Transmission (AREA)
- Bidirectional Digital Transmission (AREA)
- Dc Digital Transmission (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はディジタル伝送装置用評価方式および装置、特
に時分割双方向ディジタル伝送方式のごとくバースト状
にディジタル1コ号を授受するための伝送装置の評価に
好適なディジタル伝送装置用評価方式および装置に関す
る。
に時分割双方向ディジタル伝送方式のごとくバースト状
にディジタル1コ号を授受するための伝送装置の評価に
好適なディジタル伝送装置用評価方式および装置に関す
る。
従来、ディジタル伝送装置の評価方式として、正常な動
作が得られる範囲を示す余裕度を評価するために、既知
のパルスパターンをもつディジタル信号に雑音t−重立
させたものを評価対象装置の受信部に与えて、受信時に
おける符号誤シ率が許容限界に達した際の雑音レベル値
の大小を評価尺度とする方法が広く使用されている。
作が得られる範囲を示す余裕度を評価するために、既知
のパルスパターンをもつディジタル信号に雑音t−重立
させたものを評価対象装置の受信部に与えて、受信時に
おける符号誤シ率が許容限界に達した際の雑音レベル値
の大小を評価尺度とする方法が広く使用されている。
上述した従来のディジタル伝送装置用評価方式では、伝
送路で生じる波形歪を自動的に郷化するための等化器を
受信部に備えている評価対象装置に適用した場合、評価
用のディジタル信号に1fした雑音の影響を受けて自動
等化器の動作状態が変化するので、評価結果が実際の通
信状態における余裕度を示すとは限らず、また符号m+
>の発生原因を分析するのは不可能であるという問題点
がある。
送路で生じる波形歪を自動的に郷化するための等化器を
受信部に備えている評価対象装置に適用した場合、評価
用のディジタル信号に1fした雑音の影響を受けて自動
等化器の動作状態が変化するので、評価結果が実際の通
信状態における余裕度を示すとは限らず、また符号m+
>の発生原因を分析するのは不可能であるという問題点
がある。
本発明の目的は、上述の問題点を解決し評価対象装置の
自動等化器の動作に影響を与えず且つ符号誤シO発生原
因の分析が容易に可能なディジタル伝送装置用評価方式
および装fit?提供することに、ある。
自動等化器の動作に影響を与えず且つ符号誤シO発生原
因の分析が容易に可能なディジタル伝送装置用評価方式
および装fit?提供することに、ある。
本発明の第1の発明の方式は、両極性パルスおよびゼロ
パルスを有し所定の周期毎に該周期よりも短い所定の時
間長に亘って出現するバーストの系列から成るディジタ
ル信号に対して、前記バースト系列中の所定間隔毎の1
つのバーストの前記両極性パレスの振幅を残余のバース
トの前記両極性パルスの振幅とは異なる予め定めた大き
さに設定する第1の変形と、前記バースト系列中の所定
間隔毎の1つのバースト上の前記ゼロパルスにゼロとは
異なる予め定めた振@を付与する第2の変形と、前記バ
ースト系列中の所定間隔毎の1つのバーストの前記出現
のタイミングを予め定めた時間だけ予め定めた向きにず
らす21!3の変形との、3つの変形のうち少くとも1
つを施した上で評価対象装fK与えて動作余裕度を評価
する方法である。
パルスを有し所定の周期毎に該周期よりも短い所定の時
間長に亘って出現するバーストの系列から成るディジタ
ル信号に対して、前記バースト系列中の所定間隔毎の1
つのバーストの前記両極性パレスの振幅を残余のバース
トの前記両極性パルスの振幅とは異なる予め定めた大き
さに設定する第1の変形と、前記バースト系列中の所定
間隔毎の1つのバースト上の前記ゼロパルスにゼロとは
異なる予め定めた振@を付与する第2の変形と、前記バ
ースト系列中の所定間隔毎の1つのバーストの前記出現
のタイミングを予め定めた時間だけ予め定めた向きにず
らす21!3の変形との、3つの変形のうち少くとも1
つを施した上で評価対象装fK与えて動作余裕度を評価
する方法である。
本発明の第2の発明の装置は、所定のレートをもつクロ
ック信号に応答して両極性パルスおよびゼロパルスを有
し所定の時間長をもつバーストの系列から成るディジタ
ル信号を発生するバースト発生手段と、位相制御データ
を与えられこれに応答して前記バーストの出現タイミン
グを設定する位相制御手段と、像幅制御データを与えら
れこれに応答して前記バーストの前記両極性パルスの振
幅およぶ前記ゼロパルスに付与する振幅をおのおの個別
に設定した上で出力する出力手段とを備えている。
ック信号に応答して両極性パルスおよびゼロパルスを有
し所定の時間長をもつバーストの系列から成るディジタ
ル信号を発生するバースト発生手段と、位相制御データ
を与えられこれに応答して前記バーストの出現タイミン
グを設定する位相制御手段と、像幅制御データを与えら
れこれに応答して前記バーストの前記両極性パルスの振
幅およぶ前記ゼロパルスに付与する振幅をおのおの個別
に設定した上で出力する出力手段とを備えている。
次に、本発明について図面を参照して説明する。
第1図(a)〜(Φは本発明の第1の発明の一実施例を
示すタイミング図である。本実施例の評価対象装置は時
分割双方向ディジタル伝送方式(いわゆるピンポン伝送
方式)川伝送装置であり、同図(a)に示すごとく所定
のバースト周期T毎に所定のバースト長(T/2よりも
短かい)のディジタル信号を送信側から受信側へ伝送す
る。バースト状のディジタル信号は、値「0」を示すゼ
ロ電圧(ゼロパルス)、値「1」を示し且つ交互に「+
IJ。
示すタイミング図である。本実施例の評価対象装置は時
分割双方向ディジタル伝送方式(いわゆるピンポン伝送
方式)川伝送装置であり、同図(a)に示すごとく所定
のバースト周期T毎に所定のバースト長(T/2よりも
短かい)のディジタル信号を送信側から受信側へ伝送す
る。バースト状のディジタル信号は、値「0」を示すゼ
ロ電圧(ゼロパルス)、値「1」を示し且つ交互に「+
IJ。
「−1」と極性を変えて現われる電圧+vlおよび−V
tの両極性パルス、から成るXtff符号形式をもつ。
tの両極性パルス、から成るXtff符号形式をもつ。
本実施例は、同図(尋の信号を受信して復号化する評価
対象装置の受信部に対し同図(匈ないしく4に示すよう
な変形を加えた信号を与え1受信時における符号誤シ率
が許容限界に達した際の信号変形量の大小を評価尺度と
して用いる方法である。
対象装置の受信部に対し同図(匈ないしく4に示すよう
な変形を加えた信号を与え1受信時における符号誤シ率
が許容限界に達した際の信号変形量の大小を評価尺度と
して用いる方法である。
同図(b)は、既知のパルスパターンをもつバースト系
列において、予め定めたバースト回数おきに一つのバー
ストの両極性パルスの振幅を、予め定めた電圧ΔVsだ
け低下させたバーストを示す。
列において、予め定めたバースト回数おきに一つのバー
ストの両極性パルスの振幅を、予め定めた電圧ΔVsだ
け低下させたバーストを示す。
同図(C)に示すペーストは、既知パターンをもつバー
スト系列で、予め定めたバースト回数おきに一つのバー
スト中のゼ、ロパルスすなわち値rOJ ’i示すタイ
ムスロットの振幅に、予め定めた電圧ΔVoを与えたも
のである。また、同図(d)に示すバーストは、既知パ
ターンをもつバースト系列で、予め定めたバースト回数
おきに一つのバーストのタイミングを、予め定めた時間
ΔTだけ進ませた(あるいは遅らせた)ものである。
スト系列で、予め定めたバースト回数おきに一つのバー
スト中のゼ、ロパルスすなわち値rOJ ’i示すタイ
ムスロットの振幅に、予め定めた電圧ΔVoを与えたも
のである。また、同図(d)に示すバーストは、既知パ
ターンをもつバースト系列で、予め定めたバースト回数
おきに一つのバーストのタイミングを、予め定めた時間
ΔTだけ進ませた(あるいは遅らせた)ものである。
例えば同図(b)の変形を加えたバースト系列を所定の
バースト個数だけ評価対象装置に与えて、受信時の符号
誤り率を測定する。振幅低下を与えたバーストの出現頻
度を低く設定することによシ、この測定中に受信部の自
動等化器がバースト振幅の変化に追従して動作状態の変
化を生じるのを、防止できる。更にこのような測定を、
電圧Δ■1を変えて繰返すことにより、バースト振幅の
低下に対する余裕度すなわち値「1」の識別余裕度を評
価することができる。同様に、同図(e)および(ψの
バースト系列をそれぞれ評価対象装置に与えることによ
シ、受信部の自動等化器の動作に影響を与えずに、値「
0」の識別余裕度および位相余裕度を評価することがで
きる。更に、同図(麹ないしくψの変形を組合せること
によシ、各棟の評価目的に応じた評価も可能である。
バースト個数だけ評価対象装置に与えて、受信時の符号
誤り率を測定する。振幅低下を与えたバーストの出現頻
度を低く設定することによシ、この測定中に受信部の自
動等化器がバースト振幅の変化に追従して動作状態の変
化を生じるのを、防止できる。更にこのような測定を、
電圧Δ■1を変えて繰返すことにより、バースト振幅の
低下に対する余裕度すなわち値「1」の識別余裕度を評
価することができる。同様に、同図(e)および(ψの
バースト系列をそれぞれ評価対象装置に与えることによ
シ、受信部の自動等化器の動作に影響を与えずに、値「
0」の識別余裕度および位相余裕度を評価することがで
きる。更に、同図(麹ないしくψの変形を組合せること
によシ、各棟の評価目的に応じた評価も可能である。
第2図は本発明の第2の発明の一実施例を示すブロック
図であり、第1図(時ないしくψに示すバースト系列を
発生するための装置の構成例を示す。
図であり、第1図(時ないしくψに示すバースト系列を
発生するための装置の構成例を示す。
値「0」および1−1」を示す2値信号の送信データは
、速就変換用のバッフ7メモリー1に一時格納される。
、速就変換用のバッフ7メモリー1に一時格納される。
フレーム回路2は、クロック供給回路4からバースト内
のタイムスロットを指示するクロック信号を与えられ、
これに応じてバッファメモリー1に格納してるる送信デ
ータを読出しながら、2値のバーストを発生して出力回
路3へ送る。
のタイムスロットを指示するクロック信号を与えられ、
これに応じてバッファメモリー1に格納してるる送信デ
ータを読出しながら、2値のバーストを発生して出力回
路3へ送る。
出力回路3は、2値バース)k第1図(a)に示す3値
のバーストに変換し、出力信号として送出する。
のバーストに変換し、出力信号として送出する。
以上の動作は、例えばビンボン伝送方式の送(Th部の
場合と同じであるが、本実施例では、出力回路3には、
振幅制御データに応じて値rlJ を示す両極性パルス
の振幅および値「0」を示す両極性パルスの振幅をおの
おの個別に制御する機能全付加してあシ、またクロック
供給回路4には、位相制御データに応じてクロック信号
の位相を制御する機能を付加しである。
場合と同じであるが、本実施例では、出力回路3には、
振幅制御データに応じて値rlJ を示す両極性パルス
の振幅および値「0」を示す両極性パルスの振幅をおの
おの個別に制御する機能全付加してあシ、またクロック
供給回路4には、位相制御データに応じてクロック信号
の位相を制御する機能を付加しである。
第3図(→および(ゆはそれぞれ、本実施例における出
力回路3およびクロック供給回路4の構成例を示す回路
図である。同図(a)において、フレーム回路2から送
られてくる2値バーストは、2値−3値変換用の不平衡
−平11変換器(U/B)31と、インバータ33とに
送られる。インノ(−タ33を通って値「0」および「
1」が反転した2値バーストは論理積ゲート34の一刀
の入力端へ送られる。論理積ゲート34のもう一方の入
力端には、バースト期間中にだけバースト内のタイムス
ロットを指示するクロック信号を与える。論理積ゲート
34の送出信号はU/B32へ送られる。
力回路3およびクロック供給回路4の構成例を示す回路
図である。同図(a)において、フレーム回路2から送
られてくる2値バーストは、2値−3値変換用の不平衡
−平11変換器(U/B)31と、インバータ33とに
送られる。インノ(−タ33を通って値「0」および「
1」が反転した2値バーストは論理積ゲート34の一刀
の入力端へ送られる。論理積ゲート34のもう一方の入
力端には、バースト期間中にだけバースト内のタイムス
ロットを指示するクロック信号を与える。論理積ゲート
34の送出信号はU/B32へ送られる。
2値バースト中0値[Jを示す単極性パルス列は、U/
B31を通って交互にトランジスタQ1のペースに印加
される。また、論理積ゲート34の送出信号すなわち2
値バースト中の値rOJ e示す単極性パルス列は、U
/832に通って交互にトランジスタqlおよびq2の
ペースVC印加される。トランジスタQlおよびQ2の
コレクタには、駆動電圧VDが、スイッチアレイSWI
および抵抗RsないしRnを介し、更にトランス35の
第1の巻線の中点から差動的に巻線を通して、印加され
ている。同様に、トランジスタqtおよびq8のコレク
タには、駆動電圧VDが、スイッチアレイSWtおよび
抵抗r1 ないしrmf介し、更にトランス35の第2
の巻線を通して、印加されている。スイッチアレイSW
lおよび5Wziiそれぞれ、振幅制御データに応じて
各スイッチのオン・オフを制御して、合成抵抗値を可変
する。
B31を通って交互にトランジスタQ1のペースに印加
される。また、論理積ゲート34の送出信号すなわち2
値バースト中の値rOJ e示す単極性パルス列は、U
/832に通って交互にトランジスタqlおよびq2の
ペースVC印加される。トランジスタQlおよびQ2の
コレクタには、駆動電圧VDが、スイッチアレイSWI
および抵抗RsないしRnを介し、更にトランス35の
第1の巻線の中点から差動的に巻線を通して、印加され
ている。同様に、トランジスタqtおよびq8のコレク
タには、駆動電圧VDが、スイッチアレイSWtおよび
抵抗r1 ないしrmf介し、更にトランス35の第2
の巻線を通して、印加されている。スイッチアレイSW
lおよび5Wziiそれぞれ、振幅制御データに応じて
各スイッチのオン・オフを制御して、合成抵抗値を可変
する。
このように合成抵抗値を可変することによシ、トランス
35の第3の巻線に現われる出力信号の両極性パルスの
振幅の大小金制御できる。すなわち、スイッチアレイS
Wlの制御により値「1」を示す両極性パルスの振幅を
制御し、またスイッチSW2の制御により値「0」を示
す両極性パルスの振幅を制鶴する。いずれの振幅制御で
も、制御値の切替えは、バースト休止期間中に行えば良
く、高速な制御を必要としないので、容易に実施できる
。
35の第3の巻線に現われる出力信号の両極性パルスの
振幅の大小金制御できる。すなわち、スイッチアレイS
Wlの制御により値「1」を示す両極性パルスの振幅を
制御し、またスイッチSW2の制御により値「0」を示
す両極性パルスの振幅を制鶴する。いずれの振幅制御で
も、制御値の切替えは、バースト休止期間中に行えば良
く、高速な制御を必要としないので、容易に実施できる
。
次に同図(b)において、バーストでのクロックレ−ト
をもつクロック信号を発生するクロック発生器40の出
力信号は、複数個の遅延6(τ)41を通って順次に遅
姪される。クロック発生器4oの出力信号および各遅延
信号は、スイッチアレイ5Ws1に介して、フレーム回
路2に接続しである。
をもつクロック信号を発生するクロック発生器40の出
力信号は、複数個の遅延6(τ)41を通って順次に遅
姪される。クロック発生器4oの出力信号および各遅延
信号は、スイッチアレイ5Ws1に介して、フレーム回
路2に接続しである。
スイッチプレイ5W3Fi、位相制御データに応じて一
つのスイッチだけをオン状態にする。すなわち、スイッ
チアレイSWsの制御により、フレーム回路2へ送るク
ロック信号の位相を制御する。
つのスイッチだけをオン状態にする。すなわち、スイッ
チアレイSWsの制御により、フレーム回路2へ送るク
ロック信号の位相を制御する。
制御値の切替えはバースト休止期間中に行えば良く。高
速な制御を必要としないので、容易に実施できる。この
位相制御によって、フレーム回路2の送出バーストのタ
イミングを制御できる。
速な制御を必要としないので、容易に実施できる。この
位相制御によって、フレーム回路2の送出バーストのタ
イミングを制御できる。
本実施例は、第1図(b)ないしく→の変形を、それぞ
れ個別に、あるいは互いに組合わせて、実施できる。従
って、評価対象装置の自動等化器の動作に影41を与え
ずに1各穐の余裕度の評価を実施でき、且つ符号誤りの
発生原因の分析も容易に可能である。
れ個別に、あるいは互いに組合わせて、実施できる。従
って、評価対象装置の自動等化器の動作に影41を与え
ずに1各穐の余裕度の評価を実施でき、且つ符号誤りの
発生原因の分析も容易に可能である。
以上説明したように本発明には、評価対象装置の自動等
化器の動作に影響を与えず且つ符号誤)の発生原因の分
析が容易に可能なディジタル伝送装置用評価方式および
装置を実現できるという効果がある。
化器の動作に影響を与えず且つ符号誤)の発生原因の分
析が容易に可能なディジタル伝送装置用評価方式および
装置を実現できるという効果がある。
第1図(棹ないしくd)は本発明の第1の発明の実施例
を示すタイミング図、第2図は本発明の第2の実施例を
示すブロック図、第3図(尋および(ゆけ本発明の第2
の発明の実施例を示す回路図である。 1・・・・・・バッファメモIJ−12・・・・・・フ
レーム回路、3・・・・・・出力回路、4・・・・・・
クロック供給回路、31゜32・・・・・・平衡−不平
衡変換器(U/B)、33・・・・・・インバータ、3
4・・・・・・論理積ゲート、35・・・・・・トラン
ス、Q” +Q2+Q”+Q”・・・・・・トランジス
タ、R1% Rn 、r1% rm−・・−e抵抗、S
W 1〜S W s・・・・・・スイッチアレイ、4
0・・・・・・クロック発生器、41゛°・・・・遅延
器(τ)。 代理人 弁理士 内 原 音 量 l ロ 箔Z 国 (す (b〕 婚3 凹
を示すタイミング図、第2図は本発明の第2の実施例を
示すブロック図、第3図(尋および(ゆけ本発明の第2
の発明の実施例を示す回路図である。 1・・・・・・バッファメモIJ−12・・・・・・フ
レーム回路、3・・・・・・出力回路、4・・・・・・
クロック供給回路、31゜32・・・・・・平衡−不平
衡変換器(U/B)、33・・・・・・インバータ、3
4・・・・・・論理積ゲート、35・・・・・・トラン
ス、Q” +Q2+Q”+Q”・・・・・・トランジス
タ、R1% Rn 、r1% rm−・・−e抵抗、S
W 1〜S W s・・・・・・スイッチアレイ、4
0・・・・・・クロック発生器、41゛°・・・・遅延
器(τ)。 代理人 弁理士 内 原 音 量 l ロ 箔Z 国 (す (b〕 婚3 凹
Claims (2)
- (1)両極性パルスおよびゼロパルスを有し所定の周期
毎に該周期よりも短い所定の時間長に亘って出現するバ
ーストの系列から成るディジタル信号に対して、前記バ
ースト系列中の所定間隔毎の1つのバーストの前記両極
性パルスの振幅を残余のバーストの前記両極性パルスの
振幅とは異なる予め定めた大きさに設定する第1の変形
と、前記バースト 系列中の所定間隔毎の1つ のバーストの前記ゼロパルスにゼロとは異なる予め定め
た振幅を付与する第2の変形と、前記バースト系列中の
所定間隔毎の1つのバーストの前記出現のタイミングを
予め定めた時間だけ予め定めた向きにずらす第3の変形
との、3つの変形のうち少くとも1つを施した上で評価
対象装置に与えて動作余裕度を評価することを特徴とす
るディジタル伝送装置用評価方式。 - (2)所定のレートをもつクロック信号に応答して両極
性パルスおよびゼロパルスを有し所定の時間長をもつバ
ーストの系列から成るディジタル信号を発生するバース
ト発生手段と、位相制御データを与えられこれに応答し
て前記バーストの出現タイミングを設定する位相制御手
段と、振幅制御データを与えられこれに応答して前記バ
ーストの前記両極性パルスの振幅および前記ゼロパルス
に付与する振幅をおのおの個別に設定した上で出力する
出力手段とを備えていることを特徴とするディジタル伝
送装置用評価装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP18133086A JPS6337739A (ja) | 1986-07-31 | 1986-07-31 | デイジタル伝送装置用評価方式および装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP18133086A JPS6337739A (ja) | 1986-07-31 | 1986-07-31 | デイジタル伝送装置用評価方式および装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6337739A true JPS6337739A (ja) | 1988-02-18 |
Family
ID=16098805
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP18133086A Pending JPS6337739A (ja) | 1986-07-31 | 1986-07-31 | デイジタル伝送装置用評価方式および装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6337739A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2005348054A (ja) * | 2004-06-02 | 2005-12-15 | Murata Mfg Co Ltd | 平衡型クロック信号出力回路およびこれを用いた高周波発振器 |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS59167160A (ja) * | 1983-02-08 | 1984-09-20 | Nippon Telegr & Teleph Corp <Ntt> | 信号識別余裕度測定方法およびその装置 |
-
1986
- 1986-07-31 JP JP18133086A patent/JPS6337739A/ja active Pending
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS59167160A (ja) * | 1983-02-08 | 1984-09-20 | Nippon Telegr & Teleph Corp <Ntt> | 信号識別余裕度測定方法およびその装置 |
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2005348054A (ja) * | 2004-06-02 | 2005-12-15 | Murata Mfg Co Ltd | 平衡型クロック信号出力回路およびこれを用いた高周波発振器 |
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