JPS63309244A - Ｘ線断層撮影装置 - Google Patents
Ｘ線断層撮影装置Info
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- JPS63309244A JPS63309244A JP62036600A JP3660087A JPS63309244A JP S63309244 A JPS63309244 A JP S63309244A JP 62036600 A JP62036600 A JP 62036600A JP 3660087 A JP3660087 A JP 3660087A JP S63309244 A JPS63309244 A JP S63309244A
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- Japan
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- 238000003384 imaging method Methods 0.000 title 1
- 230000015654 memory Effects 0.000 claims abstract description 18
- 238000003325 tomography Methods 0.000 claims 2
- 238000012545 processing Methods 0.000 abstract description 10
- 238000000034 method Methods 0.000 abstract description 4
- 238000007781 pre-processing Methods 0.000 abstract description 4
- 238000010586 diagram Methods 0.000 description 6
- 238000003672 processing method Methods 0.000 description 3
- UIIRFZUAAAFHFB-UHFFFAOYSA-N 1-[1-[(3-cyanophenyl)methyl]piperidin-4-yl]-3-(2-phenylphenyl)-1-(pyridin-3-ylmethyl)urea Chemical compound C=1C=CN=CC=1CN(C1CCN(CC=2C=C(C=CC=2)C#N)CC1)C(=O)NC1=CC=CC=C1C1=CC=CC=C1 UIIRFZUAAAFHFB-UHFFFAOYSA-N 0.000 description 2
- 238000006243 chemical reaction Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 238000012805 post-processing Methods 0.000 description 2
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- 101100326920 Caenorhabditis elegans ctl-1 gene Proteins 0.000 description 1
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- 238000003199 nucleic acid amplification method Methods 0.000 description 1
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Landscapes
- Analysing Materials By The Use Of Radiation (AREA)
- Apparatus For Radiation Diagnosis (AREA)
- Image Processing (AREA)
- Image Analysis (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（産業上の利用分野）
本発明は、被検体を挟んでＸ線管と多チヤネルＸ線検出
器を設置して収集された投影データに基づく画像再構成
を行う複数の高速製篩プロセッサ（以下、ＦＰＵと言う
）に逆投影専用の逆投影器（以下、ＢＰＵ ト言う）を
付加したＸ１ｌｉｌｌｉｉ彰装置Ｉ（以下、ＣＴ装置と
言う）に関する。
器を設置して収集された投影データに基づく画像再構成
を行う複数の高速製篩プロセッサ（以下、ＦＰＵと言う
）に逆投影専用の逆投影器（以下、ＢＰＵ ト言う）を
付加したＸ１ｌｉｌｌｉｉ彰装置Ｉ（以下、ＣＴ装置と
言う）に関する。
（従来の技術）
従来から、Ｘ線を多数の角度方向から被検体にスキャン
照射して多数の投影データを収集し、該投影データに基
づく画像再構成演算処理によって所望の部位の断層像を
ＣＲＴ等に画像表示するＣＴ装置はよく知られている。
照射して多数の投影データを収集し、該投影データに基
づく画像再構成演算処理によって所望の部位の断層像を
ＣＲＴ等に画像表示するＣＴ装置はよく知られている。
この様なＣＴ装置におけるデータ処理は、基本的には前
処理、再構成演募処理及び後処理の各工程からなる。前
処理において、Ｘ線検出器の出力は増幅、積分、アナロ
グ・ディジタル変換、対数変換等や投影データに関する
補正（Ｘ６強度、線質効果、散乱線等の補正）が行われ
る。再構成演算処理工程において、前処理された投影デ
ータに基づくフーリエ法、コンポリューシコン法等によ
る画像再構成演算及び投影データを２次元ピクセル平面
に割り当てる逆投影演埠が行われる。即ち、再構成演算
処理工程によってＣＲＴに断層像を表示するためのデー
タが作成される。画像表示に供された画素値（画素デー
タ）は、後処理によって記録媒体への格納に適する形に
修正される。
処理、再構成演募処理及び後処理の各工程からなる。前
処理において、Ｘ線検出器の出力は増幅、積分、アナロ
グ・ディジタル変換、対数変換等や投影データに関する
補正（Ｘ６強度、線質効果、散乱線等の補正）が行われ
る。再構成演算処理工程において、前処理された投影デ
ータに基づくフーリエ法、コンポリューシコン法等によ
る画像再構成演算及び投影データを２次元ピクセル平面
に割り当てる逆投影演埠が行われる。即ち、再構成演算
処理工程によってＣＲＴに断層像を表示するためのデー
タが作成される。画像表示に供された画素値（画素デー
タ）は、後処理によって記録媒体への格納に適する形に
修正される。
上記のＣＴ装置では、常に画像の再現が精密、かつ、高
速に行われることが要求される。
速に行われることが要求される。
従来、この様な要望に応えるものとして、例えば特願昭
６１−１８９４２６号や第５図に示すものがある。
６１−１８９４２６号や第５図に示すものがある。
前者は高速な再構成演粋を行う１個のＦＰＵに逆投影の
みを行う１個のＢＰＵを付加して構成され、後者は１個
ノＦＰＵ１ニ複数＋７）ＢＰｔｌ ２ ．２２ 、”’
、２ｏを接続して構成される。又、更に高速なデータ処
理を行わんとして、第５図に示すＦＰＵとＢＰＵからな
る手段を複数個備える方式、いわゆる並列処理方式のも
のが実現されている。いずれの場合も、ＦＰＵは前処理
された投影データを格納するメインメモリ及び画像再構
成を行う演算部を備え、ＢＰｕは独立に逆投影を行う演
算器、画像の各ピクセルと１対１に対応したアドレスか
らなる画像メモリ、逆投影加算器等を備える。これらの
構成でＣＴ装置は所期の目的を達成している。
みを行う１個のＢＰＵを付加して構成され、後者は１個
ノＦＰＵ１ニ複数＋７）ＢＰｔｌ ２ ．２２ 、”’
、２ｏを接続して構成される。又、更に高速なデータ処
理を行わんとして、第５図に示すＦＰＵとＢＰＵからな
る手段を複数個備える方式、いわゆる並列処理方式のも
のが実現されている。いずれの場合も、ＦＰＵは前処理
された投影データを格納するメインメモリ及び画像再構
成を行う演算部を備え、ＢＰｕは独立に逆投影を行う演
算器、画像の各ピクセルと１対１に対応したアドレスか
らなる画像メモリ、逆投影加算器等を備える。これらの
構成でＣＴ装置は所期の目的を達成している。
（発明が解決しようとする問題点）
しかし、従来のＣＴ装置において、ＦＰＵを複数備える
と、当然台ＦＰＵに付加するＢＰＵも増えるため、各Ｂ
ＰＵ間でデータの授受を行うバスが必要となる（最終的
な逆投影データは各ＢＰＵで求められた逆投影データの
和で求められるので各ＢＰＵ間のデータの授受が必要で
ある）。従って、従来のＣＴｌ１置における並列処理方
式は複雑な構成になると言う問題がある。
と、当然台ＦＰＵに付加するＢＰＵも増えるため、各Ｂ
ＰＵ間でデータの授受を行うバスが必要となる（最終的
な逆投影データは各ＢＰＵで求められた逆投影データの
和で求められるので各ＢＰＵ間のデータの授受が必要で
ある）。従って、従来のＣＴｌ１置における並列処理方
式は複雑な構成になると言う問題がある。
本発明は、かかる点に鑑みてなされたものであり、その
目的は、複数のＦＰＵを備えた並列処理方式を簡単な構
成で実現するＣＴ装置を提供するにある。
目的は、複数のＦＰＵを備えた並列処理方式を簡単な構
成で実現するＣＴ装置を提供するにある。
（問題点を解決するための手段）
上記目的を達成する本発明のＣＴ装置は、ＢＰＵが、各
ＦＰＵから逆投影に必要なデータの供給を独立に受ける
逆投影実行部をＦＰＵと同じ数だけ備え、再構成演ＩＩ
Ｉの各ビューにおける同一の注目ピクセルの逆投影を同
時に実行し、該逆投影データをいずれのＦＰＩＩからも
アクセス可能な画像メモリに格納するようになっている
。
ＦＰＵから逆投影に必要なデータの供給を独立に受ける
逆投影実行部をＦＰＵと同じ数だけ備え、再構成演ＩＩ
Ｉの各ビューにおける同一の注目ピクセルの逆投影を同
時に実行し、該逆投影データをいずれのＦＰＩＩからも
アクセス可能な画像メモリに格納するようになっている
。
（実施例）
以下、図を参照して本発明について詳細に説明する。第
１図は、本発明の一実施例によるＣＴ装置における逆投
影演算手段を示す構成図である。
１図は、本発明の一実施例によるＣＴ装置における逆投
影演算手段を示す構成図である。
ＢＰｔｌｌｌは２個＋７）ＦＰｕ １２及ヒ１３ニ接続
サレテ同じであるが、ＢＰＵ １１の構成は第２図に示
すようになっている。即ち、ａｐｕ １ｉは２個の逆投
影実行部１４及び１５と、各逆投影実行部から出力され
る同一ピクセルに対応するデータを加算する加算器１６
と、画像の各ピクセルと１対１に対応したアドレスを有
し、ＦＰＵ １２用汎用バス１７とＦＰｕ １３用汎用
パス１８に接続されるボートを有する画像メモリ１９と
、画像メモリ１９から読出さ゛れたデータと加算器１６
の出力との加算をし、その結果を該読出されたデータの
アドレスに格納する加算器２０とを備える。逆投影実行
部１４は汎用バス１７を介してＦＰＵ １２ （第２図
では省略）に接続されるアドレス発生部２１及びデータ
メモリ２２を有する。又、逆投影実行部１５は汎用バス
１８を介してＦＰｔｌ １３ （第２図では省略）に接
続されるアドレス発生部２３及びデータメモリ２４を有
する。更に、加算器１６の逆投影実行部１５側の入力ボ
ートにはバッファアンプ２５が接続される。
サレテ同じであるが、ＢＰＵ １１の構成は第２図に示
すようになっている。即ち、ａｐｕ １ｉは２個の逆投
影実行部１４及び１５と、各逆投影実行部から出力され
る同一ピクセルに対応するデータを加算する加算器１６
と、画像の各ピクセルと１対１に対応したアドレスを有
し、ＦＰＵ １２用汎用バス１７とＦＰｕ １３用汎用
パス１８に接続されるボートを有する画像メモリ１９と
、画像メモリ１９から読出さ゛れたデータと加算器１６
の出力との加算をし、その結果を該読出されたデータの
アドレスに格納する加算器２０とを備える。逆投影実行
部１４は汎用バス１７を介してＦＰＵ １２ （第２図
では省略）に接続されるアドレス発生部２１及びデータ
メモリ２２を有する。又、逆投影実行部１５は汎用バス
１８を介してＦＰｔｌ １３ （第２図では省略）に接
続されるアドレス発生部２３及びデータメモリ２４を有
する。更に、加算器１６の逆投影実行部１５側の入力ボ
ートにはバッファアンプ２５が接続される。
以上の構成において、いまバッファアンプ２５の入力端
に“１″が与えられると、加算器１６は通常の加算可能
状態となり、ＦＰＵ １２及び１３は共にＢＰＵ １１
と信号の授受が可能となる。この状態にて、ＦＰｔｌ
１２は、第３図（ａ）に示すｉビューの投影データの前
処理をした後、該前処理されたデータを汎用バス１７を
介してデータメモリ２２に書込む。ＦＰＵ １３はＦＰ
Ｕ １２と同じタイミングで第３図（ｂ）に示すｊビュ
ーの投影データの前処理をした後、該前処理されたデー
タを汎用バス１８を介してデータメモリ２４に書込む。
に“１″が与えられると、加算器１６は通常の加算可能
状態となり、ＦＰＵ １２及び１３は共にＢＰＵ １１
と信号の授受が可能となる。この状態にて、ＦＰｔｌ
１２は、第３図（ａ）に示すｉビューの投影データの前
処理をした後、該前処理されたデータを汎用バス１７を
介してデータメモリ２２に書込む。ＦＰＵ １３はＦＰ
Ｕ １２と同じタイミングで第３図（ｂ）に示すｊビュ
ーの投影データの前処理をした後、該前処理されたデー
タを汎用バス１８を介してデータメモリ２４に書込む。
一方、逆投影実行部１４及び１５は同一のピクセル２６
（第３図参照）に注目して逆投影を実行する。即ち、ア
ドレス発生部２１及び２３がｉビュー及びｊビューにお
ける前記注目ピクセル２６に対応するデータが格納され
ているデータメモリ２２及び２４のアドレスを発生する
。これにより、データメモリ２２及び２４からｉビュー
及びｊビューにおける注目ピクセル２６に対応する投影
データが読出される。読出された２つのデータは加算器
１６で加算された後、画像メモリ１９の現在注目してい
るピクセル２６に対応したアドレスから読出されたそれ
までの逆投影データに加算され、再び同じアドレスに書
込まれる。これによりｉピユー及びｊビューにおける注
目ピクセル２６の逆投影が同時に実行される。この様な
操作を全てのビューの全てのピクセルにわたって行うこ
とにより逆投影が完了する。全ての逆投影が終了した後
、必要に応じてＦＰＵ １２及び１３は、画像メモリー
９にアクセスして並列処理を行う。
（第３図参照）に注目して逆投影を実行する。即ち、ア
ドレス発生部２１及び２３がｉビュー及びｊビューにお
ける前記注目ピクセル２６に対応するデータが格納され
ているデータメモリ２２及び２４のアドレスを発生する
。これにより、データメモリ２２及び２４からｉビュー
及びｊビューにおける注目ピクセル２６に対応する投影
データが読出される。読出された２つのデータは加算器
１６で加算された後、画像メモリ１９の現在注目してい
るピクセル２６に対応したアドレスから読出されたそれ
までの逆投影データに加算され、再び同じアドレスに書
込まれる。これによりｉピユー及びｊビューにおける注
目ピクセル２６の逆投影が同時に実行される。この様な
操作を全てのビューの全てのピクセルにわたって行うこ
とにより逆投影が完了する。全ての逆投影が終了した後
、必要に応じてＦＰＵ １２及び１３は、画像メモリー
９にアクセスして並列処理を行う。
尚、上記実施例において、２個のＦＰＵの例が示されて
いるが、本発明はこれに限定するものではなく、より多
くのＦＰＵを備えたＣＴ装置であってもよい。この場合
、ＢＰＵは第４図に示すように、各ＦＰＵに接続される
逆投影実行部３１ ．３１２、・・・、３１．と、ｎ個
の入力ボートを有する加算器３２を備え、該加算器３２
の出力を加算３２０に与える構成となる。逆にコスト低
減のため、ＦＰＵを１個しか用意しない場合には、第２
図のバッフ７アンブ２５への入力を“０″にして、加算
器１６が逆投影実行部１４からのデータをそのまま加算
器２０に与えるようにすればよい。
いるが、本発明はこれに限定するものではなく、より多
くのＦＰＵを備えたＣＴ装置であってもよい。この場合
、ＢＰＵは第４図に示すように、各ＦＰＵに接続される
逆投影実行部３１ ．３１２、・・・、３１．と、ｎ個
の入力ボートを有する加算器３２を備え、該加算器３２
の出力を加算３２０に与える構成となる。逆にコスト低
減のため、ＦＰＵを１個しか用意しない場合には、第２
図のバッフ７アンブ２５への入力を“０″にして、加算
器１６が逆投影実行部１４からのデータをそのまま加算
器２０に与えるようにすればよい。
（発明の効果）
以上の通り、本発明のＣＴ装置によれば、ＢＰＵが、各
ＦＰＵから逆投影に必要なデータの供給を独立に受ける
逆投影実行部をＦＰｕと同じ数だけ備え、再構成演算後
の各ビューにおける同一の注目ピクセルの逆投影を同時
に実行し、該逆投影データをいずれのＦＰＵからもアク
セス可能な画像メモリに格納するため、複数のＦＰＵを
備えた並列処理方式が簡単な構成で実現できる。
ＦＰＵから逆投影に必要なデータの供給を独立に受ける
逆投影実行部をＦＰｕと同じ数だけ備え、再構成演算後
の各ビューにおける同一の注目ピクセルの逆投影を同時
に実行し、該逆投影データをいずれのＦＰＵからもアク
セス可能な画像メモリに格納するため、複数のＦＰＵを
備えた並列処理方式が簡単な構成で実現できる。
第１図は本発明の一実施例による再構成演算手段を示す
構成図、第２図は本発明の一実施例による逆投影器（Ｂ
ＰＵ）を示す構成図、第３図（ａ）及び（ａ）は本発明
の一実施例の動作説明図、第４図は本発明の他の実施例
における逆投影器を示す構成図、第５図は従来の再構成
演算手段を示す構成図である。 １．１２．１３ ・・・高速演算プロｔ ツサ（ＦＰＵ
）、２．２、〜．２．１１・・・逆投影器（ＢＰＵ）、
１２ ｎ １４．１５．３１．３１、〜．３１．・・・適役彰実行
部、１６．２０．３２・・・加算器、１７．１８・・・
汎用バス、１９・・・画像メモリ、２１．２３・・・ア
ドレス発生部、２２．２４・・・データメモリ、２５・
・・バッファアンプ。
構成図、第２図は本発明の一実施例による逆投影器（Ｂ
ＰＵ）を示す構成図、第３図（ａ）及び（ａ）は本発明
の一実施例の動作説明図、第４図は本発明の他の実施例
における逆投影器を示す構成図、第５図は従来の再構成
演算手段を示す構成図である。 １．１２．１３ ・・・高速演算プロｔ ツサ（ＦＰＵ
）、２．２、〜．２．１１・・・逆投影器（ＢＰＵ）、
１２ ｎ １４．１５．３１．３１、〜．３１．・・・適役彰実行
部、１６．２０．３２・・・加算器、１７．１８・・・
汎用バス、１９・・・画像メモリ、２１．２３・・・ア
ドレス発生部、２２．２４・・・データメモリ、２５・
・・バッファアンプ。
Claims (1)
- 前処理済みの投影データに基づく画像再構成を行う複
数の高速演算プロセッサに逆投影専用の逆投影器を付加
するＸ線断層撮影装置において、該逆投影器は、前記高
速演算プロセッサと同じ数だけ用意される手段であって
、各高速演算プロセッサから逆投影に必要なデータの供
給を独立に受けると共に、各ビューにおける同一の注目
ピクセルに対する逆投影を同時に行う逆投影実行部と、
該逆投影によつて得られる各逆投影実行部からの出力デ
ータを加算する第１加算器と、画像の各ピクセルと１対
１に対応したアドレスを有し、前記高速演算プロセッサ
のいずれからもアクセスされる画像メモリと、該画像メ
モリから読出されたデータと前記第１加算器の出力との
加算をし、その結果を該読出されたデータのアドレスに
格納する第２加算器とで構成されることを特徴とするＸ
線断層撮影装置。
Priority Applications (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62036600A JPS63309244A (ja) | 1987-02-19 | 1987-02-19 | Ｘ線断層撮影装置 |
| DE3855671T DE3855671T2 (de) | 1987-02-19 | 1988-02-19 | Datenprozessor zur bildrekonstruktion |
| US07/274,997 US4941094A (en) | 1987-02-19 | 1988-02-19 | Image reconstruction data processing unit |
| EP88901919A EP0303709B1 (en) | 1987-02-19 | 1988-02-19 | Data processor for image reconstruction |
| PCT/JP1988/000169 WO1988006321A1 (en) | 1987-02-19 | 1988-02-19 | Data processor for image reconstruction |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62036600A JPS63309244A (ja) | 1987-02-19 | 1987-02-19 | Ｘ線断層撮影装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS63309244A true JPS63309244A (ja) | 1988-12-16 |
| JPH0436014B2 JPH0436014B2 (ja) | 1992-06-12 |
Family
ID=12474285
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62036600A Granted JPS63309244A (ja) | 1987-02-19 | 1987-02-19 | Ｘ線断層撮影装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS63309244A (ja) |
-
1987
- 1987-02-19 JP JP62036600A patent/JPS63309244A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0436014B2 (ja) | 1992-06-12 |
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