JPS63224255A - 半導体装置およびその製造方法 - Google Patents
半導体装置およびその製造方法Info
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- JPS63224255A JPS63224255A JP62056642A JP5664287A JPS63224255A JP S63224255 A JPS63224255 A JP S63224255A JP 62056642 A JP62056642 A JP 62056642A JP 5664287 A JP5664287 A JP 5664287A JP S63224255 A JPS63224255 A JP S63224255A
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- 239000004065 semiconductor Substances 0.000 title claims abstract description 38
- 238000004519 manufacturing process Methods 0.000 title claims description 11
- 229910021420 polycrystalline silicon Inorganic materials 0.000 claims abstract description 29
- 229920005591 polysilicon Polymers 0.000 claims abstract description 29
- 229910021341 titanium silicide Inorganic materials 0.000 claims abstract description 24
- NRTOMJZYCJJWKI-UHFFFAOYSA-N Titanium nitride Chemical compound [Ti]#N NRTOMJZYCJJWKI-UHFFFAOYSA-N 0.000 claims abstract description 22
- 150000004767 nitrides Chemical class 0.000 claims abstract description 19
- 238000002844 melting Methods 0.000 claims abstract description 16
- 229910052751 metal Inorganic materials 0.000 claims abstract description 16
- 239000002184 metal Substances 0.000 claims abstract description 16
- 238000010438 heat treatment Methods 0.000 claims abstract description 15
- 230000008018 melting Effects 0.000 claims description 14
- 238000000034 method Methods 0.000 claims description 10
- OKTJSMMVPCPJKN-UHFFFAOYSA-N Carbon Chemical compound [C] OKTJSMMVPCPJKN-UHFFFAOYSA-N 0.000 claims description 9
- 229910052799 carbon Inorganic materials 0.000 claims description 9
- 239000000758 substrate Substances 0.000 claims description 9
- 229910052721 tungsten Inorganic materials 0.000 claims description 7
- 239000010937 tungsten Substances 0.000 claims description 7
- 239000003870 refractory metal Substances 0.000 claims description 3
- -1 tungsten nitride Chemical class 0.000 claims 2
- RTAQQCXQSZGOHL-UHFFFAOYSA-N Titanium Chemical group [Ti] RTAQQCXQSZGOHL-UHFFFAOYSA-N 0.000 abstract description 13
- 230000006866 deterioration Effects 0.000 abstract description 11
- 206010024769 Local reaction Diseases 0.000 abstract description 2
- 230000015556 catabolic process Effects 0.000 description 12
- WFKWXMTUELFFGS-UHFFFAOYSA-N tungsten Chemical compound [W] WFKWXMTUELFFGS-UHFFFAOYSA-N 0.000 description 5
- 238000005468 ion implantation Methods 0.000 description 4
- 229910021332 silicide Inorganic materials 0.000 description 4
- 229910052782 aluminium Inorganic materials 0.000 description 3
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 description 3
- 238000009792 diffusion process Methods 0.000 description 3
- 230000000694 effects Effects 0.000 description 3
- FVBUAEGBCNSCDD-UHFFFAOYSA-N silicide(4-) Chemical compound [Si-4] FVBUAEGBCNSCDD-UHFFFAOYSA-N 0.000 description 3
- XKRFYHLGVUSROY-UHFFFAOYSA-N Argon Chemical compound [Ar] XKRFYHLGVUSROY-UHFFFAOYSA-N 0.000 description 2
- ZOKXTWBITQBERF-UHFFFAOYSA-N Molybdenum Chemical compound [Mo] ZOKXTWBITQBERF-UHFFFAOYSA-N 0.000 description 2
- 238000000151 deposition Methods 0.000 description 2
- 230000008021 deposition Effects 0.000 description 2
- 238000010586 diagram Methods 0.000 description 2
- 238000005530 etching Methods 0.000 description 2
- 239000012535 impurity Substances 0.000 description 2
- 230000002401 inhibitory effect Effects 0.000 description 2
- 229910052750 molybdenum Inorganic materials 0.000 description 2
- 239000011733 molybdenum Substances 0.000 description 2
- IJGRMHOSHXDMSA-UHFFFAOYSA-N Atomic nitrogen Chemical compound N#N IJGRMHOSHXDMSA-UHFFFAOYSA-N 0.000 description 1
- ZAMOUSCENKQFHK-UHFFFAOYSA-N Chlorine atom Chemical compound [Cl] ZAMOUSCENKQFHK-UHFFFAOYSA-N 0.000 description 1
- 229910052786 argon Inorganic materials 0.000 description 1
- 229910052785 arsenic Inorganic materials 0.000 description 1
- RQNWIZPPADIBDY-UHFFFAOYSA-N arsenic atom Chemical compound [As] RQNWIZPPADIBDY-UHFFFAOYSA-N 0.000 description 1
- 230000015572 biosynthetic process Effects 0.000 description 1
- YXTPWUNVHCYOSP-UHFFFAOYSA-N bis($l^{2}-silanylidene)molybdenum Chemical compound [Si]=[Mo]=[Si] YXTPWUNVHCYOSP-UHFFFAOYSA-N 0.000 description 1
- 230000000903 blocking effect Effects 0.000 description 1
- 239000003795 chemical substances by application Substances 0.000 description 1
- 239000000460 chlorine Substances 0.000 description 1
- 229910052801 chlorine Inorganic materials 0.000 description 1
- 239000007789 gas Substances 0.000 description 1
- 238000001755 magnetron sputter deposition Methods 0.000 description 1
- 229910021344 molybdenum silicide Inorganic materials 0.000 description 1
- 229910052710 silicon Inorganic materials 0.000 description 1
- 239000010703 silicon Substances 0.000 description 1
- 238000004544 sputter deposition Methods 0.000 description 1
- 239000000126 substance Substances 0.000 description 1
- 239000010936 titanium Substances 0.000 description 1
- 229910052719 titanium Inorganic materials 0.000 description 1
- MTPVUVINMAGMJL-UHFFFAOYSA-N trimethyl(1,1,2,2,2-pentafluoroethyl)silane Chemical compound C[Si](C)(C)C(F)(F)C(F)(F)F MTPVUVINMAGMJL-UHFFFAOYSA-N 0.000 description 1
- WQJQOUPTWCFRMM-UHFFFAOYSA-N tungsten disilicide Chemical compound [Si]#[W]#[Si] WQJQOUPTWCFRMM-UHFFFAOYSA-N 0.000 description 1
- 229910021342 tungsten silicide Inorganic materials 0.000 description 1
Landscapes
- Electrodes Of Semiconductors (AREA)
- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
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Description
【発明の詳細な説明】
〔発明の目的〕
(産業上の利用分野)
゛ 本発明は半導体装置およびその製造方法に関する。
(従来の技術)
従来、MOS型半導体装置のゲート電極層としては微細
加工の観点からポリシリコン層が広く用いられていた。
加工の観点からポリシリコン層が広く用いられていた。
しかし、ポリシリコン層のシート抵抗は30オ一ム/四
程度が限界であるため、高速動作性に問題があった。そ
こで、シート抵抗を減少させて高速動作性を向上させる
ために、近年、モリブデンシリサイドやタングステンシ
リサイトドが採用されている。しかし、これらシリサイ
ドがゲート酸化膜1−に直接堆積されている場合には、
シリサイドとシリコンとの仕事関数の差に起因するしき
い値制御の困難性やシリサイドとゲート酸化膜と間の反
応に起因するゲート電極層の耐圧劣化という問題点があ
った。そこで、この点を改良したゲート電極の構造とし
てゲート酸化膜とシリサイド層との間にポリシリコン層
を介挿させた、いわゆるポリサイド構造が知られている
。しかし、タングステンやモリブデンのポリサイド構造
にしてもシート抵抗は3から5オ一ム/口程度であり、
近年の特に高い高速動作性の要請に十分に応じるもので
はなかった。
程度が限界であるため、高速動作性に問題があった。そ
こで、シート抵抗を減少させて高速動作性を向上させる
ために、近年、モリブデンシリサイドやタングステンシ
リサイトドが採用されている。しかし、これらシリサイ
ドがゲート酸化膜1−に直接堆積されている場合には、
シリサイドとシリコンとの仕事関数の差に起因するしき
い値制御の困難性やシリサイドとゲート酸化膜と間の反
応に起因するゲート電極層の耐圧劣化という問題点があ
った。そこで、この点を改良したゲート電極の構造とし
てゲート酸化膜とシリサイド層との間にポリシリコン層
を介挿させた、いわゆるポリサイド構造が知られている
。しかし、タングステンやモリブデンのポリサイド構造
にしてもシート抵抗は3から5オ一ム/口程度であり、
近年の特に高い高速動作性の要請に十分に応じるもので
はなかった。
そこで、本発明者等は1オ一ム/四程度の極めて低いシ
ート抵抗値をしめずチタンシリサイドに着目した。ゲー
ト電極層の構造がヒ素ドープのポリシリコン層(厚さ1
000オングストローム)とチタンシリサイド層(厚さ
2000オングストローム)とから成るチタンポリサイ
ドであるときに、950℃にて熱処理した後にシート抵
抗を測定したところ、0.9オ一ム/口という満足すべ
き値が得られた。ところが、前記ゲート電極層について
のゲート耐圧を測定したところ、熱処理前には第4図(
A)に示されているように良好であるが・熱処理後には
第4図(B)に示されているように劣化が甚だしく発生
していることが解った◇同様な減少は、モリブデンポリ
サイドやタングステンポリサイドでは全く認められなか
った。本発明者等の解析によれば、チタンシリサイドの
チタン原子が熱処理中にポリシリコン層中を拡散してゲ
ート酸化膜に到達してゲート酸化膜と局所的に反応し、
ゲート酸化膜の一部が破壊されているものと推定される
。
ート抵抗値をしめずチタンシリサイドに着目した。ゲー
ト電極層の構造がヒ素ドープのポリシリコン層(厚さ1
000オングストローム)とチタンシリサイド層(厚さ
2000オングストローム)とから成るチタンポリサイ
ドであるときに、950℃にて熱処理した後にシート抵
抗を測定したところ、0.9オ一ム/口という満足すべ
き値が得られた。ところが、前記ゲート電極層について
のゲート耐圧を測定したところ、熱処理前には第4図(
A)に示されているように良好であるが・熱処理後には
第4図(B)に示されているように劣化が甚だしく発生
していることが解った◇同様な減少は、モリブデンポリ
サイドやタングステンポリサイドでは全く認められなか
った。本発明者等の解析によれば、チタンシリサイドの
チタン原子が熱処理中にポリシリコン層中を拡散してゲ
ート酸化膜に到達してゲート酸化膜と局所的に反応し、
ゲート酸化膜の一部が破壊されているものと推定される
。
(発明が解決しようとする問題点)
このように従来は、シート抵抗が充分に小さく、しきい
値制御が容易で、熱処理後でもゲート耐圧劣化の無いゲ
ート電極層は無かった。
値制御が容易で、熱処理後でもゲート耐圧劣化の無いゲ
ート電極層は無かった。
本発明は、上記事情を考慮してなされたもので、シート
抵抗が充分に小さく、ゲート耐圧劣化の少ないゲート電
極層を有する半導体装置およびその製造方法を提供する
ことを目的とする。
抵抗が充分に小さく、ゲート耐圧劣化の少ないゲート電
極層を有する半導体装置およびその製造方法を提供する
ことを目的とする。
(問題点を解決するための手段)
」二足目的を達成するため、本発明による半導体装置は
、ゲート電極層を、ゲート酸化膜上に形成されたポリシ
リコン層と、ポリシリコン層上に形成された高融点金属
窒化物層と、高融点金属窒化物層上に形成されたチタン
シリサイド層とで構成したことを特徴とする。
、ゲート電極層を、ゲート酸化膜上に形成されたポリシ
リコン層と、ポリシリコン層上に形成された高融点金属
窒化物層と、高融点金属窒化物層上に形成されたチタン
シリサイド層とで構成したことを特徴とする。
また本発明による半導体装置の製造方法では、ゲート酸
化膜上に先ずポリシリコン層を形成し、次にポリシリコ
ン層上に高融点金属窒化物層を形成し、次に高融点金属
窒化物層上にチタンシリサイド層を形成することにより
ゲート電極層を形成したことを特徴とする。
化膜上に先ずポリシリコン層を形成し、次にポリシリコ
ン層上に高融点金属窒化物層を形成し、次に高融点金属
窒化物層上にチタンシリサイド層を形成することにより
ゲート電極層を形成したことを特徴とする。
(作 用)
本発明は以上のような構成であるので、チタンシリサイ
ドのチタン原子が熱処理中にポリシリコン層中を拡散し
てゲート酸化膜に到達することを前記高融点金属窒化物
層が阻止し、チタン原子とゲート酸化膜との局所的な反
応に起因すると推定されるゲート酸化膜の破損を防止す
ることができる。
ドのチタン原子が熱処理中にポリシリコン層中を拡散し
てゲート酸化膜に到達することを前記高融点金属窒化物
層が阻止し、チタン原子とゲート酸化膜との局所的な反
応に起因すると推定されるゲート酸化膜の破損を防止す
ることができる。
(実施例)
本発明の一実施例による半導体装置を第1図に示す。半
導体基板10の表面にチャンネル領域11を挟んでソー
ス/ドレイン領域17が形成されている。チャンネル領
域11の上には約100オングストロームのゲート酸化
膜12が形成されている。このゲート酸化膜12の上に
はゲート電極層16が形成されている。ゲート電極層1
6はポリシリコン層13とチタン窒化物層14とチタン
シリサイド層15の3つの層で構成されている。
導体基板10の表面にチャンネル領域11を挟んでソー
ス/ドレイン領域17が形成されている。チャンネル領
域11の上には約100オングストロームのゲート酸化
膜12が形成されている。このゲート酸化膜12の上に
はゲート電極層16が形成されている。ゲート電極層1
6はポリシリコン層13とチタン窒化物層14とチタン
シリサイド層15の3つの層で構成されている。
ポリシリコン層13はゲート酸化膜12上に約1000
オングストロームの厚さで直接形成されている。チタン
窒化物層14はポリシリコン層13上に約1000オン
グストロームの厚さで形成されている。チタンシリサイ
ド層15はチタン窒化物層14上に約2000オングス
トロームの厚さで形成されている。さらに半導体基板1
0全体を覆うように酸化物層18が形成されている。
オングストロームの厚さで直接形成されている。チタン
窒化物層14はポリシリコン層13上に約1000オン
グストロームの厚さで形成されている。チタンシリサイ
ド層15はチタン窒化物層14上に約2000オングス
トロームの厚さで形成されている。さらに半導体基板1
0全体を覆うように酸化物層18が形成されている。
この酸化物層18にはコンタクトホールが形成され、ア
ルミニウム配線層19によりソース/ドレイン領域17
と電気的な接続がとられている。
ルミニウム配線層19によりソース/ドレイン領域17
と電気的な接続がとられている。
このように本実施例による半導体装置はゲート電極層の
ポリシリコン層とチタンシリサイド層15の間にチタン
窒化物層を設けたので、チタンシリサイド層のチタン原
子がポリシリコン層中を拡散してゲート酸化膜に到達す
るのをチタン窒化物層により阻止することができ、ゲー
ト酸化膜の劣化が防止される。すなわち本実施例の半導
体装置を950℃の高温熱処理をした場合でも、第2図
に示すようにゲート耐圧の劣化は認められなかった。ま
た本実施例の半導体装置のゲート電極にはシート抵抗値
が低いチタンシリサイド層を用いているので高速動作が
可能である。したがって本実施例による半導体装置はシ
ート抵抗が低くゲート耐圧劣化がおこらないという利点
がある。
ポリシリコン層とチタンシリサイド層15の間にチタン
窒化物層を設けたので、チタンシリサイド層のチタン原
子がポリシリコン層中を拡散してゲート酸化膜に到達す
るのをチタン窒化物層により阻止することができ、ゲー
ト酸化膜の劣化が防止される。すなわち本実施例の半導
体装置を950℃の高温熱処理をした場合でも、第2図
に示すようにゲート耐圧の劣化は認められなかった。ま
た本実施例の半導体装置のゲート電極にはシート抵抗値
が低いチタンシリサイド層を用いているので高速動作が
可能である。したがって本実施例による半導体装置はシ
ート抵抗が低くゲート耐圧劣化がおこらないという利点
がある。
上記実施例ではチタン原子を阻止するためにチタン窒化
物層を用いたが、たとえばタングステンのような他の高
融点金属の窒化物層でもよい。
物層を用いたが、たとえばタングステンのような他の高
融点金属の窒化物層でもよい。
本発明の一実施例による半導体装置の製造方法を第3図
を用いて説明する。
を用いて説明する。
先ず半導体基板10を熱酸化し、表面に厚さ約100オ
ングストロームのゲート酸化膜16を形成する。さらに
このゲート酸化膜12上に減圧CVD法により厚さ約1
000オングストロームのポリシリコン層13を堆積し
、このポリシリコン層13に砒素をイオン注入法により
ドープする(第3図(A))。
ングストロームのゲート酸化膜16を形成する。さらに
このゲート酸化膜12上に減圧CVD法により厚さ約1
000オングストロームのポリシリコン層13を堆積し
、このポリシリコン層13に砒素をイオン注入法により
ドープする(第3図(A))。
次にチタンターゲットと窒素(N2)とアルゴン(Ar
)の混合プラズマによる化成スパッタリング法により厚
さ約1000オングストロームのチタン窒化物層14を
ポリシリコン層13上に堆積する。その後、チタンシリ
サイドをターゲットとして直流マグネトロンスパッタリ
ング法によりチタン窒化物層14上にチタンシリサイド
層15を約2000オングストローム堆積する(第3図
(B))。
)の混合プラズマによる化成スパッタリング法により厚
さ約1000オングストロームのチタン窒化物層14を
ポリシリコン層13上に堆積する。その後、チタンシリ
サイドをターゲットとして直流マグネトロンスパッタリ
ング法によりチタン窒化物層14上にチタンシリサイド
層15を約2000オングストローム堆積する(第3図
(B))。
次に塩素系ガスを用いた異方性エツチングにより、半導
体基板10のチャンネル領域11となるべき領域以外の
部分にあるポリシリコン層13とチタン窒化物層14と
チタンシリサイド層15をエツチングしてゲート電極層
16を形成する(第3図(C))。なおゲート電極層1
6を構成するこれらポリシリコン層13とチタン窒化物
層14とチタンシリサイド層15は、異方性エツチング
により容易に微細加工が可能であるという特徴がある。
体基板10のチャンネル領域11となるべき領域以外の
部分にあるポリシリコン層13とチタン窒化物層14と
チタンシリサイド層15をエツチングしてゲート電極層
16を形成する(第3図(C))。なおゲート電極層1
6を構成するこれらポリシリコン層13とチタン窒化物
層14とチタンシリサイド層15は、異方性エツチング
により容易に微細加工が可能であるという特徴がある。
次に半導体基板10上に例えばゲート電極層16をマス
クとするイオン注入等によりチャンネル領域11を挟む
領域に不純物を添加してソース/ドレイン領域17とし
ての不純物領域を形成する(第3図(D))。
クとするイオン注入等によりチャンネル領域11を挟む
領域に不純物を添加してソース/ドレイン領域17とし
ての不純物領域を形成する(第3図(D))。
次に表面全体に酸化物層18を形成する。その後、酸化
物層18にコンタクトホールを形成し、さらにアルミニ
ウム配線層19を形成してソース/ドレイン領域17と
の電気的接続をとり、半導体装置を完成させた(第3図
(E))。
物層18にコンタクトホールを形成し、さらにアルミニ
ウム配線層19を形成してソース/ドレイン領域17と
の電気的接続をとり、半導体装置を完成させた(第3図
(E))。
なお上記製造方法で製造した半導体装置を950°Cの
高温熱処理をした場合でも、前述のようにゲート耐圧の
劣化は認められなかった(第2図)。しかし1000℃
で高温熱処理をした場合、わずかなゲート耐圧の劣化が
認められた。これに対しては、チタン窒化物層14の形
成後に約600℃で熱処理を施し、その後にチタンシリ
サイド層15を堆積するようにした。するとチタン窒化
物層14によるチタン原子の拡散移動に対する阻止作用
が増大する結果、チタンシリサイド層15のゲート耐圧
性が更に向上して1000℃の熱処理の後でもゲート耐
圧の劣化が全く認められなかった。
高温熱処理をした場合でも、前述のようにゲート耐圧の
劣化は認められなかった(第2図)。しかし1000℃
で高温熱処理をした場合、わずかなゲート耐圧の劣化が
認められた。これに対しては、チタン窒化物層14の形
成後に約600℃で熱処理を施し、その後にチタンシリ
サイド層15を堆積するようにした。するとチタン窒化
物層14によるチタン原子の拡散移動に対する阻止作用
が増大する結果、チタンシリサイド層15のゲート耐圧
性が更に向上して1000℃の熱処理の後でもゲート耐
圧の劣化が全く認められなかった。
又、チタン窒化物層14によるチタン原子の拡散移動阻
止作用を増大させるための他の方法としては、チタン窒
化物層14にカーボンをドープする方法がある。カーボ
ンのドープはチタン窒化物1414の堆積中にカーボン
を混入させてもよいし、チタン窒化物層14の堆積後に
カーボンをイオン注入法によりドープしてもよいし、さ
らには、チタンシリサイド層15の堆積後にカーボンを
イオン注入法によりドープしてもよい。カーボンのドー
プによりチタン原子の拡散移動阻止効果が増大するのは
、未反応チタン原子がカーボンと結合して熱的に安定し
たチタンカーバイドが形成されるためと考えられる。
止作用を増大させるための他の方法としては、チタン窒
化物層14にカーボンをドープする方法がある。カーボ
ンのドープはチタン窒化物1414の堆積中にカーボン
を混入させてもよいし、チタン窒化物層14の堆積後に
カーボンをイオン注入法によりドープしてもよいし、さ
らには、チタンシリサイド層15の堆積後にカーボンを
イオン注入法によりドープしてもよい。カーボンのドー
プによりチタン原子の拡散移動阻止効果が増大するのは
、未反応チタン原子がカーボンと結合して熱的に安定し
たチタンカーバイドが形成されるためと考えられる。
L記実施例ではチタン原子を阻止するためにチタン窒化
物層を用いたが、たとえばタングステンのような他の高
融点金属の窒化物層でもよい。
物層を用いたが、たとえばタングステンのような他の高
融点金属の窒化物層でもよい。
〔発明の効果〕
以上の通り、本発明によれば、ゲート電極層のシート抵
抗が充分に小さく、しきい値制御が容易で、熱処理後で
もゲート耐圧劣化が起きないようにすることができる。
抗が充分に小さく、しきい値制御が容易で、熱処理後で
もゲート耐圧劣化が起きないようにすることができる。
第1図は本発明の一実施例による半導体装置の断面図、
第2図は同半導体装置の高温熱処理後のゲート耐圧特性
を示す図、第3図(A)〜(E)は本発明の一実施例に
よる半導体装置の製造方法の各工程を示す断面図、第4
図(A)、(B)はそれぞれ従来の半導体装置の熱処理
前及び熱処理後のゲート耐圧特性を示す図である。 1・・・半導体基板、11・・・チャンネル領域、12
・・・ゲート酸化膜、13・・・ポリシリコン層、14
・・・チタン窒化物層、15・・・チタンシリサイド層
、16・・・ゲート電極層、17・・・ソース/ドレイ
ン領域、18・・・酸化物層、19・・・アルミニウム
配線層。 出願人代理人 佐 藤 −雄 昆 1 図 ”t lj 5G /J E (MV/cm1色2 図
第2図は同半導体装置の高温熱処理後のゲート耐圧特性
を示す図、第3図(A)〜(E)は本発明の一実施例に
よる半導体装置の製造方法の各工程を示す断面図、第4
図(A)、(B)はそれぞれ従来の半導体装置の熱処理
前及び熱処理後のゲート耐圧特性を示す図である。 1・・・半導体基板、11・・・チャンネル領域、12
・・・ゲート酸化膜、13・・・ポリシリコン層、14
・・・チタン窒化物層、15・・・チタンシリサイド層
、16・・・ゲート電極層、17・・・ソース/ドレイ
ン領域、18・・・酸化物層、19・・・アルミニウム
配線層。 出願人代理人 佐 藤 −雄 昆 1 図 ”t lj 5G /J E (MV/cm1色2 図
Claims (1)
- 【特許請求の範囲】 1、半導体基板と、 前記半導体基板上に形成されたゲート酸化膜と、前記ゲ
ート酸化膜上に形成されたポリシリコン層と、前記ポリ
シリコン層上に形成された高融点金属窒化物層と、前記
高融点金属窒化物層上に形成されたチタンシリサイド層
とを有するゲート電極層と を備えたことを特徴とする半導体装置。 2、特許請求の範囲第1項記載の半導体装置において、
前記高融点金属窒化物層は、チタン窒化物層であること
を特徴とする半導体装置。 3、特許請求の範囲第1項記載の半導体装置において、
前記高融点金属窒化物層は、タングステン窒化物層であ
ることを特徴とする半導体装置。 4、半導体基板上にゲート酸化膜を形成する第1の工程
と、 前記ゲート酸化膜上にポリシリコン層を形成する第2の
工程と、 前記ポリシリコン層上に高融点金属窒化物層を形成する
第3の工程と、 前記高融点金属窒化物層上にチタンシリサイド層を形成
する第4の工程と を有することを特徴とする半導体装置の製造方法。 5、特許請求の範囲第4項記載の半導体装置の製造方法
において、前記第3の工程の後、前記第4の工程の前に
熱処理を行う工程を有することを特徴とする半導体装置
の製造方法。 6、特許請求の範囲第5項記載の半導体装置の製造方法
において、前記高融点金属窒化物層に炭素を混入させる
工程を有することを特徴とする半導体装置の製造方法。 7、特許請求の範囲第4項乃至第6項のいずれかに記載
の半導体装置の製造方法において、前記高融点金属窒化
物層は、チタン窒化物層であることを特徴とする半導体
装置の製造方法。 8、特許請求の範囲第4項乃至第6項のいずれかに記載
の半導体装置の製造方法において、前記高融点金属窒化
物層は、タングステン窒化物層であることを特徴とする
半導体装置の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62056642A JPH0616555B2 (ja) | 1987-03-13 | 1987-03-13 | 半導体装置およびその製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62056642A JPH0616555B2 (ja) | 1987-03-13 | 1987-03-13 | 半導体装置およびその製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS63224255A true JPS63224255A (ja) | 1988-09-19 |
JPH0616555B2 JPH0616555B2 (ja) | 1994-03-02 |
Family
ID=13032992
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP62056642A Expired - Lifetime JPH0616555B2 (ja) | 1987-03-13 | 1987-03-13 | 半導体装置およびその製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0616555B2 (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH02164074A (ja) * | 1988-12-19 | 1990-06-25 | Nec Corp | 半導体装置 |
US6709911B1 (en) * | 2003-01-07 | 2004-03-23 | Intel Corporation | Method for making a semiconductor device having a high-k gate dielectric |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS60235702A (ja) * | 1984-05-09 | 1985-11-22 | Senichi Masuda | オゾンガスの製造方法と、その方法を実施するためのオゾナイザ |
JPS6114103A (ja) * | 1984-06-26 | 1986-01-22 | Senichi Masuda | セラミツクを用いたオゾナイザ− |
-
1987
- 1987-03-13 JP JP62056642A patent/JPH0616555B2/ja not_active Expired - Lifetime
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS60235702A (ja) * | 1984-05-09 | 1985-11-22 | Senichi Masuda | オゾンガスの製造方法と、その方法を実施するためのオゾナイザ |
JPS6114103A (ja) * | 1984-06-26 | 1986-01-22 | Senichi Masuda | セラミツクを用いたオゾナイザ− |
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Publication number | Priority date | Publication date | Assignee | Title |
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US6709911B1 (en) * | 2003-01-07 | 2004-03-23 | Intel Corporation | Method for making a semiconductor device having a high-k gate dielectric |
Also Published As
Publication number | Publication date |
---|---|
JPH0616555B2 (ja) | 1994-03-02 |
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