JPS63133770A - 信号処理回路 - Google Patents
信号処理回路Info
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- JPS63133770A JPS63133770A JP61280189A JP28018986A JPS63133770A JP S63133770 A JPS63133770 A JP S63133770A JP 61280189 A JP61280189 A JP 61280189A JP 28018986 A JP28018986 A JP 28018986A JP S63133770 A JPS63133770 A JP S63133770A
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- JP
- Japan
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- signal
- circuit
- edge detection
- detection circuit
- edge
- Prior art date
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- Granted
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- 230000003111 delayed effect Effects 0.000 abstract description 3
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- 206010067482 No adverse event Diseases 0.000 description 1
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Landscapes
- Television Signal Processing For Recording (AREA)
- Signal Processing Not Specific To The Method Of Recording And Reproducing (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明はビデオテープレコーダ（以下ＶＴＲと略称する
）等に用いられる信号処理回路に関するものである。
）等に用いられる信号処理回路に関するものである。
従来の技術
家庭用ＶＴＲでは、記録再生時に発生するノイズ成分を
効果的に抑圧するためにエンファシス。
効果的に抑圧するためにエンファシス。
ディエンファシスが行なわれ、それに伴いＦＭ変調の前
段にはホワイトクリップ、ダーククリップ等が行なわれ
、さらにはノイズキャンセラー等の信号処理が行なわれ
る。これら信号処理により、大きな立上りエツジ、もし
くは大きな立下りエツジをもつ波形がなまる傾向にあっ
た。
段にはホワイトクリップ、ダーククリップ等が行なわれ
、さらにはノイズキャンセラー等の信号処理が行なわれ
る。これら信号処理により、大きな立上りエツジ、もし
くは大きな立下りエツジをもつ波形がなまる傾向にあっ
た。
従来この波形なまりを解決するため、第４図に示す伸長
回路が用いられている。これによりエンファシスのかか
った信号波形第５図のａが波形すのように伸長されるこ
とになり、つまりディエンファシス後の立上り、立下が
りエツジをシャープなものにすることが可能となる。し
かし、波形のエツジ部は、一般にテープＣ／Ｎの劣化、
キャリ了り−ク、モアレ等によりＳ／Ｎが悪く、そのエ
ツジ部を伸長することは、ノイズを目立ちやすくするこ
とになる。つまり、エツジ部の拡大波形第５図Ｃがｄに
伸長された時ノイズ成分ｅも増幅されることになる。
回路が用いられている。これによりエンファシスのかか
った信号波形第５図のａが波形すのように伸長されるこ
とになり、つまりディエンファシス後の立上り、立下が
りエツジをシャープなものにすることが可能となる。し
かし、波形のエツジ部は、一般にテープＣ／Ｎの劣化、
キャリ了り−ク、モアレ等によりＳ／Ｎが悪く、そのエ
ツジ部を伸長することは、ノイズを目立ちやすくするこ
とになる。つまり、エツジ部の拡大波形第５図Ｃがｄに
伸長された時ノイズ成分ｅも増幅されることになる。
発明が解決しようとする問題点
このように、エツジ部を伸長してシャープにすると、ノ
イズが目立つという問題があった。
イズが目立つという問題があった。
問題点を解決するための手段
上記問題点を解決するために本発明は、入力信号をエツ
ジ検出回路と遅延回路に入力し、前記遅延回路の出力を
増幅回路へ入力し、前記エツジ検出回路の情報に基づい
て前記増幅回路の利得を制御するように構成したもので
ある。
ジ検出回路と遅延回路に入力し、前記遅延回路の出力を
増幅回路へ入力し、前記エツジ検出回路の情報に基づい
て前記増幅回路の利得を制御するように構成したもので
ある。
作用
本発明は上記構成により波形のエツジ部をシャープにし
、かつノイズを目立たせないことを可能とするものであ
る。
、かつノイズを目立たせないことを可能とするものであ
る。
実施例
以下、本発明の一実施例について図面を参照しながら説
明する。
明する。
第１図は、本発明のブロック図、第２図（ａ）〜（ｄ）
は各部の波形図である。
は各部の波形図である。
エンファシスのかかった再生映像信号ａが、入力端子１
より入力される。エツジ検出回路４では、所定レベル１
以上のオーバーシュート部分を検出し、信号すなる情報
を出力する。一方、入力信号ａは遅延回路２で遅延され
信号Ｃとなり、増幅回路３へ送られる。増幅回路３では
エツジ検出回路４からの信号すに基づいて利得を変化さ
せることにより信号ｄの如く立上りエツジが強調される
ことになる。しかしノイズの目立つ部分ｎは何ら強調し
ていないため、従来例の如き悪影響は全く発生しない。
より入力される。エツジ検出回路４では、所定レベル１
以上のオーバーシュート部分を検出し、信号すなる情報
を出力する。一方、入力信号ａは遅延回路２で遅延され
信号Ｃとなり、増幅回路３へ送られる。増幅回路３では
エツジ検出回路４からの信号すに基づいて利得を変化さ
せることにより信号ｄの如く立上りエツジが強調される
ことになる。しかしノイズの目立つ部分ｎは何ら強調し
ていないため、従来例の如き悪影響は全く発生しない。
第３図に本発明の一実施例の回路図を示す。
Ｑ、Ｑ、で増幅回路３を構成しており、Ｑ４Ｑｓでエツ
ジ検出回路４を構成している。各部の動作、各部の信号
波形ａ ”−ｅは、第１図のブロック図の説明の時と同
様である。
ジ検出回路４を構成している。各部の動作、各部の信号
波形ａ ”−ｅは、第１図のブロック図の説明の時と同
様である。
なお、実施例は立上りエツジについて述べているが、立
下りエツジに関してもエツジ検出回路４のＱａ Ｑｓの
トランジスタを、ｎｐｎからｐｎｐにする等、若干の修
正をすれば良く、他は同様である。
下りエツジに関してもエツジ検出回路４のＱａ Ｑｓの
トランジスタを、ｎｐｎからｐｎｐにする等、若干の修
正をすれば良く、他は同様である。
さらに、入力信号として、エンファシスがかかった状態
の信号を実施例としたが、エンファシスがかかっていな
い信号の場合、エツジ検出回路４の検出方法に若干修正
が必要となるが、本発明の構成は同一であり、本発明の
域を出るものではない。
の信号を実施例としたが、エンファシスがかかっていな
い信号の場合、エツジ検出回路４の検出方法に若干修正
が必要となるが、本発明の構成は同一であり、本発明の
域を出るものではない。
発明の効果
以上の説明から明らかなように、本発明は入力信号をエ
ツジ検出回路と遅延回路に入力し、遅延回路の出力を増
幅回路へ入力し、エツジ検出回路の情報に基づいて増幅
回路の利得を制御するように構成したことにより、再生
画面のエツジ部のノイズを強調することなくエツジ部を
シャープにすることが可能でありＶＴＲ等の磁気記録再
生装置に用いることによりその効果は大なるものがある
。
ツジ検出回路と遅延回路に入力し、遅延回路の出力を増
幅回路へ入力し、エツジ検出回路の情報に基づいて増幅
回路の利得を制御するように構成したことにより、再生
画面のエツジ部のノイズを強調することなくエツジ部を
シャープにすることが可能でありＶＴＲ等の磁気記録再
生装置に用いることによりその効果は大なるものがある
。
第１図は、本発明の信号処理回路のブロック図、第２図
は、本発明の信号処理回路の波形図、第３図は、本発明
の信号処理回路の回路図、第４図は、従来の信号処理回
路の回路図、第５図は、従来の信号処理回路の波形図で
ある。 ２・・・・・・遅延回路、３・・・・・・増幅回路、４
・・・・・・エツジ検出回路。 代理人の氏名 弁理士 中尾敏男 はか１名范 １ 図 第２図 第３図
は、本発明の信号処理回路の波形図、第３図は、本発明
の信号処理回路の回路図、第４図は、従来の信号処理回
路の回路図、第５図は、従来の信号処理回路の波形図で
ある。 ２・・・・・・遅延回路、３・・・・・・増幅回路、４
・・・・・・エツジ検出回路。 代理人の氏名 弁理士 中尾敏男 はか１名范 １ 図 第２図 第３図
Claims (4)
- （１）入力信号をエッジ検出回路と遅延回路に入力し、
前記遅延回路の出力を増幅回路へ入力し、前記エッジ検
出回路の情報に基づいて前記増幅回路の利得を制御する
ことを特徴とする信号処理回路。 - （２）エッジ検出回路は、１００％白信号レベルとホワ
イトクリップレベルの間の所定レベル以上の信号を検出
することを特徴とする特許請求の範囲第（１）項記載の
信号処理回路。 - （３）エッジ検出回路は、黒信号レベルとダーククリッ
プレベルの間の所定レベル以下の信号を検出することを
特徴とする特許請求の範囲第（１）項記載の信号処理回
路。 - （４）入力信号は、エンファシスされた信号であること
を特徴とする特許請求の範囲第（１）項記載の信号処理
回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61280189A JPH0773358B2 (ja) | 1986-11-25 | 1986-11-25 | 信号処理回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61280189A JPH0773358B2 (ja) | 1986-11-25 | 1986-11-25 | 信号処理回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS63133770A true JPS63133770A (ja) | 1988-06-06 |
| JPH0773358B2 JPH0773358B2 (ja) | 1995-08-02 |
Family
ID=17621537
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61280189A Expired - Fee Related JPH0773358B2 (ja) | 1986-11-25 | 1986-11-25 | 信号処理回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0773358B2 (ja) |
-
1986
- 1986-11-25 JP JP61280189A patent/JPH0773358B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0773358B2 (ja) | 1995-08-02 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |