JPS6223887B2 - - Google Patents
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- JPS6223887B2 JPS6223887B2 JP2652481A JP2652481A JPS6223887B2 JP S6223887 B2 JPS6223887 B2 JP S6223887B2 JP 2652481 A JP2652481 A JP 2652481A JP 2652481 A JP2652481 A JP 2652481A JP S6223887 B2 JPS6223887 B2 JP S6223887B2
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- 238000010586 diagram Methods 0.000 description 5
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- 238000000034 method Methods 0.000 description 2
- 239000000284 extract Substances 0.000 description 1
- 230000008685 targeting Effects 0.000 description 1
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-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
- G06F3/06—Digital input from, or digital output to, record carriers, e.g. RAID, emulated record carriers or networked record carriers
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- Theoretical Computer Science (AREA)
- Human Computer Interaction (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
Description
【発明の詳細な説明】
本発明は入出力制御装置、特に外部記憶装置
に、電源投入信号と、駆動信号と、読出し書込み
制御信号とを順次入力してデータ転送を制御する
入出力制御装置に関す。
に、電源投入信号と、駆動信号と、読出し書込み
制御信号とを順次入力してデータ転送を制御する
入出力制御装置に関す。
第１図は従来あるこの種入出力制御装置の一例
を示す図である。第１図において、入出力制御装
置IOCは図示されぬ中央制御装置CCからの指令
により、フロツピイ駆動装置FDに対するデータ
転送を制御する。なおデータの読出しまたは書込
みを実施していない場合は、フロツピイ駆動装置
FDは電源が切断されており、また磁気ヘツドＨ
は、フロツピイデイスクＦの記憶面上に設定され
ていない。今中央制御装置CCから、フロツピイ
デイスクＦのトラツクTR上にあるセクタＳ１お
よびＳ２に記憶されているデータを読出す指令が
到来すると、入出力制御装置IOCに在る制御回路
CTLは、フロツピイ駆動装置FDに電源投入信号
Ａを伝達する。該電源投入信号Ａを受領したフロ
ツピイ駆動装置FDは電源を投入し、フロツピイ
デイスクＦを回転させる。次に制御回路CTLは
フロツピイ駆動装置FDに駆動信号Ｂを伝達し、
磁気ヘツドＨをフロツピイデイスクＦの記憶面に
設定させる。なお駆動信号Ｂは入出力制御装置
IOCに在る時限回路TMにも入力される。該時限
回路TMは、フロツピイ駆動装置FDにおいて磁
気ヘツドＨがフロツピイデイスクＦの記憶面上に
確実に設定されるに充分な遅延時間ｔ（例えば数
ミリ秒）の後、駆動完了信号Ｃを制御回路CTL
に返送する。該駆動完了信号Ｃを受領した制御回
路CTLは、読出し書込み制御信号Ｄその他の制
御信号をフロツピイ駆動装置に伝達し、フロツピ
イデイスクＦ上の所定のセクタＳ１から読出した
データ信号Ｅを抽出する。セクタＳ１からの読出
しが終了後、セクタＳ２に記憶させているデータ
を読出すために、制御回路CTLは再び駆動信号
Ｂをフロツピイ駆動装置FDに伝達し、時限回路
TMが遅延時間ｔ後に返送する駆動完了信号Ｃを
待つて、セクタＳ２からの読出し制御を開始す
る。その間にフロツピイ駆動装置FDにおいて
は、セクタＳ１と同一トラツクTR上に在る読出
し対象のセクタＳ２は、セクタＳ１に続いて磁気
ヘツドＨを通過しており、フロツピイデイスクＦ
が１回転して再びセクタＳ２が磁気ヘツドＨの位
置に戻る迄（例えば百数十ミリ秒）経過しない
と、制御回路CTLは所要のデータ信号Ｅを受領
出来ない。
を示す図である。第１図において、入出力制御装
置IOCは図示されぬ中央制御装置CCからの指令
により、フロツピイ駆動装置FDに対するデータ
転送を制御する。なおデータの読出しまたは書込
みを実施していない場合は、フロツピイ駆動装置
FDは電源が切断されており、また磁気ヘツドＨ
は、フロツピイデイスクＦの記憶面上に設定され
ていない。今中央制御装置CCから、フロツピイ
デイスクＦのトラツクTR上にあるセクタＳ１お
よびＳ２に記憶されているデータを読出す指令が
到来すると、入出力制御装置IOCに在る制御回路
CTLは、フロツピイ駆動装置FDに電源投入信号
Ａを伝達する。該電源投入信号Ａを受領したフロ
ツピイ駆動装置FDは電源を投入し、フロツピイ
デイスクＦを回転させる。次に制御回路CTLは
フロツピイ駆動装置FDに駆動信号Ｂを伝達し、
磁気ヘツドＨをフロツピイデイスクＦの記憶面に
設定させる。なお駆動信号Ｂは入出力制御装置
IOCに在る時限回路TMにも入力される。該時限
回路TMは、フロツピイ駆動装置FDにおいて磁
気ヘツドＨがフロツピイデイスクＦの記憶面上に
確実に設定されるに充分な遅延時間ｔ（例えば数
ミリ秒）の後、駆動完了信号Ｃを制御回路CTL
に返送する。該駆動完了信号Ｃを受領した制御回
路CTLは、読出し書込み制御信号Ｄその他の制
御信号をフロツピイ駆動装置に伝達し、フロツピ
イデイスクＦ上の所定のセクタＳ１から読出した
データ信号Ｅを抽出する。セクタＳ１からの読出
しが終了後、セクタＳ２に記憶させているデータ
を読出すために、制御回路CTLは再び駆動信号
Ｂをフロツピイ駆動装置FDに伝達し、時限回路
TMが遅延時間ｔ後に返送する駆動完了信号Ｃを
待つて、セクタＳ２からの読出し制御を開始す
る。その間にフロツピイ駆動装置FDにおいて
は、セクタＳ１と同一トラツクTR上に在る読出
し対象のセクタＳ２は、セクタＳ１に続いて磁気
ヘツドＨを通過しており、フロツピイデイスクＦ
が１回転して再びセクタＳ２が磁気ヘツドＨの位
置に戻る迄（例えば百数十ミリ秒）経過しない
と、制御回路CTLは所要のデータ信号Ｅを受領
出来ない。
以上の説明から明らかな如く、従来ある入出力
制御装置IOCにおいては、フロツピイデイスクＦ
からデータを読出す場合に１セクタ毎に遅延時間
ｔをとるため、同一トラツクに連続配置されてい
るセクタから順次データを読出す場合にも回転待
ち等の余分の時間を必要とし、データ転送効率を
低下させる。
制御装置IOCにおいては、フロツピイデイスクＦ
からデータを読出す場合に１セクタ毎に遅延時間
ｔをとるため、同一トラツクに連続配置されてい
るセクタから順次データを読出す場合にも回転待
ち等の余分の時間を必要とし、データ転送効率を
低下させる。
本発明の目的は、前述の如き従来ある入出力制
御装置の欠点を除去し、データ転送に不必要な遅
延時間の介入を防止することにより、データ転送
効率を向上させることにある。
御装置の欠点を除去し、データ転送に不必要な遅
延時間の介入を防止することにより、データ転送
効率を向上させることにある。
この目的は、外部記憶装置に電源投入信号と、
駆動信号と、読出し書込み信号とを順次入力して
データ転送を制御する入出力制御装置において、
前記電源投入信号を検出して出力信号を送出する
第１の手段と、電源投入中の前記記憶装置から返
送されるインデツクス信号を所定個数検出して前
記出力信号を送出する第２の手段と、前記第１の
手段および第２の手段の何れかゞ前記出力信号を
送出後、前記駆動信号を検出することにより、前
記第１の手段および第２の手段の何れかゞ再び前
記出力信号を送出する迄、送出中の前記出力信号
を停止させる第３の手段とを有する計数回路と、
前記出力信号を受信することにより前記駆動信号
の送出後前記読出し書込み制御信号を送出する迄
の時間を所定時間遅延させる時限回路とを具備す
ることにより達成される。
駆動信号と、読出し書込み信号とを順次入力して
データ転送を制御する入出力制御装置において、
前記電源投入信号を検出して出力信号を送出する
第１の手段と、電源投入中の前記記憶装置から返
送されるインデツクス信号を所定個数検出して前
記出力信号を送出する第２の手段と、前記第１の
手段および第２の手段の何れかゞ前記出力信号を
送出後、前記駆動信号を検出することにより、前
記第１の手段および第２の手段の何れかゞ再び前
記出力信号を送出する迄、送出中の前記出力信号
を停止させる第３の手段とを有する計数回路と、
前記出力信号を受信することにより前記駆動信号
の送出後前記読出し書込み制御信号を送出する迄
の時間を所定時間遅延させる時限回路とを具備す
ることにより達成される。
以下、本発明の一実施例を第２図および第３図
により説明する。第２図は本発明の一実施例によ
る入出力制御装置を示す図であり、第３図は第２
図に示される入出力制御装置の動作説明用タイム
チヤートの一例を示す図である。第２図に示され
る入出力制御装置IOC′の、第１図に示される入
出力制御装置IOCと異なる点は、時限回路TM′が
駆動完了信号C′を制御回路CTLに返送する場合
に、遅延時間ｔの設定を制御する計数回路CNT
を設けたことにある。次に第３図を用いて、入出
力制御装置IOC′の作動過程を説明する。時点Ｔ
１に制御回路CTLがフロツピイ駆動装置FDに電
源投入信号Ａを伝達すると、計数回路CNTは該
電源投入信号Ａを検出してオーバーフロー状態に
設定され、出力信号Ｇを時限回路TM′に伝達す
る。次に時点Ｔ２に制御回路CTLがフロツピイ
デイスクＦのセクトＳ１およびＳ２に記憶されて
いるデータを読出すために、駆動信号Ｂをフロツ
ピイ駆動装置FDに伝達すると、該駆動信号Ｂを
検出した時限回路TM′は、計数回路CNTから出
力信号Ｇを受領することにより、所定の遅延時間
ｔ後に駆動完了信号C′を制御回路CTLに返送す
る。以後制御回路CTLは読出し書込み制御信号
Ｄ等をフロツピイ駆動回路FDに伝達して、セク
タＳ１から読出したデータ信号Ｅを受信する。該
データ信号Ｅを受信後、時点Ｔ３に駆動信号Ｂの
伝達を停止すると、該駆動信号Ｂの停止を検出し
た計数回路CNTはリセツト状態となり、出力信
号Ｇの伝達を停止する。続いてセクタＳ２に記憶
されているデータを読出すために、制御回路
CTLは時点Ｔ４に駆動信号Ｂを再びフロツピイ
駆動装置FDに伝達する。該駆動信号Ｂを検出し
た時限回路TM′は、今回は計数回路CNTから出
力信号Ｇを受領していないので、所定の遅延時間
ｔを経過すること無く、直ちに駆動完了信号
C′を返送する。その経果、制御回路CTLも遅滞
なく読出し書込み制御信号Ｄをフロツピイ駆動装
置FDに送出する。フロツピイ駆動装置FDは何等
磁気ヘツドＨを移動させる必要無く、セクタＳ１
に続くセクタＳ２から直ちにデータ信号Ｅを受信
することが出来る。一方フロツピイデイスクＦの
インデツクストラツクIDからは、１回転毎にイ
ンデツクス信号Ｉが抽出され、入出力制御装置
IOC′に伝達される。入出力制御装置IOC′におい
ては、計数回路CNTがインデツクス信号Ｉを検
出し、計数する。フロツピイ駆動装置FDは磁気
ヘツドＨをフロツピイデイスクＦの記憶面に設定
した状態で連続して所定回数Ｎ回転すると、一旦
磁気ヘツドＨを記憶面から強制的に設定除去す
る。フロツピー駆動装置FDはＮ回転（ex 15回
転）する間に駆動（読み出し／書込み、シーク
等）が成されないと、自動的に磁気ヘツドＨを磁
性面から浮かす様になつている。計数回路CNT
はインデツクス信号ＩをＮ個計数すると、オーバ
フロ状態となり、再び出力信号Ｇを時限回路
TM′に伝達する。かゝる状態で時点Ｔ５に制御回
路CTLが駆動信号Ｂをフロツピイ駆動装置FDに
伝達すると、出力信号Ｇを受領している時限回路
MT′は所定の遅延時間ｔ後に駆動完了信号Ｃを返
送する。その間に、フロツピイ駆動装置FDにお
いては、磁気ヘツドＨが再びフロツピイデイスク
Ｆの記憶面上に設定されている。以後、時点Ｔ２
におけると同様の過程で、所要のセクタからデー
タの読出しが実施される。なお時点Ｔ６に駆動信
号Ｂの伝達が停止されると、時点Ｔ３におけると
同様に、計数回路CNTは出力信号Ｇの伝達を停
止するので、時限回路TM′は以後検出する駆動信
号Ｂに対し、直ちに駆動完了信号C′を返送する
（時点Ｔ７）。
により説明する。第２図は本発明の一実施例によ
る入出力制御装置を示す図であり、第３図は第２
図に示される入出力制御装置の動作説明用タイム
チヤートの一例を示す図である。第２図に示され
る入出力制御装置IOC′の、第１図に示される入
出力制御装置IOCと異なる点は、時限回路TM′が
駆動完了信号C′を制御回路CTLに返送する場合
に、遅延時間ｔの設定を制御する計数回路CNT
を設けたことにある。次に第３図を用いて、入出
力制御装置IOC′の作動過程を説明する。時点Ｔ
１に制御回路CTLがフロツピイ駆動装置FDに電
源投入信号Ａを伝達すると、計数回路CNTは該
電源投入信号Ａを検出してオーバーフロー状態に
設定され、出力信号Ｇを時限回路TM′に伝達す
る。次に時点Ｔ２に制御回路CTLがフロツピイ
デイスクＦのセクトＳ１およびＳ２に記憶されて
いるデータを読出すために、駆動信号Ｂをフロツ
ピイ駆動装置FDに伝達すると、該駆動信号Ｂを
検出した時限回路TM′は、計数回路CNTから出
力信号Ｇを受領することにより、所定の遅延時間
ｔ後に駆動完了信号C′を制御回路CTLに返送す
る。以後制御回路CTLは読出し書込み制御信号
Ｄ等をフロツピイ駆動回路FDに伝達して、セク
タＳ１から読出したデータ信号Ｅを受信する。該
データ信号Ｅを受信後、時点Ｔ３に駆動信号Ｂの
伝達を停止すると、該駆動信号Ｂの停止を検出し
た計数回路CNTはリセツト状態となり、出力信
号Ｇの伝達を停止する。続いてセクタＳ２に記憶
されているデータを読出すために、制御回路
CTLは時点Ｔ４に駆動信号Ｂを再びフロツピイ
駆動装置FDに伝達する。該駆動信号Ｂを検出し
た時限回路TM′は、今回は計数回路CNTから出
力信号Ｇを受領していないので、所定の遅延時間
ｔを経過すること無く、直ちに駆動完了信号
C′を返送する。その経果、制御回路CTLも遅滞
なく読出し書込み制御信号Ｄをフロツピイ駆動装
置FDに送出する。フロツピイ駆動装置FDは何等
磁気ヘツドＨを移動させる必要無く、セクタＳ１
に続くセクタＳ２から直ちにデータ信号Ｅを受信
することが出来る。一方フロツピイデイスクＦの
インデツクストラツクIDからは、１回転毎にイ
ンデツクス信号Ｉが抽出され、入出力制御装置
IOC′に伝達される。入出力制御装置IOC′におい
ては、計数回路CNTがインデツクス信号Ｉを検
出し、計数する。フロツピイ駆動装置FDは磁気
ヘツドＨをフロツピイデイスクＦの記憶面に設定
した状態で連続して所定回数Ｎ回転すると、一旦
磁気ヘツドＨを記憶面から強制的に設定除去す
る。フロツピー駆動装置FDはＮ回転（ex 15回
転）する間に駆動（読み出し／書込み、シーク
等）が成されないと、自動的に磁気ヘツドＨを磁
性面から浮かす様になつている。計数回路CNT
はインデツクス信号ＩをＮ個計数すると、オーバ
フロ状態となり、再び出力信号Ｇを時限回路
TM′に伝達する。かゝる状態で時点Ｔ５に制御回
路CTLが駆動信号Ｂをフロツピイ駆動装置FDに
伝達すると、出力信号Ｇを受領している時限回路
MT′は所定の遅延時間ｔ後に駆動完了信号Ｃを返
送する。その間に、フロツピイ駆動装置FDにお
いては、磁気ヘツドＨが再びフロツピイデイスク
Ｆの記憶面上に設定されている。以後、時点Ｔ２
におけると同様の過程で、所要のセクタからデー
タの読出しが実施される。なお時点Ｔ６に駆動信
号Ｂの伝達が停止されると、時点Ｔ３におけると
同様に、計数回路CNTは出力信号Ｇの伝達を停
止するので、時限回路TM′は以後検出する駆動信
号Ｂに対し、直ちに駆動完了信号C′を返送する
（時点Ｔ７）。
尚、磁気ヘツドＨはフロツピデイスクＦの記憶
面に対して、電源投入直後の駆動時およびインデ
ツクス信号Ｉを所定回数Ｎ回転後の駆動時のみ浮
いている。又、電源投入後すぐシーク（読み出
し／書き込み兼用）に入る。
面に対して、電源投入直後の駆動時およびインデ
ツクス信号Ｉを所定回数Ｎ回転後の駆動時のみ浮
いている。又、電源投入後すぐシーク（読み出
し／書き込み兼用）に入る。
以上の説明から明らかな如く、本実施例によれ
ば、計数回路CNTは電源投入信号Ａを検出した
時、またはインデツクス信号Ｉを所定回数Ｎ連続
して検出した時に出力信号Ｇを時限回路TM′に伝
達し、駆動信号Ｂを検出した後、所定の遅延時間
ｔ経過後に駆動完了信号C′を返送させる。該出
力信号Ｇは最初の駆動信号Ｂが停止すると、再び
電源投入信号Ａを検出する迄、またはインデツク
ス信号Ｉを所定回数Ｎ連続して検出する迄、計数
回路CNTから伝達されなくなるので、その間時
限回路TM′は駆動信号Ｂを検出後、直ちに駆動完
了信号C′を返送する。以上により、フロツピイ
駆動装置FDにおいて、磁気ヘツドＨが非設定の
状態で駆動信号Ｂが伝達される場合に限り、磁気
ヘツドＨの設定に必要な遅延時間ｔが、読出し書
込み制御信号Ｄの伝達迄に準備され、それ以外の
時には遅延時間ｔは省略される。
ば、計数回路CNTは電源投入信号Ａを検出した
時、またはインデツクス信号Ｉを所定回数Ｎ連続
して検出した時に出力信号Ｇを時限回路TM′に伝
達し、駆動信号Ｂを検出した後、所定の遅延時間
ｔ経過後に駆動完了信号C′を返送させる。該出
力信号Ｇは最初の駆動信号Ｂが停止すると、再び
電源投入信号Ａを検出する迄、またはインデツク
ス信号Ｉを所定回数Ｎ連続して検出する迄、計数
回路CNTから伝達されなくなるので、その間時
限回路TM′は駆動信号Ｂを検出後、直ちに駆動完
了信号C′を返送する。以上により、フロツピイ
駆動装置FDにおいて、磁気ヘツドＨが非設定の
状態で駆動信号Ｂが伝達される場合に限り、磁気
ヘツドＨの設定に必要な遅延時間ｔが、読出し書
込み制御信号Ｄの伝達迄に準備され、それ以外の
時には遅延時間ｔは省略される。
なお、第２図および第３図はあく迄本発明の一
実施例に過ぎず、例えば前述のデータ転送動作は
フロツピイデイスクＦのセクタＳ１およびＳ２か
らの読出しに限定されることは無く、他の任意の
セクタを対象とするデータの読出しあるいは書込
み動作においても、本発明の効果は変らない。ま
た、データ転送の対象となる外部記憶装置はフロ
ツピイ駆動装置FDに限定されることは無く、他
の同一制御形式を採用する外部記憶装置に対して
も本発明の効果は変らない。
実施例に過ぎず、例えば前述のデータ転送動作は
フロツピイデイスクＦのセクタＳ１およびＳ２か
らの読出しに限定されることは無く、他の任意の
セクタを対象とするデータの読出しあるいは書込
み動作においても、本発明の効果は変らない。ま
た、データ転送の対象となる外部記憶装置はフロ
ツピイ駆動装置FDに限定されることは無く、他
の同一制御形式を採用する外部記憶装置に対して
も本発明の効果は変らない。
以上、本発明によれば、外部記憶装置のデータ
転送を制御する入出力制御装置が、外部記憶装置
の作動上必要最小限の遅延時間のみを設定するこ
とにより、データ転送効率を向上可能となる。
転送を制御する入出力制御装置が、外部記憶装置
の作動上必要最小限の遅延時間のみを設定するこ
とにより、データ転送効率を向上可能となる。
第１図は従来ある入出力制御装置を示す図、第
２図は本発明の一実施例による入出力制御装置を
示す図、第３図は、第２図に示される入出力制御
装置の動作説明用タイムチヤートの一例を示す図
である。 図において、IOCおよびIOC′は入出力制御装
置、CCは中央制御装置、FDはフロツピイ駆動装
置、CTLは制御回路、TMおよびTM′は時限回
路、CNTは計数回路、Ｆはフロツピイデイス
ク、TRはトラツク、Ｓ１およびＳ２はセクタ、
IDはインデツクトラツク、Ｈは磁気ヘツド、Ａ
は電源投入信号、Ｂは駆動信号、ＣおよびC′は
駆動完了信号、Ｄは読出し書込み信号、Ｅはデー
タ信号、Ｇは出力信号、Ｔ１乃至Ｔ７は時点、を
示す。
２図は本発明の一実施例による入出力制御装置を
示す図、第３図は、第２図に示される入出力制御
装置の動作説明用タイムチヤートの一例を示す図
である。 図において、IOCおよびIOC′は入出力制御装
置、CCは中央制御装置、FDはフロツピイ駆動装
置、CTLは制御回路、TMおよびTM′は時限回
路、CNTは計数回路、Ｆはフロツピイデイス
ク、TRはトラツク、Ｓ１およびＳ２はセクタ、
IDはインデツクトラツク、Ｈは磁気ヘツド、Ａ
は電源投入信号、Ｂは駆動信号、ＣおよびC′は
駆動完了信号、Ｄは読出し書込み信号、Ｅはデー
タ信号、Ｇは出力信号、Ｔ１乃至Ｔ７は時点、を
示す。
Claims (1)
- １ 外部記憶装置に電源投入信号と、駆動信号
と、読出し書込み制御信号とを順次入力してデー
タ転送を制御する入出力制御装置において、前記
電源投入信号を検出して一定幅の出力信号を送出
する第１の手段と、電源投入中の前記外部記憶装
置から返送されるインデツクス信号を所定個数検
出して一定幅の前記出力信号を送出する第２の手
段と、前記第１の手段および第２の手段の何れか
が再び前記出力信号を送出する迄、送出中の前記
出力信号を送出させない第３の手段とを有する計
数回路と、前記出力信号を受信中のみ前記駆動信
号の送出後、前記読出し書込み制御信号を送出す
る迄の時間を所定時間遅延させる時限回路とを具
備することを特徴とする入出力制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2652481A JPS57141764A (en) | 1981-02-25 | 1981-02-25 | Input and output controller |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2652481A JPS57141764A (en) | 1981-02-25 | 1981-02-25 | Input and output controller |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS57141764A JPS57141764A (en) | 1982-09-02 |
| JPS6223887B2 true JPS6223887B2 (ja) | 1987-05-26 |
Family
ID=12195858
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2652481A Granted JPS57141764A (en) | 1981-02-25 | 1981-02-25 | Input and output controller |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS57141764A (ja) |
-
1981
- 1981-02-25 JP JP2652481A patent/JPS57141764A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS57141764A (en) | 1982-09-02 |
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