JPS62216240A - 集積回路パツケ−ジ - Google Patents
集積回路パツケ−ジInfo
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- JPS62216240A JPS62216240A JP61059983A JP5998386A JPS62216240A JP S62216240 A JPS62216240 A JP S62216240A JP 61059983 A JP61059983 A JP 61059983A JP 5998386 A JP5998386 A JP 5998386A JP S62216240 A JPS62216240 A JP S62216240A
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- H01L2924/11—Device type
- H01L2924/14—Integrated circuits
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は集積回路パッケージに関し、特に集積回路チッ
プ(以下チップと称す)上の端子(以下パッドと称す)
とポンディノブするための集積回路パッケージの内部端
子(以下リードと称す)の配置及び配線に関する。
プ(以下チップと称す)上の端子(以下パッドと称す)
とポンディノブするための集積回路パッケージの内部端
子(以下リードと称す)の配置及び配線に関する。
従来の集積回路パッケージでは、外部端子とボンディン
グのためのリード及びチップ上のパッドは1通常一対一
に対応しておシ、外部端子の並びが、そのままチップ上
のパッドの並びになっていたO 〔発明が解決しようとする問題点〕 上述した従来の集積回路パッケージでは、外部端子から
の信号および電源は、集積回路パッケージのリードを通
シ、リードにボンディングされたチップ上のパッドに供
給され、このパッドからチップ内の層配線に供給される
ようになっているので、同一信号または電源をチップ上
の各辺の複数箇所のパッドに供給したい場合には、集積
回路パッケージに同一信号名を持つ複数の外部端子とリ
ードが必要であシ、且つ集積回路パッケージの外で接続
しなければならないという欠点がある。
グのためのリード及びチップ上のパッドは1通常一対一
に対応しておシ、外部端子の並びが、そのままチップ上
のパッドの並びになっていたO 〔発明が解決しようとする問題点〕 上述した従来の集積回路パッケージでは、外部端子から
の信号および電源は、集積回路パッケージのリードを通
シ、リードにボンディングされたチップ上のパッドに供
給され、このパッドからチップ内の層配線に供給される
ようになっているので、同一信号または電源をチップ上
の各辺の複数箇所のパッドに供給したい場合には、集積
回路パッケージに同一信号名を持つ複数の外部端子とリ
ードが必要であシ、且つ集積回路パッケージの外で接続
しなければならないという欠点がある。
本発明の集積回路パッケージは、チップのマスク設計や
特性に影響を与える配線のチップ上での布線を改善する
ために、集積回路パッケージの外部端子の並びに制限さ
れることなく、外部端子とチップ内の任意の複数箇所の
パッドとを接続できるように、外部端子に対応するリン
グ状のリードを有している。
特性に影響を与える配線のチップ上での布線を改善する
ために、集積回路パッケージの外部端子の並びに制限さ
れることなく、外部端子とチップ内の任意の複数箇所の
パッドとを接続できるように、外部端子に対応するリン
グ状のリードを有している。
本発明の集積回路バブケージは、集積回路チップ上の端
子を外部端子に接続するための内部端子の少くとも1つ
が集積回路チップ搭載部をリング状に囲んで設けられて
いることを特徴とする。
子を外部端子に接続するための内部端子の少くとも1つ
が集積回路チップ搭載部をリング状に囲んで設けられて
いることを特徴とする。
次に本発明について図面を参照して説明する。
第1図は本発明の一実施例で、集積回路パッケージ1に
搭載したチップ2のマワント部分の拡大図である。集積
回路パッケージ1は、第2図で示すような外部端子数が
32個の単一電源用の集積回路パッケージであり、チッ
プ2は電源vCCとGNDとのそれぞれに複数個のパッ
ドを有している。この集積回路パッケージ1は、積層構
造にすることにより、16番目の外部端子に対応する■
■リードと、32番目の外部端子に対応する■CCリー
ドとを第1図に示すような2本のリング状リード7.8
とし、他の外部端子に対応するリード4はそれぞれのパ
ッドと対応するように配置している。
搭載したチップ2のマワント部分の拡大図である。集積
回路パッケージ1は、第2図で示すような外部端子数が
32個の単一電源用の集積回路パッケージであり、チッ
プ2は電源vCCとGNDとのそれぞれに複数個のパッ
ドを有している。この集積回路パッケージ1は、積層構
造にすることにより、16番目の外部端子に対応する■
■リードと、32番目の外部端子に対応する■CCリー
ドとを第1図に示すような2本のリング状リード7.8
とし、他の外部端子に対応するリード4はそれぞれのパ
ッドと対応するように配置している。
この2本のリング状リードは積層構造の層を増やすこと
により2本以上の場合でも実現できることは言うまでも
ない。
により2本以上の場合でも実現できることは言うまでも
ない。
第3図に本発明の実施例を示す。第3図は、集積回路パ
ッケージを積層構造にすることなく1本のリング状リー
ド7と、それを囲むようにした一部が切れたリング状リ
ード8とを設けたものであシ、それぞれ、16番目の外
部端子と32番目の外部端子とに対応している。
ッケージを積層構造にすることなく1本のリング状リー
ド7と、それを囲むようにした一部が切れたリング状リ
ード8とを設けたものであシ、それぞれ、16番目の外
部端子と32番目の外部端子とに対応している。
以上説明したように本発明は集積回路パッケージ内に外
部端子に対応したリング状リードを設けることにより、
チップの任意のパッドへボンディングすることができる
。したがって、外部端子を手ツブ外で1つに接続する必
要がなく、このことは、集積回路のマスク設計において
は、ある機能ブロック単位にパッドを分離できるため、
ビルディングブロック方式の設計には都合が良い。
部端子に対応したリング状リードを設けることにより、
チップの任意のパッドへボンディングすることができる
。したがって、外部端子を手ツブ外で1つに接続する必
要がなく、このことは、集積回路のマスク設計において
は、ある機能ブロック単位にパッドを分離できるため、
ビルディングブロック方式の設計には都合が良い。
また電源、GNDのリードに本発明を用いることにより
、ノイズ対策の上からも、ノイズ発生源と他の回路を分
離することが容易であり、さらに電圧レベルの変動もチ
ップ内で均一にしかも低くおさえることができる。加え
てチップが大規模になシ消費電力が増大しても、従来の
ように全電流を流せるような幅の太い金属層配線を布設
する必要もないといった多くの効果がある。
、ノイズ対策の上からも、ノイズ発生源と他の回路を分
離することが容易であり、さらに電圧レベルの変動もチ
ップ内で均一にしかも低くおさえることができる。加え
てチップが大規模になシ消費電力が増大しても、従来の
ように全電流を流せるような幅の太い金属層配線を布設
する必要もないといった多くの効果がある。
第1図は本発明の一実施例の集積回路パッケージに搭載
したチップのマクント部分の拡大図、第2図は第1図の
集積回路パッケージの外部端子の並びを示す平面図、第
3図は本発明の他の実施例の集積回路パッケージに搭載
したチップのマクント部分の拡大図である。 1・・・・・・集積回路パッケージ、2・・・・・・チ
ップ、3・・・・・・外部端子%4・・・・・・リード
%5・・・・・・パッド、6・・・・・・ボンディング
ワイヤー 、7,8・・・・・・リング状リード。 代理人 弁理士 内 原 晋、へ第1図 8 リ〕ジ”収り−ド
したチップのマクント部分の拡大図、第2図は第1図の
集積回路パッケージの外部端子の並びを示す平面図、第
3図は本発明の他の実施例の集積回路パッケージに搭載
したチップのマクント部分の拡大図である。 1・・・・・・集積回路パッケージ、2・・・・・・チ
ップ、3・・・・・・外部端子%4・・・・・・リード
%5・・・・・・パッド、6・・・・・・ボンディング
ワイヤー 、7,8・・・・・・リング状リード。 代理人 弁理士 内 原 晋、へ第1図 8 リ〕ジ”収り−ド
Claims (1)
- 集積回路チップ上の端子を外部端子に接続するための内
部端子の少くとも1つが集積回路チップ搭載部をリング
状に囲んで設けられていることを特徴とする集積回路パ
ッケージ。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61059983A JPS62216240A (ja) | 1986-03-17 | 1986-03-17 | 集積回路パツケ−ジ |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61059983A JPS62216240A (ja) | 1986-03-17 | 1986-03-17 | 集積回路パツケ−ジ |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS62216240A true JPS62216240A (ja) | 1987-09-22 |
Family
ID=13128914
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP61059983A Pending JPS62216240A (ja) | 1986-03-17 | 1986-03-17 | 集積回路パツケ−ジ |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS62216240A (ja) |
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH01106436A (ja) * | 1987-10-19 | 1989-04-24 | Shinko Electric Ind Co Ltd | 半導体装置 |
JPH02128438A (ja) * | 1988-11-08 | 1990-05-16 | Mitsubishi Electric Corp | 半導体集積回路 |
JPH05167000A (ja) * | 1991-12-18 | 1993-07-02 | Kawasaki Steel Corp | 半導体装置用パッケージのリード配線 |
EP0517247A3 (ja) * | 1991-06-06 | 1994-02-16 | Toshiba Kk | |
WO1994025979A1 (en) * | 1993-04-30 | 1994-11-10 | Lsi Logic Corporation | Integrated circuit with lead frame package having internal power and ground busses |
-
1986
- 1986-03-17 JP JP61059983A patent/JPS62216240A/ja active Pending
Cited By (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH01106436A (ja) * | 1987-10-19 | 1989-04-24 | Shinko Electric Ind Co Ltd | 半導体装置 |
JPH02128438A (ja) * | 1988-11-08 | 1990-05-16 | Mitsubishi Electric Corp | 半導体集積回路 |
EP0517247A3 (ja) * | 1991-06-06 | 1994-02-16 | Toshiba Kk | |
JPH05167000A (ja) * | 1991-12-18 | 1993-07-02 | Kawasaki Steel Corp | 半導体装置用パッケージのリード配線 |
WO1994025979A1 (en) * | 1993-04-30 | 1994-11-10 | Lsi Logic Corporation | Integrated circuit with lead frame package having internal power and ground busses |
US6114749A (en) * | 1993-04-30 | 2000-09-05 | Lsi Loigc Corporation | Integrated circuit with lead frame package having internal power and ground busses |
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