JPS62179156A - 薄膜トランジスタの構造 - Google Patents
薄膜トランジスタの構造Info
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- JPS62179156A JPS62179156A JP61019361A JP1936186A JPS62179156A JP S62179156 A JPS62179156 A JP S62179156A JP 61019361 A JP61019361 A JP 61019361A JP 1936186 A JP1936186 A JP 1936186A JP S62179156 A JPS62179156 A JP S62179156A
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Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/76—Unipolar devices, e.g. field effect transistors
- H01L29/772—Field effect transistors
- H01L29/78—Field effect transistors with field effect produced by an insulated gate
- H01L29/786—Thin film transistors, i.e. transistors with a channel being at least partly a thin film
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔概要〕
本発明は、アクティブマトリックス形液晶表示装置のア
クティブ素子に用いるアモルファス7リコン薄膜トラン
ジスタに光が照射されたときにオフ電流が増加したりソ
ース電位がドレイン電極の影響を受けるのを解決するこ
とな目的としたもので、遮光膜材料として高抵抗のカル
コゲナイド系化合物を用いるようにして目的の達成を図
っているO 〔産業上の利用分野〕 本発明は、アモルファスシリコン薄膜トランジスタ(a
−8ITFT)の構造Vcr!Aするものである0a−
8iTFTはアクティブマトリックス形液晶表示装置の
マクティブ素子として使用される力t、この場合、該a
−8LTPTの表面には、光照射時におけるオフ電流の
増加等を避けるために遮光膜か設けられている。
クティブ素子に用いるアモルファス7リコン薄膜トラン
ジスタに光が照射されたときにオフ電流が増加したりソ
ース電位がドレイン電極の影響を受けるのを解決するこ
とな目的としたもので、遮光膜材料として高抵抗のカル
コゲナイド系化合物を用いるようにして目的の達成を図
っているO 〔産業上の利用分野〕 本発明は、アモルファスシリコン薄膜トランジスタ(a
−8ITFT)の構造Vcr!Aするものである0a−
8iTFTはアクティブマトリックス形液晶表示装置の
マクティブ素子として使用される力t、この場合、該a
−8LTPTの表面には、光照射時におけるオフ電流の
増加等を避けるために遮光膜か設けられている。
この穂の従来のa−8iTFTの構造を第2図に示す〇
第2図のa−3iTFT1 は、em性基板2上に、ゲ
ート′N、他3と、ゲート絶縁膜4と、動作半導体層と
してのアモルファスシリコy g (a −8i [)
5と、ソース電極6及びドレイン電極7と、保護膜8と
を形成してなり、保護膜80表面には、金属膜(遮光膜
)9が設けられている。
ート′N、他3と、ゲート絶縁膜4と、動作半導体層と
してのアモルファスシリコy g (a −8i [)
5と、ソース電極6及びドレイン電極7と、保護膜8と
を形成してなり、保護膜80表面には、金属膜(遮光膜
)9が設けられている。
ところが、第2図のa−5iTFTの場合は、遮光膜が
金属であるため、交流駆動させるとソース・ドレイン電
極間に遮光膜を介して容量結合(Cカップル)が生じる
〇 〔問題点を解決するだめの手段〕 本発明は、上述の問題点を解決することのできる薄膜ト
ランジスタの構造を提供するもので、そのための手段と
して第1図に示すような高抵抗の遮yt、膜を採用して
いる。
金属であるため、交流駆動させるとソース・ドレイン電
極間に遮光膜を介して容量結合(Cカップル)が生じる
〇 〔問題点を解決するだめの手段〕 本発明は、上述の問題点を解決することのできる薄膜ト
ランジスタの構造を提供するもので、そのための手段と
して第1図に示すような高抵抗の遮yt、膜を採用して
いる。
Te添化セレン化砒素(Asl Sea )、 −X
(AidTemlXo、1≦X≦0.5は光吸収性を有
しているので、これは遮光膜としての役割りを果たす。
(AidTemlXo、1≦X≦0.5は光吸収性を有
しているので、これは遮光膜としての役割りを果たす。
また、これは高抵抗であるので、従来問題となっていた
遮光膜を介してのソースードレイン電極間のCカヅプル
をなくすことができる。
遮光膜を介してのソースードレイン電極間のCカヅプル
をなくすことができる。
以下、第1図に関連して本発明の詳細な説明する。
第1図は、本発明忙係る薄膜トランジスタの構造を示す
#r面図で、a−8iTFT21は、絶縁性基板22上
にゲート電極23と、ゲート絶縁膜24と、動作半導体
層としてのa−5ilif+!25と、ソース電極26
及びドレイン電極27とを形成してなり、その表面には
、保W1膜28.遮光膜29が設けられている。
#r面図で、a−8iTFT21は、絶縁性基板22上
にゲート電極23と、ゲート絶縁膜24と、動作半導体
層としてのa−5ilif+!25と、ソース電極26
及びドレイン電極27とを形成してなり、その表面には
、保W1膜28.遮光膜29が設けられている。
遮光膜29の形成は3セレン化砒素とセレン化Teの2
つのソースから同時蒸着法によりて保護膜28上に蒸着
形成される。
つのソースから同時蒸着法によりて保護膜28上に蒸着
形成される。
遮光膜29は、チャネル層を覆っているため、TF’l
−遮光する口また、遮光膜29は高抵抗であるため、遮
光膜を介してのソースeドレイン電極間のCfj−vプ
ルを低減できる。従って、光照射時においてもTPTの
オフ電流の増加が避けられ、かつソース電位がドレイ/
電極の影響を受けないので、アクティブマトリックス液
晶表示パネルの階調表示が可能になる。
−遮光する口また、遮光膜29は高抵抗であるため、遮
光膜を介してのソースeドレイン電極間のCfj−vプ
ルを低減できる。従って、光照射時においてもTPTの
オフ電流の増加が避けられ、かつソース電位がドレイ/
電極の影響を受けないので、アクティブマトリックス液
晶表示パネルの階調表示が可能になる。
なお遮光膜29の形成において(As!5es)と(A
sTe、)の成分比を最蒼哨、かつ膜厚な1μm程度と
することにより抵抗値がlXl0−’(Ω・ca)−”
以上で、光学ギヤーt 7が1,4eV以下の条件を膚
たす遮光膜が祷られる。
sTe、)の成分比を最蒼哨、かつ膜厚な1μm程度と
することにより抵抗値がlXl0−’(Ω・ca)−”
以上で、光学ギヤーt 7が1,4eV以下の条件を膚
たす遮光膜が祷られる。
以上述べたように、木兄明忙よれば、容ff1N!合の
ない[相]光膜を構成することができるので、交流ノイ
ズのないTPTを得ることかでき、品質の良い液晶表示
が実現され乙。
ない[相]光膜を構成することができるので、交流ノイ
ズのないTPTを得ることかでき、品質の良い液晶表示
が実現され乙。
第1図は、本発明の実施例の4膜トランジスタの構造を
示す断面図、 第2図は、従来の薄膜トランジスタの構造を示す断面図
、 21はa−8iTFT(アモルファスシリコン薄膜トラ
ンジスタ)、 22は絶縁性基板、 23はゲート電極、 24はゲート絶縁膜、 25は動作半導体層としてのa−8i膜(アモルファス
シリコンIII)、 26はソースIE極、 27はドレイ/電極、 28は保瞳膜、 29は遮光膜である。
示す断面図、 第2図は、従来の薄膜トランジスタの構造を示す断面図
、 21はa−8iTFT(アモルファスシリコン薄膜トラ
ンジスタ)、 22は絶縁性基板、 23はゲート電極、 24はゲート絶縁膜、 25は動作半導体層としてのa−8i膜(アモルファス
シリコンIII)、 26はソースIE極、 27はドレイ/電極、 28は保瞳膜、 29は遮光膜である。
Claims (2)
- (1)絶縁性基板上に、ゲート電極、ゲート絶縁膜、動
作半導体層としてのマモルファスシリコン膜、ソース及
びドレイン電極を形成してより、表面に保護膜及び遮光
膜が形成されたアモルファスシリコン薄膜トランジスタ
において、前記遮光膜が、カルコゲナイド系化合物によ
って形成されたことを特徴とする薄膜トランジスタの構
造。 - (2)カルコゲナイド系化合物としてTe添化セレン化
砒素(As_2Se_3)_1_−_X(As_2Te
_3)_Xただし0.1≦X≦0.5を用い、これを遮
光膜とした特許請求の範囲第1項記載の薄膜トランジス
タの構造。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61019361A JPS62179156A (ja) | 1986-01-31 | 1986-01-31 | 薄膜トランジスタの構造 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61019361A JPS62179156A (ja) | 1986-01-31 | 1986-01-31 | 薄膜トランジスタの構造 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS62179156A true JPS62179156A (ja) | 1987-08-06 |
Family
ID=11997228
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP61019361A Pending JPS62179156A (ja) | 1986-01-31 | 1986-01-31 | 薄膜トランジスタの構造 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS62179156A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0943632A (ja) * | 1995-05-19 | 1997-02-14 | Nec Corp | 薄膜トランジスタアレイ |
-
1986
- 1986-01-31 JP JP61019361A patent/JPS62179156A/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0943632A (ja) * | 1995-05-19 | 1997-02-14 | Nec Corp | 薄膜トランジスタアレイ |
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