JPS6210529U - - Google Patents
Info
- Publication number
- JPS6210529U JPS6210529U JP10270885U JP10270885U JPS6210529U JP S6210529 U JPS6210529 U JP S6210529U JP 10270885 U JP10270885 U JP 10270885U JP 10270885 U JP10270885 U JP 10270885U JP S6210529 U JPS6210529 U JP S6210529U
- Authority
- JP
- Japan
- Prior art keywords
- flip
- majority
- flops
- input
- circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000010586 diagram Methods 0.000 description 5
Landscapes
- Manipulation Of Pulses (AREA)
- Logic Circuits (AREA)
Description
第１図は本考案の多数決によるノイズ除去回路
の原理ブロツク図、第２図は本考案の一実施例の
ブロツク図、第３図は本考案の実施例の波形図、
第４図は従来例のブロツク図、第５図は従来例の
従形図である。 図において、１〜Ｎはフリツプフロツプ。
の原理ブロツク図、第２図は本考案の一実施例の
ブロツク図、第３図は本考案の実施例の波形図、
第４図は従来例のブロツク図、第５図は従来例の
従形図である。 図において、１〜Ｎはフリツプフロツプ。
Claims (1)
- 【実用新案登録請求の範囲】 クロツク（ＣＬＫ）によつて制御される少なく
とも３個の奇数個フリツプフロツプ１〜Ｎが直列
に接続され、 該フリツプフロツプ１〜Ｎのそれぞれの出力信
号が、入力信号の多数決によつて決まる信号を出
力する多数決回路５の入力に接続された回路構成
からなり、 前記直列に接続されたフリツプフロツプ１〜Ｎ
の第１フリツプフロツプ１の入力端子１１に信号
を入力し、 前記多数決回路５の出力端子５０から出力を得
ることを特徴とする多数決論理によるノイズ除去
回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10270885U JPS6210529U (ja) | 1985-07-04 | 1985-07-04 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10270885U JPS6210529U (ja) | 1985-07-04 | 1985-07-04 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6210529U true JPS6210529U (ja) | 1987-01-22 |
Family
ID=30974594
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10270885U Pending JPS6210529U (ja) | 1985-07-04 | 1985-07-04 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6210529U (ja) |
-
1985
- 1985-07-04 JP JP10270885U patent/JPS6210529U/ja active Pending
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