JPH0439740U - - Google Patents
Info
- Publication number
- JPH0439740U JPH0439740U JP8210190U JP8210190U JPH0439740U JP H0439740 U JPH0439740 U JP H0439740U JP 8210190 U JP8210190 U JP 8210190U JP 8210190 U JP8210190 U JP 8210190U JP H0439740 U JPH0439740 U JP H0439740U
- Authority
- JP
- Japan
- Prior art keywords
- flip
- gate
- output
- clock signal
- input
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000010586 diagram Methods 0.000 description 4
Landscapes
- Pulse Circuits (AREA)
- Manipulation Of Pulses (AREA)
Description
第１図は本考案の一実施例を示すブロツク図で
、第２図は各部の波形を示す図、第３図は従来例
を示す図、第４図は従来のタイミング遅延を示す
波形図である。 １……クロツク信号、２……第１のＤフリツプ
フロツプ回路、３……第２のＤフリツプフロツプ
回路、４……ＮＯＲゲート、５……ＸＯＲゲート
である。
、第２図は各部の波形を示す図、第３図は従来例
を示す図、第４図は従来のタイミング遅延を示す
波形図である。 １……クロツク信号、２……第１のＤフリツプ
フロツプ回路、３……第２のＤフリツプフロツプ
回路、４……ＮＯＲゲート、５……ＸＯＲゲート
である。
Claims (1)
- クロツク信号が入力される第１及び第２のＤフ
リツプフロツプ回路と、上記第１のＤフリツプフ
ロツプ回路のとＤ端子とが接続されそのＱ端子
出力と上記クロツク信号とが入力されるＮＯＲゲ
ートと、該ＮＯＲゲートの出力と第２のＤフリツ
プフロツプ回路のＱ端子出力とが入力されるＸＯ
Ｒゲートとを具備し、該ＸＯＲゲートの出力を第
２のＤフリツプフロツプ回路のＤ端子に入力し上
記クロツク信号に対し遅延の少ない２組の分周信
号を得ることを特徴とするクロツク分周回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8210190U JPH0439740U (ja) | 1990-07-31 | 1990-07-31 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8210190U JPH0439740U (ja) | 1990-07-31 | 1990-07-31 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0439740U true JPH0439740U (ja) | 1992-04-03 |
Family
ID=31628619
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8210190U Pending JPH0439740U (ja) | 1990-07-31 | 1990-07-31 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0439740U (ja) |
-
1990
- 1990-07-31 JP JP8210190U patent/JPH0439740U/ja active Pending
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| JPH0439740U (ja) | ||
| JPH0163225U (ja) | ||
| JPS611926U (ja) | パルスデユ−テイ整形回路 | |
| JPS61128841U (ja) | ||
| JPS62203521U (ja) | ||
| JPH0163224U (ja) | ||
| JPH02147932U (ja) | ||
| JPS643329U (ja) | ||
| JPS62178676U (ja) | ||
| JPH0223124U (ja) | ||
| JPS6335154U (ja) | ||
| JPS5994438U (ja) | ノイズ除去回路 | |
| JPH0163213U (ja) | ||
| JPS58114598U (ja) | Ｃｃｄ入出力回路 | |
| JPS6114534U (ja) | タイマ回路 | |
| JPH0357630U (ja) | ||
| JPS59143149U (ja) | 積分判定回路 | |
| JPS5864137U (ja) | 周波数電圧変換回路 | |
| JPS61116436U (ja) | ||
| JPS6181221U (ja) | ||
| JPS59187225U (ja) | デイレイ調整回路 | |
| JPS61112459U (ja) | ||
| JPH02148474U (ja) | ||
| JPS62159027U (ja) | ||
| JPS6085474U (ja) | 垂直パルス分離回路 |