JPS62159027U - - Google Patents

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JPS62159027U
JPS62159027U JP4730786U JP4730786U JPS62159027U JP S62159027 U JPS62159027 U JP S62159027U JP 4730786 U JP4730786 U JP 4730786U JP 4730786 U JP4730786 U JP 4730786U JP S62159027 U JPS62159027 U JP S62159027U
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JP
Japan
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terminal
input
stage
type flip
flop circuit
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Pending
Application number
JP4730786U
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Publication date
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Description

【図面の簡単な説明】
第１図はこの考案の一実施例であるカウンタの
入力回路を示すブロツク図、第２図は、この考案
の一実施例及び従来例におけるカウンタの入力回
路の動作を説明するための各部のタイミングチヤ
ート、第３図は従来のカウンタの入力回路を示す
ブロツク図である。 図において、１１…ゲート制御信号の入力する
端子、１２…ゲート、１３…入力パルスの入力す
る端子、１４…カウンタ、１６，２６…Ｄ型フリ
ツプフロツプ回路、１７…遅延回路、２１…イン
バータである。なお、各図中、同一符号は同一、
又は相当部分を示す。

Claims (1)

    【実用新案登録請求の範囲】
  1. １段目のＤ型フリツプフロツプ回路で、その入
    力端子へゲート制御信号を与え、そのクロツク端
    子へ入力パルスを与え、その出力端子は２段目の
    Ｄ型フリツプフロツプ回路の入力端子へ接続され
    、この２段目のＤ型フリツプフロツプ回路で、そ
    のクロツク端子へ前記入力パルスより高速なクロ
    ツクを与え、その出力端子はカウンタへ接続され
    ると共に、その反転出力端子は前記１段目のＤ型
    フリツプフロツプ回路のリセツト端子へ接続され
    て成ることを特徴とするカウンタの入力回路。
JP4730786U 1986-03-31 1986-03-31 Pending JPS62159027U (ja)

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JP4730786U JPS62159027U (ja) 1986-03-31 1986-03-31

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JP4730786U JPS62159027U (ja) 1986-03-31 1986-03-31

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Publication Number Publication Date
JPS62159027U true JPS62159027U (ja) 1987-10-08

Family

ID=30867788

Family Applications (1)

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JP4730786U Pending JPS62159027U (ja) 1986-03-31 1986-03-31

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