JPS6170155A - 車載マイクロコンピユ−タのメモリバツクアツプ装置 - Google Patents
車載マイクロコンピユ−タのメモリバツクアツプ装置Info
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- JPS6170155A JPS6170155A JP18948784A JP18948784A JPS6170155A JP S6170155 A JPS6170155 A JP S6170155A JP 18948784 A JP18948784 A JP 18948784A JP 18948784 A JP18948784 A JP 18948784A JP S6170155 A JPS6170155 A JP S6170155A
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- Japan
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- voltage
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- F—MECHANICAL ENGINEERING; LIGHTING; HEATING; WEAPONS; BLASTING
- F02—COMBUSTION ENGINES; HOT-GAS OR COMBUSTION-PRODUCT ENGINE PLANTS
- F02D—CONTROLLING COMBUSTION ENGINES
- F02D41/00—Electrical control of supply of combustible mixture or its constituents
- F02D41/24—Electrical control of supply of combustible mixture or its constituents characterised by the use of digital means
- F02D41/2406—Electrical control of supply of combustible mixture or its constituents characterised by the use of digital means using essentially read only memories
- F02D41/2425—Particular ways of programming the data
-
- F—MECHANICAL ENGINEERING; LIGHTING; HEATING; WEAPONS; BLASTING
- F02—COMBUSTION ENGINES; HOT-GAS OR COMBUSTION-PRODUCT ENGINE PLANTS
- F02D—CONTROLLING COMBUSTION ENGINES
- F02D41/00—Electrical control of supply of combustible mixture or its constituents
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- F02D41/266—Electrical control of supply of combustible mixture or its constituents characterised by the use of digital means using computer, e.g. microprocessor the computer being backed-up or assisted by another circuit, e.g. analogue
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〈産業上の利用分野〉
本発明は車載マイクロコンピュータのメモリバックアッ
プ装置に関する。
プ装置に関する。
〈従来の技術〉
たとえば車両に搭載された内燃機関を集中制御する車載
マイクロコンピュータは、その作動開始時に前回作動時
のデータを必要とするものである。
マイクロコンピュータは、その作動開始時に前回作動時
のデータを必要とするものである。
このため、この種の車載マイクロコンピュータは、キー
スイッチオフ後も、バッテリから、バックアップ電源回
路を介してＲＡＭに給電することにより、次回の作動時
までＲＡＭ内のデータを保持させるメモリバックアップ
装置を有している（例えば特願昭５８−７３０６２号等
）。
スイッチオフ後も、バッテリから、バックアップ電源回
路を介してＲＡＭに給電することにより、次回の作動時
までＲＡＭ内のデータを保持させるメモリバックアップ
装置を有している（例えば特願昭５８−７３０６２号等
）。
従来のメモリバックアップ装置の一例を第３図に示す。
図において、バッテリ１の電圧はキースイッチ２を介し
てメイン安定化電源である定電圧レギュレータ３に入力
され、その出力電圧Ｖ、（例えば５Ｖ）は、メイン通電
回路Ａを介して図示しないＲＯＭ、ＭＰＵに供給される
と共に、トランジスタ１１．１２及び抵抗１３〜１６か
らなるスイッチング回路１０を介してＲＡＭ４に供給さ
れる。また、バッテリ電圧はキースイッチ２を介さず直
接にダイオード２１．コンデンサ２２．ツェナダイオー
ド２３からなるバックアップ電源回路２０に入力され、
その出力電圧■２ （例えば５Ｖ）はバックアップ通電
回路Ｂを通って前記ＲＡＭ４に供給される。更に、バッ
テリ電圧はキースイッチ２を介してトランジスタ３１．
ダイオード３２．３３および抵抗３４．３５等で構成さ
れＲＡＭ４とＭＰＵの断接を制御するスタンバイ信号を
形成するスタンバイ信号形成回路３０に入力されている
。
てメイン安定化電源である定電圧レギュレータ３に入力
され、その出力電圧Ｖ、（例えば５Ｖ）は、メイン通電
回路Ａを介して図示しないＲＯＭ、ＭＰＵに供給される
と共に、トランジスタ１１．１２及び抵抗１３〜１６か
らなるスイッチング回路１０を介してＲＡＭ４に供給さ
れる。また、バッテリ電圧はキースイッチ２を介さず直
接にダイオード２１．コンデンサ２２．ツェナダイオー
ド２３からなるバックアップ電源回路２０に入力され、
その出力電圧■２ （例えば５Ｖ）はバックアップ通電
回路Ｂを通って前記ＲＡＭ４に供給される。更に、バッ
テリ電圧はキースイッチ２を介してトランジスタ３１．
ダイオード３２．３３および抵抗３４．３５等で構成さ
れＲＡＭ４とＭＰＵの断接を制御するスタンバイ信号を
形成するスタンバイ信号形成回路３０に入力されている
。
次にかかる従来装置の作用を説明する。
キースイッチ２をＯＮ操作すると、定電圧レギュレータ
３の出力電圧■、が立ち上がりＲＯＭ。
３の出力電圧■、が立ち上がりＲＯＭ。
ＭＰＵへ供給される。また、前記■１の立ち上がりに伴
ってスイッチング回路１０のトランジスタ１１がＯＮし
、トランジスタ１２がＯＮしてメイン通電回路Ａが閉成
され、ＲＡＭ４に供給される電圧がバックアップ電源回
路２０の出力電圧■２から定電圧レギュレータ３の出力
電圧Ｖ１に切り換えられる。
ってスイッチング回路１０のトランジスタ１１がＯＮし
、トランジスタ１２がＯＮしてメイン通電回路Ａが閉成
され、ＲＡＭ４に供給される電圧がバックアップ電源回
路２０の出力電圧■２から定電圧レギュレータ３の出力
電圧Ｖ１に切り換えられる。
また、キースイッチ２のＯＮ操作に伴い、スタンバイ信
号形成回路３０にもバッテリ電圧が入力され、この入力
電圧Ｕ′、とバックアップ電源回路２０の出力電圧■２
との差が所定レベル以上になるとダイオード３２．抵抗
３４を介してベース電流が流れトランジスタ３１がＯＮ
し、トランジスタ３１と抵抗３５との接続点ａの電圧が
略入力電圧Ｕ’ｍと等しくなり、所定時間後に、２つの
ＮＡＮＤ回路５．６を介してスタンバイ信号が“Ｌ”レ
ベルから”Ｈ”レベルに切り換えられ、ＲＡＭ４とＭＰ
Ｕが接続される。そして、定電圧レギュレータ３からの
安定した出力電圧■１によってＭＰＵが作動しエンジン
運転等に要求される各種演算が行われる。
号形成回路３０にもバッテリ電圧が入力され、この入力
電圧Ｕ′、とバックアップ電源回路２０の出力電圧■２
との差が所定レベル以上になるとダイオード３２．抵抗
３４を介してベース電流が流れトランジスタ３１がＯＮ
し、トランジスタ３１と抵抗３５との接続点ａの電圧が
略入力電圧Ｕ’ｍと等しくなり、所定時間後に、２つの
ＮＡＮＤ回路５．６を介してスタンバイ信号が“Ｌ”レ
ベルから”Ｈ”レベルに切り換えられ、ＲＡＭ４とＭＰ
Ｕが接続される。そして、定電圧レギュレータ３からの
安定した出力電圧■１によってＭＰＵが作動しエンジン
運転等に要求される各種演算が行われる。
一方、キースイッチ２をＯＦＦにすると、スタンバイ信
号形成回路３０の入力電圧Ｕ′、が低下しトランジスタ
３１がＯＦＦとなり、接続点ａの電圧が低下することに
よりスタンバイ信号が“Ｈルベルから″Ｌ″レベルに切
り換わり、ＲＡＭ４とＭＰＵが切り離される。また、ス
イッチング回路１０のトランジスタ１２がＯＦＦになり
ＲＡＭ４からメイン通電回路Ａが切り離されるが、ＲＡ
Ｍ４へはバックアップ通電回路Ｂを介してバンクアップ
電源回路２０の出力電圧ｖ２が入力され、ＲＡＭｄ内に
記憶された次回作動時に必要なデータを保持するように
なっている。
号形成回路３０の入力電圧Ｕ′、が低下しトランジスタ
３１がＯＦＦとなり、接続点ａの電圧が低下することに
よりスタンバイ信号が“Ｈルベルから″Ｌ″レベルに切
り換わり、ＲＡＭ４とＭＰＵが切り離される。また、ス
イッチング回路１０のトランジスタ１２がＯＦＦになり
ＲＡＭ４からメイン通電回路Ａが切り離されるが、ＲＡ
Ｍ４へはバックアップ通電回路Ｂを介してバンクアップ
電源回路２０の出力電圧ｖ２が入力され、ＲＡＭｄ内に
記憶された次回作動時に必要なデータを保持するように
なっている。
〈発明が解決しようとする問題点〉
しかしながら、従来装置では、メイン通電回路ＡとＲＡ
Ｍ４とを断接するスイッチング回路１０の動作信号を、
定電圧レギュレータ３の出力から取り入れていたため、
定電圧レギュレータ３の出力電圧■、が安定しないうち
にスイッチング回路１０のトランジスタ１１がＯＮＬ、
てしまう。このため、キースイッチ２のＯＮ操作直後に
おいて、バックアップ通電回路Ｂを流れる電流が、スイ
ッチング回路１０の抵抗１５及びトランジスタＩＩを介
してアースに流れてしまい、ＲＡＭ４に供給するバック
アップ電源回路２０の出力電圧ｖ２の落ち込みが生じる
。この場合、バックアップ電源回路２０のコンデンサ２
２の経時変化及び温度特性等を考慮すると、ＲＡＭ４の
データ保持に必要な最小電圧である２■を割る恐れがあ
るという問題を有していた。
Ｍ４とを断接するスイッチング回路１０の動作信号を、
定電圧レギュレータ３の出力から取り入れていたため、
定電圧レギュレータ３の出力電圧■、が安定しないうち
にスイッチング回路１０のトランジスタ１１がＯＮＬ、
てしまう。このため、キースイッチ２のＯＮ操作直後に
おいて、バックアップ通電回路Ｂを流れる電流が、スイ
ッチング回路１０の抵抗１５及びトランジスタＩＩを介
してアースに流れてしまい、ＲＡＭ４に供給するバック
アップ電源回路２０の出力電圧ｖ２の落ち込みが生じる
。この場合、バックアップ電源回路２０のコンデンサ２
２の経時変化及び温度特性等を考慮すると、ＲＡＭ４の
データ保持に必要な最小電圧である２■を割る恐れがあ
るという問題を有していた。
本発明は上記の問題点に鑑みてなされたもので、メイン
安定化電源の出力が安定した後に、スイッチング回路が
動作を開始するようにし、以てキースイッチのＯＮ直後
におけるＲＡＭへの供給電圧の落ち込み現象を防止する
ことを目的とする。
安定化電源の出力が安定した後に、スイッチング回路が
動作を開始するようにし、以てキースイッチのＯＮ直後
におけるＲＡＭへの供給電圧の落ち込み現象を防止する
ことを目的とする。
く問題点を解決するための手段〉
このため本発明では、トランジスタを用いたスイッチン
グ回路によってメイン安定化電源とＲＡＭとを断接する
ようにしてバックアップ電源とメイン安定化電源との切
り換えを行う構成のメモリバックアップ装置において、
スイッチング回路の動作信号を、メイン安定化電源と並
列でかつキースイッチを介してバッテリと接続されるス
タンバイ信号形成回路を介して取り出す構成とすると共
に、スイッチング回路への動作信号の入力を遅延させる
遅延回路を設けるようにした。
グ回路によってメイン安定化電源とＲＡＭとを断接する
ようにしてバックアップ電源とメイン安定化電源との切
り換えを行う構成のメモリバックアップ装置において、
スイッチング回路の動作信号を、メイン安定化電源と並
列でかつキースイッチを介してバッテリと接続されるス
タンバイ信号形成回路を介して取り出す構成とすると共
に、スイッチング回路への動作信号の入力を遅延させる
遅延回路を設けるようにした。
く作用）
これにより、メイン安定化電源の安定時の出力電圧以上
の電圧で作動するスタンバイ信号形成回路が作動してか
ら所定時間遅延されてスイッチング回路へ動作信号が入
力することになり、スイッチング回路の作動開始が、確
実にメイン安定化電源の出力が安定した後に行われるよ
うになる。
の電圧で作動するスタンバイ信号形成回路が作動してか
ら所定時間遅延されてスイッチング回路へ動作信号が入
力することになり、スイッチング回路の作動開始が、確
実にメイン安定化電源の出力が安定した後に行われるよ
うになる。
〈実施例〉
以下本発明の一実施例を第１図及び第２図に基づいて説
明する。尚、第３図に示す従来例と同一構成部分には同
一符号を付して詳細な説明を省略する。
明する。尚、第３図に示す従来例と同一構成部分には同
一符号を付して詳細な説明を省略する。
第１図において、定電圧レギュレータ３．バックアップ
電源回路２０．スタンバイ信号形成回路３０は従来同様
に構成され接続されている。
電源回路２０．スタンバイ信号形成回路３０は従来同様
に構成され接続されている。
一方、スイッチング回路１０゛ は、その動作信号をス
タンバイ信号形成回路３０を介して取り入れるよう構成
されている。即ち、トランジスタ１１のベースを、抵抗
４１及びコンデンサ４２で構成された遅延回路４０を介
してスタンバイ信号形成回路３０のトランジスタ３１の
コレクタと抵抗３５との間に接続しである。
タンバイ信号形成回路３０を介して取り入れるよう構成
されている。即ち、トランジスタ１１のベースを、抵抗
４１及びコンデンサ４２で構成された遅延回路４０を介
してスタンバイ信号形成回路３０のトランジスタ３１の
コレクタと抵抗３５との間に接続しである。
次に作用を第２図のタイムチャートを参照しながら説明
する。
する。
キースイッチ２をＯＮ操作すると、定電圧レギュレータ
３への供給電圧Ｕ′８と共にその出力電圧Ｖ、が立ち上
がり、出力電圧■、は所定値（例えば５Ｖ）に達すると
一定に保たれるが前記Ｕ′ｇ即ちスタンバイ信号形成回
路３０の入力電圧は、さらに増大して定常時のバッテリ
電圧に達する。
３への供給電圧Ｕ′８と共にその出力電圧Ｖ、が立ち上
がり、出力電圧■、は所定値（例えば５Ｖ）に達すると
一定に保たれるが前記Ｕ′ｇ即ちスタンバイ信号形成回
路３０の入力電圧は、さらに増大して定常時のバッテリ
電圧に達する。
そして、従来と同様にしてＵｏおがバンクアンプ電源回
路２０の出力電圧ＶＺ（例えば５Ｖ）よりも所定レベル
以上になると、トランジスタ３１がＯＮとなり、トラン
ジスタ３Ｉのコレクタと抵抗３５との間の電圧が上昇し
略Ｕ’ｍと等しくなる。かかる電圧の上昇によってスイ
ッチング回路１０’ の動作信号が遅延回路４１を介し
て所定時間遅延されてトランジスタ１１のベースに入力
する。これにより、トランジスタ１１がＯＮＬ、、さら
にトランジスタ１２がＯＮＬ、てメイン通電回路Ａを介
して定電圧レギュレータ３をＲＡＭ４に接続する。この
時点では、定電圧レギュレータ３の出力電圧■１は安定
しているため、従来のようなバックアップ通電回路Ｂか
らの電流の流れ込みを確実に防止できる。従っで、電圧
の落ち込み現象を生ずることなく、ＲＡＭ４への供給電
圧がバックアップ電源回路２０の出力電圧■２から定電
圧レギュレータ３の出力電圧■、へ安定した状態でスム
ーズに切り換えられる。
路２０の出力電圧ＶＺ（例えば５Ｖ）よりも所定レベル
以上になると、トランジスタ３１がＯＮとなり、トラン
ジスタ３Ｉのコレクタと抵抗３５との間の電圧が上昇し
略Ｕ’ｍと等しくなる。かかる電圧の上昇によってスイ
ッチング回路１０’ の動作信号が遅延回路４１を介し
て所定時間遅延されてトランジスタ１１のベースに入力
する。これにより、トランジスタ１１がＯＮＬ、、さら
にトランジスタ１２がＯＮＬ、てメイン通電回路Ａを介
して定電圧レギュレータ３をＲＡＭ４に接続する。この
時点では、定電圧レギュレータ３の出力電圧■１は安定
しているため、従来のようなバックアップ通電回路Ｂか
らの電流の流れ込みを確実に防止できる。従っで、電圧
の落ち込み現象を生ずることなく、ＲＡＭ４への供給電
圧がバックアップ電源回路２０の出力電圧■２から定電
圧レギュレータ３の出力電圧■、へ安定した状態でスム
ーズに切り換えられる。
また、スタンバイ信号形成回路３０のａ点が電圧上昇し
てから所定時間後に、２つのＮＡＮＤ回路５．６を介し
てスタンイ信号が“Ｌ”レベルから“Ｈルベルに切り換
わりＭＰＵとＲＡＭ４が接続され演算動作が開始される
。
てから所定時間後に、２つのＮＡＮＤ回路５．６を介し
てスタンイ信号が“Ｌ”レベルから“Ｈルベルに切り換
わりＭＰＵとＲＡＭ４が接続され演算動作が開始される
。
一方、キースイッチ２をＯＮからＯＦＦにすると、Ｕｏ
、が低下し、スタンバイ信号形成回路３０のトランジス
タ３１がＯＦＦになった時点から所定時間遅れてスイッ
チング回路１０゛ のトランジスター１がＯＦＦとなり
、トランジスター２が０ＦＦｊ、てメイン通電回路Ａを
ＲＡＭ４から切り離す。そして、ＲＡＭ４へはバックア
ップ電源回路２０の出力電圧■２がバックアップ通電回
路Ｂを介して供給される。このときには、定電圧レギュ
レータ３の出力電圧■１はまだ安定状態にあるので、前
記切り換えはスムーズに行われる。従って、ＲＡＭＡ内
の次回作動時に必要なデータは確実に保持される。
、が低下し、スタンバイ信号形成回路３０のトランジス
タ３１がＯＦＦになった時点から所定時間遅れてスイッ
チング回路１０゛ のトランジスター１がＯＦＦとなり
、トランジスター２が０ＦＦｊ、てメイン通電回路Ａを
ＲＡＭ４から切り離す。そして、ＲＡＭ４へはバックア
ップ電源回路２０の出力電圧■２がバックアップ通電回
路Ｂを介して供給される。このときには、定電圧レギュ
レータ３の出力電圧■１はまだ安定状態にあるので、前
記切り換えはスムーズに行われる。従って、ＲＡＭＡ内
の次回作動時に必要なデータは確実に保持される。
尚、スタンバイ信号も、トランジスタ３１のＯＦＦ後所
定時間後に“Ｈ″レベルら“Ｌ”レベルに切り換わりＭ
ＰＵとＲＡＭ４とを切り離すことは従来同様である。
定時間後に“Ｈ″レベルら“Ｌ”レベルに切り換わりＭ
ＰＵとＲＡＭ４とを切り離すことは従来同様である。
〈発明の効果）
以上述べたように本発明によれば、スイッチング回路の
動作信号をメイン安定化電源の出力からではなく、メイ
ン安定化電源への供給電圧から取り入れかつ遅延回路で
遅らせて入力するようにしたので、メイン安定化電源の
出力電圧が安定した後に、スイッチング回路の動作が開
始してメイン安定化電源をＲＡＭに接続するため、ＲＡ
Ｍへの供給電圧の落ち込み現象を防止できる。従って、
ＲＡＭの記憶保持を確実なものにできる。
動作信号をメイン安定化電源の出力からではなく、メイ
ン安定化電源への供給電圧から取り入れかつ遅延回路で
遅らせて入力するようにしたので、メイン安定化電源の
出力電圧が安定した後に、スイッチング回路の動作が開
始してメイン安定化電源をＲＡＭに接続するため、ＲＡ
Ｍへの供給電圧の落ち込み現象を防止できる。従って、
ＲＡＭの記憶保持を確実なものにできる。
第１図は本発明の一実施例の回路構成図、第２図は同上
実施例のタイムチャート、第３図は従来例の回路構成図
である。
実施例のタイムチャート、第３図は従来例の回路構成図
である。
Claims (1)
- バッテリにキースイッチを介して接続されるメイン安定
化電源を介装したメイン通電回路と、バッテリに直接接
続されるバックアップ電源を介装したバックアップ通電
回路と、キースイッチのＯＮ動作によってメイン通電回
路を閉成しメイン安定化電源をＲＡＭに接続するスイッ
チング回路と、メイン安定化電源と並列かつキースイッ
チを介してバッテリと接続され前記ＲＡＭとメイン安定
化電源によって作動するＭＰＵとの断接を制御するスタ
ンバイ信号を形成する回路とを備えた車載マイクロコン
ピュータのメモリバックアップ装置において、前記スイ
ッチング回路の動作信号を、前記スタンバイ信号形成回
路を介して取り出す構成とすると共に、前記動作信号を
遅延させる遅延回路を設けたことを特徴とする車載マイ
クロコンピュータのメモリバックアップ装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18948784A JPS6170155A (ja) | 1984-09-12 | 1984-09-12 | 車載マイクロコンピユ−タのメモリバツクアツプ装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18948784A JPS6170155A (ja) | 1984-09-12 | 1984-09-12 | 車載マイクロコンピユ−タのメモリバツクアツプ装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6170155A true JPS6170155A (ja) | 1986-04-10 |
| JPH0328584B2 JPH0328584B2 (ja) | 1991-04-19 |
Family
ID=16242082
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18948784A Granted JPS6170155A (ja) | 1984-09-12 | 1984-09-12 | 車載マイクロコンピユ−タのメモリバツクアツプ装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6170155A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH055607U (ja) * | 1991-07-04 | 1993-01-26 | 本田技研工業株式会社 | Ｒａｍデ―タ保障装置 |
-
1984
- 1984-09-12 JP JP18948784A patent/JPS6170155A/ja active Granted
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH055607U (ja) * | 1991-07-04 | 1993-01-26 | 本田技研工業株式会社 | Ｒａｍデ―タ保障装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0328584B2 (ja) | 1991-04-19 |
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