JPS6160042A - ノ−ドの配列順序識別方式 - Google Patents
ノ−ドの配列順序識別方式Info
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- JPS6160042A JPS6160042A JP59181980A JP18198084A JPS6160042A JP S6160042 A JPS6160042 A JP S6160042A JP 59181980 A JP59181980 A JP 59181980A JP 18198084 A JP18198084 A JP 18198084A JP S6160042 A JPS6160042 A JP S6160042A
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- Japan
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- nodes
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はループ形通信網におけるノードの配列順序識別
方式に関す。
方式に関す。
１以上の端末装置を収容する通信制御装置（以後ノード
と称す）と、前記端末装置間の通信を制御する制御装置
とを一方向に通信可能な伝送路によりループ状に接続す
るループ形通信編が広く採用されている。前記伝送路は
、互いに通信方向の相反する二組を設けることにより、
当該ループ形通信綱の信頼性の向上が図られている。例
えばループ形通信網の一部の伝送路が障害等の為に通信
不能となった場合、前記制御装置は罹“障伝送路により
接続される両ノードに指令を送って前記二組の伝送路を
折返し接続させてループ形通信網を形成しく所謂ループ
バンクモード）、当該ループ形通信網内の通信を維持す
る。制御装置が障害個所の判定、並びにループバックモ
ードの設定を確実に実行する為には、当該ループ形通信
網における各ノードの配列順序を正確に把握している必
要がある。
と称す）と、前記端末装置間の通信を制御する制御装置
とを一方向に通信可能な伝送路によりループ状に接続す
るループ形通信編が広く採用されている。前記伝送路は
、互いに通信方向の相反する二組を設けることにより、
当該ループ形通信綱の信頼性の向上が図られている。例
えばループ形通信網の一部の伝送路が障害等の為に通信
不能となった場合、前記制御装置は罹“障伝送路により
接続される両ノードに指令を送って前記二組の伝送路を
折返し接続させてループ形通信網を形成しく所謂ループ
バンクモード）、当該ループ形通信網内の通信を維持す
る。制御装置が障害個所の判定、並びにループバックモ
ードの設定を確実に実行する為には、当該ループ形通信
網における各ノードの配列順序を正確に把握している必
要がある。
この種ループ形通信綱における従来あるノードの配列順
序識別方式においては、管理者が各ノードの配列順序を
確認し、該配列順序を制御装置内の管理テーブル４こ記
憶させ、制御装置は該管理テーブルを参照することによ
り、当該ループ形通信網の制？ＴＩｌを行っていた。然
しかかるノードの配列順序識別方式においては、ノード
の配列順序を誤って設置した場合、或いはノードが追加
されたにも拘わらず、制御装置の管理テーブルが更新さ
れなかった場合には、制御装置は的確な制御が不可能と
なる欠点があった。
序識別方式においては、管理者が各ノードの配列順序を
確認し、該配列順序を制御装置内の管理テーブル４こ記
憶させ、制御装置は該管理テーブルを参照することによ
り、当該ループ形通信網の制？ＴＩｌを行っていた。然
しかかるノードの配列順序識別方式においては、ノード
の配列順序を誤って設置した場合、或いはノードが追加
されたにも拘わらず、制御装置の管理テーブルが更新さ
れなかった場合には、制御装置は的確な制御が不可能と
なる欠点があった。
第３図はかかる欠点を除去した従来あるノードの配列順
序識別方式の一例を示す図である。
序識別方式の一例を示す図である。
第３図においては、制御装置１と３ｍのノード２−１乃
至２−３が伝送路３−１乃至３−４により接続されてい
る。なお伝送路３の通信方向は時計方向とする。
至２−３が伝送路３−１乃至３−４により接続されてい
る。なお伝送路３の通信方向は時計方向とする。
かかる状態で、制御装置１は伝送路３−１に、Ｌ／−）
’２−１乃至２−３宛のコマンドフレームＣ５乃至Ｃコ
を順次送出する。コマンドフレーム＋ Ｃ
３は、伝送路３−１を経由してノード２−３に伝達され
、コマンドフレームＣ１は伝送路３−１、ノード２−３
および伝送路３−２を経由してノード２−１に伝達され
、コマンドフレームＣ２は伝送路３−１、ノード２−３
、伝送路３−２、ノード２−１および伝送路３−３を経
由してノード２−２に伝達される。各ノード２−１乃至
２−３はそれぞれ自ノード宛のコマンドフレームＣ１乃
至Ｃ１を受信し、それぞれ対応するレスポンスフレーム
Ｒ１乃至Ｒ１を送出する。レスポンスフレームＲ１は伝
送路３−２、ノート２−１′、伝送路３−３、ノード２
−２および伝送路３−４を経由して制御装置１に伝達さ
れ、レスポンスフレームＲ４は伝送路３−３、ノード２
−２および伝送路３−４を経由して制御装置１に伝達さ
れ、レスポンスフレームＲ，は伝送路３−４を経由して
制御装置１に伝達される。ノード２−１は、レスポンス
フレームＲ３を転送する際にレスポンスフレームＲ１に
付与されている送信元ノード２−３のアドレスａ、を複
写して記憶し、またノード２−２は、レスポンスフレー
ムＲ１およびＲ３に付与されている送信元ノード２−１
および２−３のアドレスａ、およびａ、を複写して記憶
する。かかる状態で、制御装置１は各ノード２−１乃至
２−３に各々記憶中のアドレスを返送する指令を送る。
’２−１乃至２−３宛のコマンドフレームＣ５乃至Ｃコ
を順次送出する。コマンドフレーム＋ Ｃ
３は、伝送路３−１を経由してノード２−３に伝達され
、コマンドフレームＣ１は伝送路３−１、ノード２−３
および伝送路３−２を経由してノード２−１に伝達され
、コマンドフレームＣ２は伝送路３−１、ノード２−３
、伝送路３−２、ノード２−１および伝送路３−３を経
由してノード２−２に伝達される。各ノード２−１乃至
２−３はそれぞれ自ノード宛のコマンドフレームＣ１乃
至Ｃ１を受信し、それぞれ対応するレスポンスフレーム
Ｒ１乃至Ｒ１を送出する。レスポンスフレームＲ１は伝
送路３−２、ノート２−１′、伝送路３−３、ノード２
−２および伝送路３−４を経由して制御装置１に伝達さ
れ、レスポンスフレームＲ４は伝送路３−３、ノード２
−２および伝送路３−４を経由して制御装置１に伝達さ
れ、レスポンスフレームＲ，は伝送路３−４を経由して
制御装置１に伝達される。ノード２−１は、レスポンス
フレームＲ３を転送する際にレスポンスフレームＲ１に
付与されている送信元ノード２−３のアドレスａ、を複
写して記憶し、またノード２−２は、レスポンスフレー
ムＲ１およびＲ３に付与されている送信元ノード２−１
および２−３のアドレスａ、およびａ、を複写して記憶
する。かかる状態で、制御装置１は各ノード２−１乃至
２−３に各々記憶中のアドレスを返送する指令を送る。
該指令を受信したノード２−１は記憶中のアドレスａ、
を制御装置ｌに返送し、ノード２−２は記憶中のアドレ
スａ、およびａ３を返送し、ノード２−３は記憶中のア
ドレスが無い為返送しない。制御装置ｌは、各ノード２
−１乃至２〜３から返送されるアドレスａ１乃至ａ、を
分析の結果、ノード２−３．２−１および２−２の順に
配列されていることを識別する。
を制御装置ｌに返送し、ノード２−２は記憶中のアドレ
スａ、およびａ３を返送し、ノード２−３は記憶中のア
ドレスが無い為返送しない。制御装置ｌは、各ノード２
−１乃至２〜３から返送されるアドレスａ１乃至ａ、を
分析の結果、ノード２−３．２−１および２−２の順に
配列されていることを識別する。
〔発明が解決しようとする問題点９
以上の説明°から明らかな如く、従来あるノードの配列
順序識別方式においては、制御装置１は各ノード２−１
乃至２−３にコマンドフレームＣ６乃至Ｃ３を伝達せね
ばならず、また各ノード２−１乃至２−３から返送され
たアドレスａ、乃至ａ、を分析した上で各ノード２−１
乃至２−３の配列順序を識別せねばムらなかった。
順序識別方式においては、制御装置１は各ノード２−１
乃至２−３にコマンドフレームＣ６乃至Ｃ３を伝達せね
ばならず、また各ノード２−１乃至２−３から返送され
たアドレスａ、乃至ａ、を分析した上で各ノード２−１
乃至２−３の配列順序を識別せねばムらなかった。
ｎ：ｊ記問題点は、制御装置、と複数のノードとを一方
向に通信可１ｊヒなループ状伝送路で接続するループ形
通信網において、自ノートのアドレスを前記伝送路を経
由して後位ノードへ通知する手段と、前位ノードから通
知されたアドレスを記憶する手段と、前記制御装置から
の要求に基づき自ノードで記憶中の前位ノードのアドレ
スを前記制御装置へ通知する手段とを前記各ノードに設
けることを特徴とする本発明により解決される。゛〔作
用〕 即ち本発明によれば、各ノードはそれぞれ１１１１位ノ
ードのアドレスのみを記憶し、制御装置は各ノードが記
憶中の前位ノードのアドレスを収集することにより、複
雑な分析過程を経ること無（直ちに当該ループ形通信網
におけるノードの配列順序を識別することが可能となる
。
向に通信可１ｊヒなループ状伝送路で接続するループ形
通信網において、自ノートのアドレスを前記伝送路を経
由して後位ノードへ通知する手段と、前位ノードから通
知されたアドレスを記憶する手段と、前記制御装置から
の要求に基づき自ノードで記憶中の前位ノードのアドレ
スを前記制御装置へ通知する手段とを前記各ノードに設
けることを特徴とする本発明により解決される。゛〔作
用〕 即ち本発明によれば、各ノードはそれぞれ１１１１位ノ
ードのアドレスのみを記憶し、制御装置は各ノードが記
憶中の前位ノードのアドレスを収集することにより、複
雑な分析過程を経ること無（直ちに当該ループ形通信網
におけるノードの配列順序を識別することが可能となる
。
〔実施例〕
以下、本発明の一実施例を図面により説明する。
第１図は本発明の一実施例によるノードを示す図であり
、第２図は本発明の一実施例によるノードの配列順序識
別方式を示す図である。なお、企図を通じて同一符号は
同一対象物を示す。また対象とするループ形通信網の構
成は第３図と同様とする。
、第２図は本発明の一実施例によるノードの配列順序識
別方式を示す図である。なお、企図を通じて同一符号は
同一対象物を示す。また対象とするループ形通信網の構
成は第３図と同様とする。
第１図および第２図において、制御装置１は、フレーム
内の総てのノード２−１乃至２−３が受信可能なマルチ
ドロップ形式のタイムスロットに制御装置１のアドレス
ａ０を付加して伝送路３−１に送出する。該フレームは
、伝送路３−１を経由してノード２−３に伝達される。
内の総てのノード２−１乃至２−３が受信可能なマルチ
ドロップ形式のタイムスロットに制御装置１のアドレス
ａ０を付加して伝送路３−１に送出する。該フレームは
、伝送路３−１を経由してノード２−３に伝達される。
ノード２−３においては、受信部２１が伝送路３−１か
ら到着する前記フレームを受信し、受信データ分岐回路
２２に伝達する。受信データ分岐回路２２は、受信した
前記フレームをシフトレジスタ２３を経由して送信デー
タ挿入回路２４に伝達すると共に、該フレーム内のマル
チドロップ形式のタイムスロットを抽出して受信バ・ノ
ノア２５にも蓄積する。処理装置２６は、受信バッファ
２５に蓄積される夕・イムスロットに付加されているア
ドレスａ０を抽出し、アドレス記憶回路２７に記憶する
。更に処理装置２６は、アドレス付加回路２８に記憶さ
れている自ノード２−３のアドレスａ、を送信データ挿
入回路２４に伝達し、受信データ分岐回路２２からシフ
トレジスタ２３を経由して伝達されるフレームのマルチ
ドロップ形式のタイムスロットに付加し、送信部２９を
経由して伝送路３−２に送出する。その結果ノード２−
３から伝送路３−２に送出されるフレー゛ムのマルチド
ロップ形式のタイムスロットにば°、制御装置ｌのアド
レスａ０の代わりにノード２−３のアドレスミコが付加
される。
ら到着する前記フレームを受信し、受信データ分岐回路
２２に伝達する。受信データ分岐回路２２は、受信した
前記フレームをシフトレジスタ２３を経由して送信デー
タ挿入回路２４に伝達すると共に、該フレーム内のマル
チドロップ形式のタイムスロットを抽出して受信バ・ノ
ノア２５にも蓄積する。処理装置２６は、受信バッファ
２５に蓄積される夕・イムスロットに付加されているア
ドレスａ０を抽出し、アドレス記憶回路２７に記憶する
。更に処理装置２６は、アドレス付加回路２８に記憶さ
れている自ノード２−３のアドレスａ、を送信データ挿
入回路２４に伝達し、受信データ分岐回路２２からシフ
トレジスタ２３を経由して伝達されるフレームのマルチ
ドロップ形式のタイムスロットに付加し、送信部２９を
経由して伝送路３−２に送出する。その結果ノード２−
３から伝送路３−２に送出されるフレー゛ムのマルチド
ロップ形式のタイムスロットにば°、制御装置ｌのアド
レスａ０の代わりにノード２−３のアドレスミコが付加
される。
該フレームは、伝送路３−２を経由して後位ノード２−
１に伝達される。ノード２−１においては、ノード２−
３におけると同様の過程により、受信したフレームのマ
ルチドロップ形式のタイムスロットに付加されていた前
位ノード２−３のアドレスａ３をアドレス記憶回路２７
に記憶し、代わりに自ノード２−１のアドレスａ、をマ
ルチドロップ形式のタイムスロットに付加したフレーム
を伝送路３−３に送出する。
１に伝達される。ノード２−１においては、ノード２−
３におけると同様の過程により、受信したフレームのマ
ルチドロップ形式のタイムスロットに付加されていた前
位ノード２−３のアドレスａ３をアドレス記憶回路２７
に記憶し、代わりに自ノード２−１のアドレスａ、をマ
ルチドロップ形式のタイムスロットに付加したフレーム
を伝送路３−３に送出する。
該フレームは、伝送路３−３を経由して後位ノード２−
２に伝手される。ノード２−２においても、ノード２−
３および２−１におけると同様の過程により、受信した
フレームのマルチドロップ形式のタイムスロットに付加
されていた前位ノード２−１のアドレスａ１をアドレス
記憶回路２７に記憶し、代わりに自ノード２−２のアド
レスａ２をマルチドロップ形式のタイムスロットに付加
したフレームを伝送路３−４に送出する。
２に伝手される。ノード２−２においても、ノード２−
３および２−１におけると同様の過程により、受信した
フレームのマルチドロップ形式のタイムスロットに付加
されていた前位ノード２−１のアドレスａ１をアドレス
記憶回路２７に記憶し、代わりに自ノード２−２のアド
レスａ２をマルチドロップ形式のタイムスロットに付加
したフレームを伝送路３−４に送出する。
該フレームは、伝送路３−４を経由して制御装置ｌに伝
達される。該フレームを受信した制御装置１は、マルチ
ドロップ形式のタイムスロットに付加されているアドレ
スａ２を抽出し、制御装置１の前位にノード２−２が配
置されていることを知る。更に制御装置１はノード２−
１乃至２−３に、各アドレス記憶回路２７に記憶中の前
位ノードのアドレスを返送する指令を送る。該指令を受
信したノード２−１は記憶中のアドレスａ３を制御装置
１に返送する。制御装置１は、ノード２−１から７トレ
スａ３が返送されたことにより、ノード２−１の前位が
ノード２−３であることを識別する。同様にして、ノー
ド２−２は記憶中のアドレスａ１を制ｉＪＩ装置１に返
送し、ノード２−３は記憶中のアドレスａ０を返送する
と、制御装置１は、ノード２−２の前位がノード２−１
であり、ノード２−３の前位が制御装置ｌであることを
直ちに識別し、ノード２−３．２−１および２−２ 。
達される。該フレームを受信した制御装置１は、マルチ
ドロップ形式のタイムスロットに付加されているアドレ
スａ２を抽出し、制御装置１の前位にノード２−２が配
置されていることを知る。更に制御装置１はノード２−
１乃至２−３に、各アドレス記憶回路２７に記憶中の前
位ノードのアドレスを返送する指令を送る。該指令を受
信したノード２−１は記憶中のアドレスａ３を制御装置
１に返送する。制御装置１は、ノード２−１から７トレ
スａ３が返送されたことにより、ノード２−１の前位が
ノード２−３であることを識別する。同様にして、ノー
ド２−２は記憶中のアドレスａ１を制ｉＪＩ装置１に返
送し、ノード２−３は記憶中のアドレスａ０を返送する
と、制御装置１は、ノード２−２の前位がノード２−１
であり、ノード２−３の前位が制御装置ｌであることを
直ちに識別し、ノード２−３．２−１および２−２ 。
の順に配列されていることを確認する。
以上の説明から明らかな如く、本実施例によれば、各ノ
ード２−１乃至２−３はマルチドロップ形式のタイムス
ロットに付加された１１１位ノードのアドレスａ＝ 、
ａ、およびａｏをそれぞれ記憶し、制御装置１は各ノー
ド２−１乃至２−３が記憶しているアドレス”３、ａｌ
およびａｏを収集することにより、当８亥ルーフ゛形通
イ言綱におけるノードの配列順序を識別する。
ード２−１乃至２−３はマルチドロップ形式のタイムス
ロットに付加された１１１位ノードのアドレスａ＝ 、
ａ、およびａｏをそれぞれ記憶し、制御装置１は各ノー
ド２−１乃至２−３が記憶しているアドレス”３、ａｌ
およびａｏを収集することにより、当８亥ルーフ゛形通
イ言綱におけるノードの配列順序を識別する。
なお、第１図および第２図はあく迄本発明の一実施例に
過ぎず、例えばループ形通信網を構成するノードは３組
に限定されることは無く、他の任意組数の場合にも本発
明の効果は変わらない。またノードの構成は図示される
ものに限定されることは無く、他に幾多の変形が考慮さ
れるが、何れの場合にも本発明の効果は変わらない。
過ぎず、例えばループ形通信網を構成するノードは３組
に限定されることは無く、他の任意組数の場合にも本発
明の効果は変わらない。またノードの構成は図示される
ものに限定されることは無く、他に幾多の変形が考慮さ
れるが、何れの場合にも本発明の効果は変わらない。
以上、本発明によれば、前記ループ形通信編において、
制御装置が複雑な分析過程を経ること無くノードの配列
順序を識別可能となる。
制御装置が複雑な分析過程を経ること無くノードの配列
順序を識別可能となる。
第１図は本発明の一実施例によるノードを示す図、第２
図は本発明の一実施例によるノードの配列順序識別方式
を示す図、第３図はかかる欠点を除去した従来あるノー
ドの配列順序識別方式の一例を示す図である。 図において、ｉは制御装置、２−１乃至２−３はノ・−
ド、３−１乃至３−４は伝送路、２１は受信部、２２は
受信データ分岐回路、２３はシフトレジスタ、２４は送
信データ挿入回路、２５は受信ハンノア、２６は処理装
置、２７はアドレス記憶回路、２８はアドレス付加回路
、２９は送信部、２０は送信バッファ、ａｏ乃至ａ３は
アドレス、ＣＩ乃至Ｃ３はコマンドフレーム、ＲＩ乃至
Ｒ５はレスポンスフレーム、を示す。 葛１１ 牟 ２０
図は本発明の一実施例によるノードの配列順序識別方式
を示す図、第３図はかかる欠点を除去した従来あるノー
ドの配列順序識別方式の一例を示す図である。 図において、ｉは制御装置、２−１乃至２−３はノ・−
ド、３−１乃至３−４は伝送路、２１は受信部、２２は
受信データ分岐回路、２３はシフトレジスタ、２４は送
信データ挿入回路、２５は受信ハンノア、２６は処理装
置、２７はアドレス記憶回路、２８はアドレス付加回路
、２９は送信部、２０は送信バッファ、ａｏ乃至ａ３は
アドレス、ＣＩ乃至Ｃ３はコマンドフレーム、ＲＩ乃至
Ｒ５はレスポンスフレーム、を示す。 葛１１ 牟 ２０
Claims (1)
- 制御装置と複数のノードとを一方向に通信可能なループ
状伝送路で接続するループ形通信網において、自ノード
のアドレスを前記伝送路を経由して後位ノードへ通知す
る手段と、前位ノードから通知されたアドレスを記憶す
る手段と、前記制御装置からの要求に基づき自ノードで
記憶中の前位ノードのアドレスを前記制御装置へ通知す
る手段とを前記各ノードに設けることを特徴とするノー
ドの配列順序識別方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59181980A JPS6160042A (ja) | 1984-08-31 | 1984-08-31 | ノ−ドの配列順序識別方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59181980A JPS6160042A (ja) | 1984-08-31 | 1984-08-31 | ノ−ドの配列順序識別方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6160042A true JPS6160042A (ja) | 1986-03-27 |
Family
ID=16110217
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59181980A Pending JPS6160042A (ja) | 1984-08-31 | 1984-08-31 | ノ−ドの配列順序識別方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6160042A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02278536A (ja) * | 1989-04-20 | 1990-11-14 | Toppan Printing Co Ltd | 光記録媒体 |
| JPH03201637A (ja) * | 1989-12-27 | 1991-09-03 | Komatsu Ltd | 直列制御装置のノード割り付け制御装置 |
-
1984
- 1984-08-31 JP JP59181980A patent/JPS6160042A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02278536A (ja) * | 1989-04-20 | 1990-11-14 | Toppan Printing Co Ltd | 光記録媒体 |
| JPH03201637A (ja) * | 1989-12-27 | 1991-09-03 | Komatsu Ltd | 直列制御装置のノード割り付け制御装置 |
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