JPS6158008B2 - - Google Patents
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- JPS6158008B2 JPS6158008B2 JP54010041A JP1004179A JPS6158008B2 JP S6158008 B2 JPS6158008 B2 JP S6158008B2 JP 54010041 A JP54010041 A JP 54010041A JP 1004179 A JP1004179 A JP 1004179A JP S6158008 B2 JPS6158008 B2 JP S6158008B2
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- Japan
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- signal
- voltage
- shows
- generation circuit
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- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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- 239000003990 capacitor Substances 0.000 claims description 9
- 239000004973 liquid crystal related substance Substances 0.000 description 12
- 238000000034 method Methods 0.000 description 10
- 238000010586 diagram Methods 0.000 description 9
- 230000002411 adverse Effects 0.000 description 1
- 230000005669 field effect Effects 0.000 description 1
- 230000003068 static effect Effects 0.000 description 1
- 230000001052 transient effect Effects 0.000 description 1
Landscapes
- Liquid Crystal (AREA)
- Liquid Crystal Display Device Control (AREA)
Description
【発明の詳細な説明】
本発明は、電源電圧を複数の抵抗によつて分割
することにより中間電圧を発生させるようにした
電圧発生回路に係り、特には液晶表示装置駆動用
の電圧発生回路として実施するにきわめて好適な
電圧発生回路を提供するものである。
することにより中間電圧を発生させるようにした
電圧発生回路に係り、特には液晶表示装置駆動用
の電圧発生回路として実施するにきわめて好適な
電圧発生回路を提供するものである。
TN（ツイステツドネマテイツク）型電界効果
型液晶表示装置の駆動方式は大きく分けてスタテ
イツク方式とダイナミツク方式とがあり、更に、
後者の方式としては1/2デユーテイ1/2バイアス方
式、1/3デユーテイ1/3バイアス方式、1/4デユー
テイ1/3バイアス方式等が一般的に採用されてい
るが、電子式卓上計算機（以下、電卓という）で
は、駆動用の端子数が少なくてよい1/3デユーテ
イ1/3バイアス方式または1/4デユーテイ1/3バイ
アス方式が最も多く採用されている。第１図ａ〜
ｅは、1/3デユーテイ1/3バイアス方式に於ける駆
動信号波形及び液晶に印加される電圧波形を示す
信号波形図であり、ａ〜ｃは走査電極（共通電
極）に印加される走査電極信号H1，H2，H3の信
号波形、ｄは信号電極（セグメント電極）に印加
される信号電極信号Siの信号波形の一例、ｅは液
晶に印加される電圧波形の一例を示す。上記信号
波形でＯV及びＥは電源電圧であるが、1/3Ｅ，2/
３Ｅは中間電圧となつており、各波形の実現は、
Ｏ〜Ｅ間を抵抗で分割することにより1/3Ｅ，2/3
Ｅを作り、おのおのの電位をアナログスイツチで
選択供給することにより行つている。第２図に、
上記走査電極信号H1及び信号電極信号Siを発生
させるための回路の一例を示す。同図ａは中間電
圧発生回路、同図ｂは走査電極信号H1の発生回
路、同図ｃは信号電極信号Siの発生回路、同図ｄ
は上記ａ，ｂ，ｃに於て示される各信号の電圧波
形を示す信号波形図である。尚、第２図ｅはアナ
ログスイツチASの機能を示す図である。また、
第２図ａに於てＲは電源電圧分割用の各抵抗を示
す。
型液晶表示装置の駆動方式は大きく分けてスタテ
イツク方式とダイナミツク方式とがあり、更に、
後者の方式としては1/2デユーテイ1/2バイアス方
式、1/3デユーテイ1/3バイアス方式、1/4デユー
テイ1/3バイアス方式等が一般的に採用されてい
るが、電子式卓上計算機（以下、電卓という）で
は、駆動用の端子数が少なくてよい1/3デユーテ
イ1/3バイアス方式または1/4デユーテイ1/3バイ
アス方式が最も多く採用されている。第１図ａ〜
ｅは、1/3デユーテイ1/3バイアス方式に於ける駆
動信号波形及び液晶に印加される電圧波形を示す
信号波形図であり、ａ〜ｃは走査電極（共通電
極）に印加される走査電極信号H1，H2，H3の信
号波形、ｄは信号電極（セグメント電極）に印加
される信号電極信号Siの信号波形の一例、ｅは液
晶に印加される電圧波形の一例を示す。上記信号
波形でＯV及びＥは電源電圧であるが、1/3Ｅ，2/
３Ｅは中間電圧となつており、各波形の実現は、
Ｏ〜Ｅ間を抵抗で分割することにより1/3Ｅ，2/3
Ｅを作り、おのおのの電位をアナログスイツチで
選択供給することにより行つている。第２図に、
上記走査電極信号H1及び信号電極信号Siを発生
させるための回路の一例を示す。同図ａは中間電
圧発生回路、同図ｂは走査電極信号H1の発生回
路、同図ｃは信号電極信号Siの発生回路、同図ｄ
は上記ａ，ｂ，ｃに於て示される各信号の電圧波
形を示す信号波形図である。尚、第２図ｅはアナ
ログスイツチASの機能を示す図である。また、
第２図ａに於てＲは電源電圧分割用の各抵抗を示
す。
本発明は、第２図ａに示される中間電圧発生回
路に関するものである。
路に関するものである。
液晶を負荷とする場合、等価回路は、第３図に
示すように、コンデンサＣLと抵抗ＲLの並列接続
の負荷とされている。このようなコンデンサＣL
と抵抗ＲLの並列接続から成る負荷を駆動する場
合、第１図に示すような駆動信号波形を得るため
には、実際には、中間電圧発生回路よりの出力イ
ンピーダンスを極力小さくしておかなければなら
ない。しかし、出力インピーダンスを小さくする
ことは、分割抵抗Ｒの抵抗値を小さくすることで
あり、システムとしての消費電力が増加するとい
う問題点が生じてくる。これは、液晶駆動のシス
テムが低消費電力性を目的とすることと矛盾する
ことになる。よつて、上記第２図ａに示す従来の
中間電圧発生回路では駆動信号波形の歪をある程
度犠性にしてでも、分割抵抗Ｒの抵抗値を大きく
して低消費電力化を計つている。上記従来の回路
で、分割抵抗Ｒの抵抗値を大きくした場合の、各
波形の一例を第４図に示す。第４図ａは中間電圧
発生回路よりの出力電圧波形を、同図ｂは走査電
極信号H1の信号波形を、同図ｃは信号電極信号
Siの信号波形を、同図ｄは液晶に実際に印加され
る電圧の波形を、それぞれ示す。第４図は、ある
表示パターンのときの例であり、波形の歪は種々
のパターンが考えられるが、傾向は第４図に示す
ものと同程度のものである。第４図ｄは、上記の
ように、液晶に実際に印加される電圧の波形であ
り、この歪が大きくなると、表示品位に悪影響を
与えることになる。この歪は主に、上記ＣLによ
る影響の為であり、歪の完全な除去のためには上
述したように、分割抵抗Ｒの抵抗値を相当小さく
する必要がある。
示すように、コンデンサＣLと抵抗ＲLの並列接続
の負荷とされている。このようなコンデンサＣL
と抵抗ＲLの並列接続から成る負荷を駆動する場
合、第１図に示すような駆動信号波形を得るため
には、実際には、中間電圧発生回路よりの出力イ
ンピーダンスを極力小さくしておかなければなら
ない。しかし、出力インピーダンスを小さくする
ことは、分割抵抗Ｒの抵抗値を小さくすることで
あり、システムとしての消費電力が増加するとい
う問題点が生じてくる。これは、液晶駆動のシス
テムが低消費電力性を目的とすることと矛盾する
ことになる。よつて、上記第２図ａに示す従来の
中間電圧発生回路では駆動信号波形の歪をある程
度犠性にしてでも、分割抵抗Ｒの抵抗値を大きく
して低消費電力化を計つている。上記従来の回路
で、分割抵抗Ｒの抵抗値を大きくした場合の、各
波形の一例を第４図に示す。第４図ａは中間電圧
発生回路よりの出力電圧波形を、同図ｂは走査電
極信号H1の信号波形を、同図ｃは信号電極信号
Siの信号波形を、同図ｄは液晶に実際に印加され
る電圧の波形を、それぞれ示す。第４図は、ある
表示パターンのときの例であり、波形の歪は種々
のパターンが考えられるが、傾向は第４図に示す
ものと同程度のものである。第４図ｄは、上記の
ように、液晶に実際に印加される電圧の波形であ
り、この歪が大きくなると、表示品位に悪影響を
与えることになる。この歪は主に、上記ＣLによ
る影響の為であり、歪の完全な除去のためには上
述したように、分割抵抗Ｒの抵抗値を相当小さく
する必要がある。
ここで、駆動信号波形の歪に関してその発生原
因を、第５図を参照して簡単に説明する。第５図
ａは、第１図に示す駆動信号によつて表示される
パターンを示す図である。また、第５図ｂは走査
電極信号H1，H2，H3及び信号電極信号Siの波形
の各電圧が中間電圧発生回路のどの出力より供給
されているかを示している。そして、第５図ｃ
は、同図ｂの各時間帯（Ｆ・T1，Ｆ・T2，Ｆ・
T3，・T1，・T2，・T3，）の初期状態に
於ける液晶負荷ＣL（ＣL1，ＣL2，ＣL3）と分割
抵抗Ｒとの関係を表わしている。また、同図ｄ
は、ＦフレームのT1時間（Ｆ・T1）の初期状態
と、その電流ループを示している。更に、同図ｅ
は、同図ｄに於けるＶA，ＶM，ＶBの各電位の過
度状態の変化を示しており、この図は上記第４図
ａの一部をより詳細に示したものとなつている。
以下、他の時間帯についても同様に調べていく
と、第４図ａに示す如くなる。
因を、第５図を参照して簡単に説明する。第５図
ａは、第１図に示す駆動信号によつて表示される
パターンを示す図である。また、第５図ｂは走査
電極信号H1，H2，H3及び信号電極信号Siの波形
の各電圧が中間電圧発生回路のどの出力より供給
されているかを示している。そして、第５図ｃ
は、同図ｂの各時間帯（Ｆ・T1，Ｆ・T2，Ｆ・
T3，・T1，・T2，・T3，）の初期状態に
於ける液晶負荷ＣL（ＣL1，ＣL2，ＣL3）と分割
抵抗Ｒとの関係を表わしている。また、同図ｄ
は、ＦフレームのT1時間（Ｆ・T1）の初期状態
と、その電流ループを示している。更に、同図ｅ
は、同図ｄに於けるＶA，ＶM，ＶBの各電位の過
度状態の変化を示しており、この図は上記第４図
ａの一部をより詳細に示したものとなつている。
以下、他の時間帯についても同様に調べていく
と、第４図ａに示す如くなる。
本発明は、上記従来の中間電圧発生回路に於て
生じていた上記問題点を解決することを目的とし
てなされたものであり、消費電力の増大化を招く
ことなく、上記波形の歪を除去できるように構成
した中間電圧発生回路を提供するものである。即
ち、本発明の中間電圧発生回路は電源電圧を複数
の抵抗によつて分割することにより中間電圧を発
生させるようにしたものに於て、上記抵抗の両端
の電位差が一定である箇所に、波形歪除去用の比
較的大容量のコンデンサを接続したことを特徴と
するものである。
生じていた上記問題点を解決することを目的とし
てなされたものであり、消費電力の増大化を招く
ことなく、上記波形の歪を除去できるように構成
した中間電圧発生回路を提供するものである。即
ち、本発明の中間電圧発生回路は電源電圧を複数
の抵抗によつて分割することにより中間電圧を発
生させるようにしたものに於て、上記抵抗の両端
の電位差が一定である箇所に、波形歪除去用の比
較的大容量のコンデンサを接続したことを特徴と
するものである。
第６図に、本発明の一実施例の回路を示す。そ
の特徴は、コンデンサC1，C2を付加している点
にある。このような構成とすることにより、上記
ＣLによる波形歪を完全に除去することができ
る。これは、波形歪の原因となるＶA−ＶM間また
はＶM−ＶB間の交流インピーダンスを、上記コン
デンサC1，C2により、ほぼゼロにすることがで
きるからである。一般に電卓に於ては、８桁のハ
ンデイタイプ程度のものではＣL≒10-3μＦのオ
ーダーであり、C1＝C2＝１μＦ程度で充分効果
がある。一方、消費電力は、従来の回路となんら
変わらず、むしろ波形歪の除去分だけ更には、分
割抵抗Ｒの抵抗値を更に大きくすることができる
こと等により、一層の低消費電力化を可能として
いる。
の特徴は、コンデンサC1，C2を付加している点
にある。このような構成とすることにより、上記
ＣLによる波形歪を完全に除去することができ
る。これは、波形歪の原因となるＶA−ＶM間また
はＶM−ＶB間の交流インピーダンスを、上記コン
デンサC1，C2により、ほぼゼロにすることがで
きるからである。一般に電卓に於ては、８桁のハ
ンデイタイプ程度のものではＣL≒10-3μＦのオ
ーダーであり、C1＝C2＝１μＦ程度で充分効果
がある。一方、消費電力は、従来の回路となんら
変わらず、むしろ波形歪の除去分だけ更には、分
割抵抗Ｒの抵抗値を更に大きくすることができる
こと等により、一層の低消費電力化を可能として
いる。
以上詳細に説明したように、本発明の電圧発生
回路は、中間電圧を選択するためのスイツチ手段
と、電源電圧を前記スイツチ手段の動作に基づい
て所定の抵抗により分割し、当該電源電圧の分割
により選択された中間電圧を発生させるようにし
たものに於て、分割抵抗の両端の電位差が一定の
箇所にコンデンサを接続することにより、その消
費電力の増大化を招くことなく、出力波形の歪を
解消することができ（即ち、中間電圧レベルの安
定化をはかることができ）、しかも、分割抵抗の
両端の電圧差が一定でない箇所にコンデンサを接
続しないから、当該コンデンサの放電が原因の電
力消費も避けられ、きわめて有用な中間電圧発生
回路を提供することができるものである。
回路は、中間電圧を選択するためのスイツチ手段
と、電源電圧を前記スイツチ手段の動作に基づい
て所定の抵抗により分割し、当該電源電圧の分割
により選択された中間電圧を発生させるようにし
たものに於て、分割抵抗の両端の電位差が一定の
箇所にコンデンサを接続することにより、その消
費電力の増大化を招くことなく、出力波形の歪を
解消することができ（即ち、中間電圧レベルの安
定化をはかることができ）、しかも、分割抵抗の
両端の電圧差が一定でない箇所にコンデンサを接
続しないから、当該コンデンサの放電が原因の電
力消費も避けられ、きわめて有用な中間電圧発生
回路を提供することができるものである。
第１図は、1/3デユーテイ1/3バイアス液晶駆動
方式に於ける走査電極信号、信号電極信号及び液
晶に印加される電圧の波形を示す信号波形図、第
２図は、第１図に示す信号を得るための回路の説
明に供する図、第３図は液晶負荷の等価回路図、
第４図は、従来の電圧発生回路に於て発生してい
た波形歪を加味した各信号の波形を示す信号波形
図、第５図は上記波形歪の発生原因の説明に供す
る図、第６図は本発明の一実施例を示す回路図で
ある。 符号、Ｅ，ＯV：電源電圧、Ｒ：分割抵抗、
C1，C2：コンデンサＣ。
方式に於ける走査電極信号、信号電極信号及び液
晶に印加される電圧の波形を示す信号波形図、第
２図は、第１図に示す信号を得るための回路の説
明に供する図、第３図は液晶負荷の等価回路図、
第４図は、従来の電圧発生回路に於て発生してい
た波形歪を加味した各信号の波形を示す信号波形
図、第５図は上記波形歪の発生原因の説明に供す
る図、第６図は本発明の一実施例を示す回路図で
ある。 符号、Ｅ，ＯV：電源電圧、Ｒ：分割抵抗、
C1，C2：コンデンサＣ。
Claims (1)
- 【特許請求の範囲】 １ 複数の抵抗を直列接続することにより、電源
電圧を分割して中間電圧を発生させる電圧発生回
路において、 前記直列接続した抵抗の両端の抵抗に、夫々、
並列に接続したスイツチング手段と、 前記スイツチング手段と並列に接続された抵抗
以外の各抵抗に、夫々、並列に接続したコンデン
サとを備えたことを特徴とする電圧発生回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1004179A JPS55101989A (en) | 1979-01-30 | 1979-01-30 | Voltage generator circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1004179A JPS55101989A (en) | 1979-01-30 | 1979-01-30 | Voltage generator circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS55101989A JPS55101989A (en) | 1980-08-04 |
| JPS6158008B2 true JPS6158008B2 (ja) | 1986-12-09 |
Family
ID=11739298
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1004179A Granted JPS55101989A (en) | 1979-01-30 | 1979-01-30 | Voltage generator circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS55101989A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0253306U (ja) * | 1988-10-11 | 1990-04-17 |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5991491A (ja) * | 1982-11-17 | 1984-05-26 | 松下電子工業株式会社 | 駆動電圧発生装置 |
| JPS6283724A (ja) * | 1985-10-09 | 1987-04-17 | Hitachi Ltd | 液晶表示装置駆動回路 |
| KR100626077B1 (ko) | 2005-05-02 | 2006-09-20 | 삼성에스디아이 주식회사 | 감마 기준전압 발생회로 및 이를 구비하는 평판 표시장치 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS51130191A (en) * | 1975-05-08 | 1976-11-12 | Sanyo Electric Co Ltd | Driving method for a liquid crystal |
| JPS51132940A (en) * | 1975-05-14 | 1976-11-18 | Sharp Corp | Electric source apparatus |
-
1979
- 1979-01-30 JP JP1004179A patent/JPS55101989A/ja active Granted
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS51130191A (en) * | 1975-05-08 | 1976-11-12 | Sanyo Electric Co Ltd | Driving method for a liquid crystal |
| JPS51132940A (en) * | 1975-05-14 | 1976-11-18 | Sharp Corp | Electric source apparatus |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0253306U (ja) * | 1988-10-11 | 1990-04-17 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS55101989A (en) | 1980-08-04 |
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