JPS6149656A - 電源装置 - Google Patents
電源装置Info
- Publication number
- JPS6149656A JPS6149656A JP16928184A JP16928184A JPS6149656A JP S6149656 A JPS6149656 A JP S6149656A JP 16928184 A JP16928184 A JP 16928184A JP 16928184 A JP16928184 A JP 16928184A JP S6149656 A JPS6149656 A JP S6149656A
- Authority
- JP
- Japan
- Prior art keywords
- output
- transformer
- voltage
- flip
- flop
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M3/00—Conversion of dc power input into dc power output
- H02M3/22—Conversion of dc power input into dc power output with intermediate conversion into ac
- H02M3/24—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters
- H02M3/28—Conversion of dc power input into dc power output with intermediate conversion into ac by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate ac
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Dc-Dc Converters (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔技術分野〕
本発明は電源装置、特に昇圧トランスの一次側を断続し
て二次側に発生する電力を負荷に給供する電源装置に関
するものである。
て二次側に発生する電力を負荷に給供する電源装置に関
するものである。
従来この種の装置は複写機の帯電器やＣＲＴの水平偏向
電圧などの高圧を発生する装置として広く用いられてい
る。
電圧などの高圧を発生する装置として広く用いられてい
る。
この種の装置の多くは昇圧トランスの一次側巻綴に対す
る電力の印加を、トランジスタ等によるスイッチング手
段により断続して二次側に＠諌死に応じた電圧を発生す
るように構成されている。
る電力の印加を、トランジスタ等によるスイッチング手
段により断続して二次側に＠諌死に応じた電圧を発生す
るように構成されている。
前記のスイッチング手段のスイッチングパルスのうち一
次巻線に対する電力の印加を遮１新する時間、即ちオフ
時間は用いられる昇圧トランス（（応じて回路ごとに適
宜決定されていた。従っていくつかの異なった昇圧トラ
ンスを用いる電源装置を製造する場合には各トランスに
応じて適切なオフタイムを設定するよう装置に応じて制
御回路を適宜変更する必要があった。即ちある程度まで
は回路基板を共有化することができるが、トランスの種
類に応じてオフタイムを適宜変化させることができろよ
うな調整手段を設ける必要があった。従ってこの分回路
基板上のスペースを多く必要とし、寸だ製造時間もこの
調整時間分長くなるという問題があった。
次巻線に対する電力の印加を遮１新する時間、即ちオフ
時間は用いられる昇圧トランス（（応じて回路ごとに適
宜決定されていた。従っていくつかの異なった昇圧トラ
ンスを用いる電源装置を製造する場合には各トランスに
応じて適切なオフタイムを設定するよう装置に応じて制
御回路を適宜変更する必要があった。即ちある程度まで
は回路基板を共有化することができるが、トランスの種
類に応じてオフタイムを適宜変化させることができろよ
うな調整手段を設ける必要があった。従ってこの分回路
基板上のスペースを多く必要とし、寸だ製造時間もこの
調整時間分長くなるという問題があった。
〔目 １′白〕
本発明は以上の問題点に鑑みて成されたもので、用いら
れる昇圧トランスが変更になった場合でも無調整で制御
回路部分を対応させることができ、製］貴が容易で簡単
安価な電源装置を提伸することを目的とする。
れる昇圧トランスが変更になった場合でも無調整で制御
回路部分を対応させることができ、製］貴が容易で簡単
安価な電源装置を提伸することを目的とする。
以下図面に示す実施例に基づき本発明の詳細な説明する
。
。
第１図は本発明による電源装置の一実施例を示すもので
、同図において′ｒで示されるものは昇圧トランスであ
る。昇圧トランスＴの一次巻線Ｔ１ Ｔ １の一端は抵
抗Ｒ１を介して電源電圧ＶＣＣに接続されるとともに、
コンデンサＣ２を介して接地されている。また−次巻線
Ｔ１の他端はスイッチングトランジスタＴｒのコレクタ
に接続されている。
、同図において′ｒで示されるものは昇圧トランスであ
る。昇圧トランスＴの一次巻線Ｔ１ Ｔ １の一端は抵
抗Ｒ１を介して電源電圧ＶＣＣに接続されるとともに、
コンデンサＣ２を介して接地されている。また−次巻線
Ｔ１の他端はスイッチングトランジスタＴｒのコレクタ
に接続されている。
接地されており、さらにコレフタル接地間にはコンデン
サＣ１及びダイオードＤ１が接続されている。ここでコ
ンデンサＣ１は一次巻線Ｔ１と共振して効率的な電圧変
換を行なうためのもの、またダイオードＤ１は一次巻線
Ｔ１の逆電力を吸収し、トランジスタＴｒを保護するだ
めのものである。
サＣ１及びダイオードＤ１が接続されている。ここでコ
ンデンサＣ１は一次巻線Ｔ１と共振して効率的な電圧変
換を行なうためのもの、またダイオードＤ１は一次巻線
Ｔ１の逆電力を吸収し、トランジスタＴｒを保護するだ
めのものである。
−次巻線Ｔ１に対する電力印加はスイッチングトランジ
スタＴ ？、によシ断続される。この結果二次巻線Ｔ２
には巻線比に応じて昇圧された電圧が発生する。この交
流電圧はダイオードＤ２及びコンデンサＣ６により整流
、平滑され負荷ＲＬに供給される。
スタＴ ？、によシ断続される。この結果二次巻線Ｔ２
には巻線比に応じて昇圧された電圧が発生する。この交
流電圧はダイオードＤ２及びコンデンサＣ６により整流
、平滑され負荷ＲＬに供給される。
本発明では昇圧トランスＴに検出用巻線Ｔ６を設けであ
る。検出用巻線Ｔ６の一嬬は接地されておシもう一端は
抵抗Ｒ５を介して接地されている。
る。検出用巻線Ｔ６の一嬬は接地されておシもう一端は
抵抗Ｒ５を介して接地されている。
抵抗Ｒ５の端子電圧はオペアンプ等から構成されたゼロ
クロス検出器１の一方の入力に接続されている。
クロス検出器１の一方の入力に接続されている。
ゼロクロス検出器１の他方の入力には負の基準電圧−Ｖ
ｒｅｆが接続されている。ゼロクロス検出器１の出力信
号ａは抵抗及びコンデンサ等から形成した微分回路２に
入力され正のパルスが形成される。微分回路２の出力信
号すけＲＳフリップフロップ３のセット端子に接続され
ている。
ｒｅｆが接続されている。ゼロクロス検出器１の出力信
号ａは抵抗及びコンデンサ等から形成した微分回路２に
入力され正のパルスが形成される。微分回路２の出力信
号すけＲＳフリップフロップ３のセット端子に接続され
ている。
とのＲＳフリップフロップ３の出力信号Ｃは、トランジ
スタ等から構成した電流増幅器４を介して増幅され、こ
の増幅された信号によシＩＹｌＮ記のスイッチングトラ
ンジスタ’Ｉｆのベースが制御され一次巻線Ｔ１「１の
断続が制御される。
スタ等から構成した電流増幅器４を介して増幅され、こ
の増幅された信号によシＩＹｌＮ記のスイッチングトラ
ンジスタ’Ｉｆのベースが制御され一次巻線Ｔ１「１の
断続が制御される。
一方「」１」記の二次巻に’［’２の一端には片側と接
地された電流検出用の抵抗Ｒ２が接続されており、この
抵抗Ｒ２の端子電圧はオペアンプ等から構成された誤差
増幅器６の一方の入力に接続されている。誤差増幅器６
のもう一方の入力には電源電圧ＶＣＣを抵抗Ｒ３、Ｒ４
で分圧した所定の基準電圧が供給されている。誤差増幅
器６の出力信号ｅけオペアンプ等からＦ７’？成された
比較器７の一方の入力に接続されている。比較器７のも
う一方の入力には時定数回路５の出力信号ｄが接続され
ている。
地された電流検出用の抵抗Ｒ２が接続されており、この
抵抗Ｒ２の端子電圧はオペアンプ等から構成された誤差
増幅器６の一方の入力に接続されている。誤差増幅器６
のもう一方の入力には電源電圧ＶＣＣを抵抗Ｒ３、Ｒ４
で分圧した所定の基準電圧が供給されている。誤差増幅
器６の出力信号ｅけオペアンプ等からＦ７’？成された
比較器７の一方の入力に接続されている。比較器７のも
う一方の入力には時定数回路５の出力信号ｄが接続され
ている。
時定数回路５の入力には前記のＲＳフリッグ７０ツブ３
の出力信号Ｃが入力されている。時定数回路５の出力信
号ｄけフリップフロップ３の出力信号Ｃのオンにより一
定の時定数で立ち上がシ、信号Ｃがオフになった場合急
激にオフになる。比較器７の出力信号ｆはフリップ７０
ツブ６のリセット端子に接続されている。
の出力信号Ｃが入力されている。時定数回路５の出力信
号ｄけフリップフロップ３の出力信号Ｃのオンにより一
定の時定数で立ち上がシ、信号Ｃがオフになった場合急
激にオフになる。比較器７の出力信号ｆはフリップ７０
ツブ６のリセット端子に接続されている。
次に以上の構成における動作につき第２図のタイミング
図を参照して詳細に説明する。第２図の最上段に符号Ｆ
ＢＶで示される波形は抵抗Ｒ５の両端の電圧波形を示し
ており、昇圧トランスＴのフライバック電圧を示してい
る。
図を参照して詳細に説明する。第２図の最上段に符号Ｆ
ＢＶで示される波形は抵抗Ｒ５の両端の電圧波形を示し
ており、昇圧トランスＴのフライバック電圧を示してい
る。
前記の各印加点に電源電圧■ＣＣを印加すると、スイッ
チングトランジスタＴＹが一次巻線Ｔ１を断続させ、こ
の結果検出用巻線Ｔ６には第２図最上段の様な交流波形
が発生される。二次巻線Ｔ２にも同様の波形が生じるが
、この場合その電圧値は一次巻線Ｔ１との巻線比に応じ
た値となる。フライバック電圧ＦＢＶが正の領域に入る
とゼロクロス検出回路１は出力を反転させ負の電圧を発
生するようになっており、この結果ゼロクロス検出器１
の出力信号ａは第２図の２段目に示されるよりなＣ成形
となる。
チングトランジスタＴＹが一次巻線Ｔ１を断続させ、こ
の結果検出用巻線Ｔ６には第２図最上段の様な交流波形
が発生される。二次巻線Ｔ２にも同様の波形が生じるが
、この場合その電圧値は一次巻線Ｔ１との巻線比に応じ
た値となる。フライバック電圧ＦＢＶが正の領域に入る
とゼロクロス検出回路１は出力を反転させ負の電圧を発
生するようになっており、この結果ゼロクロス検出器１
の出力信号ａは第２図の２段目に示されるよりなＣ成形
となる。
この信号ａは微分回路２に入力され正の方向の変化のみ
が取り出される。この結果微分回路２の出力（では第２
図の３段目に示すようなパルスが発生する。
が取り出される。この結果微分回路２の出力（では第２
図の３段目に示すようなパルスが発生する。
このパルスによシフリップフロップ３がセットされる。
フリップ７０ツブ３の出力信号Ｃの波形は第２図の４段
目に示されている。図から分かるようにフリップフロッ
プ６は昇圧トランスＴのオフ時間の最初に同期してセン
トされる。
目に示されている。図から分かるようにフリップフロッ
プ６は昇圧トランスＴのオフ時間の最初に同期してセン
トされる。
フリップフロップ３のセットによシ時定数回路５は徐々
に立ち上がり第２図箒５段目に示すような波形を出力す
る。第２図５段目の符号ｄで示されている波形が時定数
回路５の出力信号の波形である。この出力信号ｄは比較
器７で、誤差増幅器６により形成された所定の負荷電流
と実際の負荷電流との誤差に対応する信号ｅと比較され
、この結果信号ｄのレベルが信号ｅのレベルに達した際
がフリップフロップ６のリセット端子に入力される。こ
れによりフリップフロップ６の出力信号Ｃは第２図の４
段目に示すような矩形波となる。
に立ち上がり第２図箒５段目に示すような波形を出力す
る。第２図５段目の符号ｄで示されている波形が時定数
回路５の出力信号の波形である。この出力信号ｄは比較
器７で、誤差増幅器６により形成された所定の負荷電流
と実際の負荷電流との誤差に対応する信号ｅと比較され
、この結果信号ｄのレベルが信号ｅのレベルに達した際
がフリップフロップ６のリセット端子に入力される。こ
れによりフリップフロップ６の出力信号Ｃは第２図の４
段目に示すような矩形波となる。
以上の１サイクルが順次繰り返されて電圧変換が行なわ
れる。
れる。
以上の実施例によれば、昇圧トランスのオフ時間が検出
されたゼロクロスのタイミングと負荷電流から自動的に
決定されるので、昇圧トランスＴが異なっていても回路
の変更や調整なしに適切なオフ時間制御が行なえ効率の
良い電圧変換を行なうことができる。
されたゼロクロスのタイミングと負荷電流から自動的に
決定されるので、昇圧トランスＴが異なっていても回路
の変更や調整なしに適切なオフ時間制御が行なえ効率の
良い電圧変換を行なうことができる。
以上の実施例ではフライバック電圧を検出するために昇
圧トランスＴに検出巻線を設けたが、検出巻線を設けな
くてもフライバンク電圧に対応したスイッチングトラン
ジスタＴ尺のコレクタ電圧を検出してゼロクロス検出を
行なうようにしても良い。以上の実施例では昇圧トラン
スを用いたスイッチング電源装置を例示したが、オン／
オフ方式のスイッチング電源装置、あるいはオン／オフ
方式のスイッチング電源装置にも本発明が応用できる。
圧トランスＴに検出巻線を設けたが、検出巻線を設けな
くてもフライバンク電圧に対応したスイッチングトラン
ジスタＴ尺のコレクタ電圧を検出してゼロクロス検出を
行なうようにしても良い。以上の実施例では昇圧トラン
スを用いたスイッチング電源装置を例示したが、オン／
オフ方式のスイッチング電源装置、あるいはオン／オフ
方式のスイッチング電源装置にも本発明が応用できる。
この場合にはフライバック電圧を検出するのではなく、
電圧降下や電流減少などを検出することによりゼロクロ
ス検出を行なうようにすれば良い。
電圧降下や電流減少などを検出することによりゼロクロ
ス検出を行なうようにすれば良い。
以上の説明から明らかなように本発明によれば、昇圧ト
ランスの一次側をスイッチング手段により断続してその
二次側に発生する電圧変換された出力を負荷に供給する
電源装置において、昇圧トランスのフライバンク電圧の
ゼロ点通過時を検出するゼロクロス検出手段と、電圧変
換効率を制御する手段と、この効率制御手段の出力とＲ
Ｓフリップフロップの出力により立ち上がる時定数回路
の出力を比較する手段とを有し、この比較手段の出力に
よりリセットされ前記ゼロクロス検出手段の出力により
セットされる前記ＲＳフリップフロップの出力により前
記スイッチング手段が制御される構成を採用しているの
で、フライバック電圧のゼロ点通過タイミングと検出し
た負荷電流に応じて最適なオフ時間を自動的に設定する
ことができ、異なったトランスにも無調整で対応できる
製造コスト、製造時間の点で有利な優れた電源装置を提
供することができる。
ランスの一次側をスイッチング手段により断続してその
二次側に発生する電圧変換された出力を負荷に供給する
電源装置において、昇圧トランスのフライバンク電圧の
ゼロ点通過時を検出するゼロクロス検出手段と、電圧変
換効率を制御する手段と、この効率制御手段の出力とＲ
Ｓフリップフロップの出力により立ち上がる時定数回路
の出力を比較する手段とを有し、この比較手段の出力に
よりリセットされ前記ゼロクロス検出手段の出力により
セットされる前記ＲＳフリップフロップの出力により前
記スイッチング手段が制御される構成を採用しているの
で、フライバック電圧のゼロ点通過タイミングと検出し
た負荷電流に応じて最適なオフ時間を自動的に設定する
ことができ、異なったトランスにも無調整で対応できる
製造コスト、製造時間の点で有利な優れた電源装置を提
供することができる。
第１図は本発明による電源装置の一実施ＦＩＪを説明す
る回路図、第２図は第１図の各部の電圧波形を示すタイ
ミングチャート図である。 １・・・ゼロクロス検出器 ２・・・微分回路６・・・
ＲＳフリップフロップ４・・・電流増幅器５・・・時定
数回路 ６・・・誤差増幅器戸・・比較器
Ｔ・・・昇圧トランスＴＲ・・・スイッチングト
ランジスタ ＲＬ・・・負荷 Ｔ１・・・−次巻線Ｔ２
・・・二次巻線 Ｔ６・・・検出巻線特許出願人
キ ヤ ノ ン 法式会社ｒ′ − 代 理 人 弁理士 加 藤 卓 ；□し、＝
Ｌ、） 第１図 十Ｖｃｃ 第２図
る回路図、第２図は第１図の各部の電圧波形を示すタイ
ミングチャート図である。 １・・・ゼロクロス検出器 ２・・・微分回路６・・・
ＲＳフリップフロップ４・・・電流増幅器５・・・時定
数回路 ６・・・誤差増幅器戸・・比較器
Ｔ・・・昇圧トランスＴＲ・・・スイッチングト
ランジスタ ＲＬ・・・負荷 Ｔ１・・・−次巻線Ｔ２
・・・二次巻線 Ｔ６・・・検出巻線特許出願人
キ ヤ ノ ン 法式会社ｒ′ − 代 理 人 弁理士 加 藤 卓 ；□し、＝
Ｌ、） 第１図 十Ｖｃｃ 第２図
Claims (1)
- 昇圧トランスの一次側をスイッチング手段により断続し
てその二次側に発生する電圧変換された出力を負荷に供
給する電源装置において、昇圧トランスのフライバック
電圧のゼロ点通過時を検出するゼロクロス検出手段と、
電圧変換効率を検出した負荷電流に応じて制御する手段
と、この効率制御手段の出力とＲＳフリップフロップの
出力により立ち上がる時定数回路の出力を比較する手段
とを有し、この比較手段の出力によりリセットされ前記
ゼロクロス検出手段の出力によりセットされる前記ＲＳ
フリップフロップの出力により前記スイッチング手段が
制御されることを特徴とする電源装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16928184A JPS6149656A (ja) | 1984-08-15 | 1984-08-15 | 電源装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16928184A JPS6149656A (ja) | 1984-08-15 | 1984-08-15 | 電源装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6149656A true JPS6149656A (ja) | 1986-03-11 |
Family
ID=15883604
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16928184A Pending JPS6149656A (ja) | 1984-08-15 | 1984-08-15 | 電源装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6149656A (ja) |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58190277A (ja) * | 1982-04-30 | 1983-11-07 | Shikoku Henatsuki Kk | スイツチング型直流変換装置の駆動回路 |
| JPS5932370A (ja) * | 1982-08-16 | 1984-02-21 | Hitachi Ltd | 高圧電源装置 |
| JPS6148346A (ja) * | 1984-08-11 | 1986-03-10 | 鈴木 晃 | 大動脈内用バル−ン装置 |
-
1984
- 1984-08-15 JP JP16928184A patent/JPS6149656A/ja active Pending
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58190277A (ja) * | 1982-04-30 | 1983-11-07 | Shikoku Henatsuki Kk | スイツチング型直流変換装置の駆動回路 |
| JPS5932370A (ja) * | 1982-08-16 | 1984-02-21 | Hitachi Ltd | 高圧電源装置 |
| JPS6148346A (ja) * | 1984-08-11 | 1986-03-10 | 鈴木 晃 | 大動脈内用バル−ン装置 |
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