JPS61270911A - スライス・レベル選択回路 - Google Patents
スライス・レベル選択回路Info
- Publication number
- JPS61270911A JPS61270911A JP60113428A JP11342885A JPS61270911A JP S61270911 A JPS61270911 A JP S61270911A JP 60113428 A JP60113428 A JP 60113428A JP 11342885 A JP11342885 A JP 11342885A JP S61270911 A JPS61270911 A JP S61270911A
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- JP
- Japan
- Prior art keywords
- image signal
- lower limit
- slice level
- upper limit
- value
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K5/00—Manipulating of pulses not covered by one of the other main groups of this subclass
- H03K5/01—Shaping pulses
- H03K5/08—Shaping pulses by limiting; by thresholding; by slicing, i.e. combined limiting and thresholding
Landscapes
- Physics & Mathematics (AREA)
- Nonlinear Science (AREA)
- Facsimile Image Signal Circuits (AREA)
- Manipulation Of Pulses (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〈産業上の利用分野〉
本発明は、文書、絵等を光学的に読み取るイメージ・セ
ンサから出力される画信号をスライス・レベル値によっ
て２値化信号に変換する変換装置等において、このスラ
イス・レベル値を決定するスライス・レベル選択回路に
関するものである。
ンサから出力される画信号をスライス・レベル値によっ
て２値化信号に変換する変換装置等において、このスラ
イス・レベル値を決定するスライス・レベル選択回路に
関するものである。
〈従来の技術〉
文書、絵等のイメージを光学的に読み取る場合、このイ
メージを格子状に分割して各格子の中をイメージ・セン
サで読み取っていくが、このイメージの明暗に対応した
２値化信号（０，１）を得るためには、イメージ・セン
サの出力電圧（アナログ画信号）をあるスライス・レベ
ル＜ｔａ圧信号等）を用いて、このアナログ画信号のＯ
”レベルまたは“１″レベルを判定する。
メージを格子状に分割して各格子の中をイメージ・セン
サで読み取っていくが、このイメージの明暗に対応した
２値化信号（０，１）を得るためには、イメージ・セン
サの出力電圧（アナログ画信号）をあるスライス・レベ
ル＜ｔａ圧信号等）を用いて、このアナログ画信号のＯ
”レベルまたは“１″レベルを判定する。
このとき、このスライス・レベルを決定する方式として
、イメージ・センサからの横１ライン分のアナログ画信
号を複数のスライス・レベルによって２値化信号を得、
各スライス・レベル毎のこの２値化信号の変化数を計数
し、この計数値が最大であるスライス・レベル値を用い
て次のラインの画信号を走査していた。
、イメージ・センサからの横１ライン分のアナログ画信
号を複数のスライス・レベルによって２値化信号を得、
各スライス・レベル毎のこの２値化信号の変化数を計数
し、この計数値が最大であるスライス・レベル値を用い
て次のラインの画信号を走査していた。
しかしながら、上記した方式であると文書、絵等の背景
の明暗の濃度や文字の濃度等に対応する画信号レベルに
近いスライス・レベルにおいて、文書、絵以外の余分な
２値化信号が発生してこれも計数し、イメージに対応す
る２値化画信号の誤差の原因となっていた。
の明暗の濃度や文字の濃度等に対応する画信号レベルに
近いスライス・レベルにおいて、文書、絵以外の余分な
２値化信号が発生してこれも計数し、イメージに対応す
る２値化画信号の誤差の原因となっていた。
〈発明が解決しようとする問題点〉 一本発明が解決し
ようとする技術的課題は、イメージ・センサ出力の画信
号を２値化信号に変換する際のスライス・レベルを自動
的に選択できるようにすることであり、誤差の少ないイ
メージ・センサの２値化変換装置のスライス・レベル選
択回路を実現することを目的とする。
ようとする技術的課題は、イメージ・センサ出力の画信
号を２値化信号に変換する際のスライス・レベルを自動
的に選択できるようにすることであり、誤差の少ないイ
メージ・センサの２値化変換装置のスライス・レベル選
択回路を実現することを目的とする。
く問題を°解決するための手段〉
本発明は、スライス・レベルにある幅を持た才てこの幅
の外側にある画信号のみを検出するようにしたものであ
り、その構成は次の通りである。
の外側にある画信号のみを検出するようにしたものであ
り、その構成は次の通りである。
即ち、画信号を入力しスライス・レベルが設定されこの
スライス・レベルによって２値化信号を得る変換装置に
おける前記スライス・レベルを決定するスライス・レベ
ル選択回路において、前記画信号と画信号上限設定値と
を比較する上限比較器と、前記画信号と画信号下限設定
値とを比較する下限比較器と、画信号上限設定値と画信
号下限設定値との幅の外側に前記画信号が存在する際に
この状態を検出して記憶する状態検出器と、この状態検
出器からの検出信号を計数する計数回路と、この計数回
路の計数値が最大になった時の画信号上限設定値と画信
号下限設定値を前記画信号のスライス・レベルと決定す
る処理部とを備えるスライス・レベル選択回路である。
スライス・レベルによって２値化信号を得る変換装置に
おける前記スライス・レベルを決定するスライス・レベ
ル選択回路において、前記画信号と画信号上限設定値と
を比較する上限比較器と、前記画信号と画信号下限設定
値とを比較する下限比較器と、画信号上限設定値と画信
号下限設定値との幅の外側に前記画信号が存在する際に
この状態を検出して記憶する状態検出器と、この状態検
出器からの検出信号を計数する計数回路と、この計数回
路の計数値が最大になった時の画信号上限設定値と画信
号下限設定値を前記画信号のスライス・レベルと決定す
る処理部とを備えるスライス・レベル選択回路である。
〈作用〉
イメージ・センサから出力された画信号を画信号上限設
定値と画信号下限設定値と比較し、この２つの設定値の
幅の外側にある画信号のみを有効とし、２値化信号に変
換して変化数を計数し、この上限設定値と下限設定値を
それぞれ変化させて、そのときの２値化した信号の計数
値が最大の上限設定値と下限設定値をスライス・レベル
として選択して次のライ ンの走査を行なう。
定値と画信号下限設定値と比較し、この２つの設定値の
幅の外側にある画信号のみを有効とし、２値化信号に変
換して変化数を計数し、この上限設定値と下限設定値を
それぞれ変化させて、そのときの２値化した信号の計数
値が最大の上限設定値と下限設定値をスライス・レベル
として選択して次のライ ンの走査を行なう。
〈実施例〉
第１図は本発明を実施したスライス・レベル選択回路の
１例であり、イメージ・センサ（図示せず）からのアナ
ログ画信号ａを入力してこれに対応する２値化画信号Ａ
′を出力するものである。
１例であり、イメージ・センサ（図示せず）からのアナ
ログ画信号ａを入力してこれに対応する２値化画信号Ａ
′を出力するものである。
この図において、１はイメージ・センサからのアナログ
画信号ａを入力してディジタル信号に変換するアナログ
・ディジタル変換器、２は画信号の下限設定値Ｑ＋が設
定され画信１ｉ！Ａと比較を行ないＡ≦Ｑ１の際に１４
８”出力を行なう下限比較器、３は画信号の上限設定値
Ｑ２が設定され画信号Ａと比較を行ないＡ＞Ｑ２の際に
“Ｈ”出力を行なう上限比較器、４は下限比較器２へ下
限値Ｑ１を設定する下限値レジスタ、５は上限比較器３
へ上限値Ｑ２を設定する上限値レジスタである。
画信号ａを入力してディジタル信号に変換するアナログ
・ディジタル変換器、２は画信号の下限設定値Ｑ＋が設
定され画信１ｉ！Ａと比較を行ないＡ≦Ｑ１の際に１４
８”出力を行なう下限比較器、３は画信号の上限設定値
Ｑ２が設定され画信号Ａと比較を行ないＡ＞Ｑ２の際に
“Ｈ”出力を行なう上限比較器、４は下限比較器２へ下
限値Ｑ１を設定する下限値レジスタ、５は上限比較器３
へ上限値Ｑ２を設定する上限値レジスタである。
６はクロック・パルスＣＰの“Ｈ”状態と上限比較器３
のＨ”出力によって出力がなされるナンド・ゲート、７
はクロック・パルスＣＰの“Ｈｊｌ状態と下限比較器２
の“Ｈ′°出力によって出力がなされるナンド・ゲート
、８はナンド・ゲート６の出力がセット端子Ｓに、ナン
ド・ゲート７の出力がリセット端子Ｒに与えられるセッ
ト・リセット・フリップ・７０ツブ回路５ＲＦＦ、９は
５ＲＦＦ回路９のセット、リセットの反転状態を計数す
る計数回路である。１０は計数回路９の計数値によって
下限値Ｑ＋、上限値Ｑ２を設定し計数回路９をリセット
する処理部である。また、処理部１゜はゲート回路１１
．１２のゲート開閉信号を出力し、ゲート回路１１から
は、画信号クロック・パルスＣＰ′が出力され、ゲート
回路１２からは上限設定値Ｑ２より大きい画信号が″′
Ｈパとなる２１ｉ１１化信号Ａ′が出力される。
のＨ”出力によって出力がなされるナンド・ゲート、７
はクロック・パルスＣＰの“Ｈｊｌ状態と下限比較器２
の“Ｈ′°出力によって出力がなされるナンド・ゲート
、８はナンド・ゲート６の出力がセット端子Ｓに、ナン
ド・ゲート７の出力がリセット端子Ｒに与えられるセッ
ト・リセット・フリップ・７０ツブ回路５ＲＦＦ、９は
５ＲＦＦ回路９のセット、リセットの反転状態を計数す
る計数回路である。１０は計数回路９の計数値によって
下限値Ｑ＋、上限値Ｑ２を設定し計数回路９をリセット
する処理部である。また、処理部１゜はゲート回路１１
．１２のゲート開閉信号を出力し、ゲート回路１１から
は、画信号クロック・パルスＣＰ′が出力され、ゲート
回路１２からは上限設定値Ｑ２より大きい画信号が″′
Ｈパとなる２１ｉ１１化信号Ａ′が出力される。
このように構成された本発明のスライス・レベル選択回
路の動作を第２図の信号チャートを用いて説明する。
路の動作を第２図の信号チャートを用いて説明する。
外部のイメージ・センサからアナログ画信号ａが入力さ
れると、アナログ・ディジタル変換器１によってこのア
ナログ画信号ａはディジタル画信号Ａに変換される。尚
、第２図においては、簡単のためアナログ画信号ａとス
ライス・レベル（イ）（ロ）、（ハ）との関係を表わし
ているが、このアナログ画信号ａはディジタル信号Ａに
対応するものである。
れると、アナログ・ディジタル変換器１によってこのア
ナログ画信号ａはディジタル画信号Ａに変換される。尚
、第２図においては、簡単のためアナログ画信号ａとス
ライス・レベル（イ）（ロ）、（ハ）との関係を表わし
ているが、このアナログ画信号ａはディジタル信号Ａに
対応するものである。
そして、このディジタル画信号Ａは、下限比較器２と上
限比較器３へ与えられる。
限比較器３へ与えられる。
はじめに、この図の（イ）に示すように下限比較器２に
は下限値Ｑ１としてＱ、Ｉが設定され、上限比較器３に
は上限値Ｑ２としてＱ２ ＋が設定されている。
は下限値Ｑ１としてＱ、Ｉが設定され、上限比較器３に
は上限値Ｑ２としてＱ２ ＋が設定されている。
この場合、ディジタル信号に変換された画信号ａは、ク
ロック・パルスＣＰのＨ１１状態のタイミングでそのレ
ベルを検出され、このレベルが下限値Ｑ＋＋より小さい
場合には、下限比較器２から“Ｈ”出力がなされ、ナン
ド・ゲート７を介して５ＲＦＦ８がこの下限比較器２の
゛′Ｈ″出力によってリセットされる。
ロック・パルスＣＰのＨ１１状態のタイミングでそのレ
ベルを検出され、このレベルが下限値Ｑ＋＋より小さい
場合には、下限比較器２から“Ｈ”出力がなされ、ナン
ド・ゲート７を介して５ＲＦＦ８がこの下限比較器２の
゛′Ｈ″出力によってリセットされる。
そして、画信号ａが上限設定値Ｑ２１を越えると上限比
較器３から“Ｈ１１出力がなされ、この“ＨＨ出力によ
って５ＲＦＦ８はリセット状態からセット状態へ反転す
る。
較器３から“Ｈ１１出力がなされ、この“ＨＨ出力によ
って５ＲＦＦ８はリセット状態からセット状態へ反転す
る。
このとき、計数回路９は、この５ＲＦＦ８が反転したこ
とを検出して計数する。
とを検出して計数する。
また、画信号ａがａ＞Ｑ２＋の状態からＱ＋＋〉ａの状
態となると５ＲＦＦ８はセット状態からリセット状態へ
反転し、計数回路９はこの反転したことを計数する。
態となると５ＲＦＦ８はセット状態からリセット状態へ
反転し、計数回路９はこの反転したことを計数する。
即ち、（イ）の場合、計数値は画信号ａが値Ｑ＋＋と値
Ｑ２１の幅を横切る回数「２」である。
Ｑ２１の幅を横切る回数「２」である。
同様にして、（ロ）の場合、下限ｆｌｆｌＱ＋２（＜Ｑ
ｌｌ）と上限値Ｑ２２（＜Ｑ２瞥）の値を画信号ａが横
切る回数は、「１６」である。
ｌｌ）と上限値Ｑ２２（＜Ｑ２瞥）の値を画信号ａが横
切る回数は、「１６」である。
次に（ハ）の場合は、下限値ＱＩ３、上限値Ｑ２３が設
定され、画信＠ａがこの値の幅を横切る回数は「１０」
である。
定され、画信＠ａがこの値の幅を横切る回数は「１０」
である。
このように下限値０１及び上限値Ｑ２のヒステリシスを
持つスライス・レベルを数回変化させて画信号ａを走査
すると、下限１ｔｉＱ＋ｚ、上限値Ｑ２２にスライス・
レベルを設定したときに、画信号がこの幅を横切る回数
が最大となる。次に、このスライス・レベル値Ｑ＋ ２
Ｉ Ｑ２ ｙによって画信号ａを走査し、処理部１０
の出力によってゲート回路１１．１２が開かれて、画信
号が上限値Ｑ２２を越えた際の信号をゲート回路１２か
ら２値化画信号Ａ′として出力し、ゲート回路１２から
はタイミング制御のクロック・パルスＣＰが出力される
。
持つスライス・レベルを数回変化させて画信号ａを走査
すると、下限１ｔｉＱ＋ｚ、上限値Ｑ２２にスライス・
レベルを設定したときに、画信号がこの幅を横切る回数
が最大となる。次に、このスライス・レベル値Ｑ＋ ２
Ｉ Ｑ２ ｙによって画信号ａを走査し、処理部１０
の出力によってゲート回路１１．１２が開かれて、画信
号が上限値Ｑ２２を越えた際の信号をゲート回路１２か
ら２値化画信号Ａ′として出力し、ゲート回路１２から
はタイミング制御のクロック・パルスＣＰが出力される
。
そして以上の動作が完了すると、次のラインの走査を行
ない、再び、上述したような数回のスライス・レベルに
よって計数が行なわれ、最適なスライス・レベルの検出
が同様に行なわれる。
ない、再び、上述したような数回のスライス・レベルに
よって計数が行なわれ、最適なスライス・レベルの検出
が同様に行なわれる。
尚、本発明の実施例にあっては、アナログ画信号を一旦
、ディジタル信号に変換して下限設定値と上限設定値と
の比較を行なったが、第３図に示すように、設定値にヒ
ステリシスを持たせることができるアナログ比較器１３
を用いても同様の効果が得られる。
、ディジタル信号に変換して下限設定値と上限設定値と
の比較を行なったが、第３図に示すように、設定値にヒ
ステリシスを持たせることができるアナログ比較器１３
を用いても同様の効果が得られる。
即ち、処理部１０からの設定値データをディジタル・ア
ナログ変換器１４で変換してアナログ比較器１３に設定
し、この設定値にヒステリシス設定器１５で下限値、上
限値をの幅を設定するようにして、アナログ画信号ａを
入力して２値化画信号Ａ′を出力して計数回路９で計数
し、計数値が最大となる設定値をスライス・レベル値と
しても良い。
ナログ変換器１４で変換してアナログ比較器１３に設定
し、この設定値にヒステリシス設定器１５で下限値、上
限値をの幅を設定するようにして、アナログ画信号ａを
入力して２値化画信号Ａ′を出力して計数回路９で計数
し、計数値が最大となる設定値をスライス・レベル値と
しても良い。
また、設定値である上限値を複数用意してこれらを切り
換えることができるアナログ比較器と、下限値を複数値
有してこれらを切り換えることができるようなアナログ
比較器を用いても良い。
換えることができるアナログ比較器と、下限値を複数値
有してこれらを切り換えることができるようなアナログ
比較器を用いても良い。
以上のように、本発明のスライス・レベル選択回路は、
入力された画信号に対する最適なレベルにスライス・レ
ベルを決定することができる。
入力された画信号に対する最適なレベルにスライス・レ
ベルを決定することができる。
〈発明の効果〉
本発明のスライス・レベル選択回路によれば、イメージ
・センサから出力された画信号を画信号上限設定値と画
信号下限設定値と比較し、この２つの設定値の幅の外側
にある画信号のみを有効とし、２値化信号に変換して変
化数を計数し、この上限設定値と下限設定値をそれぞれ
変化させて、そのときの２値化した信号の計数値が最大
の上限設定値と下限設定値をスライス・レベルとして選
択して次のラインの走査を行なうので、文書、絵等を読
み込む際に、背景に色ムラ等があった際もイメージ・セ
ンサ出力の画信号を２値化信号に変換する際のスライス
・レベルを自動的に選択できるようにすることができ、
誤差の少ないイメージ・センサの２値化変換装置のスラ
イス・レベル選択回路を実現できる。
・センサから出力された画信号を画信号上限設定値と画
信号下限設定値と比較し、この２つの設定値の幅の外側
にある画信号のみを有効とし、２値化信号に変換して変
化数を計数し、この上限設定値と下限設定値をそれぞれ
変化させて、そのときの２値化した信号の計数値が最大
の上限設定値と下限設定値をスライス・レベルとして選
択して次のラインの走査を行なうので、文書、絵等を読
み込む際に、背景に色ムラ等があった際もイメージ・セ
ンサ出力の画信号を２値化信号に変換する際のスライス
・レベルを自動的に選択できるようにすることができ、
誤差の少ないイメージ・センサの２値化変換装置のスラ
イス・レベル選択回路を実現できる。
第１図は本発明の実施例によるスライス・レベル選択回
路のブロック図、第２図は本発明の実施例によるスライ
ス・レベル選択回路の動作を説明するための信号チャー
ト、第３図は本発明の他の実施例によるスライス・レベ
ル選択回路の図である。 １・・・アナログ・ディジタル変換器、２・・・下限比
較器、３・・・上限比較器、４・・・下限値レジスタ、
５・・・上限値レジスタ、６，７・・・ナンド・ゲート
、８・・・セット・リセット・フリップ・フロップ回路
、９・・・計数回路、１０・・・処理部、１１．１２・
・・ゲート回路、１３・・・アナログ比較器、１４・・
・ディジタル・アテログ変換器、１５・・・ヒステリシ
ス設定器。
路のブロック図、第２図は本発明の実施例によるスライ
ス・レベル選択回路の動作を説明するための信号チャー
ト、第３図は本発明の他の実施例によるスライス・レベ
ル選択回路の図である。 １・・・アナログ・ディジタル変換器、２・・・下限比
較器、３・・・上限比較器、４・・・下限値レジスタ、
５・・・上限値レジスタ、６，７・・・ナンド・ゲート
、８・・・セット・リセット・フリップ・フロップ回路
、９・・・計数回路、１０・・・処理部、１１．１２・
・・ゲート回路、１３・・・アナログ比較器、１４・・
・ディジタル・アテログ変換器、１５・・・ヒステリシ
ス設定器。
Claims (1)
- （１）画信号を入力しスライス・レベルが設定されこの
スライス・レベルによって２値化信号を得る変換装置に
おける前記スライス・レベルを決定するスライス・レベ
ル選択回路において、前記画信号と画信号上限設定値と
を比較する上限比較器と、前記画信号と画信号下限設定
値とを比較する下限比較器と、画信号上限設定値と画信
号下限設定値との幅の外側に前記画信号が存在する際に
この状態を検出して記憶する状態検出器と、この状態検
出器からの信号を計数する計数回路と、この計数回路の
計数値が最大になった時の画信号上限設定値と画信号下
限設定値を前記画信号のスライス・レベルと決定する処
理部とを備えるスライス・レベル選択回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60113428A JPS61270911A (ja) | 1985-05-27 | 1985-05-27 | スライス・レベル選択回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60113428A JPS61270911A (ja) | 1985-05-27 | 1985-05-27 | スライス・レベル選択回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61270911A true JPS61270911A (ja) | 1986-12-01 |
Family
ID=14611978
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60113428A Pending JPS61270911A (ja) | 1985-05-27 | 1985-05-27 | スライス・レベル選択回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61270911A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2001278554A (ja) * | 2000-03-29 | 2001-10-10 | Mitsubishi Electric Corp | エレベーターの電磁ブレーキ制御装置 |
-
1985
- 1985-05-27 JP JP60113428A patent/JPS61270911A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2001278554A (ja) * | 2000-03-29 | 2001-10-10 | Mitsubishi Electric Corp | エレベーターの電磁ブレーキ制御装置 |
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