JPS61264405A - シ−ケンス制御装置 - Google Patents
シ−ケンス制御装置Info
- Publication number
- JPS61264405A JPS61264405A JP10580785A JP10580785A JPS61264405A JP S61264405 A JPS61264405 A JP S61264405A JP 10580785 A JP10580785 A JP 10580785A JP 10580785 A JP10580785 A JP 10580785A JP S61264405 A JPS61264405 A JP S61264405A
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- JP
- Japan
- Prior art keywords
- unit
- data
- program
- outside
- section
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明は、プログラマブルシーケンス制御装置に係り、
特忙基本ユニットの入力部と出力部の情報の外部とのや
りとりを行う入出力のカードを1とめてコントロールす
る増設ユニット忙関する。
特忙基本ユニットの入力部と出力部の情報の外部とのや
りとりを行う入出力のカードを1とめてコントロールす
る増設ユニット忙関する。
入力に対して高速応答動作をさせる方法として高速応答
が必要な入出力回路のみにハード構成の論理回路を付随
′:8ぜることにより、本来のシーケンスコントローラ
の処理速度に関係なく、その入出力回路の高速化応答を
可能とするものがある。
が必要な入出力回路のみにハード構成の論理回路を付随
′:8ぜることにより、本来のシーケンスコントローラ
の処理速度に関係なく、その入出力回路の高速化応答を
可能とするものがある。
この方法により入出力の両方を備えた回路に対しては高
速化応答が可能であるが、一般的には入出力回路は別々
のモジュールになっていることが多く、本方法は適用し
にくく、全てノーードで構成されているため、処理を変
更するためにはハード構成を変更する必要がある。
速化応答が可能であるが、一般的には入出力回路は別々
のモジュールになっていることが多く、本方法は適用し
にくく、全てノーードで構成されているため、処理を変
更するためにはハード構成を変更する必要がある。
又、別の例としてシーケンスコントローラの入出力部を
形成するカードにCPUを設けることKより、カードを
高速カウント動作を実行できるように高機能化するもの
がおる。この方法もやはり。
形成するカードにCPUを設けることKより、カードを
高速カウント動作を実行できるように高機能化するもの
がおる。この方法もやはり。
入出力の両方の回路を備えている必要がおり、入力と出
力が別々のモジュールで構成されている場合には適用し
にくく、高速カウントという所定の動作を行うだけに届
1つている〇 なお、特開昭59−62907号、特開昭58−186
804号公報に示しであるものが公知である。
力が別々のモジュールで構成されている場合には適用し
にくく、高速カウントという所定の動作を行うだけに届
1つている〇 なお、特開昭59−62907号、特開昭58−186
804号公報に示しであるものが公知である。
本発明の目的は、増設ユニットのコントローラ部分にイ
ンテリジェント機能を持たせることKより、プログラマ
ブルシーケンス制御装置における外部入力信号に対する
外部出力信号までの応答時間を高速にL−高速応答ので
きるプログラマブルシーケンス制御装置を提供すること
Kある。
ンテリジェント機能を持たせることKより、プログラマ
ブルシーケンス制御装置における外部入力信号に対する
外部出力信号までの応答時間を高速にL−高速応答ので
きるプログラマブルシーケンス制御装置を提供すること
Kある。
本発明では増設ユニットのコントローラ部に演算部とそ
の演算部を制御するためのプログラムエリアを付加し基
本ユニットよりのデータを外部に伝える一方、外部から
のデータを基本ユニットへ伝え、さらに、コントローラ
部内部でも必要に応じて演算を行ない、データを外部へ
出力するととKより、高速応答ができるようにした。
の演算部を制御するためのプログラムエリアを付加し基
本ユニットよりのデータを外部に伝える一方、外部から
のデータを基本ユニットへ伝え、さらに、コントローラ
部内部でも必要に応じて演算を行ない、データを外部へ
出力するととKより、高速応答ができるようにした。
〔発明の実施例コ
以下本発明の図に示す実施例圧ついて説明する。
基本ユニット8はプロセスの制御手順を表わす複数の命
令によるプログラムを記憶する記憶部8aと、順次プロ
グラムを読み出してサイクリックに実行する演算部8b
と、プロセスの制御に必要な情報を外部より取り込む入
力部8Cと、プログラムを実行することにより得られる
演算結果を外部へ出力する出力部8dとを有している〇
増設ユニット3においてコントローラ部は通常、基本ユ
ニット8よりのデータを外部工10%ジュール10a−
10hに伝送したり、逆に、外部工10よりのデータを
読み取り、基本ユニット8へそのデータを転送する。
令によるプログラムを記憶する記憶部8aと、順次プロ
グラムを読み出してサイクリックに実行する演算部8b
と、プロセスの制御に必要な情報を外部より取り込む入
力部8Cと、プログラムを実行することにより得られる
演算結果を外部へ出力する出力部8dとを有している〇
増設ユニット3においてコントローラ部は通常、基本ユ
ニット8よりのデータを外部工10%ジュール10a−
10hに伝送したり、逆に、外部工10よりのデータを
読み取り、基本ユニット8へそのデータを転送する。
増設ユニットコントローラ部1K、データの一時受は渡
し用のデータ記憶部としてのRAM2と、増設ユニット
3内のデータの転送を行うマイクロプロセッサ4と、そ
の制御プログラムを格納したプログラム記憶部としての
ROM5を全てまとめた、シングルチップマイコン6を
設ける。増設ユニット3内のコントローラ7は、基本ユ
ニット8よりのデータをRAMに書き込むととにより外
部出力データの転送を終了し、外部入力のデータはこの
RAM2よりデータを読みとり、基本ユニット8へ転送
する。実際の外部とのデータのやりとりは、このRAM
2の内容を新忙付加されたマイクロプロセッサ4が転送
することにより出力を行い、RAM2に書き込むことに
より入力データの転送を行う。これらの動作を周期的に
行ないながら、ユーザが作成したプログラムをユーザー
プログラム記憶部としてのROM9から読み出し外部I
10モジュール10a〜10hの状態に従い演算を行な
い、その結果を、基本ユニット8の処理より早く外部出
力へ出力する。
し用のデータ記憶部としてのRAM2と、増設ユニット
3内のデータの転送を行うマイクロプロセッサ4と、そ
の制御プログラムを格納したプログラム記憶部としての
ROM5を全てまとめた、シングルチップマイコン6を
設ける。増設ユニット3内のコントローラ7は、基本ユ
ニット8よりのデータをRAMに書き込むととにより外
部出力データの転送を終了し、外部入力のデータはこの
RAM2よりデータを読みとり、基本ユニット8へ転送
する。実際の外部とのデータのやりとりは、このRAM
2の内容を新忙付加されたマイクロプロセッサ4が転送
することにより出力を行い、RAM2に書き込むことに
より入力データの転送を行う。これらの動作を周期的に
行ないながら、ユーザが作成したプログラムをユーザー
プログラム記憶部としてのROM9から読み出し外部I
10モジュール10a〜10hの状態に従い演算を行な
い、その結果を、基本ユニット8の処理より早く外部出
力へ出力する。
以上により、従来では外部入力信号を基本ユニットへ伝
送しその基本ユニット8内の処理結果に従い外部への出
力信号を出力していたため、外部人力に対する応答に時
間を要していた力(本発明忙より、外部入力信号を基本
ユニット8へ伝送することと平行して増設ユニット内で
も演算を行表いその結果を外部へ出力するため、従来万
式に比較して、外部入力信号に対する応答が高速になる
O 〔発明の効果〕 本発明によれは、外部の入力信号に対して、高速に外部
へ出力信号を出すという高速応答が可能となり、さらに
高速応答を行なうユーザープログラムを基本ユニットと
は別に持つため、基本ユニットにおけるプログラムが簡
易化する。そして、プログラムが短かくなることKより
基本ユニットでのプログラム処理に要する時間が短縮さ
れ、プログラマブルシーケンス制御kfi1全体として
のスルーブツトが向上する等の効果がある。
送しその基本ユニット8内の処理結果に従い外部への出
力信号を出力していたため、外部人力に対する応答に時
間を要していた力(本発明忙より、外部入力信号を基本
ユニット8へ伝送することと平行して増設ユニット内で
も演算を行表いその結果を外部へ出力するため、従来万
式に比較して、外部入力信号に対する応答が高速になる
O 〔発明の効果〕 本発明によれは、外部の入力信号に対して、高速に外部
へ出力信号を出すという高速応答が可能となり、さらに
高速応答を行なうユーザープログラムを基本ユニットと
は別に持つため、基本ユニットにおけるプログラムが簡
易化する。そして、プログラムが短かくなることKより
基本ユニットでのプログラム処理に要する時間が短縮さ
れ、プログラマブルシーケンス制御kfi1全体として
のスルーブツトが向上する等の効果がある。
図は高速応答のできる増設ユニットの例t″ちる。
1はコントローラ部、2は共通RAM、3は増設ユニッ
ト、4はマイクロプロセッサ、5はシステム用ROM、
6はシングルチップマイコン、7は増設コントロール用
工C18は基本ユニット、8aは記憶部、8bは演算部
、8Cは入力部8dは出力瓢 9はユーザ用ROM、1
0a 〜10hは工10モジュール
ト、4はマイクロプロセッサ、5はシステム用ROM、
6はシングルチップマイコン、7は増設コントロール用
工C18は基本ユニット、8aは記憶部、8bは演算部
、8Cは入力部8dは出力瓢 9はユーザ用ROM、1
0a 〜10hは工10モジュール
Claims (1)
- プロセスの制御手順を表わす複数の命令によるプログラ
ムを記憶する記憶部と、順次プログラムを読み出してサ
イクリックに実行する演算部と、プロセスの制御に必要
な情報を外部より取り込む入力部と、プログラムを実行
することにより得られる演算結果を外部へ出力する出力
部とからなる基本ユニットと、入力部へ伝える情報を外
部より入力し、出力部よりの情報を外部へ出力する増設
ユニットとを有するものにおいて、増設ユニット内に入
力部へ伝える情報と、出力部よりの情報を一時的に記憶
するデータ記憶部と、入力部への情報を外部より取り込
みデータ記憶部へ記憶させ、出力部よりのデータをデー
タ記憶部より外部へ出力するマイクロプロセッサーと、
マイクロプロセッサーを制御するためのプログラムを記
憶するプログラム記憶部と、ユーザがプログラムしたプ
ログラムを記憶するユーザプログラム記憶部とを持ち、
外部入力に対して、基本ユニットで処理を行わずに、増
設ユニット側で応答を行うことを特徴とするシーケンス
制御装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP10580785A JPS61264405A (ja) | 1985-05-20 | 1985-05-20 | シ−ケンス制御装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP10580785A JPS61264405A (ja) | 1985-05-20 | 1985-05-20 | シ−ケンス制御装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS61264405A true JPS61264405A (ja) | 1986-11-22 |
Family
ID=14417376
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP10580785A Pending JPS61264405A (ja) | 1985-05-20 | 1985-05-20 | シ−ケンス制御装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS61264405A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO1989001656A1 (en) * | 1987-08-12 | 1989-02-23 | Fanuc Ltd | High-speed input/output module and plc apparatus |
CN103984258A (zh) * | 2014-03-31 | 2014-08-13 | 广东顺德伯纳德数控设备有限公司 | 基于单片机开发的工业自动化控制方法及系统 |
-
1985
- 1985-05-20 JP JP10580785A patent/JPS61264405A/ja active Pending
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO1989001656A1 (en) * | 1987-08-12 | 1989-02-23 | Fanuc Ltd | High-speed input/output module and plc apparatus |
CN103984258A (zh) * | 2014-03-31 | 2014-08-13 | 广东顺德伯纳德数控设备有限公司 | 基于单片机开发的工业自动化控制方法及系统 |
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