JPS61263129A - 半導体製造装置 - Google Patents

半導体製造装置

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Publication number
JPS61263129A
JPS61263129A JP10442085A JP10442085A JPS61263129A JP S61263129 A JPS61263129 A JP S61263129A JP 10442085 A JP10442085 A JP 10442085A JP 10442085 A JP10442085 A JP 10442085A JP S61263129 A JPS61263129 A JP S61263129A
Authority
JP
Japan
Prior art keywords
wafer
lower electrode
etching
gear
turntable
Prior art date
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Pending
Application number
JP10442085A
Other languages
English (en)
Inventor
Tatsuo Akiyama
秋山 龍雄
Yutaka Etsuno
越野 裕
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Toshiba Corp
Original Assignee
Toshiba Corp
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Filing date
Publication date
Application filed by Toshiba Corp filed Critical Toshiba Corp
Priority to JP10442085A priority Critical patent/JPS61263129A/ja
Publication of JPS61263129A publication Critical patent/JPS61263129A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/302Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to change their surface-physical characteristics or shape, e.g. etching, polishing, cutting

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 ハ(半導体基板)止め810.膜等を均一にエツチング
するRIB (Reactive Ion Etchi
ng )装置に係わる。
〔発明の技術的背景〕
従来、RIE装置は1図示しないがガス導入口、排出口
を有したエツチング室、このエツチング室内に設けられ
た複数のウェハを載置するターンテーブル、電極及び高
周波電源等から構成されている。こうした構造のRIR
ffl置において、ターンテーブルは同一方向に回転す
るようになっている。
〔背景技術の問題点〕
しかしながら、従来のRIB装置において、ウェハはタ
ーンテーブル上に該テーブルの円周部に沿ってセットさ
れる。しかるに、ターンテーブルのみが一方向に回転す
るのみであるから、同じウェハでもターンテーブルの周
辺部端に位置する方が、ターンテーブルの中心部に位置
する方よりもエツチングレートが速いという問題を有す
る。
〔発明の目的〕
本発明は上記事情に鑑みてなされたもので、ウェハを自
転することにより、エツチングばらつきを低減し得る半
導体製造装置を提供することを目的とする。
〔発明の概要〕
本発明は、ガス導入口及び排出口を設けたエツチング室
と、このエツチング室内に回転可能に設けられ、ウェハ
を載置しかつ下部電極を兼ねる機能を有したターンテー
ブルと、前記エツチング室内でかつターンテーブルの上
方に設けられた上部電極と、高周波電源とを具備する半
導体製造装置において、ウェハが自転することを特徴と
するもので、これによりウニ八面内におけるエツチング
レートをできるだけ均一化し、エツチングばらつきを低
減することを骨子とする。
〔発明の実施例〕
以下、本発明の一実施例を第1図及び第2図を参照して
説明する。ここで、第2図は第1図のRID装置のター
ンテーブルの平面図である。
図中の1はエツチング室である。このエツチング室1内
には、下部電極を兼ねたターンテーブル2が設けられて
いる。このターンテーブル2は、下部電極部3と、複数
の円盤状のフェノ−載置部4と、これらウェハ載置部4
を支持するテーブル本体5とから構成される。ここで、
前記下部電極部3の上部は円盤状をなし、その周側面に
はギア6を設け、下側は軸となって高周波電源(RF)
7に接続されている。前記ウェハ載置部4の周側面には
ギア8が設けられ、前記下部電極部3のギア6、及びテ
ーブル本体5のギア9と噛合されている。前記エツチン
グ室1内でターンテーブル2の上方には、上部電極1o
が設けられている。前記エツチング室1の側壁及び下部
には、夫々ガス導入口1ノ、ガス排出口12が設けられ
ている。
しかして、本発明のRIB装置によれば、ターンテーブ
ル2を構成する下部電極部3、ウェハ載置部4及びテー
ブル本体5の夫々にギア6゜8.9を設けた構造となっ
ている。従って、下部電極部3が矢印Aの方向に回転す
ると、ウェハ載置部4がギア6.8を夫々介して矢印B
方向に回転すると同時に、ウェハ載置部4゛も自転して
、ウェハが自転する。その結果、エツチングばらつきを
従来と比べ著しく低減できる。
事実、シリコン基板上にStO,膜を形成し、これを上
記装置及び従来装置を用いて CF420@ccm、H22accm 、圧力10Pa
 。
パワー300Wの条件で10分間エツチングしたところ
、第3図に示すウェハ面内のばらつき特性図を得た。な
お、第3図において、○印は本発明装置による場合を、
X印は従来装置による場合を夫々示す。同図よシ、本発
明が従来と比べ5tO2膜のエツチング量が狭い範囲に
分布していることが明らかである。
〔発明の効果〕
以上詳述した如く本発明によれば、従来と比ベエッチン
グばらつきを低減しえる信頼性の高い半導体製造装置を
提供できる。
【図面の簡単な説明】
第1図は本発明の一実施例に係るRIE vc置の説明
図、第2図は同装置のターンテーブルの平面図、第3図
は従来及び本発明のRIE装置によるS10.膜のエツ
チング量とサンプル数との関係を示す特性図である。 1・・・エツチング室、2川ターンテーブル、3・・・
下部電極部、4・・・ウェハ載置部、5・・・テーブル
本体、6,8.9・・・ギア、7・・・高周波電源、1
0・・・上部電極、1ノ・・・ガス導入口、J2・・・
yx排出口。 出願人代理人  弁理士 鈴 江 武 彦・第1図 第2図 第3図

Claims (1)

    【特許請求の範囲】
  1. ガス導入口及び排出口を設けたエッチング室と、このエ
    ッチング室内に回転可能に設けられ、ウェハを載置しか
    つ下部電極を兼ねる機能を有したターンテーブルと、前
    記エッチング室内でかつターンテーブルの上方に設けら
    れた上部電極と、高周波電源とを具備する半導体製造装
    置において、ウェハが自転することを特徴とする半導体
    製造装置。
JP10442085A 1985-05-16 1985-05-16 半導体製造装置 Pending JPS61263129A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP10442085A JPS61263129A (ja) 1985-05-16 1985-05-16 半導体製造装置

Applications Claiming Priority (1)

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JP10442085A JPS61263129A (ja) 1985-05-16 1985-05-16 半導体製造装置

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Publication Number Publication Date
JPS61263129A true JPS61263129A (ja) 1986-11-21

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ID=14380199

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JP10442085A Pending JPS61263129A (ja) 1985-05-16 1985-05-16 半導体製造装置

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