JPS61258436A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
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- JPS61258436A JPS61258436A JP60100808A JP10080885A JPS61258436A JP S61258436 A JPS61258436 A JP S61258436A JP 60100808 A JP60100808 A JP 60100808A JP 10080885 A JP10080885 A JP 10080885A JP S61258436 A JPS61258436 A JP S61258436A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は半導体装置の製造方法に関し、特に樹脂封止型
半導体装置の表面保護用内部樹脂膜の形成方法に関する
。
半導体装置の表面保護用内部樹脂膜の形成方法に関する
。
従来、半導体装置は、組立工程において、半導体素子鷺
所定の支持体上に接着し、半導体素子上の各電極パッド
部を外部リードに金属#1線で結線したのち、前記半導
体素子の表面を表面保護用樹脂(以下表面コート材と略
す)で被膜を形成する場合がある。このような被膜を形
成する方法として、樹脂を棒状又は管状の治具を用いて
滴下する方法が一般に用いらnている。
所定の支持体上に接着し、半導体素子上の各電極パッド
部を外部リードに金属#1線で結線したのち、前記半導
体素子の表面を表面保護用樹脂(以下表面コート材と略
す)で被膜を形成する場合がある。このような被膜を形
成する方法として、樹脂を棒状又は管状の治具を用いて
滴下する方法が一般に用いらnている。
上述した従来の塗布法(滴下法)は半導体素子が小さい
場合には有効であり、かつ吐出装置のコントロールも容
易であるが、半導体素子が大型化するにつれて、形成さ
れる樹脂膜に様々な問題が発生する。例えば、第2図に
示すように、表面コート材4を吐出する管状の治具(シ
リン?と称す)5の先端部(ニードルと称す)が半導体
素子1の轡面の中央上部に正確に位置されていなり場合
、そのニードルが半導体素子の表面に対して垂直になっ
ていない場合、また、半導体素子の表面が水平でない場
合等により、表面コート材が均等な厚さで均一な膜4を
得られないことが多い1.(第2図山))。その上表面
コート材の粘度、比重、半導体素子の表面との濡れ性、
吐出条件等によっても要求される塗布面を覆うことが難
しくなりてくる。
場合には有効であり、かつ吐出装置のコントロールも容
易であるが、半導体素子が大型化するにつれて、形成さ
れる樹脂膜に様々な問題が発生する。例えば、第2図に
示すように、表面コート材4を吐出する管状の治具(シ
リン?と称す)5の先端部(ニードルと称す)が半導体
素子1の轡面の中央上部に正確に位置されていなり場合
、そのニードルが半導体素子の表面に対して垂直になっ
ていない場合、また、半導体素子の表面が水平でない場
合等により、表面コート材が均等な厚さで均一な膜4を
得られないことが多い1.(第2図山))。その上表面
コート材の粘度、比重、半導体素子の表面との濡れ性、
吐出条件等によっても要求される塗布面を覆うことが難
しくなりてくる。
このような樹脂膜の不完全さや個々のバラツキは、第2
図(C)に示す樹脂7によりトランスファモールドした
後、当然のごとく半導体装置の特性劣化や工程不良を誘
発し、更には市場不良に迄発展しかねない重大な問題を
有している。
図(C)に示す樹脂7によりトランスファモールドした
後、当然のごとく半導体装置の特性劣化や工程不良を誘
発し、更には市場不良に迄発展しかねない重大な問題を
有している。
本発明の目的は、半導体素子の表面に定量・等厚・均一
な樹脂膜を得る製造方法を開発し、高品質・高信頼性の
半導体装置を提供することである。
な樹脂膜を得る製造方法を開発し、高品質・高信頼性の
半導体装置を提供することである。
本発明の着目点は、既に金属細線で結線(ボンディング
と称す)された半導体素子の電極パッドの配置と金属細
線のループ形状にある。電極パッドは半導体素子の表面
の外周4辺のうち、少なくとも2辺の近傍に1列に並ん
で配置されており、他方、金属細線はこの工程中で半導
体装置の上部に位置して、電極パッドに接続されている
。この2点をうまく表面コートに利用できないかと検討
した結果、金属細線を下向きになる様に裏返し、金属細
線の上部(この時は下部)だけを表面コート材に浸漬し
、その後光に戻し放置して要求される樹脂膜を得ること
を特徴とする製造方法を見い出した。
と称す)された半導体素子の電極パッドの配置と金属細
線のループ形状にある。電極パッドは半導体素子の表面
の外周4辺のうち、少なくとも2辺の近傍に1列に並ん
で配置されており、他方、金属細線はこの工程中で半導
体装置の上部に位置して、電極パッドに接続されている
。この2点をうまく表面コートに利用できないかと検討
した結果、金属細線を下向きになる様に裏返し、金属細
線の上部(この時は下部)だけを表面コート材に浸漬し
、その後光に戻し放置して要求される樹脂膜を得ること
を特徴とする製造方法を見い出した。
上述の工程の次に半導体装置はトランスファーモールド
樹脂成型を行なうことを特徴としている。
樹脂成型を行なうことを特徴としている。
以上、実施例によって、本発明を説明する。
第1図は本発明による半導体装置の製造方法を(&)〜
(・)の順に示したものである、(a)において、半導
体素子1は、既1【リードフレーム2の所定の位置に載
置(ダイ・ボンド)され、金属配線3によって、半導体
素子1の電極パッド(図示せず)とリードフレーム2の
間が(ワイヤー)ボンディングされていて、金属細線3
が下向きになる様に裏返される。次に0)において、表
面コート材4の入った容器5の中に、少なくとも金属細
線3の上部が表面コート材4に浸る様にディッピング(
dipp−ing)を行なう。その後(e)で、元の向
きに戻すと、金属細線3の上部に付着した表面コート材
4は、それ自身の重みで、金属細線3に沿って流下する
方向6ヘシに移動する。尚では2表面コート材4が既に
流れ落ちた状態を示す。図では、金属細線3と半導体素
子10表面の両方共表面コート材4で覆われているが、
表面コート材4の粘度、比重によっては、そのどちらか
一方の場合もあり得る。(e)に至って、トランス7ア
モールド樹脂7で樹脂成形を行なって次の工程へ続くこ
とになる。
(・)の順に示したものである、(a)において、半導
体素子1は、既1【リードフレーム2の所定の位置に載
置(ダイ・ボンド)され、金属配線3によって、半導体
素子1の電極パッド(図示せず)とリードフレーム2の
間が(ワイヤー)ボンディングされていて、金属細線3
が下向きになる様に裏返される。次に0)において、表
面コート材4の入った容器5の中に、少なくとも金属細
線3の上部が表面コート材4に浸る様にディッピング(
dipp−ing)を行なう。その後(e)で、元の向
きに戻すと、金属細線3の上部に付着した表面コート材
4は、それ自身の重みで、金属細線3に沿って流下する
方向6ヘシに移動する。尚では2表面コート材4が既に
流れ落ちた状態を示す。図では、金属細線3と半導体素
子10表面の両方共表面コート材4で覆われているが、
表面コート材4の粘度、比重によっては、そのどちらか
一方の場合もあり得る。(e)に至って、トランス7ア
モールド樹脂7で樹脂成形を行なって次の工程へ続くこ
とになる。
第2図、は従来技術による製造方法を示したものテ(a
)4(オい゛て半導体素子1はリードフレーム2の所定
位置にダイボンドされ、金属細線3でワイヤーボンディ
ングされていて、表面コート材4は吐出治具5により滴
下される。伽)は、滴下後の状態を示すもので、表面コ
ート材4は、半導体素子10表面と金属細線4を覆って
いるが膜の形状は良 −くない。(e)でトランスファ
ーモールド樹脂成形を行ない、次工程へ流nることにな
る。
)4(オい゛て半導体素子1はリードフレーム2の所定
位置にダイボンドされ、金属細線3でワイヤーボンディ
ングされていて、表面コート材4は吐出治具5により滴
下される。伽)は、滴下後の状態を示すもので、表面コ
ート材4は、半導体素子10表面と金属細線4を覆って
いるが膜の形状は良 −くない。(e)でトランスファ
ーモールド樹脂成形を行ない、次工程へ流nることにな
る。
以上説明したように本発明は、表面コート材4を金属細
線3にディッピングして、滴下させる方法を採るために
、半導体素子10表面の周囲(電極パッド複数)から、
表面コート材4が供給されることにより、表面コート材
の拡がりがよく、か、り均一な膜が得られる効果がある
。更に表面コート材の粘度を溶剤等で調整すれば、従来
法よりも簡便に薄膜コートが可能になる。また、表面コ
ート材4の量は、浸漬する深さや回数を変更することに
より充分に対応がとれる本のである。他に、金属細線3
も表面コート材4で覆わnるため、表面コート法につき
屯のの温度サイクルによるワイヤーオープンも防ぐこと
ができ、かつ、金属細線の腐蝕が抑えらnるので、細線
の卑金属化も実現可能となる点が望める。
線3にディッピングして、滴下させる方法を採るために
、半導体素子10表面の周囲(電極パッド複数)から、
表面コート材4が供給されることにより、表面コート材
の拡がりがよく、か、り均一な膜が得られる効果がある
。更に表面コート材の粘度を溶剤等で調整すれば、従来
法よりも簡便に薄膜コートが可能になる。また、表面コ
ート材4の量は、浸漬する深さや回数を変更することに
より充分に対応がとれる本のである。他に、金属細線3
も表面コート材4で覆わnるため、表面コート法につき
屯のの温度サイクルによるワイヤーオープンも防ぐこと
ができ、かつ、金属細線の腐蝕が抑えらnるので、細線
の卑金属化も実現可能となる点が望める。
第1図は本発明の半導体装置の製造方法を示す各断面図
、第2図は従来技術による半導体装置の製造方法を示す
各断面図である。 1・・・・・・半導体素子、2・・・・・・リードフレ
ーム、3・・・・・・金属細線、4・・・・・・表面コ
ート材、5・・・・・・容器、6・・・・・・金属細線
に沿って流下する方向、7・・・・・・トランスファー
モールド樹脂。
、第2図は従来技術による半導体装置の製造方法を示す
各断面図である。 1・・・・・・半導体素子、2・・・・・・リードフレ
ーム、3・・・・・・金属細線、4・・・・・・表面コ
ート材、5・・・・・・容器、6・・・・・・金属細線
に沿って流下する方向、7・・・・・・トランスファー
モールド樹脂。
Claims (1)
- 表面保護用樹脂を半導体素子に塗布する方法において、
金属細線が下向きになる様に該半導体装置を浸漬した後
、裏返して樹脂膜を形成する工程に加え、該半導体装置
を覆うトランスファーモールド樹脂成型する工程を設け
たことを特徴とする半導体装置の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60100808A JPS61258436A (ja) | 1985-05-13 | 1985-05-13 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60100808A JPS61258436A (ja) | 1985-05-13 | 1985-05-13 | 半導体装置の製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS61258436A true JPS61258436A (ja) | 1986-11-15 |
Family
ID=14283669
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP60100808A Pending JPS61258436A (ja) | 1985-05-13 | 1985-05-13 | 半導体装置の製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS61258436A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5096851A (en) * | 1988-05-19 | 1992-03-17 | Semiconductor Energy Laboratory Co., Ltd. | Method of packaging an electronic device using a common holder to carry the device in both a cvd and molding step |
EP1594165A2 (de) * | 2004-05-04 | 2005-11-09 | Semikron Elektronik GmbH & Co. KG Patentabteilung | Verfahren zur elektrischen Isolation eines Substrats für ein Leistungsmodul |
-
1985
- 1985-05-13 JP JP60100808A patent/JPS61258436A/ja active Pending
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5096851A (en) * | 1988-05-19 | 1992-03-17 | Semiconductor Energy Laboratory Co., Ltd. | Method of packaging an electronic device using a common holder to carry the device in both a cvd and molding step |
EP1594165A2 (de) * | 2004-05-04 | 2005-11-09 | Semikron Elektronik GmbH & Co. KG Patentabteilung | Verfahren zur elektrischen Isolation eines Substrats für ein Leistungsmodul |
EP1594165A3 (de) * | 2004-05-04 | 2007-06-27 | Semikron Elektronik GmbH & Co. KG Patentabteilung | Verfahren zur elektrischen Isolation eines Substrats für ein Leistungsmodul |
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