JPS6125602U - シ−ケンサ - Google Patents
シ−ケンサInfo
- Publication number
- JPS6125602U JPS6125602U JP5109684U JP5109684U JPS6125602U JP S6125602 U JPS6125602 U JP S6125602U JP 5109684 U JP5109684 U JP 5109684U JP 5109684 U JP5109684 U JP 5109684U JP S6125602 U JPS6125602 U JP S6125602U
- Authority
- JP
- Japan
- Prior art keywords
- data
- output
- control
- input
- address
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第1図は本考案の基本的構成図、第2図は本考案の一実
施例のシーケンサとその周辺装置との概略構成を示すブ
ロック図、第3図は■/○RAMコントローラの一例を
示す概略回路図、第4図は実施例シーケンサの制両の一
例を示すフ0−チャート、第5図AはI/Oリード・ラ
イトストローブIORD,IOWTとインヒビット信号
INHとのタイミングを説明ザるタイムチャート、第5
図BはI/Oリード・ライトストローブIORD,IO
WTと無効信号INEFとのタイミングを説明するタイ
ムチャ・一ト、第6図Aは許可手段のもうひとつの回路
例を示す回路図、第6図Bはその動作を説明するタイム
チャートである。 1・・・シーケンサ、3・・・データロガー、10・・
・cpu,16・・・入力回路、18・・・出力回路、
2o・・・I/OR#へ 22・・・I/ORAMコン
トローラ、94.102・・・単安定マルチパイブレー
ク、330・・・D型フリツブフロツフ。
施例のシーケンサとその周辺装置との概略構成を示すブ
ロック図、第3図は■/○RAMコントローラの一例を
示す概略回路図、第4図は実施例シーケンサの制両の一
例を示すフ0−チャート、第5図AはI/Oリード・ラ
イトストローブIORD,IOWTとインヒビット信号
INHとのタイミングを説明ザるタイムチャート、第5
図BはI/Oリード・ライトストローブIORD,IO
WTと無効信号INEFとのタイミングを説明するタイ
ムチャ・一ト、第6図Aは許可手段のもうひとつの回路
例を示す回路図、第6図Bはその動作を説明するタイム
チャートである。 1・・・シーケンサ、3・・・データロガー、10・・
・cpu,16・・・入力回路、18・・・出力回路、
2o・・・I/OR#へ 22・・・I/ORAMコン
トローラ、94.102・・・単安定マルチパイブレー
ク、330・・・D型フリツブフロツフ。
Claims (1)
- 【実用新案登録請求の範囲】 1 制御対象の状態を示す状態データを入力する入力手
段と、 制御対象を制御する制御データを出力する出力手段と、 前記入力手段を介して入力された前記状態データに基づ
いて、前記出力手段を介して制御対象に制御データを出
力する制御手段と、 を備えるシーケンサにおいて、 制御手段に対して入力手段・出力手段と同じアドレス空
間に割付けられ、そのアドレスの一部が入力手段もしく
は出力手段のアドレスと重なっており、制御手段によっ
て読み書き可能な記憶手段と、 前記制御手段が入力手段もしくは出力手段を介して前記
状態データもしくは制御データの入・出力を行なう毎に
、該データと同一のデータを、入・出力が行なわれる入
力手段もしくは出力手段のアドレスと対応する記憶手段
のアドレスに書き込むデータ書き込み手段と、 前記制御手段が前記記憶手段に記憶されたデータの内容
を変更しない期間を検出して、該記憶手段へのデータの
入出力を外部機器に許可する許可手段と、 前記記憶手段への外部機器からの読み出し・書き込み制
御信号を入力して、外部機器と該記憶手段とのデータの
入出力を行なうデータ入出力手段と、 を備えたことを特徴とするシーケンサ。 2 制御手段が記憶手段に記憶されたデータの内容を変
更しない期間が、制御手段が入力手段、出力手段あるい
は記憶手段を読み書きしていない期間、および入力手段
を介して読みとった制御対象の状態データに変化がなく
出力される制御データがそれ以前の制御データと同一で
ある場合の制御データ出力期間である実用新案登録請求
の範囲第1項記載のシーケンサ。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5109684U JPS6125602U (ja) | 1984-04-06 | 1984-04-06 | シ−ケンサ |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5109684U JPS6125602U (ja) | 1984-04-06 | 1984-04-06 | シ−ケンサ |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6125602U true JPS6125602U (ja) | 1986-02-15 |
Family
ID=30569834
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP5109684U Pending JPS6125602U (ja) | 1984-04-06 | 1984-04-06 | シ−ケンサ |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6125602U (ja) |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5769309A (en) * | 1980-10-13 | 1982-04-28 | Omron Tateisi Electronics Co | Programmable logic controller |
JPS5840619A (ja) * | 1981-09-04 | 1983-03-09 | Hitachi Ltd | シ−ケンスコントロ−ラおよびその制御方法 |
-
1984
- 1984-04-06 JP JP5109684U patent/JPS6125602U/ja active Pending
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5769309A (en) * | 1980-10-13 | 1982-04-28 | Omron Tateisi Electronics Co | Programmable logic controller |
JPS5840619A (ja) * | 1981-09-04 | 1983-03-09 | Hitachi Ltd | シ−ケンスコントロ−ラおよびその制御方法 |
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