JPS61251154A - 半導体基板に絶縁体充填分離溝を形成する方法 - Google Patents
半導体基板に絶縁体充填分離溝を形成する方法Info
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- H01L21/76—Making of isolation regions between components
- H01L21/762—Dielectric regions, e.g. EPIC dielectric isolation, LOCOS; Trench refilling techniques, SOI technology, use of channel stoppers
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- Y10S430/00—Radiation imagery chemistry: process, composition, or product thereof
- Y10S430/167—X-ray
- Y10S430/168—X-ray exposure process
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
A、産業上の利用分野
本発明は半導体の領域を絶縁するために絶縁材料を充填
した半導体ウェハの表面中の溝の形成に関する。
した半導体ウェハの表面中の溝の形成に関する。
B、開示の概要
本発明に従う、半導体の基板中に絶縁材料を充填した溝
を形成する方法は基板及び溝を光重合体層で被覆する段
階を含む、使用される放射線の型に依存して、光重合体
層は充填溝の真上の領域を除きマスクされる。この構造
体はマスクを介して放射線に露光され、次にマスクが除
去される。光重合体層の非露光部分は洗浄によって除去
される。
を形成する方法は基板及び溝を光重合体層で被覆する段
階を含む、使用される放射線の型に依存して、光重合体
層は充填溝の真上の領域を除きマスクされる。この構造
体はマスクを介して放射線に露光され、次にマスクが除
去される。光重合体層の非露光部分は洗浄によって除去
される。
次に徐々に熱を与えて、残った光重合体を溝中に収縮さ
せ、光重合体を半導体の基板の表面と同一平面にする。
せ、光重合体を半導体の基板の表面と同一平面にする。
放射線が紫外線である時は、マスクが使用されるが、電
子ビームもしくはX線が使用される時はマスクは使用さ
れない。
子ビームもしくはX線が使用される時はマスクは使用さ
れない。
C0従来技術
半導体の絶縁溝を充填するための一般に知られている技
術は全チップ領域を充填材料で一様に付着する段階を含
み、従って溝の外側の余分の材料を除去するバック・エ
ツチングを必要とする。バック・エツチングは時間がか
かり、高価で及び制御が困難である。
術は全チップ領域を充填材料で一様に付着する段階を含
み、従って溝の外側の余分の材料を除去するバック・エ
ツチングを必要とする。バック・エツチングは時間がか
かり、高価で及び制御が困難である。
従来技法の例は次の文献に見出される。
米国特許第4385975号は溝中に化学蒸着した2酸
化ケイ素の広いプラグを形成し、化学蒸着によって残り
の非充填溝部分の基板上に2酸化ケイ素の層を充填し、
この層をエッチ・バックする事によってケイ素半導体基
板の表面に広い深い絶縁体充填分離用溝を形成する方法
を開示している。この方法は化学的に純粋な、平坦で広
くて深い絶縁体充填溝を形成し、又同時に狭くて深い絶
縁体充填溝を形成している。
化ケイ素の広いプラグを形成し、化学蒸着によって残り
の非充填溝部分の基板上に2酸化ケイ素の層を充填し、
この層をエッチ・バックする事によってケイ素半導体基
板の表面に広い深い絶縁体充填分離用溝を形成する方法
を開示している。この方法は化学的に純粋な、平坦で広
くて深い絶縁体充填溝を形成し、又同時に狭くて深い絶
縁体充填溝を形成している。
米国特許第4307180号はケイ素基板の表面上に絶
縁層(sio、)を形成し、Sin、層上に多結晶のケ
イ素の相対的に厚い層を付着し、多結晶層及びSin、
層を通って基板中に達する開孔を形成して溝を形成し、
基板の表面上に溝を充填するのに十分な深さに絶縁材料
の層を蒸着して溝をうめ、絶縁材料の層上に平坦化層を
付着し、平坦化層、絶縁材料の層、及び多結晶層を反応
性イオン・エツチングし、残りの多結晶ケイ素の層を選
択的に除去してSun、層を露出することにより、基板
の表面を平坦にする方法を開示している。
縁層(sio、)を形成し、Sin、層上に多結晶のケ
イ素の相対的に厚い層を付着し、多結晶層及びSin、
層を通って基板中に達する開孔を形成して溝を形成し、
基板の表面上に溝を充填するのに十分な深さに絶縁材料
の層を蒸着して溝をうめ、絶縁材料の層上に平坦化層を
付着し、平坦化層、絶縁材料の層、及び多結晶層を反応
性イオン・エツチングし、残りの多結晶ケイ素の層を選
択的に除去してSun、層を露出することにより、基板
の表面を平坦にする方法を開示している。
米国特許第4016017号は半導体の絶縁領域として
その一方の主表面迄のびる酸化された高密度の多孔性領
域のパターンを有する半導体装置を製造する方法を開示
している。この方法はケイ素ウェハの如き半導体基板の
表面に形成される半導体装置の間に絶縁隔離部が望まれ
ている領域に多孔性のケイ素領域を形成する。多孔性ケ
イ素は次にこれを完全に酸化するに十分な温度で酸化さ
れる。酸化の結果、酸化した多孔性ケイ素が半導体ウェ
ハの表面上に突出する。酸化多孔性ケイ素領域は次に前
の段階に使用した酸化温度よりも高い温度にさらされ、
酸化多孔性ケイ素領域の高密度化が行われる。この高密
度化段階の結果多孔性酸化物が崩壊して稠密な、半導体
ウニへの表面に略一致する構造体になる。
その一方の主表面迄のびる酸化された高密度の多孔性領
域のパターンを有する半導体装置を製造する方法を開示
している。この方法はケイ素ウェハの如き半導体基板の
表面に形成される半導体装置の間に絶縁隔離部が望まれ
ている領域に多孔性のケイ素領域を形成する。多孔性ケ
イ素は次にこれを完全に酸化するに十分な温度で酸化さ
れる。酸化の結果、酸化した多孔性ケイ素が半導体ウェ
ハの表面上に突出する。酸化多孔性ケイ素領域は次に前
の段階に使用した酸化温度よりも高い温度にさらされ、
酸化多孔性ケイ素領域の高密度化が行われる。この高密
度化段階の結果多孔性酸化物が崩壊して稠密な、半導体
ウニへの表面に略一致する構造体になる。
米国特許第4104086号はケイ素のブロック内のケ
イ素の領域を隔離するため、適切に先細りになった開孔
を形成し、開孔の表面を熱的に酸化し、開孔を誘電体材
料で充填する段階を含むケイ素領域を分離する方法を開
示している。この方法は高濃度に添加された導電性の層
を有するケイ素領域を通って開孔を形成する場合に特に
有用である。
イ素の領域を隔離するため、適切に先細りになった開孔
を形成し、開孔の表面を熱的に酸化し、開孔を誘電体材
料で充填する段階を含むケイ素領域を分離する方法を開
示している。この方法は高濃度に添加された導電性の層
を有するケイ素領域を通って開孔を形成する場合に特に
有用である。
米国特許第4404736号は半導体基板の表面中東子
を取巻いて予定の深さのメサ型のくぼみを形成し、半導
体基板の裏側に応力の集中を減少するための薄膜を形成
して、ガラスの粉末を焼結してガラスの絶縁体を形成す
るメサ型の半導体装置の製造方法を開示している。この
方法によれば半導体基板及びメサ型のくぼみ中に形成さ
れたガラス絶縁体中のひび割れが防止される。
を取巻いて予定の深さのメサ型のくぼみを形成し、半導
体基板の裏側に応力の集中を減少するための薄膜を形成
して、ガラスの粉末を焼結してガラスの絶縁体を形成す
るメサ型の半導体装置の製造方法を開示している。この
方法によれば半導体基板及びメサ型のくぼみ中に形成さ
れたガラス絶縁体中のひび割れが防止される。
米国特許第4404735号は半導体基板中に溝を形成
し、基板上、少なく弁溝中に絶縁層を形成しその上にガ
ラス層もしくはケイ素層を形成し、その後ガラス層もし
くはケイ素層上にレーザ・ビームの如き高エネルギ・ビ
ームを照射して、該層を選択的に加熱して層を溶融もし
くは流体化し、溶融した層を溝中に流込む事による半導
体装置のためのフィールド分離構造体を形成する方法を
開示している。上述の溶融過程によって平坦で滑らかな
表面が与えられ、その上に形成される配線層中の電気的
なひび割れが防止される。この方法は特に小さなフィー
ルド分離構造体を形成し、装置の集積密度を改善するの
に適している。
し、基板上、少なく弁溝中に絶縁層を形成しその上にガ
ラス層もしくはケイ素層を形成し、その後ガラス層もし
くはケイ素層上にレーザ・ビームの如き高エネルギ・ビ
ームを照射して、該層を選択的に加熱して層を溶融もし
くは流体化し、溶融した層を溝中に流込む事による半導
体装置のためのフィールド分離構造体を形成する方法を
開示している。上述の溶融過程によって平坦で滑らかな
表面が与えられ、その上に形成される配線層中の電気的
なひび割れが防止される。この方法は特に小さなフィー
ルド分離構造体を形成し、装置の集積密度を改善するの
に適している。
米国特許第4420874号はV字状溝によって半導体
装置の他の部分から分離した基本領域を有する半導体装
置を開示している。上述の半導体装置は装置の半導体基
板の表面を覆う絶縁層を含み注入領域が該絶縁層の下に
形成されていて、ベース領域が絶縁層の下の該絶縁層の
厚い部分と上記V字状溝との間に形成されている。
装置の他の部分から分離した基本領域を有する半導体装
置を開示している。上述の半導体装置は装置の半導体基
板の表面を覆う絶縁層を含み注入領域が該絶縁層の下に
形成されていて、ベース領域が絶縁層の下の該絶縁層の
厚い部分と上記V字状溝との間に形成されている。
D0発明が解決しようとする問題点
本発明の目的は絶縁体を充填した溝によって半導体ウェ
ハの分離領域を形成するための改良された方法を与える
事にある。
ハの分離領域を形成するための改良された方法を与える
事にある。
本発明に従えば、光重合体材料を使用し、洗浄によって
その過剰部分を除去する事により半導体ウェハ中の分離
溝を充填するための改良された方法が与えられる。
その過剰部分を除去する事により半導体ウェハ中の分離
溝を充填するための改良された方法が与えられる。
本発明に従えば傾斜熱処理によって収縮する光重合体を
使用して半導体ウェハ中の分離溝を充填する改良方法が
与えられる。
使用して半導体ウェハ中の分離溝を充填する改良方法が
与えられる。
E0問題点を解決するための手段
半導体基体及びその中の溝中に光重合体の層を付着し、
マスクを介して溝の上を放射線に露光する。光重合体層
の非露光部分を洗浄する。熱を徐々に加えると残った光
重合体が収縮して基板の表面と一致する。
マスクを介して溝の上を放射線に露光する。光重合体層
の非露光部分を洗浄する。熱を徐々に加えると残った光
重合体が収縮して基板の表面と一致する。
F、実施例
添付図面の工程(A)を参照するに、ホトリソゲラブイ
・マスキング技法の様な一般に知られている方法で溝1
2が形成されている半導体ウェハ1oの概略が示されて
いる。
・マスキング技法の様な一般に知られている方法で溝1
2が形成されている半導体ウェハ1oの概略が示されて
いる。
工程CB)はウェハ10の表面を覆うだけでなく溝12
を充填した光重合体14を示している。
を充填した光重合体14を示している。
工程(C)を参照すると、溝12の真上の領域を除き、
被覆したウェハの表面をブロックするマスク16が与え
られている。マスク16は工程(A)の溝12を画定す
るのに使用したマスクと同じものである事が好ましい。
被覆したウェハの表面をブロックするマスク16が与え
られている。マスク16は工程(A)の溝12を画定す
るのに使用したマスクと同じものである事が好ましい。
マスク16は露光用放射線が光である時にだけ必要であ
る。電子ビーム装置もしくはX線装置によって放射線が
与えられる場合には、マスクを必要としないで、電子ビ
ームもしくはX線ビームを光重合体充填溝の上に指向し
、限定する事が出来る。
る。電子ビーム装置もしくはX線装置によって放射線が
与えられる場合には、マスクを必要としないで、電子ビ
ームもしくはX線ビームを光重合体充填溝の上に指向し
、限定する事が出来る。
次に被覆ウェハ構造体は紫外線、電子ビームもしくはX
線の様な活性線に露らされる。紫外線の場合には、光1
8は工程(C)に示された様にマスク16を介して行わ
れる。光18はマスク16を通過し、溝12の上の光重
合体14の部分を露光する。
線の様な活性線に露らされる。紫外線の場合には、光1
8は工程(C)に示された様にマスク16を介して行わ
れる。光18はマスク16を通過し、溝12の上の光重
合体14の部分を露光する。
次にマスクが取除かれ、光重合体層14を洗浄する。非
露光部分が除去され、溝12中及び溝12の上の領域(
過充填部分、すなわち、ウェハ10の表面上の元の光重
合体被膜14の厚さ部分)に架橋光重合体が残される。
露光部分が除去され、溝12中及び溝12の上の領域(
過充填部分、すなわち、ウェハ10の表面上の元の光重
合体被膜14の厚さ部分)に架橋光重合体が残される。
結果の構造体は工程図(D)に示されている。
次にウェハ構造体は傾斜熱処理を受ける、すなわち徐々
に加熱される。これによって残りの光重合体が収縮し、
溝12中に後退し、ウェハ10の表面と同じ平面になる
。この収縮は光重合体が収縮を可能にする溶剤もしくは
組成上の不安定性を含む組成を有するから生じるもので
ある。
に加熱される。これによって残りの光重合体が収縮し、
溝12中に後退し、ウェハ10の表面と同じ平面になる
。この収縮は光重合体が収縮を可能にする溶剤もしくは
組成上の不安定性を含む組成を有するから生じるもので
ある。
上述の過程に使用される光重合体の種類は多い。
光充填は特定の重合体の型に依存しないが、好ましいい
くつかの型がある1例えばポリイミドをベースとするレ
ジストや、活性線を受けた時に架橋する。ポリイミドと
類似の高温特性、電気的特性を有する光重合化可能なシ
ロキサンをベースとする化合物を使用出来る。又ケイ酸
をベースとする光重合体及び光架橋可能な化合物も高温
の制限なく使用出来る。ケイ酸化合物は70%乃至80
%の2酸化ケイ素を含む様に調製出来るので、収縮が制
御出来、同時に高温という制約を避ける事が出来る。
くつかの型がある1例えばポリイミドをベースとするレ
ジストや、活性線を受けた時に架橋する。ポリイミドと
類似の高温特性、電気的特性を有する光重合化可能なシ
ロキサンをベースとする化合物を使用出来る。又ケイ酸
をベースとする光重合体及び光架橋可能な化合物も高温
の制限なく使用出来る。ケイ酸化合物は70%乃至80
%の2酸化ケイ素を含む様に調製出来るので、収縮が制
御出来、同時に高温という制約を避ける事が出来る。
以上、バック・エツチングを必要としないで、加熱によ
り、充填溝の表面がウェハの表面と同じ平面になる迄溝
中に収縮する絶縁材料で半導体ウェハの分離溝を充填す
る方法を説明した。又製造中に非露光もしくは望ましく
ない絶縁材料はエツチングによらないで簡単な洗浄でウ
ェハの表面から取除く事が出来る。
り、充填溝の表面がウェハの表面と同じ平面になる迄溝
中に収縮する絶縁材料で半導体ウェハの分離溝を充填す
る方法を説明した。又製造中に非露光もしくは望ましく
ない絶縁材料はエツチングによらないで簡単な洗浄でウ
ェハの表面から取除く事が出来る。
G0発明の効果
本発明によれば、絶縁体を充填した分離領域を簡単に形
成することができる。
成することができる。
添付図面は本発明の製造方法における種々の製造段階(
A)〜(E)を示す製造工程図である。 10・・・・半導体ウェハ、12・・・・溝、14・・
・・光重合体、16・・・・マスク、18・・・・光。 出願人 インターナショナル・ビジネス・マシーンズ
・コーポレーション 代理人 弁理士 山 本 仁 朗(外1名) 6、補正の対象 手続補正書Cjf幻 昭和61年4月17日 特許庁長官 宇 賀 道 部 殿 1、事件の表示 昭和61年 特許層 第4452号 2、発明の名称 半導体基板に絶縁体充填分離溝を形成する方法3、補正
をする者 事件との関係 特許出願人 4、代理人 図面の簡単な説明 (1)明細書の図面の簡単な説明の欄 (2)図 面 7、補正の内容 (1)図面の簡単な説明の欄の記載を別紙のとおりに補
正する。 (2)図面を添付訂正図面のとおりに補正する。 第1図は本発明の製造方法における種々の製造段階を示
す製造工程図である。
A)〜(E)を示す製造工程図である。 10・・・・半導体ウェハ、12・・・・溝、14・・
・・光重合体、16・・・・マスク、18・・・・光。 出願人 インターナショナル・ビジネス・マシーンズ
・コーポレーション 代理人 弁理士 山 本 仁 朗(外1名) 6、補正の対象 手続補正書Cjf幻 昭和61年4月17日 特許庁長官 宇 賀 道 部 殿 1、事件の表示 昭和61年 特許層 第4452号 2、発明の名称 半導体基板に絶縁体充填分離溝を形成する方法3、補正
をする者 事件との関係 特許出願人 4、代理人 図面の簡単な説明 (1)明細書の図面の簡単な説明の欄 (2)図 面 7、補正の内容 (1)図面の簡単な説明の欄の記載を別紙のとおりに補
正する。 (2)図面を添付訂正図面のとおりに補正する。 第1図は本発明の製造方法における種々の製造段階を示
す製造工程図である。
Claims (1)
- 【特許請求の範囲】 (a)半導体基板の表面に形成した溝を充填する様にこ
の溝を含む基板表面領域を光重合体材料で覆い、 (b)上記溝の領域の光重合体材料を露光し、 (c)上記光重合体材料の非露光領域を除去し、 (d)上記半導体基板に熱を加えて上記溝中の露光した
光重合体材料を収縮させ、上記溝中の光重合体材料を上
記半導体基板の表面と同平面にする、 ことを含む、半導体基板に絶縁体充填分離溝を形成する
方法。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US06/728,633 US4665010A (en) | 1985-04-29 | 1985-04-29 | Method of fabricating photopolymer isolation trenches in the surface of a semiconductor wafer |
US728633 | 1985-04-29 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS61251154A true JPS61251154A (ja) | 1986-11-08 |
JPH0434296B2 JPH0434296B2 (ja) | 1992-06-05 |
Family
ID=24927637
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP61004452A Granted JPS61251154A (ja) | 1985-04-29 | 1986-01-14 | 半導体基板に絶縁体充填分離溝を形成する方法 |
Country Status (4)
Country | Link |
---|---|
US (1) | US4665010A (ja) |
EP (1) | EP0199965B1 (ja) |
JP (1) | JPS61251154A (ja) |
DE (1) | DE3685363D1 (ja) |
Families Citing this family (11)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4983545A (en) * | 1987-03-20 | 1991-01-08 | Nec Corporation | Planarization of dielectric films on integrated circuits |
US4789646A (en) * | 1987-07-20 | 1988-12-06 | North American Philips Corporation, Signetics Division Company | Method for selective surface treatment of semiconductor structures |
US5135891A (en) * | 1988-01-19 | 1992-08-04 | Mitsubishi Denki Kabushiki Kaisha | Method for forming film of uniform thickness on semiconductor substrate having concave portion |
US4876217A (en) * | 1988-03-24 | 1989-10-24 | Motorola Inc. | Method of forming semiconductor structure isolation regions |
US5068959A (en) * | 1988-07-11 | 1991-12-03 | Digital Equipment Corporation | Method of manufacturing a thin film head |
DE4300765C1 (de) * | 1993-01-14 | 1993-12-23 | Bosch Gmbh Robert | Verfahren zum Planarisieren grabenförmiger Strukturen |
JP2687948B2 (ja) * | 1995-10-05 | 1997-12-08 | 日本電気株式会社 | 半導体装置の製造方法 |
US5776660A (en) * | 1996-09-16 | 1998-07-07 | International Business Machines Corporation | Fabrication method for high-capacitance storage node structures |
KR100228773B1 (ko) * | 1996-12-31 | 1999-11-01 | 김영환 | 반도체소자 및 그 제조방법 |
FR2766012B1 (fr) * | 1997-07-08 | 2001-01-19 | France Telecom | Procede de minimisation de l'effet de coin par densification de la couche isolante |
US8136875B2 (en) * | 2009-07-15 | 2012-03-20 | Honda Motor Co., Ltd. | Cup holder and pivoting armrest |
Family Cites Families (12)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4041190A (en) * | 1971-06-29 | 1977-08-09 | Thomson-Csf | Method for producing a silica mask on a semiconductor substrate |
GB1451623A (en) * | 1973-10-01 | 1976-10-06 | Mullard Ltd | Method of prov8ding a patterned layer of silicon-containing oxide on a substrate |
US4016017A (en) * | 1975-11-28 | 1977-04-05 | International Business Machines Corporation | Integrated circuit isolation structure and method for producing the isolation structure |
US4104086A (en) * | 1977-08-15 | 1978-08-01 | International Business Machines Corporation | Method for forming isolated regions of silicon utilizing reactive ion etching |
JPS6043024B2 (ja) * | 1978-12-30 | 1985-09-26 | 富士通株式会社 | 半導体装置の製造方法 |
JPS56160050A (en) * | 1980-05-14 | 1981-12-09 | Fujitsu Ltd | Semiconductor device and manufacture thereof |
US4307180A (en) * | 1980-08-22 | 1981-12-22 | International Business Machines Corp. | Process of forming recessed dielectric regions in a monocrystalline silicon substrate |
JPS5784138A (en) * | 1980-11-13 | 1982-05-26 | Toshiba Corp | Manufacture of mesa semiconductor device |
US4385975A (en) * | 1981-12-30 | 1983-05-31 | International Business Machines Corp. | Method of forming wide, deep dielectric filled isolation trenches in the surface of a silicon semiconductor substrate |
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US4568601A (en) * | 1984-10-19 | 1986-02-04 | International Business Machines Corporation | Use of radiation sensitive polymerizable oligomers to produce polyimide negative resists and planarized dielectric components for semiconductor structures |
US4576834A (en) * | 1985-05-20 | 1986-03-18 | Ncr Corporation | Method for forming trench isolation structures |
-
1985
- 1985-04-29 US US06/728,633 patent/US4665010A/en not_active Expired - Fee Related
-
1986
- 1986-01-14 JP JP61004452A patent/JPS61251154A/ja active Granted
- 1986-03-19 EP EP86103743A patent/EP0199965B1/en not_active Expired - Lifetime
- 1986-03-19 DE DE8686103743T patent/DE3685363D1/de not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
EP0199965A2 (en) | 1986-11-05 |
US4665010A (en) | 1987-05-12 |
EP0199965B1 (en) | 1992-05-20 |
EP0199965A3 (en) | 1989-11-02 |
DE3685363D1 (de) | 1992-06-25 |
JPH0434296B2 (ja) | 1992-06-05 |
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