JPS61214455A - 混成集積回路装置 - Google Patents
混成集積回路装置Info
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- JPS61214455A JPS61214455A JP60057348A JP5734885A JPS61214455A JP S61214455 A JPS61214455 A JP S61214455A JP 60057348 A JP60057348 A JP 60057348A JP 5734885 A JP5734885 A JP 5734885A JP S61214455 A JPS61214455 A JP S61214455A
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- Japan
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- insulating substrate
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- semiconductor chip
- metallic plate
- point solder
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
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- H01L23/36—Selection of materials, or shaping, to facilitate cooling or heating, e.g. heatsinks
-
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- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/12—Mountings, e.g. non-detachable insulating substrates
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
- H01L2224/48—Structure, shape, material or disposition of the wire connectors after the connecting process of an individual wire connector
- H01L2224/481—Disposition
- H01L2224/48151—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/48221—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/48225—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
- H01L2224/48227—Connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation connecting the wire to a bond pad of the item
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- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/42—Wire connectors; Manufacturing methods related thereto
- H01L2224/47—Structure, shape, material or disposition of the wire connectors after the connecting process
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- H01L2224/491—Disposition
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、半導体チップから発生する熱による悪影響
をなくした混成集積回路装置に関するものである。
をなくした混成集積回路装置に関するものである。
従来、高出力の性能を要求される混成集積回路装置の構
造は、第2図(a)、 (b)K示すようK。
造は、第2図(a)、 (b)K示すようK。
放熱のための金属板(一般には銅を使用、メッキ仕様は
省略)1の上に、半導体チップ4を搭載した熱伝導性の
絶縁性基板(一般にはBeO) 2と、周辺回路形成用
の絶縁性基板(一般にはA I 10B )3とを、融
点が約180℃以下のpb−s1系の低融点半田6にて
接合した構造となっている。なお、5は前記半導体チッ
プ4の電極と、絶縁性基板2上の電極とを接続した金属
細線である。
省略)1の上に、半導体チップ4を搭載した熱伝導性の
絶縁性基板(一般にはBeO) 2と、周辺回路形成用
の絶縁性基板(一般にはA I 10B )3とを、融
点が約180℃以下のpb−s1系の低融点半田6にて
接合した構造となっている。なお、5は前記半導体チッ
プ4の電極と、絶縁性基板2上の電極とを接続した金属
細線である。
このような構造においては、娼出カの半導体チップ4か
ら発生する熱損失のため、熱伝導性の絶縁性基板2と金
属板1とを接合しているPb −Sn・ 系の低融点半
田6に悪影響を及ぼし、最終的には半田クランク、界面
はく離等に至ることが環境試験により判明している。
ら発生する熱損失のため、熱伝導性の絶縁性基板2と金
属板1とを接合しているPb −Sn・ 系の低融点半
田6に悪影響を及ぼし、最終的には半田クランク、界面
はく離等に至ることが環境試験により判明している。
このため、製品の用途として使用環境が非常に厳しい場
合や、宇宙用等のように高信頼度を要求される場合多大
の問題点があった。
合や、宇宙用等のように高信頼度を要求される場合多大
の問題点があった。
この発明は、このような問題点を解消するためkなされ
たもので、高信頼性の混成果槓回路装置を提供するもの
である。
たもので、高信頼性の混成果槓回路装置を提供するもの
である。
この発明に係る混成集積回路装置は、半導体チップを搭
載した絶縁性基板を接合するろう材KAg−Cuろ5材
を用い、周辺回路形成用の絶縁性基板を接合するろう材
1c Pb −Sn系の低融点半田を用いたものである
。
載した絶縁性基板を接合するろう材KAg−Cuろ5材
を用い、周辺回路形成用の絶縁性基板を接合するろう材
1c Pb −Sn系の低融点半田を用いたものである
。
この発明においては、半導体チップから発生する熱損失
のために%Pb −Sn系の低融点半田に熱による悪影
響を与えることがない。
のために%Pb −Sn系の低融点半田に熱による悪影
響を与えることがない。
第1図(a)、 (b)はこの発明の一実施例を示す
混成集積回路装置の平面図およびA−A娠忙よる断面図
である。この発明の特徴は、熱伝導性の絶縁性基板2と
金属板1の接合材をAg −Cuろ5材7によって接合
し、周辺回路形成用の118縁性基板3と金属板1との
接合は基板われ防止のため、従来どおりのPb−8n系
の低融点半田6を採用したことである。
混成集積回路装置の平面図およびA−A娠忙よる断面図
である。この発明の特徴は、熱伝導性の絶縁性基板2と
金属板1の接合材をAg −Cuろ5材7によって接合
し、周辺回路形成用の118縁性基板3と金属板1との
接合は基板われ防止のため、従来どおりのPb−8n系
の低融点半田6を採用したことである。
すなわち、第1図(a)、 (b)に示すように、放
熱用の金属板1上に半導体チップ4が搭載された熱伝導
性の絶縁性基板2を金属板10所定部分を突出させた凸
部1a上にAg−Cuろう材7により接合し、周辺回路
形成用の絶縁性4叡3を従来と同様KPb−8n系の低
融点半田6を使用しズ接合したものである。
熱用の金属板1上に半導体チップ4が搭載された熱伝導
性の絶縁性基板2を金属板10所定部分を突出させた凸
部1a上にAg−Cuろう材7により接合し、周辺回路
形成用の絶縁性4叡3を従来と同様KPb−8n系の低
融点半田6を使用しズ接合したものである。
上記のような構造の採用により、第1表のようなパラメ
ータを持つ混成集積回路装置くおいて、ヒートショック
テスト(−40℃〜+125℃、各30+)の結果、従
来の構造の混成集積回路装置は、約200サイクルにて
不良発生の可能性を持つが、この発明による構造のもの
は、1000サイクルをクリアする結果を得ている。
ータを持つ混成集積回路装置くおいて、ヒートショック
テスト(−40℃〜+125℃、各30+)の結果、従
来の構造の混成集積回路装置は、約200サイクルにて
不良発生の可能性を持つが、この発明による構造のもの
は、1000サイクルをクリアする結果を得ている。
第 1 表
〔発明の効果〕
この発明は以上説明したとおり、半導体チップが搭載さ
れた絶縁性基板を放熱のための金属板にAg −Cuろ
5材を用い″C接合し、周辺回路形成用の絶縁性基板を
Pb −Sn系の低融点半田を用いて接合したので、半
導体チップから発生される熱による悪影響を低融点半田
に与えることがな(なり、高信頼性の高出力混成系、積
回路装置の提供がcq能となる利点が得られる。
れた絶縁性基板を放熱のための金属板にAg −Cuろ
5材を用い″C接合し、周辺回路形成用の絶縁性基板を
Pb −Sn系の低融点半田を用いて接合したので、半
導体チップから発生される熱による悪影響を低融点半田
に与えることがな(なり、高信頼性の高出力混成系、積
回路装置の提供がcq能となる利点が得られる。
a41図(a)、 (b)はこの発明の一実施例を示
す混成集積回路装置の平面図およびA−A’lR面図、
第2図(a)、 (b)は従来の混成集積回路装置を
示す平面図およびB−8断面図である0 図において、1は金属板、2は熱伝導性の絶縁性基板、
3は周辺回路形成用の絶縁性基板、4は半導体チップ、
5は金属細線、6はPb7Sn系の低融点半田、7はA
g −Cuろ5材である。 なお、各図中の同一符号は同一または相当部分な示す◎ 第1図 (a) 7’Ag−Cuろう材
す混成集積回路装置の平面図およびA−A’lR面図、
第2図(a)、 (b)は従来の混成集積回路装置を
示す平面図およびB−8断面図である0 図において、1は金属板、2は熱伝導性の絶縁性基板、
3は周辺回路形成用の絶縁性基板、4は半導体チップ、
5は金属細線、6はPb7Sn系の低融点半田、7はA
g −Cuろ5材である。 なお、各図中の同一符号は同一または相当部分な示す◎ 第1図 (a) 7’Ag−Cuろう材
Claims (1)
- 放熱のための金属板の上に半導体チツプがそれぞれ搭
載される所要数の熱伝導性の絶縁性基板と、周辺回路形
成用の所要数の絶縁性基板を接合した混成集積回路装置
において、前記半導体チツプが搭載される絶縁性基板を
Ag−Cuろう材によりそれぞれ接合し、前記周辺回路
形成用の絶縁性基板を低融点半田にてそれぞれ接合した
ことを特徴とする混成集積回路装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60057348A JPS61214455A (ja) | 1985-03-19 | 1985-03-19 | 混成集積回路装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP60057348A JPS61214455A (ja) | 1985-03-19 | 1985-03-19 | 混成集積回路装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS61214455A true JPS61214455A (ja) | 1986-09-24 |
Family
ID=13053067
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP60057348A Pending JPS61214455A (ja) | 1985-03-19 | 1985-03-19 | 混成集積回路装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS61214455A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0637076A2 (en) * | 1993-07-29 | 1995-02-01 | Motorola, Inc. | Electronic circuit assembly with improved heatsinking |
-
1985
- 1985-03-19 JP JP60057348A patent/JPS61214455A/ja active Pending
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0637076A2 (en) * | 1993-07-29 | 1995-02-01 | Motorola, Inc. | Electronic circuit assembly with improved heatsinking |
EP0637076A3 (en) * | 1993-07-29 | 1995-08-30 | Motorola Inc | Electronic circuit arrangement with improved heat dissipation. |
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