JPS61198807A - Ａｇｃ制御装置 - Google Patents
Ａｇｃ制御装置Info
- Publication number
- JPS61198807A JPS61198807A JP3787685A JP3787685A JPS61198807A JP S61198807 A JPS61198807 A JP S61198807A JP 3787685 A JP3787685 A JP 3787685A JP 3787685 A JP3787685 A JP 3787685A JP S61198807 A JPS61198807 A JP S61198807A
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- Japan
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- circuit
- phase
- detection circuit
- signal
- gain
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- Pending
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- Control Of Amplification And Gain Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
°〔産業上の利用分野〕
本発明はソーナー装置などに用いられるＡＧＣ制御装置
に関する。
に関する。
従来、この種のＡＧＣ制御装置は、第４図のブロック図
に示すように構成されていた。すなわち、送信信号は送
信器１から送受転換器２を経由して送受波器３で電気信
号から音波に変換され送波される。
に示すように構成されていた。すなわち、送信信号は送
信器１から送受転換器２を経由して送受波器３で電気信
号から音波に変換され送波される。
一方、受信信号は、送受波器３から送受転換器２を経由
し、前置増幅器４で増幅された後、利得制御部５１と増
幅器５２とからなるＡＧＣ部５によって入力レベル変動
（数十ｄＢ ）を圧縮した出力レベル変動信号（数ｄＢ
）を得ている。このＡＧＣ郁５の出力はＡＧＣ制御部
６に供給さ些、検波回路６１によシ受信信号を検波し直
流電圧とし、直流増幅回路６２で増幅して利得制御部５
１に加えられ、受信信号が大きいときは利得制御部５１
の利得を小さくするよう制御することによシレペル圧縮
を行っている。
し、前置増幅器４で増幅された後、利得制御部５１と増
幅器５２とからなるＡＧＣ部５によって入力レベル変動
（数十ｄＢ ）を圧縮した出力レベル変動信号（数ｄＢ
）を得ている。このＡＧＣ郁５の出力はＡＧＣ制御部
６に供給さ些、検波回路６１によシ受信信号を検波し直
流電圧とし、直流増幅回路６２で増幅して利得制御部５
１に加えられ、受信信号が大きいときは利得制御部５１
の利得を小さくするよう制御することによシレペル圧縮
を行っている。
一般に、水中に送波された音波は、第３図（ａ）の波形
図に示すように時間とともに減少する残響信号が受信さ
れ、目標からの受信信号は、この残響に重畳して受信さ
れる。ＡＧＣ制御部６は、この受信信号を検波して、第
３図（ｂ）に示す直流制御電圧を得て、利得制御部５１
に与えて利得調整を行っている。しかし、目標からの受
信信号についても利得調整が行なわれるため、第３図（
Ｃ）に示すように、ＡＧＣ出力信号は入力レベルと比べ
て信号レベルが劣化する。
図に示すように時間とともに減少する残響信号が受信さ
れ、目標からの受信信号は、この残響に重畳して受信さ
れる。ＡＧＣ制御部６は、この受信信号を検波して、第
３図（ｂ）に示す直流制御電圧を得て、利得制御部５１
に与えて利得調整を行っている。しかし、目標からの受
信信号についても利得調整が行なわれるため、第３図（
Ｃ）に示すように、ＡＧＣ出力信号は入力レベルと比べ
て信号レベルが劣化する。
一般に、ＡＧＣ制御部６は、この信号レベルの劣化を少
なくするため検波回路６１でコンデンサと抵抗の時定数
を用いて、目標からの受信信号によるパルス信号には追
従を悪くして８／Ｎの劣化を少くしている。
なくするため検波回路６１でコンデンサと抵抗の時定数
を用いて、目標からの受信信号によるパルス信号には追
従を悪くして８／Ｎの劣化を少くしている。
この信号レベル（８）と残響レベル及び雑音レベル（へ
）との比を８／Ｎといい、ＡＧＣの作動によシ、入力８
１ ／Ｎ ｔ Ｋ比べＡＧＣ出力８ ｚ ／ Ｎ ｚは
数ｄＢ劣化する。
）との比を８／Ｎといい、ＡＧＣの作動によシ、入力８
１ ／Ｎ ｔ Ｋ比べＡＧＣ出力８ ｚ ／ Ｎ ｚは
数ｄＢ劣化する。
この従来のＡＧＯ制御装置は、入力振幅情報によって利
得制御を行なっているため、ＡＧＣ出力において８７Ｎ
を劣化させるという欠点がある。
得制御を行なっているため、ＡＧＣ出力において８７Ｎ
を劣化させるという欠点がある。
本発明の目的は、このような欠点を除き、Ｓ／Ｎの劣化
をなくしたＡＧＣ制御装置を提供することにある。
をなくしたＡＧＣ制御装置を提供することにある。
本発明の構成は、受信信号の利得制御を行いかつ増幅す
る利得制御部と、この利得制御部の出力を検波する検波
回路と、この検波回路の出力を直流増幅して利得制御用
電圧として出力する直流増幅回路とを有するＡＧＣ制御
装置において、前記利得制御部の出力から信号位相を検
出する位相検出回路を備え、この位相検出出力を前記検
波出力と共に前記直流増幅回路で増幅して前記受信信号
の入力レベル変動を圧縮した出力信号を得ることを特徴
とする。
る利得制御部と、この利得制御部の出力を検波する検波
回路と、この検波回路の出力を直流増幅して利得制御用
電圧として出力する直流増幅回路とを有するＡＧＣ制御
装置において、前記利得制御部の出力から信号位相を検
出する位相検出回路を備え、この位相検出出力を前記検
波出力と共に前記直流増幅回路で増幅して前記受信信号
の入力レベル変動を圧縮した出力信号を得ることを特徴
とする。
（発明の原理）
本発明によれば、ＡＧＣ制御部に受信信号の位相検出回
路を付加しているので、この位相検出回路によっても直
流増幅回路の利得を可変することにより８／Ｎの劣化を
少くすことを可能としている。
路を付加しているので、この位相検出回路によっても直
流増幅回路の利得を可変することにより８／Ｎの劣化を
少くすことを可能としている。
すなわち、ンーナー受信信号の残響信号は、水中の多数
の小物体からの反射波が合成されたものであるため、そ
の位相検出回路によシ検出された位相信号は、第３図（
ｄ） Ｋ示すように大きく変動するが、目標からの受信
信号はある大きさをもった物体からの反射波であシ、そ
の位相は比較的安定した小レベルの出力となる。したが
ってこのような位相信号によシ利得制御される受信信号
は、第３図（ｅ）よりもさらに残響信号の圧縮された出
力、すなわち８／Ｎの劣化を少くした出力が可能となる
。
の小物体からの反射波が合成されたものであるため、そ
の位相検出回路によシ検出された位相信号は、第３図（
ｄ） Ｋ示すように大きく変動するが、目標からの受信
信号はある大きさをもった物体からの反射波であシ、そ
の位相は比較的安定した小レベルの出力となる。したが
ってこのような位相信号によシ利得制御される受信信号
は、第３図（ｅ）よりもさらに残響信号の圧縮された出
力、すなわち８／Ｎの劣化を少くした出力が可能となる
。
次に図面により本発明の詳細な説明する。
第１図は本発明の一実施例のブロック図である。
本実施例は、従来の回路に対して位相検出回路６３を付
加したものである。この位相検出６３は、位相が一定の
ときは、利得を小さくし、位相が変動するときは振幅の
み制御したときの大きい利得になるように、直流増幅回
路６２を制御することにより、受信信号の位相情報も加
味した直流制御電圧を作シ、その利得調整は利得調整回
路５１で行われる。
加したものである。この位相検出６３は、位相が一定の
ときは、利得を小さくし、位相が変動するときは振幅の
み制御したときの大きい利得になるように、直流増幅回
路６２を制御することにより、受信信号の位相情報も加
味した直流制御電圧を作シ、その利得調整は利得調整回
路５１で行われる。
Ｗｌｚ図（ａ）は９Ｊ１１図の位相検出回路６３ブロツ
ク図である。この回路６３は、受信信号をクリップ回路
７１でクリップした後、一方を受信信号の半波長（使用
周波数から決める）に相当する遅延量を、その受信信号
に遅延回路７２から与え、減算回路７４によシ遅延しな
い信号との差をとった後、検波回路７３で検波するもの
である。この回路により、第２図（Ｃ）に示すように、
位相が一定の信号の場合は小さい直流電圧ｅｓが、位相
が変動する残響のような場合は大きな直流電圧ｅｎが出
力される。この直流電圧直流増幅回路６２の利得を変化
させることによｊＤＡＧｃ制御が可能となる。
ク図である。この回路６３は、受信信号をクリップ回路
７１でクリップした後、一方を受信信号の半波長（使用
周波数から決める）に相当する遅延量を、その受信信号
に遅延回路７２から与え、減算回路７４によシ遅延しな
い信号との差をとった後、検波回路７３で検波するもの
である。この回路により、第２図（Ｃ）に示すように、
位相が一定の信号の場合は小さい直流電圧ｅｓが、位相
が変動する残響のような場合は大きな直流電圧ｅｎが出
力される。この直流電圧直流増幅回路６２の利得を変化
させることによｊＤＡＧｃ制御が可能となる。
第２図（ｂ）は、検波回路６１と位相検出回路６３とを
同時に行う場合のブロック図でメジ、受信信号を遅延回
路８１で遅延させ、減算回路８３により一方の信号との
差をとった後、検波回路８２で検波を行うものであシ、
振幅と位相情報による出力電圧が得られ、この直流制御
電圧を利得調整回路５１に与えて、利得調整を可能とす
る。
同時に行う場合のブロック図でメジ、受信信号を遅延回
路８１で遅延させ、減算回路８３により一方の信号との
差をとった後、検波回路８２で検波を行うものであシ、
振幅と位相情報による出力電圧が得られ、この直流制御
電圧を利得調整回路５１に与えて、利得調整を可能とす
る。
以上説明したように、本発明によれば、ＡＧＣ制御部の
振幅情報に位相情報を付加することにより、ＡＧＣの作
動によシ生ずるＳ／Ｎ比の劣化を生ずることなく、残響
信号の入力レベル変動範囲を圧縮した出力レベルを得る
仁とが出来、非常に広範囲に渡る目標について、安定し
たＳ／Ｎ比が得られる。したがってソーナー装置の目標
探知性能を向上させることができる。
振幅情報に位相情報を付加することにより、ＡＧＣの作
動によシ生ずるＳ／Ｎ比の劣化を生ずることなく、残響
信号の入力レベル変動範囲を圧縮した出力レベルを得る
仁とが出来、非常に広範囲に渡る目標について、安定し
たＳ／Ｎ比が得られる。したがってソーナー装置の目標
探知性能を向上させることができる。
第１図は本発明の一実施例のブロック図、第２図（１）
、 （ｂ）は％１図位相検出回路の２つの例のブロック
図、第２図（Ｃ）はこの位相検出回路の特性図、第３図
（ａ）、 （ｂｌ、 （Ｃ１，（ｄ）は本実施例の動作
を示す受信信号、ＡＧＣ制御電圧波形、ＡＧＣ出力波形
および受信信号の位相変動状況の波形図、第４図は従来
のＡＧＣ制御装置のブロック図である。図において１・
・・・・・送信器、２・・・・・・送受転換器、３・・
・・・・送受波器、４・・・・・・前置増幅器、５・・
・・・・ＡＧＣ部。 ６・・・・・・ＡＧＣ制御部、５１・・・・・・利得制
御部、５２゛°°°増幅器、６１，７３．８２・・・・
・検波回路。 ６２・・・・・直流増幅回路、６３・・・・・・位相検
出回路。 ７１・・・・・・クリップ回路、７２．８１・・川・遅
延回路。 ７４．８３・・・・・・減算回路である。 代理人 弁理士 内 原 晋 ｖ１回 ’ｆ−２＠ （ａ）
＄２ Ｓ ｒ−ｔ＞ｖ ２ 毛ＥｂＣノ ￥−３ｆ１ １肴閘
、 （ｂ）は％１図位相検出回路の２つの例のブロック
図、第２図（Ｃ）はこの位相検出回路の特性図、第３図
（ａ）、 （ｂｌ、 （Ｃ１，（ｄ）は本実施例の動作
を示す受信信号、ＡＧＣ制御電圧波形、ＡＧＣ出力波形
および受信信号の位相変動状況の波形図、第４図は従来
のＡＧＣ制御装置のブロック図である。図において１・
・・・・・送信器、２・・・・・・送受転換器、３・・
・・・・送受波器、４・・・・・・前置増幅器、５・・
・・・・ＡＧＣ部。 ６・・・・・・ＡＧＣ制御部、５１・・・・・・利得制
御部、５２゛°°°増幅器、６１，７３．８２・・・・
・検波回路。 ６２・・・・・直流増幅回路、６３・・・・・・位相検
出回路。 ７１・・・・・・クリップ回路、７２．８１・・川・遅
延回路。 ７４．８３・・・・・・減算回路である。 代理人 弁理士 内 原 晋 ｖ１回 ’ｆ−２＠ （ａ）
＄２ Ｓ ｒ−ｔ＞ｖ ２ 毛ＥｂＣノ ￥−３ｆ１ １肴閘
Claims (1)
- 受信信号の利得制御を行いかつ増幅する利得制御部と、
この利得制御部の出力を検波する検波回路と、この検波
回路の出力を直流増幅して利得制御用電圧として出力す
る直流増幅回路とを有するＡＧＣ制御装置において、前
記利得制御部の出力から信号位相を検出する位相検出回
路を備え、この位相検出出力を前記検波出力と共に前記
直流増幅回路で増幅して前記受信信号の入力レベル変動
を圧縮した出力信号を得ることを特徴とするＡＧＣ制御
装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3787685A JPS61198807A (ja) | 1985-02-27 | 1985-02-27 | Ａｇｃ制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3787685A JPS61198807A (ja) | 1985-02-27 | 1985-02-27 | Ａｇｃ制御装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61198807A true JPS61198807A (ja) | 1986-09-03 |
Family
ID=12509731
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3787685A Pending JPS61198807A (ja) | 1985-02-27 | 1985-02-27 | Ａｇｃ制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61198807A (ja) |
-
1985
- 1985-02-27 JP JP3787685A patent/JPS61198807A/ja active Pending
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