JPS6117590Y2 - - Google Patents
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- Publication number
- JPS6117590Y2 JPS6117590Y2 JP1980174855U JP17485580U JPS6117590Y2 JP S6117590 Y2 JPS6117590 Y2 JP S6117590Y2 JP 1980174855 U JP1980174855 U JP 1980174855U JP 17485580 U JP17485580 U JP 17485580U JP S6117590 Y2 JPS6117590 Y2 JP S6117590Y2
- Authority
- JP
- Japan
- Prior art keywords
- signal
- main amplifier
- amplifier circuit
- resistor
- transistor
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 230000008054 signal transmission Effects 0.000 claims description 4
- 230000003321 amplification Effects 0.000 description 3
- 238000003199 nucleic acid amplification method Methods 0.000 description 3
- 238000010586 diagram Methods 0.000 description 1
- 238000006748 scratching Methods 0.000 description 1
- 230000002393 scratching effect Effects 0.000 description 1
Landscapes
- Signal Processing Not Specific To The Method Of Recording And Reproducing (AREA)
- Control Of Amplification And Gain Control (AREA)
Description
【考案の詳細な説明】
本考案はテープレコーダー等の音響装置におけ
る信号レベル制御回路に関する。
る信号レベル制御回路に関する。
斯かる音響装置は、スピーカーを備えていると
共に該スピーカーを駆動する主増幅回路を備えて
いるが、該主増幅回路に入力される信号のレベル
が増大し、そのレベルが所定値を越えると信号が
クリツプされ第１図ａに示すような波形の信号が
スピーカーに印加されて放音されることになる。
共に該スピーカーを駆動する主増幅回路を備えて
いるが、該主増幅回路に入力される信号のレベル
が増大し、そのレベルが所定値を越えると信号が
クリツプされ第１図ａに示すような波形の信号が
スピーカーに印加されて放音されることになる。
このようにクリツプされた信号は高調波成分を
多く含み、スピーカーより放音される信号は使用
者にチリチリ音として聞こえ不快感を与えること
になる。
多く含み、スピーカーより放音される信号は使用
者にチリチリ音として聞こえ不快感を与えること
になる。
本考案は、斯かる点に鑑みてなされたものであ
り、以下第２図に示した実施例を参照して詳細に
説明する。同図において、１は磁気ヘツドによつ
て再生された信号等が入力される入力端子、２は
該入力端子１に入力された信号を増幅する前置増
幅回路、３は該前置増幅回路２によつて増幅され
た信号が入力されると共に該信号を更に増幅する
主増幅回路、４は該主増幅回路３によつて増幅さ
れた信号が印加されると共に該信号を放音するス
ピーカーである。６は前記前置増幅回路２の出力
端子と主増幅回路３の入力端子の間の信号伝送路
６内に挿入接続された第１抵抗、７及び８は、コ
レクタ、エミツタ及びベースが互いに共通接続さ
れていると共にエミツタが接地されているNPN
型トランジスター及びPNP型トランジスターであ
り、そのコレクタと前記第１抵抗６の主増幅回路
３側の端子との間には第２抵抗９が接続されてい
る。１０及び１１は前記主増幅回路３の出力端子
と接地間にブリーダー接続された第１及び第２の
ブリーダー抵抗であり、そのブリーダー点Ａは前
記NPN型トランジスター７及びPNP型トランジ
スター８のベースに接続されている。斯かる回路
において、第１ブリーダー抵抗１０及び第２ブリ
ーダー抵抗１１によるNPN型トランジスター７
及びPNP型トランジスター１１が導通状態に反転
する動作点は前記主増幅回路３の出力信号がクリ
ツプを開始する直前に設定されている。
り、以下第２図に示した実施例を参照して詳細に
説明する。同図において、１は磁気ヘツドによつ
て再生された信号等が入力される入力端子、２は
該入力端子１に入力された信号を増幅する前置増
幅回路、３は該前置増幅回路２によつて増幅され
た信号が入力されると共に該信号を更に増幅する
主増幅回路、４は該主増幅回路３によつて増幅さ
れた信号が印加されると共に該信号を放音するス
ピーカーである。６は前記前置増幅回路２の出力
端子と主増幅回路３の入力端子の間の信号伝送路
６内に挿入接続された第１抵抗、７及び８は、コ
レクタ、エミツタ及びベースが互いに共通接続さ
れていると共にエミツタが接地されているNPN
型トランジスター及びPNP型トランジスターであ
り、そのコレクタと前記第１抵抗６の主増幅回路
３側の端子との間には第２抵抗９が接続されてい
る。１０及び１１は前記主増幅回路３の出力端子
と接地間にブリーダー接続された第１及び第２の
ブリーダー抵抗であり、そのブリーダー点Ａは前
記NPN型トランジスター７及びPNP型トランジ
スター８のベースに接続されている。斯かる回路
において、第１ブリーダー抵抗１０及び第２ブリ
ーダー抵抗１１によるNPN型トランジスター７
及びPNP型トランジスター１１が導通状態に反転
する動作点は前記主増幅回路３の出力信号がクリ
ツプを開始する直前に設定されている。
以上の如く本考案は構成されており、次に動作
について説明する。入力端子１に入力される信号
のレベルが小さい場合には主増幅回路３のクリツ
プレベルを越えないためNPN型トランジスター
７及びPNP型トランジスター８は導通状態に反転
することはなく、それ故入力端子１に入力された
信号は前置増幅回路２によつて増幅された後第２
抵抗９による影響を受けることなく主増幅回路３
に入力され、該主増幅回路３にて更に増幅された
後スピーカー４にて放音される。入力端子１に印
加される信号のレベルが大きくなり、主増幅回路
３の出力信号がクリツプされる直前のレベルにな
ると第１ブリーダー抵抗及び第２ブリーダー抵抗
１１のブリーダー点Ａの電位がNPN型トランジ
スター７及びPNP型トランジスター８を導通せし
める値になる。即ちブリーダー点Ａの電位が正電
位にあるときにはNPN型トランジスター７のみ
が順バイアス状態となつて導通しブリーダー点Ａ
の電位が負電位にあるときにはPNP型トランジス
ター８のみが順バイアス状態となつて導通する。
従つて信号伝送路６を流れる正側の信号レベルは
NPN型トランジスター７の導通により第１抵抗
５及び第２抵抗９の分割比によつて低下せしめら
れ、反対に信号伝送路６を流れる負側の信号レベ
ルはPNP型トランジスター８の導通により第１抵
抗５及び第２抵抗９の分割比によつて低下せしめ
られる。このように所定レベル以上の信号が入力
されるとそのレベルが低下せしめられるため、主
増幅回路３の出力信号はクリツプされることはな
く第１図ｂに示すようにその頂部が丸く波形整形
される。斯かる波形の信号は、第１図ａに示すク
リツプされた信号に比較して聞きやすく聴取者に
与える不快感は少ない。
について説明する。入力端子１に入力される信号
のレベルが小さい場合には主増幅回路３のクリツ
プレベルを越えないためNPN型トランジスター
７及びPNP型トランジスター８は導通状態に反転
することはなく、それ故入力端子１に入力された
信号は前置増幅回路２によつて増幅された後第２
抵抗９による影響を受けることなく主増幅回路３
に入力され、該主増幅回路３にて更に増幅された
後スピーカー４にて放音される。入力端子１に印
加される信号のレベルが大きくなり、主増幅回路
３の出力信号がクリツプされる直前のレベルにな
ると第１ブリーダー抵抗及び第２ブリーダー抵抗
１１のブリーダー点Ａの電位がNPN型トランジ
スター７及びPNP型トランジスター８を導通せし
める値になる。即ちブリーダー点Ａの電位が正電
位にあるときにはNPN型トランジスター７のみ
が順バイアス状態となつて導通しブリーダー点Ａ
の電位が負電位にあるときにはPNP型トランジス
ター８のみが順バイアス状態となつて導通する。
従つて信号伝送路６を流れる正側の信号レベルは
NPN型トランジスター７の導通により第１抵抗
５及び第２抵抗９の分割比によつて低下せしめら
れ、反対に信号伝送路６を流れる負側の信号レベ
ルはPNP型トランジスター８の導通により第１抵
抗５及び第２抵抗９の分割比によつて低下せしめ
られる。このように所定レベル以上の信号が入力
されるとそのレベルが低下せしめられるため、主
増幅回路３の出力信号はクリツプされることはな
く第１図ｂに示すようにその頂部が丸く波形整形
される。斯かる波形の信号は、第１図ａに示すク
リツプされた信号に比較して聞きやすく聴取者に
与える不快感は少ない。
以上説明したように本考案の信号レベル制御回
路によれば主増幅回路に入力される信号のレベル
が増大し、そのレベルがクリツプするレベルに達
すると信号レベルを低下せしめるようにしたので
主増幅回路の出力信号はクリツプされることはな
く聴取者に不快感を与えることはない。また、信
号レベルを低下せしめる手段としてコレクタ、エ
ミツタ及びベースが互いに共通接続されたNPN
型トランジスター及びPNP型トランジスターのベ
ースに交流信号を印加せしめるようにしたので、
即ち正及び負の信号によつて各々一方のトランジ
スターを導通状態にせしめるようにしたので信号
の波形を正及び負側共に同じように波形整形する
ことが出来、それ故スピーカーより放音される信
号は非常に聞きやすい音となり、本考案の実用的
価値は非常に大である。
路によれば主増幅回路に入力される信号のレベル
が増大し、そのレベルがクリツプするレベルに達
すると信号レベルを低下せしめるようにしたので
主増幅回路の出力信号はクリツプされることはな
く聴取者に不快感を与えることはない。また、信
号レベルを低下せしめる手段としてコレクタ、エ
ミツタ及びベースが互いに共通接続されたNPN
型トランジスター及びPNP型トランジスターのベ
ースに交流信号を印加せしめるようにしたので、
即ち正及び負の信号によつて各々一方のトランジ
スターを導通状態にせしめるようにしたので信号
の波形を正及び負側共に同じように波形整形する
ことが出来、それ故スピーカーより放音される信
号は非常に聞きやすい音となり、本考案の実用的
価値は非常に大である。
第１図は信号波形図、第２図は本考案の信号レ
ベル制御回路の一実施例である。 主な図番の説明、２……前置増幅回路、３……
主増幅回路、５……第１抵抗、７……NPN型ト
ランジスター、８……PNP型トランジスター、９
……第２抵抗、１０……第１ブリーダー抵抗、１
１……第２ブリーダー抵抗。
ベル制御回路の一実施例である。 主な図番の説明、２……前置増幅回路、３……
主増幅回路、５……第１抵抗、７……NPN型ト
ランジスター、８……PNP型トランジスター、９
……第２抵抗、１０……第１ブリーダー抵抗、１
１……第２ブリーダー抵抗。
Claims (1)
- 磁気ヘツド等から得られる信号が入力されると
共に該信号を増幅する前置増幅回路と、該前置増
幅回路からの信号が入力されると共に該信号を増
幅する主増幅回路と、該主増幅回路からの信号が
印加されると共に該信号を放音するスピーカー
と、前記前置増幅回路の出力端子と主増幅回路の
入力端子との間の信号伝送路内に挿入接続された
第１抵抗と、該第１抵抗の主増幅回路側の端子に
一端が接続された抵抗と、コレクタ、エミツタ及
びベースが互いに共通接続されていると共にコレ
クタが前記第２抵抗の他端に接続され、且つエミ
ツタが接地されているNPN型トランジスター及
びPNP型トランジスターと、前記主増幅回路の出
力端子と接地間にブリーダー接続されていると共
にそのブリーダー点が前記NPN型トランジスタ
ー及びPNP型トランジスターのベースに接続され
ている第１及び第２のブリーダー抵抗とより成
り、前記第１及び第２ブリーダー抵抗による前記
NPN型トランジスター及びPNP型トランジスタ
ーの動作点を前記主増幅回路の出力信号がクリツ
プを開始する直前に設定すると共に該NPN型ト
ランジスター及びPNP型トランジスターのベース
に交流信号を印加せしめるようにしたことを特徴
とする信号レベル制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1980174855U JPS6117590Y2 (ja) | 1980-12-04 | 1980-12-04 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1980174855U JPS6117590Y2 (ja) | 1980-12-04 | 1980-12-04 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5798509U JPS5798509U (ja) | 1982-06-17 |
| JPS6117590Y2 true JPS6117590Y2 (ja) | 1986-05-29 |
Family
ID=29966974
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1980174855U Expired JPS6117590Y2 (ja) | 1980-12-04 | 1980-12-04 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6117590Y2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59171207A (ja) * | 1984-03-09 | 1984-09-27 | Rohm Co Ltd | 自動レベル調整回路 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS54110045U (ja) * | 1978-01-20 | 1979-08-02 |
-
1980
- 1980-12-04 JP JP1980174855U patent/JPS6117590Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5798509U (ja) | 1982-06-17 |
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