JPS61174888A - デ−タ信号受信装置 - Google Patents

デ−タ信号受信装置

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JPS61174888A
JPS61174888A JP1593285A JP1593285A JPS61174888A JP S61174888 A JPS61174888 A JP S61174888A JP 1593285 A JP1593285 A JP 1593285A JP 1593285 A JP1593285 A JP 1593285A JP S61174888 A JPS61174888 A JP S61174888A
Authority
JP
Japan
Prior art keywords
signal
gate
output
counter
data signal
Prior art date
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Pending
Application number
JP1593285A
Other languages
English (en)
Inventor
Masao Kirimoto
桐本 昌郎
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
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Filing date
Publication date
Application filed by Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electric Industrial Co Ltd
Priority to JP1593285A priority Critical patent/JPS61174888A/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 本発明は文字放送等に用いられるデータ信号受信装置に
関する。
従来の技術 データ信号送信の一例である文字放送は、天気予報、ニ
ュース、株式情報などの文字・図形で構成される画像情
報をディジタルデータ信号で伝送する放送システムであ
る。この文字放送は、テレビ信号の垂直帰線消去期間の
第10番目の水平走査期間(1oH)から21Hまで、
次のフィールドでは、273Hから284Hまでに重畳
される。
文字信号は、第3図に示すように、1水平走査線を単位
とするデータパケットで伝送される。第3図において、
1は水平同期信号、2はカラーパースト、3は37バイ
トで構成されるデータパケット、4はデータパケット3
のうちの初めの3バイトで形成される同期部、6は残り
34バイトでデータ部である。さらに、同期部4のうち
、6は「101010101010101 oJの2バ
イト長で、クロックライン(以下CRIという)と呼ば
れ、ビット同期用として、7は「111o0101」の
1バイトで、フレーミングコードト呼ばれ、バイト同期
用としてそれぞれ使用される。このフレーミングコード
了は、データ単位の区切りを表わしており、このフレー
ミングコードが検出された時点から1バイト単位のデー
タが始まることを示している。これらの文字信号の同期
部を抜収る操作は、文字放送受信機において極で重要で
ある。
従来例の一例として、文字信号のCRIを抜取るために
、第4図に示すように、CRIよりも高い周波数のクロ
ック信号(例えば、カラーサブキャリア波)を用いてゲ
ート信号を発生させている。
第4図において、8は水平同期パルス入力端子、9はク
ロック信号源、1oはカウンタ、11はゲート発生RO
M、12は文字信号入力端子、13はレベル変換器、1
4はクド回路、15はCRI出力端子である。水平同期
信号に同期した水平同期パルスは、水平同期パルス入力
端子8を介してカウンタ10のリセット入力に加えられ
、カウンタ10は動作可能になる。クロック信号源9の
出力は、カウンタ10のクロック入力端子に加えられ、
カウンタ10はある設定した計数値まで動作する。カウ
ンタ10の出力は、ゲート発生ROM11のアドレス入
力に接続され、ゲート発生ROM11の出力はアンド回
路14の一方の入力に加えられる。また、文字信号は文
字信号入力端子12を介して、レベル変換器13の入力
に供給され、レベル変換された文字信号がレベル変換器
13の出力として、アンド回路14の他方の入力に加え
られる。このようにして、希望するCRI信号は、CR
I信号出力端子15を介して、アンド回路14の出力か
ら得られる。
第5図に第4図に示す回路のタイミングチャートを示す
。第5図において、(a)は水平同期パルスで、カウン
タ10をリセットする。(b)はゲート発生ROM11
の出力で、文字信号CのCRI部分を抜取る。
発明が解決しようとする問題点 ところで、従来例のゲート回路では、水平同期パルスを
基準にして、ゲート信号を発生しているので、例えば第
6図(d) 、 (el )ように、文字信号の重畳位
置が正規の位置か゛)変移している場合、その変移に対
応してCRI部分を抜取るゲート信号を発生させること
は不可能で、CRIを正確に抜取ることは困・唯であっ
た。
本発明は、この点に鑑みてなされたもので、データ信号
の重畳位置が変化しても正確に特定コードを抜収るだめ
のゲート回路を提供するものである。
問題点を解決するだめの手段 本発明はこのような問題点を解決するために、水平同期
パルスを基準にして、正規に重畳されるデータ信号の特
定コード部分よりも若干幅の広いゲート信号を発生する
第1のゲート回路と、データ信号のレベル変換を行うレ
ベル変換器と、前記第1のゲート回路の出力期間中のみ
前記レベル変換器の出力を計数し、予め設定した範囲の
計数値の期間中ゲート信号を発生する第2のゲート回路
から構成されている。
作  用 本発明は上記した構成により、特定コードを抜取るに当
たり、特定コードを含むデータ信号からゲート信号を生
成しているので、上記データ信号の重畳位置が変化して
も、正確に特定コードを抜取るゲート信号を得ることが
容易に可能になる。
実施例 文字信号を例に取った場合の本発明の一実施例を第1図
に示す。第1図において、8は水平同期パルス入力端子
、9はクロック信号源、12は文字信号入力端子、13
はレベル変換器、14はアンド回路、15はCRI出力
端子で、第3図のものと同様である。また、16は第1
のカウンタ、17は第1のゲート発生ROMで、第3図
のカウンタ10とゲート発生ROM11に対応し、特に
、第1のカウンタ16はカウンタ3と同様の動作をする
クロック信号源9からのクロック信号は、第1のカウン
タ16のクロック入力に供給される。また、水平同期パ
ルスは水平同期パルス入力端子8を介して、第1のカウ
ンタ16のリセット入力に供給される。また、第1のゲ
ート発生ROM17のアドレス入力には、第1のカウン
タ16の出力が供給され、第1のゲート発生ROM17
の出力は第2のカラ/り18のリセット入力に供給され
る。文字信号は、文字信号入力端子12を介してレベル
変換器13の入力に加えられる。レベル変換器13の出
力は、第2のカウンタ18のクロック入力に加えられる
と共に、アンド回路14の一方の入力に加えられる。ま
だ、第2のカウンタ18の出力は、第2のゲート発生R
OM19のアドレス入力に加えられる。第2のゲート発
生ROM19の出力は、アンド回路14の他方の入力に
加えられ、希望するCRI信号は、ゲート信号出力端子
15を介して、アンド回路14の出力から得られる。
第2図は、本実施例における各部のタイミングチャート
である。第2図において、(f)は水平同期パルスで、
第5図の(alと同様である。(q)は第1のゲート発
生ROM17の出力で、正規の文字信号の重畳位置に対
して、CRIの部分より前後数ピット幅の広いゲート信
号を発生している。このゲート信号が出力されている期
間は、第2のカウンタは動作可能で、それ以外の期間で
は、前記第2のカウンタはリセット状態になっている。
(h)は、正規の重畳位置にある文字信号で、(i)は
(h)の文字信号入力に対したレベル変換器13の出力
である。
(ilはCR,Iを抜取るCRIゲート信号で、第2の
ゲート発生ROM19の出力である。今の場合、CRI
(7)最初の「1」から最後のroJまで、16ビツト
長のゲート信号を発生しているが、例えば、14ビツト
長のゲート信号を発生させることも可能である。(k)
、(ホ)は、文字信号の重畳位置が変化した場合のレベ
ル変換器13の出力信号で、(cr)のゲート信号内に
CRIが存在する変動であれば、(1) 、 (n)の
ようなCRIゲート信号を得ることができる。
発明の効果 以上、述べてきたように、本発明によれば、テレビ信号
の垂直帰線消去期間に伝送されるデータ信号の特定コー
ドを抜取るゲート回路を簡単な回路構成で実現でき、デ
ータ信号の重畳位置が多少変化した場合でも、正確に特
定コードを抜取ることが可能である。
【図面の簡単な説明】
第1図は本発明の一実施例におけるデータ信号受信装置
のブロック図、第2図は第1図の動作を説明するだめの
タイミングチャート、第3図は文字信号を説明するため
の信号波形図、第4図は従来例のブロック図、第5図は
第4図の動作を説明するだめのタイミングチャートであ
る。 8・・・・・・水平同期パルス入力端子、9・・・・・
・クロック信号源、10・・・・・・カウンタ、11・
・・・・・ゲート発生ROM、12・・・・・・文字信
号入力端子、13・・・・・・レベル変換器、16・・
・・・・第1のカウンタ、1了・・・・・・第1のゲー
ト発生ROM、18・・・・・・第2のカウンタ、19
・・・・・・第2のゲート発生ROM0代理人の氏名 
弁理士 中 尾 敏 男 ほか1名第1図 第2図 第3図 第4図

Claims (1)

    【特許請求の範囲】
  1. テレビ信号の垂直帰線消去期間の水平走査期間に多重伝
    送されるデータ信号の特定コードを抜取るために前記テ
    レビ信号の水平同期信号でリセットされ、前記特定コー
    ドが正規に多重伝送される位置よりも若干幅の広いゲー
    ト信号を発生する第1のゲート回路と、前記データ信号
    のレベルを変換するレベル変換器と、前記第1のゲート
    回路の出力期間中に動作可能になり前記レベル変換器の
    出力を計数し、予め設定した計数値を計数する間、ゲー
    ト信号を発生する第2のゲート回路とを有することを特
    徴とするデータ信号受信装置。
JP1593285A 1985-01-30 1985-01-30 デ−タ信号受信装置 Pending JPS61174888A (ja)

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Application Number Priority Date Filing Date Title
JP1593285A JPS61174888A (ja) 1985-01-30 1985-01-30 デ−タ信号受信装置

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JP1593285A JPS61174888A (ja) 1985-01-30 1985-01-30 デ−タ信号受信装置

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JPS61174888A true JPS61174888A (ja) 1986-08-06

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ID=11902544

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Application Number Title Priority Date Filing Date
JP1593285A Pending JPS61174888A (ja) 1985-01-30 1985-01-30 デ−タ信号受信装置

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