JPS6051833B2 - デ−タ抜取方法 - Google Patents
デ−タ抜取方法Info
- Publication number
- JPS6051833B2 JPS6051833B2 JP53145181A JP14518178A JPS6051833B2 JP S6051833 B2 JPS6051833 B2 JP S6051833B2 JP 53145181 A JP53145181 A JP 53145181A JP 14518178 A JP14518178 A JP 14518178A JP S6051833 B2 JPS6051833 B2 JP S6051833B2
- Authority
- JP
- Japan
- Prior art keywords
- fleming
- detection pulse
- code
- slice level
- signal
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
Landscapes
- Testing, Inspecting, Measuring Of Stereoscopic Televisions And Televisions (AREA)
- Television Systems (AREA)
Description
【発明の詳細な説明】
本発明はデータの抜取方法に関し、特に多重された信
号の抜取りを自動化する核能を有するテレビ多重文字放
送受信機として最適なデータ抜取方法を提供するもので
ある。
号の抜取りを自動化する核能を有するテレビ多重文字放
送受信機として最適なデータ抜取方法を提供するもので
ある。
先ず本発明をこのテレビ多重文字放送受信機に使用し
た例に添つて説明する。
た例に添つて説明する。
・ 近年テレビの多重放送に関する技術が発達し、これ
に伴い種々のテレビ多重方式が提案されている。
に伴い種々のテレビ多重方式が提案されている。
この一方式として提案されているテレビ多重文字放送に
おいては、１水平走査期間分の２値信号により構成され
る文字情報と、この情報のデー、夕処理の同期信号とし
て所定の２値信号により構成されるフレミングコードと
を、テレビ信号の垂直周線消去期間の特定の１ライン例
えば、第２幡目のラインと第２８旙目のライン（以下こ
れを各各２０Ｈ，２８３１（と称す）に重畳して順次伝
送するものであり、これを受信する受信機においてはこ
のデータをスライスして抜取り、デジタル処理し文字情
報をブラウン管上に表示させるものである。この際ゴー
ストあるいは受信機のＩＦ特性による位相歪及びノイズ
等によりデータの波形がしばしば劣化する。したがつて
、この種の受信機では良好にデータをサンプリングする
ために、データのスライスレベルを常に最適位置にする
必要がある。従来スライスレベルは可変抵抗器等により
手動で調整する場合が多かつたが、これではデータレベ
ルが変動するたびに再度調整を要する。
おいては、１水平走査期間分の２値信号により構成され
る文字情報と、この情報のデー、夕処理の同期信号とし
て所定の２値信号により構成されるフレミングコードと
を、テレビ信号の垂直周線消去期間の特定の１ライン例
えば、第２幡目のラインと第２８旙目のライン（以下こ
れを各各２０Ｈ，２８３１（と称す）に重畳して順次伝
送するものであり、これを受信する受信機においてはこ
のデータをスライスして抜取り、デジタル処理し文字情
報をブラウン管上に表示させるものである。この際ゴー
ストあるいは受信機のＩＦ特性による位相歪及びノイズ
等によりデータの波形がしばしば劣化する。したがつて
、この種の受信機では良好にデータをサンプリングする
ために、データのスライスレベルを常に最適位置にする
必要がある。従来スライスレベルは可変抵抗器等により
手動で調整する場合が多かつたが、これではデータレベ
ルが変動するたびに再度調整を要する。
本発明はデータレベルが変動しても常に最適なスライス
レベルを自動的に確保するものである。
レベルを自動的に確保するものである。
以下図面に従つて本発明を詳細に説明する。第１図は本
発明の実施例による多重文字放送受信機のブロック図で
あつて、同図において１はビデオ信号を適当なレベルに
増幅するバッファアンプ、２はビデオ信号からＤＡＴＡ
を抜取る本発明のデータ抜取回路、３は多重期間ＤＡＴ
Ａの位相に同期して発振し、それ以外の期間はテレビ受
像機の水平ＡＦＣパルスに同期して発振することにより
ＤＡＴＡのパルス信号に同期したビットクロックパルス
（ＢＩＴＣＫ）を発生するクロック発生回路である。４
はビデオ信号から水平、垂直同期信号ＨＳＹＮＣ，ＶＳ
ＹＮＣを分離する同期分離回路、５はＢＩＴＣＫ、水平
ＡＦＣパルスを入力として動作し水平方向の信号処理を
行なう水平位置カウンタ、６はＨＳＹＮＣ及びＶＳＹＮ
Ｃを入力として動作．し垂直方向の信号処理を行なう垂
直位置カウンタ、７はＤＡＴＡに含まれるコントロール
コードの処理例えば伝送されるプログラムコードと受信
機のキーボード１１で選択したプログラムとの比較を行
ない、両者の一致がとれるとメモリ１０をＪ書込み状態
にするコントロール信号処理回路である。
発明の実施例による多重文字放送受信機のブロック図で
あつて、同図において１はビデオ信号を適当なレベルに
増幅するバッファアンプ、２はビデオ信号からＤＡＴＡ
を抜取る本発明のデータ抜取回路、３は多重期間ＤＡＴ
Ａの位相に同期して発振し、それ以外の期間はテレビ受
像機の水平ＡＦＣパルスに同期して発振することにより
ＤＡＴＡのパルス信号に同期したビットクロックパルス
（ＢＩＴＣＫ）を発生するクロック発生回路である。４
はビデオ信号から水平、垂直同期信号ＨＳＹＮＣ，ＶＳ
ＹＮＣを分離する同期分離回路、５はＢＩＴＣＫ、水平
ＡＦＣパルスを入力として動作し水平方向の信号処理を
行なう水平位置カウンタ、６はＨＳＹＮＣ及びＶＳＹＮ
Ｃを入力として動作．し垂直方向の信号処理を行なう垂
直位置カウンタ、７はＤＡＴＡに含まれるコントロール
コードの処理例えば伝送されるプログラムコードと受信
機のキーボード１１で選択したプログラムとの比較を行
ない、両者の一致がとれるとメモリ１０をＪ書込み状態
にするコントロール信号処理回路である。
８はメモリの水平方向のアドレスを指定するＸアドレス
カウンタ、９は垂直方向のアドレスを指定するＹアドレ
スカウンタ、１２はメモリの出力信号をテレビ信号とＭ
ＩＸさせたり、単独で表示・したりする機能を有する出
力切換回路である。
カウンタ、９は垂直方向のアドレスを指定するＹアドレ
スカウンタ、１２はメモリの出力信号をテレビ信号とＭ
ＩＸさせたり、単独で表示・したりする機能を有する出
力切換回路である。
第２図に本発明のデータ抜取回路２の実施例ブロック図
を、第３図にデータスライスの説明図を、第４図にデー
タ抜取回路説明用の波形図を示す。第２図中１３はデー
タ抜取処理に用いるクロックパルス作成用の発振器、１
４はこのクロックパルスをカウントするカウンタ、１５
は１４の出力をアナログ値に変換する第１のＤ−Ａ変換
回路、１６及び１７はそれぞれカウンタ１４の出力をラ
ッチする第１レジスタ及び第２レジスタ、１８及び１９
はそれぞれ第１レジスタ１６及び第２レジスタ１７の出
力をアナログ値に変換する第２のＤｊ−Ａ変換回路及び
第３のＤ−Ａ変換回路である。２０及び２１はビデオ信
号からＤＡＴＡをスライスして取出す第１比較器及び第
２比較器であり、比較器２０のスライスレベルは第１Ｄ
−Ａ変換回路１５の出力レベルであり、比較器２１のス
ライスレベルは第１及び第鉋−Ａ変換回路１８と１９の
出力レベルの中間の値である。
を、第３図にデータスライスの説明図を、第４図にデー
タ抜取回路説明用の波形図を示す。第２図中１３はデー
タ抜取処理に用いるクロックパルス作成用の発振器、１
４はこのクロックパルスをカウントするカウンタ、１５
は１４の出力をアナログ値に変換する第１のＤ−Ａ変換
回路、１６及び１７はそれぞれカウンタ１４の出力をラ
ッチする第１レジスタ及び第２レジスタ、１８及び１９
はそれぞれ第１レジスタ１６及び第２レジスタ１７の出
力をアナログ値に変換する第２のＤｊ−Ａ変換回路及び
第３のＤ−Ａ変換回路である。２０及び２１はビデオ信
号からＤＡＴＡをスライスして取出す第１比較器及び第
２比較器であり、比較器２０のスライスレベルは第１Ｄ
−Ａ変換回路１５の出力レベルであり、比較器２１のス
ライスレベルは第１及び第鉋−Ａ変換回路１８と１９の
出力レベルの中間の値である。
２２は２０Ｈ，２８３１１の期間のみＤＡＴＡを出力す
るデータゲート回路である。２４は第１比較器２０を経
て入力されたビデオ信号より所定の２値信号で構成され
たフレミングコードをデコードし、第４図ｃに示すよう
なフレミングコード検出パルスを出力する。
るデータゲート回路である。２４は第１比較器２０を経
て入力されたビデオ信号より所定の２値信号で構成され
たフレミングコードをデコードし、第４図ｃに示すよう
なフレミングコード検出パルスを出力する。
また、２３は例えばモノマルチバイブレータ等で構成さ
れ、すでに述べた情報及びフレミングコードの多重化さ
れた２０Ｈと２８３１１の多重ラインごとに１発のパル
スを発生させかつ、第４図ｂに示すような多重ラインの
立上りから２４より出力されるフレミングコード検出パ
ルスと一致する位置まで適宜遅延させて得た第４図ｄの
ようなサンプリングパルスを出力する。２５はフレミン
グコードの検出が行なわれている間Ｑ出力が立上るフリ
ップフロップであり、２４の力がＤ端子へ入力されかつ
サンプリングパルス作成回路２３より得られるサンプリ
ングパルスがクロック端子ＣＫへ入力される。２６及び
２７はそれぞれフリップフロップ２５のＱ出力の立上り
及び立下りを示す信号を出力する第１ゲート及び第２ゲ
ートである。
れ、すでに述べた情報及びフレミングコードの多重化さ
れた２０Ｈと２８３１１の多重ラインごとに１発のパル
スを発生させかつ、第４図ｂに示すような多重ラインの
立上りから２４より出力されるフレミングコード検出パ
ルスと一致する位置まで適宜遅延させて得た第４図ｄの
ようなサンプリングパルスを出力する。２５はフレミン
グコードの検出が行なわれている間Ｑ出力が立上るフリ
ップフロップであり、２４の力がＤ端子へ入力されかつ
サンプリングパルス作成回路２３より得られるサンプリ
ングパルスがクロック端子ＣＫへ入力される。２６及び
２７はそれぞれフリップフロップ２５のＱ出力の立上り
及び立下りを示す信号を出力する第１ゲート及び第２ゲ
ートである。
以上回路構成を説明したが以下に具体的な動作説明を行
なう。
なう。
第３図にスライスレベルの上限、下限、最適なスライス
レベルを表わす波形図を示す。第２図において端子２８
には第１図の垂直位置カウンタ６より出力された第４図
ｂに示すような２０１２８３Ｈの信号が入力される。
レベルを表わす波形図を示す。第２図において端子２８
には第１図の垂直位置カウンタ６より出力された第４図
ｂに示すような２０１２８３Ｈの信号が入力される。
また端子２９には第１図のバッファアンプ１より出力さ
れたビデオ信号が入力される。第２図においてカウンタ
１４は発振器１３より得られるクロックをカウントして
行きこのカウント値は第１のＤ−Ａ変換器１５によりア
ナログ値に変換され、これは第１の比較器２０のスライ
スレベルとなる。カウンタ１４のカウント値の上昇に伴
いスライスレベルが上昇し第３図に示ずスライスレベル
の下限まで達するとフレミングコード検出回路２４より
第４図ｃに示すようにフレミング検出パルスが発生し、
サンプリングパルス作成回路２３より得られる第４図ｄ
に示すサンプリングパルスによりフリップフロップ２５
のＱ出力が第４図ｅのように立上る。その結果、第１ゲ
ート２６の出力には第４図ｆに示すようなスライスレベ
ル下限の検出信号が発生しこれを第１レジスタ１６へ加
えカウンタ１４のカウント数をラッチし、第２のＤ−Ａ
変換器１８に第３図に示す下限のスライスレベル■２の
値が出力される。カウンタ１４はさらにカウント数を増
して行き第１比較器２０のスライスレベルを上昇させて
第３図に示すようなスライスレベル上限Ｖ１に達すると
、フレミングコード検出回路２４より第４図ｃに示すフ
レミングコード検出パルスが発生しなくなる。その結果
、フリップフロップ２５のＱ出力が立下り、第２ゲート
２７の出力には第４図ｇに示すようなスライスレベル上
限の検出信号が出力される。これにより第２レジスタ１
７へこの時のカウント数をラッチし、第３のＤ−Ａ変換
器１９には上限のスライスレベルＶ１が出力される。第
２比較器２１には１８及び１９の出力の中間のレベルが
入力されるようになつていて、上限のスライスレベルＶ
１が検出された後は常に上限と下限の中間のスライスレ
ベルＶ。が入力されることになる。この時カウンタ１４
はリセットされカウント数を゛ゼロ゛に戻し上記の動作
をくりかえす。以上のように本発明によればデータのレ
ベルが変動しても常に最適なスライスレベルが確保され
る。
れたビデオ信号が入力される。第２図においてカウンタ
１４は発振器１３より得られるクロックをカウントして
行きこのカウント値は第１のＤ−Ａ変換器１５によりア
ナログ値に変換され、これは第１の比較器２０のスライ
スレベルとなる。カウンタ１４のカウント値の上昇に伴
いスライスレベルが上昇し第３図に示ずスライスレベル
の下限まで達するとフレミングコード検出回路２４より
第４図ｃに示すようにフレミング検出パルスが発生し、
サンプリングパルス作成回路２３より得られる第４図ｄ
に示すサンプリングパルスによりフリップフロップ２５
のＱ出力が第４図ｅのように立上る。その結果、第１ゲ
ート２６の出力には第４図ｆに示すようなスライスレベ
ル下限の検出信号が発生しこれを第１レジスタ１６へ加
えカウンタ１４のカウント数をラッチし、第２のＤ−Ａ
変換器１８に第３図に示す下限のスライスレベル■２の
値が出力される。カウンタ１４はさらにカウント数を増
して行き第１比較器２０のスライスレベルを上昇させて
第３図に示すようなスライスレベル上限Ｖ１に達すると
、フレミングコード検出回路２４より第４図ｃに示すフ
レミングコード検出パルスが発生しなくなる。その結果
、フリップフロップ２５のＱ出力が立下り、第２ゲート
２７の出力には第４図ｇに示すようなスライスレベル上
限の検出信号が出力される。これにより第２レジスタ１
７へこの時のカウント数をラッチし、第３のＤ−Ａ変換
器１９には上限のスライスレベルＶ１が出力される。第
２比較器２１には１８及び１９の出力の中間のレベルが
入力されるようになつていて、上限のスライスレベルＶ
１が検出された後は常に上限と下限の中間のスライスレ
ベルＶ。が入力されることになる。この時カウンタ１４
はリセットされカウント数を゛ゼロ゛に戻し上記の動作
をくりかえす。以上のように本発明によればデータのレ
ベルが変動しても常に最適なスライスレベルが確保され
る。
以上データ抜取の自動化を多重文字放送受信機の例に添
つて説明したが、本発明はこれに限らず他のデータ伝送
システムにおいても応用可能なものである。
つて説明したが、本発明はこれに限らず他のデータ伝送
システムにおいても応用可能なものである。
第１図は本発明実施例の多重文字放送受信機の構成を示
すブロック回路図、第２図は本発明実施例の主要回路の
ブロック回路図、第３図はデータスライス動作の説明用
波形図、第４図はデータ抜取回路２の説明用波形図であ
る。 １・・・・・・バッファアンプ、２・・・・・・データ
抜取回路、３・・・・・・クロック発生回路、４・・・
・・・同期分離回゛路、５・・・・・・水平位置カウン
タ、６・・・・・・垂直位置カウンタ、７・・・・・・
コントロール信号処理回路、８・・・・・Ｘアドレスカ
ウンタ、９・・・・・・Ｙアドレスカウンタ、１０・・
・・・・メモリ、１１・・・・・キーボード、１２・・
・・出力切換回路、１３・・・・・・発振器、１４・・
・・・・力・ウンタ、１５・・・・・・第１のＤ−Ａ変
換器、１６・・・第１レジスタ、１７・・・・・・第２
レジスタ、１８・・・第２のＤ−Ａ変換器、１９・・・
・・・第３のＤ−Ａ変換器、２０・・・・・第１比較器
、２１・・・・・・第２比較器、２２・・・・・・デー
タゲー１・、２３・・・・・・サンプリングパンルス作
成回路、２４・・・・・・フレミングコード検出回路、
２５・・・・フリップフロップ、２６・・・・・・第１
ゲート、２７・・・・・・第２ゲ゛一ト。
すブロック回路図、第２図は本発明実施例の主要回路の
ブロック回路図、第３図はデータスライス動作の説明用
波形図、第４図はデータ抜取回路２の説明用波形図であ
る。 １・・・・・・バッファアンプ、２・・・・・・データ
抜取回路、３・・・・・・クロック発生回路、４・・・
・・・同期分離回゛路、５・・・・・・水平位置カウン
タ、６・・・・・・垂直位置カウンタ、７・・・・・・
コントロール信号処理回路、８・・・・・Ｘアドレスカ
ウンタ、９・・・・・・Ｙアドレスカウンタ、１０・・
・・・・メモリ、１１・・・・・キーボード、１２・・
・・出力切換回路、１３・・・・・・発振器、１４・・
・・・・力・ウンタ、１５・・・・・・第１のＤ−Ａ変
換器、１６・・・第１レジスタ、１７・・・・・・第２
レジスタ、１８・・・第２のＤ−Ａ変換器、１９・・・
・・・第３のＤ−Ａ変換器、２０・・・・・第１比較器
、２１・・・・・・第２比較器、２２・・・・・・デー
タゲー１・、２３・・・・・・サンプリングパンルス作
成回路、２４・・・・・・フレミングコード検出回路、
２５・・・・フリップフロップ、２６・・・・・・第１
ゲート、２７・・・・・・第２ゲ゛一ト。
Claims (1)
- 【特許請求の範囲】 １ 常時発振される一定周期のクロック信号をカウント
アップし、このカウント値を逐一アナログ値に変換し、
情報のデータ処理の周期信号としてこの情報と同時に伝
送されてくる２値信号を前記アナログ値をもつスライス
レベルで逐一スライスし、前記カウントアップに伴つて
基準レベルより逐一上昇したスライスレベルがこの２値
信号を検出したとき下限検出パルスを立て、さらに上昇
するスライスレベルがこの２値信号を検出しなくなつた
とき上限の検出パルスを立て、この下限検出パルスが立
つたときの前記カウント値をラッチするとともに下限の
スライスレベルとしてアナログ値に変換しかつ、前記上
限検出パルスが立つたときの前記カウント値をラッチす
るとともに上限のスライスレベルとしてアナログ値に変
換し、この両アナログ値を加算して常にその中間のアナ
ログ値をもつスライスレベルを生成し、このスライスレ
ベルで前記情報をスライスすることを特徴としたデータ
抜取方法。 ２ テレビ信号の垂直帰線期間の特定の１ラインに、２
値信号により構成される情報と、この情報のデータ処理
の同期信号として所定の２値信号により構成されるフレ
ミングコードとよりなるデータを重畳して順次伝送され
る放送を受信して画面に表示するテレビジョン多重文字
放送受信機における前記フレミングコードをスライスさ
れる２値信号としたことを特徴とした特許請求の範囲第
１項記載のデータ抜取方法。 ３ フレミングコードを検出したときフレミングコード
検出パルスを立て、このフレミングコードを検出しなく
なつたときフレミングコード検出パルスを禁止し、この
フレミングコード検出パルスを前記データの多重化され
た多重ラインが伝送されてくるごとに発生するパルスで
サンプリングし、このフレミングコード検出パルスをサ
ンプリングしたとき下限の検出パルスを立て、サンプリ
ングしなかつたとき上限の検出パルスを立ててなること
を特徴とした特許請求の範囲第２項記載のデータ抜取方
法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP53145181A JPS6051833B2 (ja) | 1978-11-24 | 1978-11-24 | デ−タ抜取方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP53145181A JPS6051833B2 (ja) | 1978-11-24 | 1978-11-24 | デ−タ抜取方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5571368A JPS5571368A (en) | 1980-05-29 |
| JPS6051833B2 true JPS6051833B2 (ja) | 1985-11-15 |
Family
ID=15379291
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP53145181A Expired JPS6051833B2 (ja) | 1978-11-24 | 1978-11-24 | デ−タ抜取方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6051833B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62139158U (ja) * | 1986-02-21 | 1987-09-02 |
Families Citing this family (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57107689A (en) * | 1980-12-25 | 1982-07-05 | Toshiba Corp | Sampling pulse correcting system |
| JPS57107686A (en) * | 1980-12-25 | 1982-07-05 | Toshiba Corp | Sampling pulse correcting system |
| JPS5897986A (ja) * | 1981-12-07 | 1983-06-10 | Nippon Hoso Kyokai <Nhk> | 信号識別方式 |
| FR2565448B1 (fr) * | 1984-06-04 | 1986-10-10 | France Etat | Procede et dispositif d'extraction de synchronisation pour systeme de diffusion a multiplexage temporel de signaux numeriques et analogiques |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5187948A (ja) * | 1975-01-29 | 1976-07-31 | Matsushita Electric Ind Co Ltd |
-
1978
- 1978-11-24 JP JP53145181A patent/JPS6051833B2/ja not_active Expired
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5187948A (ja) * | 1975-01-29 | 1976-07-31 | Matsushita Electric Ind Co Ltd |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62139158U (ja) * | 1986-02-21 | 1987-09-02 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5571368A (en) | 1980-05-29 |
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