JPS6116648U - マイクロプログラム制御式情報処理装置 - Google Patents

マイクロプログラム制御式情報処理装置

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JPS6116648U
JPS6116648U JP9218085U JP9218085U JPS6116648U JP S6116648 U JPS6116648 U JP S6116648U JP 9218085 U JP9218085 U JP 9218085U JP 9218085 U JP9218085 U JP 9218085U JP S6116648 U JPS6116648 U JP S6116648U
Authority
JP
Japan
Prior art keywords
microprogram
information processing
processing device
controlled information
gate means
Prior art date
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JP9218085U
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JPS6117474Y2 (ja
Inventor
行生 谷山
哲夫 長堀
Original Assignee
富士通株式会社
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Publication date
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Granted legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は本考案の一実施例のブロック図、第２図は上記
実施例における制御メモリのアドレス設定を説明するた
めの図である。 １０・・・制御メモリ、１１・・・アドレスレジスタ、
１２・・・データレジスタ、１３・・・デコーダ、１４
，２５・・・ゲート、１５，２６・・・フリップフロツ
プ、′１７・・・演算回路、１８．２０・・・演算用レ
ジスタ、１９，２１，２２・・・バス、２３・・田一カ
ルストレツジレジスタ、２４・・・パリティチェック回
路、２７・・・出力線、２８・・・コンベア・アドレス
レジスタ、２９・・・コンベア回路。

Claims (1)

  1. 【実用新案登録請求の範囲】 、 マイクロプログラムを格納する記憶装置と、該記憶
    装置をアクセスするためのアドレスがセットされるアド
    レスレジスタと、 情報処理装置を構成する各素子からの情報の誤りを検出
    する誤り検出手段と、 を備えたマイクロプログラム制御式情報処理装置であっ
    て、 前記アドレスレジスタは、マイクロプログラムのイニシ
    ャルスタート時から該各素子の不安定期間経過後は、特
    定のビットが異なる内容にセットされて成ると共に、 該誤り検出手段の検出出力が入力されるゲート手段と、 イニシャルス゜タート時は、該ゲート手段の閉成信号を
    出力し、該アドレスレジスタの特定のビツトが異なる内
    容にセットされた場合、該ゲート手段の開成信号を出力
    する手段と、 を具備してなることを特徴とするマイクロプログラム制
    御式情報処理装置。
JP9218085U 1985-06-20 1985-06-20 マイクロプログラム制御式情報処理装置 Granted JPS6116648U (ja)

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JP9218085U JPS6116648U (ja) 1985-06-20 1985-06-20 マイクロプログラム制御式情報処理装置

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JP9218085U JPS6116648U (ja) 1985-06-20 1985-06-20 マイクロプログラム制御式情報処理装置

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Publication Number Publication Date
JPS6116648U true JPS6116648U (ja) 1986-01-30
JPS6117474Y2 JPS6117474Y2 (ja) 1986-05-28

Family

ID=30648745

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JP9218085U Granted JPS6116648U (ja) 1985-06-20 1985-06-20 マイクロプログラム制御式情報処理装置

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JPS6117474Y2 (ja) 1986-05-28

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