JPS61107844A - デ−タの送受信方式 - Google Patents

デ−タの送受信方式

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Publication number
JPS61107844A
JPS61107844A JP59229137A JP22913784A JPS61107844A JP S61107844 A JPS61107844 A JP S61107844A JP 59229137 A JP59229137 A JP 59229137A JP 22913784 A JP22913784 A JP 22913784A JP S61107844 A JPS61107844 A JP S61107844A
Authority
JP
Japan
Prior art keywords
circuit
signal
address
inputted
data
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP59229137A
Other languages
English (en)
Inventor
Toyohiko Yajima
矢島 豊彦
Yoshiharu Kousai
義治 幸西
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Seiko Epson Corp
Original Assignee
Seiko Epson Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Seiko Epson Corp filed Critical Seiko Epson Corp
Priority to JP59229137A priority Critical patent/JPS61107844A/ja
Publication of JPS61107844A publication Critical patent/JPS61107844A/ja
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  • Communication Control (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 小型携帯機器のデータの送受信の方式に関する。
〔従来の技術〕
データの送受信方式特にパソコン間のデータ転送の方法
として、R82520を持ち入られる事が多い。現在、
R82520のデータ転送用の回路としてS工Oや82
51等の市販のICが工(使われている。上記の市販の
ICは、R82520の汎用的彦使い方に最適である。
〔発明が解決し二つとする問題点〕
しかし、小型情報機器において、R82520を用いて
データ転送をおこなう場合、上記汎用ICt−用いても
可能であるが、不用な機能が多く工’Cが多くなる。そ
こで必要最小限の回路で信頼   性が高くコストが安
い送受信方式が必要になる。
本発明は前記回路を容易に得る事のできる送受信方式で
ある。
〔作用〕
本発明の送受信方式は、シフトレジスタ回路とタイマー
回路とアドレス検出回路から構成されてデータの入力に
ダしタイマー回路によって時間で検出する手段と、アド
レス検出回路によってアドレスを検出〜する手段を有し
、データ出力に対しアドレス検出回路によってアドレス
を検出する手段を有する。
〔実施例〕
i@1図に本発明の実施例のブロック図を示す。
シフトレジスタ回路3にはパラレル入力端子トパラレル
出力端子2・シリアルデータの入出力バス4・シリアル
データの入出力パス4は、記憶装置などのデータバスと
接続されている。シフトレジスタ回路50制御信号とし
て、パラレル変換スタート信号5と、シリアル変換エン
ド信号6が入力している。タイマー回路8は、シリアル
変換エンド信号6が入力し、入力したらある一定時間に
間に仄の7リアル変換工ンド信号6が入力しないと、入
力終了信号16を出力する。アドレス検出回路7は、デ
ータ受信の際はシリアル変換エンド信号6が入力し、ア
ドレスの+10アドレス信号11を記憶装置などのアド
レスバスに出力され、ライト信号9により外部へ書き込
まれる。又、セットされているアドレスより大きくなる
と、入力終了信号15を出力する。受信終了信号13は
入力終了信号15.16のOR出力となっている。
又、データ送信の際は、送信開始アドレスと、送信終了
アドレスをアドレス検出回路7にセラトスる。送信を開
始すると、アドレス検出回路7は、パラレル変換スター
ト信号5をシフトレジスタ回路5ヘリード信号10t−
外部装置へ出力する。送信終了信号を検出するとアドレ
ス検出回路7は、送信終了アドレス12を出力する。シ
フトレジスタd、パラレル変換スタート信号5を受けと
ると外部装置から入出力パスから入力し、7リアル変換
をし、パラレル出力端子2からデータを出力する。デー
タ受信の際は、データが任意の時間入力しない事を検出
する手段と、一定データ数が入力すると検出する手段を
備えている。一方、データ    ”送信の際は、ある
データ僻が出力されると検出する手段を備えている。
〔発明の効果〕
本発明は、小型携帯装置の人出カ装置として、非常に容
易に複雑な制御回路を全く必要とせず簡単な回路を用い
て高い信頓性を得る事ができる。
【図面の簡単な説明】
第1図に本発明の実施例のブロック図を示す。 1・・・パラレル入力端子 2・・・パラレル出力端子 5・・・シフトレジスタ回路 4・・・入出力バス 5・・・パラレル変換スタート信号 6・・・シリアル変換エンド信号 7・・・アドレス検出回路 8・・・タイマー回路 9・・・ライト信号 10・・・リード信号 11・・・アドレス信号 12・・・送信終了信号 15・・・受信終了信号 14 ・・・0R 15・・・入力終了信号 16・・・入力終了信号 以上

Claims (3)

    【特許請求の範囲】
  1. (1)データ送受信回路として、シフトレジスタ回路と
    タイマー回路とアドレス検出回路を具備し、データを受
    信する時に、シフトレジスタ回路に入力するデータがあ
    る一定時間以上入力しないことをタイマー回路により検
    出し受信終了とする事を特徴とするデータの送受信方式
  2. (2)データを受信する時に、ある一定以上のアドレス
    になると前記アドレス検出回路により検出し受信終了と
    する事を特徴とする特許請求第1項記載のデータの送受
    信方式。
  3. (3)データを送信する時に、ある一定以上のアドレス
    になると前記アドレス検出回路により検出し送信終了と
    する事を特徴とする特許請求第1項記載のデータの送受
    信方式。
JP59229137A 1984-10-31 1984-10-31 デ−タの送受信方式 Pending JPS61107844A (ja)

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JPS61107844A true JPS61107844A (ja) 1986-05-26

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5721766A (en) * 1986-08-04 1998-02-24 Canon Kabushiki Kaisha Communication apparatus able to call plural designated destinations

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5721766A (en) * 1986-08-04 1998-02-24 Canon Kabushiki Kaisha Communication apparatus able to call plural designated destinations

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