JPS61107754A - チツプキヤリア型素子を搭載するキヤリア - Google Patents

チツプキヤリア型素子を搭載するキヤリア

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Publication number
JPS61107754A
JPS61107754A JP22861084A JP22861084A JPS61107754A JP S61107754 A JPS61107754 A JP S61107754A JP 22861084 A JP22861084 A JP 22861084A JP 22861084 A JP22861084 A JP 22861084A JP S61107754 A JPS61107754 A JP S61107754A
Authority
JP
Japan
Prior art keywords
carrier
leads
chip carrier
type element
flat package
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP22861084A
Other languages
English (en)
Inventor
Kimio Meguro
目黒 喜美男
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
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Publication of JPS61107754A publication Critical patent/JPS61107754A/ja
Pending legal-status Critical Current

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    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/12Mountings, e.g. non-detachable insulating substrates
    • H01L23/13Mountings, e.g. non-detachable insulating substrates characterised by the shape
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/0001Technical content checked by a classifier
    • H01L2924/0002Not covered by any one of groups H01L24/00, H01L24/00 and H01L2224/00

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  • Physics & Mathematics (AREA)
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  • General Physics & Mathematics (AREA)
  • Engineering & Computer Science (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Testing Or Measuring Of Semiconductors Or The Like (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (技術分野) 本発明はICのキャリアにかかり、とくにチップキャリ
ア型素子用キャリアに関するものである。
(従来技術) ICを使用して構成される装置において、ICの高密度
実装のため、従来の標準デコアル、インラインパッケー
ジ(DIP)などに比べ、より小型のパッケージが種々
出現している。この小型パッケージの主なものとして、
フラットパッケージ型素子とチップキャリア型素子があ
る。通常、ICはパッケージに搭載されてから製品とし
ての機能を満たしているかどうかのテストが種々行なゎ
える。大規模化し、複雑な機能を有するICのテストは
自動特性測定装置(ICテスタ)で行ない、大量生産さ
れるICは、ICを自動供給するオートハンドラとIC
テスタとを組み合わせてテストすることが一般的である
が、前述のとおり、種々のパッケージが出現すると、そ
れぞれのパッケージに対応したテストユニ7)やオート
ハンド2か必要となる。
9 (発明の概要) 本発明の目的はチップキャリア要素子を7ラツトパツケ
ージ型素子の搭載されるキャリアと同様のキャリアに搭
載する事で7ラツトパツケージ型素子で用いるテスト装
置やオートハンドラを使用できる様な、チップキャリア
素子搭載用キャリアを提供する事にある。
(発明の説明) 以下に図面を用いて本発明の詳細な説明する。
第1図は代表的な24PINのフラットパッケージ型素
子10外形図であり、第1図Aは平面図、第1図Bは側
面図である。同図から明らかのように複数のリード1が
水平方向に延長している。この素子10は第2図に示す
様なフラットパッケージ用キャリア11に搭載されて、
とり扱われ、特性のテストは位置決め穴13で位置を決
めて、リードにプローグ等を当てることで行なわれる。
尚、第2図Aは平面図、第2図Bは側面図である。
一方、第3図は、24PINフラツトパツケージ型素子
に対応するチップキャリア型素子20外形図である。図
に示す様にチップキャリア型素子20にはリードを伸ば
さない事で、実装密度を上げることを特徴とする特性の
テストは複数のパッド2にプローブ等を当てることで行
なわれるが、フラットパッケージのリードとチップキャ
リアイパッドはそのピッチも位置も一般には異なる。尚
、第3図Aは平面図、第3図Bは側面図である。
このため、本発明は第2図に示すフラットパッケージ用
キャリアとリード部、位置決め穴を合致させたチップキ
ャリア用を提供し、テストユニットオートハンドラを共
通化することを可能とするものである。
(発明の実施例) 第4図に本発明の実施例を示す。フラットパッケージ型
素子搭載用キャリアと外形を合わせたチップキャリア型
素子搭載用キャリア12には複数のリード3を埋め込み
、そのリードの先端にはチップキャリアのパッドに接触
させるパッド接触子4を有する。この場合リード3の外
形はフラットパッケージのリード位置と一致させ、リー
ドのパッド接触子はチップキャリアの、4ツドと位置が
合う様にするために第4図Aの平面図に示すように平面
形状で曲げられている。尚、第4図Bは側面図、符号1
4は位置出し穴(切欠き)である。
(発明の効果)                  
  、じ以上述べてきた様に本発明によれば、フラット
パッケージ用のキャリアに外形を合わせた、チップキャ
リア用キャリアにチップキャリア型ICを入れて取り扱
う事で、フラットパッケージと同一のテストユニットや
オートノ1ンドラを用いる事ができる。
(発明のまとめ) 本、発明はフラットパッケージのリードと位置を合わせ
たリードを有するチップキャリ用キャリアであるが、リ
ードのかわりにプリントパターンなどでも良い事はもち
ろんであり、さらにPIN数が異なっても可能である。
【図面の簡単な説明】
第1図はフラットパッケージ型ICを示す外形図である
。第2図はフラットパッケージ用のキャ 拳リアを示す
外形図である。第3図はチップキャリア型ICの外形図
である。第4図は本発明へ1実施例を示す外形図である
。 1・・・・・・リード、2・・・・・・パッド、3・・
・・・・リード、4・・・・・・パッド接触子、10・
・・・・・フラットパッケージ型IC素子、11・・・
・・・フラットパッケージ型IC素子用キャリア、12
・・・・・・チップキャリア型IC素子用キャリア、1
3 、14・・・・・・位置穴め穴(切欠き)である。 榮1図 第3図 第2図

Claims (1)

    【特許請求の範囲】
  1.  搭載せるチップキャリア型素子の複数のパッド部にそ
    れぞれ接触することを可能ならしめた複数のリードを有
    することを特徴とするチップキャリア型素子を搭載する
    キャリア。
JP22861084A 1984-10-30 1984-10-30 チツプキヤリア型素子を搭載するキヤリア Pending JPS61107754A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP22861084A JPS61107754A (ja) 1984-10-30 1984-10-30 チツプキヤリア型素子を搭載するキヤリア

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Application Number Priority Date Filing Date Title
JP22861084A JPS61107754A (ja) 1984-10-30 1984-10-30 チツプキヤリア型素子を搭載するキヤリア

Publications (1)

Publication Number Publication Date
JPS61107754A true JPS61107754A (ja) 1986-05-26

Family

ID=16879043

Family Applications (1)

Application Number Title Priority Date Filing Date
JP22861084A Pending JPS61107754A (ja) 1984-10-30 1984-10-30 チツプキヤリア型素子を搭載するキヤリア

Country Status (1)

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JP (1) JPS61107754A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS63151038A (ja) * 1986-12-16 1988-06-23 Tokyo Electron Ltd Ic製品搬送用具及びic製品検査方法

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS63151038A (ja) * 1986-12-16 1988-06-23 Tokyo Electron Ltd Ic製品搬送用具及びic製品検査方法

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