JPS6095641A - ２重化装置 - Google Patents
２重化装置Info
- Publication number
- JPS6095641A JPS6095641A JP58203182A JP20318283A JPS6095641A JP S6095641 A JPS6095641 A JP S6095641A JP 58203182 A JP58203182 A JP 58203182A JP 20318283 A JP20318283 A JP 20318283A JP S6095641 A JPS6095641 A JP S6095641A
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- JP
- Japan
- Prior art keywords
- common bus
- always
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- stand
- devices
- Prior art date
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- Pending
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Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F11/00—Error detection; Error correction; Monitoring
- G06F11/07—Responding to the occurrence of a fault, e.g. fault tolerance
- G06F11/16—Error detection or correction of the data by redundancy in hardware
- G06F11/20—Error detection or correction of the data by redundancy in hardware using active fault-masking, e.g. by switching out faulty elements or by switching in spare elements
Landscapes
- Engineering & Computer Science (AREA)
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- Quality & Reliability (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Hardware Redundancy (AREA)
- Multi Processors (AREA)
- Exchange Systems With Centralized Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は共通バスに疎結合された２重化装置の装置番号
変更方式に関する。
変更方式に関する。
第１図に従来の２重化装置の一例を示す。
従来の２重化装置１００は共通バス１０に結合され、シ
ステム全体の共通制御装置として動作する。
ステム全体の共通制御装置として動作する。
この２重化装置１００はＯ系２０と１系３０とからなり
、各基は共通バスインタフェース部２１．２３、中央処
理部２２．２４をそれぞれ具備している。各基の中央処
理部２２ 、２４には予備情報通知部４０が接続されて
おり、この予備情報通知部４０は通知線５０を介して複
数の処理装置２００ａ 、 ２００ｂに接続されている
。
、各基は共通バスインタフェース部２１．２３、中央処
理部２２．２４をそれぞれ具備している。各基の中央処
理部２２ 、２４には予備情報通知部４０が接続されて
おり、この予備情報通知部４０は通知線５０を介して複
数の処理装置２００ａ 、 ２００ｂに接続されている
。
２重化装置１００のＯ系２０．１系３０には共通バスに
対してそれぞれ固有の装置番号が付与されており、上記
予備情報通知部４０が現用系がＯ系であるのか、１系で
あるのかを各処理装置に通知している。これにより各処
理装置２００は現用系を知り、その装置番号を使用して
共通バス経由で２重化装置１００と情報の授受を行なう
。
対してそれぞれ固有の装置番号が付与されており、上記
予備情報通知部４０が現用系がＯ系であるのか、１系で
あるのかを各処理装置に通知している。これにより各処
理装置２００は現用系を知り、その装置番号を使用して
共通バス経由で２重化装置１００と情報の授受を行なう
。
ところが、このような２重化装置１ｉｏｏの装置Ｒ番号
変更方式では各処理部２００に通知するためのハードウ
ェアを増加させなければならず、また、各処理装置２０
０の内蔵ソフトウェアは通知情報を意識する必要があり
、ン７トウエア自体権雑になるという欠点があった。
変更方式では各処理部２００に通知するためのハードウ
ェアを増加させなければならず、また、各処理装置２０
０の内蔵ソフトウェアは通知情報を意識する必要があり
、ン７トウエア自体権雑になるという欠点があった。
本発明の目的は処理装置が２重化装置の装置番号を意識
せずに情報の授受ができ、かつその付加回路およびソフ
トウェアを簡易化できる２重化装置を提供することにあ
る。
せずに情報の授受ができ、かつその付加回路およびソフ
トウェアを簡易化できる２重化装置を提供することにあ
る。
前記目的を達成するために本発明による２重化装置は共
通バスに疎結合された現用、予備装置を具備し、この両
装置に装置番号を与えてシステム全体の共通制御する２
重化装置において、前記現用、予備装置の装置番号を反
転させる装置番号反転回路を設け、現用、予備との切替
えが発生したとき、常に現用系はｍ１予備系はｎになる
ように装置番号を変更し、共通バスに接続された処理装
置に対し、常にＩｎ番号の装置が情報の授受を行なうよ
うに構成しである。
通バスに疎結合された現用、予備装置を具備し、この両
装置に装置番号を与えてシステム全体の共通制御する２
重化装置において、前記現用、予備装置の装置番号を反
転させる装置番号反転回路を設け、現用、予備との切替
えが発生したとき、常に現用系はｍ１予備系はｎになる
ように装置番号を変更し、共通バスに接続された処理装
置に対し、常にＩｎ番号の装置が情報の授受を行なうよ
うに構成しである。
前記構成によれば、本発明の目的は完全に達成できる。
以下、図面を参照して本発明をさらに詳しく説明する。
第２図は本発明による２重化装置の一実施例を示すブロ
ック図である。図におして、１５は共通バス、２０５は
処理装置である。２重化装置１０５は共通バス１５に結
合されており、０系２５と１系３５より構成されている
。各基は共通バスインタフェース部２６．２８、中央処
理装置２７．２９より構成されている。装置番号反転回
路４５は中央処理装置２７．２９の情報を受け、その出
力は共通バスインタフェース部２６．２８に接続されて
いる。
ック図である。図におして、１５は共通バス、２０５は
処理装置である。２重化装置１０５は共通バス１５に結
合されており、０系２５と１系３５より構成されている
。各基は共通バスインタフェース部２６．２８、中央処
理装置２７．２９より構成されている。装置番号反転回
路４５は中央処理装置２７．２９の情報を受け、その出
力は共通バスインタフェース部２６．２８に接続されて
いる。
２重化装置１０５の０系２５．１系３５には共通バスに
対してｍ 、 ｎの装置番号が付与されており、現用系
の切替情報が中央処理装置２７ 、２９より転送される
と常に現用系がｍ１予備系がｎと固定されるように共通
バスインタフェース部２６ 、２８にその情報を送出す
る。
対してｍ 、 ｎの装置番号が付与されており、現用系
の切替情報が中央処理装置２７ 、２９より転送される
と常に現用系がｍ１予備系がｎと固定されるように共通
バスインタフェース部２６ 、２８にその情報を送出す
る。
処理装置２０５は共通バス１５を経由してｍの装置番号
の装置（現用系）との間で情報の授受を行なう。
の装置（現用系）との間で情報の授受を行なう。
この結果、処理装置２０５は２重化装置の現用系切替え
を意識せず、常にｍの装置番号の装置との間で、情報の
授受を行なう。
を意識せず、常にｍの装置番号の装置との間で、情報の
授受を行なう。
本発明は以上の説明で明らかなように装置番号反転回路
という簡易な回路を付加することにより、装置が自律的
に装置番号を変更でき、かつその現用系が常に所定の装
置番号となるように構成しであるので処理装置は所定の
装置番号の装置との間で情報の授受を行なえば、それは
現用系との間で制御がなされることになる。したがって
処理装置におけるノ１−ドウエアおよびソフトウェアを
少なくできる効果がある。
という簡易な回路を付加することにより、装置が自律的
に装置番号を変更でき、かつその現用系が常に所定の装
置番号となるように構成しであるので処理装置は所定の
装置番号の装置との間で情報の授受を行なえば、それは
現用系との間で制御がなされることになる。したがって
処理装置におけるノ１−ドウエアおよびソフトウェアを
少なくできる効果がある。
第１図は従来の２重化装置のブロック図、第２図は本発
明による２重化装置の一実施例を示すブロック図である
。 １０ 、１５・・・共通バス ２０ 、２５・・・２重化装置のＯ系 ２１ 、２６・・・共通バスインタフェース部２２ 、
２７・・・中央処理装置 ３０ 、３５・・・２重化装置の１系 ４０・・・現用予備通知部 ４５・・・装置番号反転回路 ５０・・・通知線１００
、１０５・・・２重化装置 ２００ 、２０５・・・処理装置 代理人 弁理士 井 ノ ロ 壽
明による２重化装置の一実施例を示すブロック図である
。 １０ 、１５・・・共通バス ２０ 、２５・・・２重化装置のＯ系 ２１ 、２６・・・共通バスインタフェース部２２ 、
２７・・・中央処理装置 ３０ 、３５・・・２重化装置の１系 ４０・・・現用予備通知部 ４５・・・装置番号反転回路 ５０・・・通知線１００
、１０５・・・２重化装置 ２００ 、２０５・・・処理装置 代理人 弁理士 井 ノ ロ 壽
Claims (1)
- 共通バスに疎結合された現用、予備装置を具備し、この
両装置に装置番号を与えてシステム全体の共通制御する
２重化装置において、前記現用、予備装置の装置番号を
反転させる装置番号反転回路を設け、現用、予備との切
替えが発生したとき、常に現用系はｍ１予備系はｎにな
るように装置番号を変更し、共通バスに接続された処理
装置に対し、常にｍ番号の装置が情報の授受を行なうこ
とを特徴とする２重化装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58203182A JPS6095641A (ja) | 1983-10-28 | 1983-10-28 | ２重化装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58203182A JPS6095641A (ja) | 1983-10-28 | 1983-10-28 | ２重化装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6095641A true JPS6095641A (ja) | 1985-05-29 |
Family
ID=16469813
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58203182A Pending JPS6095641A (ja) | 1983-10-28 | 1983-10-28 | ２重化装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6095641A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH06295958A (ja) * | 1992-04-08 | 1994-10-21 | Fu-Chieh Hsu | 回路モジュール冗長性アーキテクチャ |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5068237A (ja) * | 1973-10-17 | 1975-06-07 | ||
| JPS5133945A (ja) * | 1974-09-17 | 1976-03-23 | Omron Tateisi Electronics Co | |
| JPS5156149A (ja) * | 1974-11-12 | 1976-05-17 | Omron Tateisi Electronics Co |
-
1983
- 1983-10-28 JP JP58203182A patent/JPS6095641A/ja active Pending
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5068237A (ja) * | 1973-10-17 | 1975-06-07 | ||
| JPS5133945A (ja) * | 1974-09-17 | 1976-03-23 | Omron Tateisi Electronics Co | |
| JPS5156149A (ja) * | 1974-11-12 | 1976-05-17 | Omron Tateisi Electronics Co |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH06295958A (ja) * | 1992-04-08 | 1994-10-21 | Fu-Chieh Hsu | 回路モジュール冗長性アーキテクチャ |
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