JPS6086840A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は半導体集積回路の実装方法、特に半導体素子上
への電極形成、並びに多数リードの一括接続に関するも
のである。
への電極形成、並びに多数リードの一括接続に関するも
のである。
従来例の構成とその問題点
LSIの高集積化と電子機器の高密度実装の進展によシ
、LSIの外部回路と接続するだめの電極数即ちポンデ
ィングパッド数が造加し、現在20oビンで、前記パッ
ドピッチが100μmのLSIが出現している。このよ
うな多ピン・狭ピッチのLSIにおいては、もはや金属
細線を用いたワイヤボンドで組立てることができず、フ
ィルムキャリヤ方式が導入され始めている。現在実用化
されているフィルムキャリヤ方式はLSIのボンディン
グパッド上に金の突起電極が形成されており、錫メッキ
されたリード群を前記LSI上の全突起電極に一括ボン
ディングするものである。
、LSIの外部回路と接続するだめの電極数即ちポンデ
ィングパッド数が造加し、現在20oビンで、前記パッ
ドピッチが100μmのLSIが出現している。このよ
うな多ピン・狭ピッチのLSIにおいては、もはや金属
細線を用いたワイヤボンドで組立てることができず、フ
ィルムキャリヤ方式が導入され始めている。現在実用化
されているフィルムキャリヤ方式はLSIのボンディン
グパッド上に金の突起電極が形成されており、錫メッキ
されたリード群を前記LSI上の全突起電極に一括ボン
ディングするものである。
第1図A−Fに従来のフィルムキャリヤ方式における突
起電極形成プロセスを示す。第1図において、1はシリ
コン基板で詳細部分は省略した。
起電極形成プロセスを示す。第1図において、1はシリ
コン基板で詳細部分は省略した。
2はポンディングパッド、3は窒化シリコン、酸化シリ
コン等の保護膜、4は多層の金層膜でメッキ用電極、5
はメソキレシスト膜、6は金の突起電極、7は金の突起
電極6の下の多層の金属膜(以下、バリヤメタルと称す
)である。
コン等の保護膜、4は多層の金層膜でメッキ用電極、5
はメソキレシスト膜、6は金の突起電極、7は金の突起
電極6の下の多層の金属膜(以下、バリヤメタルと称す
)である。
まず、第1図Aは細部を省略したが、LSIが形成され
たシリコン基板1の一部を示している。
たシリコン基板1の一部を示している。
このシリコン基板1上全面に金属膜4を蒸着で形成する
。金属膜4はクロムと銅等の多属膜で、メッキ電極とし
て働くものである。次にCに示すように感光性樹脂等で
メッキマスク5を形成する。
。金属膜4はクロムと銅等の多属膜で、メッキ電極とし
て働くものである。次にCに示すように感光性樹脂等で
メッキマスク5を形成する。
次に金属層4を一方の電極として金メッキを行ない、金
の突起電極6を形成する。メンキマスク6を除去した後
、金へ突起電極6をマスクとして金属層4をエツチング
除去すれば第1図Fの形状が得られる。
の突起電極6を形成する。メンキマスク6を除去した後
、金へ突起電極6をマスクとして金属層4をエツチング
除去すれば第1図Fの形状が得られる。
上記工程を経た後、個々のペレットに裁断分割し、フィ
ルムキャリヤに一部ボンディングするのであるがこの方
法ではウェハ状態で突起電極6を形成するだめの不良ペ
レット上にも金メッキされる。さらには、LSIがすで
に形成されているウェハをエツチング液、メッキ液等に
浸漬するため、汚染の問題等がある。
ルムキャリヤに一部ボンディングするのであるがこの方
法ではウェハ状態で突起電極6を形成するだめの不良ペ
レット上にも金メッキされる。さらには、LSIがすで
に形成されているウェハをエツチング液、メッキ液等に
浸漬するため、汚染の問題等がある。
発明の目的
本発明はこのような従来の問題に鑑み、通常のワイヤボ
ンディング用ポンディングパッドを有する半導体ペレッ
トに容易に全突起電極を付与する方法を提供することを
目的とする。
ンディング用ポンディングパッドを有する半導体ペレッ
トに容易に全突起電極を付与する方法を提供することを
目的とする。
発明の構成
この目的を達成するために本発明は、基板上に形成され
た突起電極とホルダーに裏面が吸着、固定された半導体
素子上の電極パッドとを加熱圧接により接合し、しかる
後基板と半導体素子を離間させるとともに基板上の突起
電極を半導体素子上の電極パッドへ転写することによシ
、容易に突起電極付ペレットを作る方法を提供するもの
である。
た突起電極とホルダーに裏面が吸着、固定された半導体
素子上の電極パッドとを加熱圧接により接合し、しかる
後基板と半導体素子を離間させるとともに基板上の突起
電極を半導体素子上の電極パッドへ転写することによシ
、容易に突起電極付ペレットを作る方法を提供するもの
である。
実施例の説明
第2図A、Bは本発明の一実施例である別基板上の全突
起電極を半導体ペレットに転写する工程、第3図は前記
半導体ペレットをフィルムキャリヤK 一括ボンディン
グする工程を示す。
起電極を半導体ペレットに転写する工程、第3図は前記
半導体ペレットをフィルムキャリヤK 一括ボンディン
グする工程を示す。
第2図A、Bにおいて、21は基板でガラス等の透明基
板が良い。22は電極、23はメッキマスク、24は突
起電極、26はホルダ、26は吸引口、27は半導体ペ
レット、28はポンディングパッド、29は半導体ペレ
ットに転写された全突起電極である。
板が良い。22は電極、23はメッキマスク、24は突
起電極、26はホルダ、26は吸引口、27は半導体ペ
レット、28はポンディングパッド、29は半導体ペレ
ットに転写された全突起電極である。
また、第3図A、Hにおいて、30は基台で透明・弾力
性あるものが望ましい。32は通常のフィルムキャリヤ
のリードで錫メッキされた銅リードである。31はフィ
ルムキャリヤのベースフィルムである。
性あるものが望ましい。32は通常のフィルムキャリヤ
のリードで錫メッキされた銅リードである。31はフィ
ルムキャリヤのベースフィルムである。
まず、別工程で基板21上に金の突起電極24が形成さ
れる。基板21はガラス等の透明体が良い。前記基板2
1上にはメッキ用の電極22が形成されるがこれも透明
電導膜例えば酸化インジウムと酸化錫等が良い。その上
にメッキマスク23が形成され、ついで電気メッキによ
υ金の突起電極24が形成される。一方、半導体ペレッ
ト27はホルダ26に吸着され、加熱されている。半導
体ペレット27上のポンディングパッド28は通常アル
ミである、前記基板21上の全突起電極24と熱圧着で
接合される。このとき全突起電極24とメッキ電極22
の密着強度が低い組合せの金属を用いると全突起電極2
4は半導体ペレット27例へ転写される。この方式では
、ホルダ26を介して超音波を印加すると150℃程度
で全突起電極24を転写できる。第2図Bには半導体ペ
レット27例に転写された全突起電極29を示した。
れる。基板21はガラス等の透明体が良い。前記基板2
1上にはメッキ用の電極22が形成されるがこれも透明
電導膜例えば酸化インジウムと酸化錫等が良い。その上
にメッキマスク23が形成され、ついで電気メッキによ
υ金の突起電極24が形成される。一方、半導体ペレッ
ト27はホルダ26に吸着され、加熱されている。半導
体ペレット27上のポンディングパッド28は通常アル
ミである、前記基板21上の全突起電極24と熱圧着で
接合される。このとき全突起電極24とメッキ電極22
の密着強度が低い組合せの金属を用いると全突起電極2
4は半導体ペレット27例へ転写される。この方式では
、ホルダ26を介して超音波を印加すると150℃程度
で全突起電極24を転写できる。第2図Bには半導体ペ
レット27例に転写された全突起電極29を示した。
次に上記突起電極付半導体ペレット27をフィルムキャ
リヤに接続する方法を第3図により説明する。
リヤに接続する方法を第3図により説明する。
基台3o上にフィルムキャリヤが載置されている。32
は錫メッキされた銅リードでその先端部と半導体ペレッ
ト上に転写された全突起電極を一致させ加圧する。突起
電極29とリード32は金−錫合金接続されるが、半導
体ペレット27はホルダ25に吸引されているとともに
加熱される。
は錫メッキされた銅リードでその先端部と半導体ペレッ
ト上に転写された全突起電極を一致させ加圧する。突起
電極29とリード32は金−錫合金接続されるが、半導
体ペレット27はホルダ25に吸引されているとともに
加熱される。
第2図に示す基板21は、全ての全突起電極24が半導
体ペレット27に転写された後、洗浄・メッキを行なえ
ば、再び全突起電極が形成できる。
体ペレット27に転写された後、洗浄・メッキを行なえ
ば、再び全突起電極が形成できる。
発明の効果
以上のように本発明は、別基板に形成した全突起電極を
半導体ペレットに転写するのであるが、良品ペレットに
のみ全突起電極を転写するため、金の消費量が通常のフ
ィルムキャリヤ方式に比べ少なくて良い。また、そのと
きペレットが加熱され、超音波が印加できるので極めて
高い転写歩留りが期待できる。
半導体ペレットに転写するのであるが、良品ペレットに
のみ全突起電極を転写するため、金の消費量が通常のフ
ィルムキャリヤ方式に比べ少なくて良い。また、そのと
きペレットが加熱され、超音波が印加できるので極めて
高い転写歩留りが期待できる。
この方式では、通常のワイヤボンディングに使用する半
導体ペレットを使用できるため、半導体デバイス選択の
範囲が広がる。通常のフィルムキャリヤ方式ではLSI
等の形成されたシリコン基板上に突起電極を形成する工
程での不良発生や汚染が心配されるが、本発明の方式で
は全く別基板に突起電極を形成するため極めて信頼性の
高い方式と言える。また、安定な金−アルミ接合を先に
行ない、次により温度の低い金−錫接合を行なっている
点工程的にも安定した方法と言える。
導体ペレットを使用できるため、半導体デバイス選択の
範囲が広がる。通常のフィルムキャリヤ方式ではLSI
等の形成されたシリコン基板上に突起電極を形成する工
程での不良発生や汚染が心配されるが、本発明の方式で
は全く別基板に突起電極を形成するため極めて信頼性の
高い方式と言える。また、安定な金−アルミ接合を先に
行ない、次により温度の低い金−錫接合を行なっている
点工程的にも安定した方法と言える。
第1図A、Fは従来のフィルムキャリヤ方式における突
起電極形成法を示す断面図、第2図A。 ペレットとリードの一括ボンディング法を示す断面図で
ある。 1・・・・・・基板、6・・・・・・メッキ電極、5・
・・・・・メンキマスク、ら・・・・・・全突起電極、
26・・・・・・ホルダー、27・・・・・・半導体ベ
レット、29・・・・・・転写された突起電極、30・
・・・・・基台、32・・・・・・フィルムキャリヤの
リード。 代理人の氏名 弁理士 中 尾 敏 男 ほか1基筒
2 図
起電極形成法を示す断面図、第2図A。 ペレットとリードの一括ボンディング法を示す断面図で
ある。 1・・・・・・基板、6・・・・・・メッキ電極、5・
・・・・・メンキマスク、ら・・・・・・全突起電極、
26・・・・・・ホルダー、27・・・・・・半導体ベ
レット、29・・・・・・転写された突起電極、30・
・・・・・基台、32・・・・・・フィルムキャリヤの
リード。 代理人の氏名 弁理士 中 尾 敏 男 ほか1基筒
2 図
Claims (1)
- 基板上に形成された突起電極とホルダーに裏面が吸着・
固定された半導体素子上の電極パッドとを加熱圧接によ
り接合し、しかる後前記基板と前記半導体素子を離間さ
せるとともに前記基板上の突起電極を前記半導体素子上
の電極パッドへ転写する工程と、基板上に載置されたフ
ィルムキャリヤのリード先端部に前記半導体素子上の突
起電極を一致させて加熱・圧接する工程とからなること
を特徴とする半導体装置の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58195644A JPS6086840A (ja) | 1983-10-19 | 1983-10-19 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58195644A JPS6086840A (ja) | 1983-10-19 | 1983-10-19 | 半導体装置の製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS6086840A true JPS6086840A (ja) | 1985-05-16 |
JPH0469427B2 JPH0469427B2 (ja) | 1992-11-06 |
Family
ID=16344597
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP58195644A Granted JPS6086840A (ja) | 1983-10-19 | 1983-10-19 | 半導体装置の製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6086840A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0218946A (ja) * | 1988-07-06 | 1990-01-23 | Rohm Co Ltd | Icの実装方法および実装装置 |
US5456003A (en) * | 1992-06-18 | 1995-10-10 | Matsushita Electric Industrial Co., Ltd. | Method for packaging a semiconductor device having projected electrodes |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS4869471A (ja) * | 1971-12-22 | 1973-09-20 | ||
JPS57152147A (en) * | 1981-03-16 | 1982-09-20 | Matsushita Electric Ind Co Ltd | Formation of metal projection on metal lead |
-
1983
- 1983-10-19 JP JP58195644A patent/JPS6086840A/ja active Granted
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS4869471A (ja) * | 1971-12-22 | 1973-09-20 | ||
JPS57152147A (en) * | 1981-03-16 | 1982-09-20 | Matsushita Electric Ind Co Ltd | Formation of metal projection on metal lead |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0218946A (ja) * | 1988-07-06 | 1990-01-23 | Rohm Co Ltd | Icの実装方法および実装装置 |
US5456003A (en) * | 1992-06-18 | 1995-10-10 | Matsushita Electric Industrial Co., Ltd. | Method for packaging a semiconductor device having projected electrodes |
Also Published As
Publication number | Publication date |
---|---|
JPH0469427B2 (ja) | 1992-11-06 |
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