JPS6043033A - 電圧レベル検出回路 - Google Patents
電圧レベル検出回路Info
- Publication number
- JPS6043033A JPS6043033A JP58149029A JP14902983A JPS6043033A JP S6043033 A JPS6043033 A JP S6043033A JP 58149029 A JP58149029 A JP 58149029A JP 14902983 A JP14902983 A JP 14902983A JP S6043033 A JPS6043033 A JP S6043033A
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- Japan
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- circuit
- level
- output
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は電圧レベル検−出回路に関するものである。
従来から、種々の電子機器において、供給電圧等のレベ
ルを監視し、そのレベルが所定値以下となったことを検
出する電圧レベル検出回路が用いられてきている。例え
ば、マイクロコンピュータにおいて、停電若しくは電源
装置の故障等によりＲＡ、 Ｍ内のストア内容が消失す
るのを防止するため、電源ラインのレベルが所定値以下
となった場合に、ＲＡＭに供給される電源が７ｉＩ池等
のバンクアップ用電源から供給されるよう電瀞の切期を
行なうように構成されているが、この種の構成をとる場
合には上述の電圧レベル検出回路が必要となる。ところ
で、このような目的で使用される電圧レベル検出Ｉ回路
は、供給電圧のレベル低下がＱｒ定の値に達したか否か
を比較的１１′ノ開よく検出することがしばしは要求さ
れるが、１直流電圧のレベル比較を行なうため、温度ド
、リフト、温度変化によって生じる基準レベルと被検出
レベルの変化の変動率の差により、検出精度が大きく左
右されるという問題点を有していた。
ルを監視し、そのレベルが所定値以下となったことを検
出する電圧レベル検出回路が用いられてきている。例え
ば、マイクロコンピュータにおいて、停電若しくは電源
装置の故障等によりＲＡ、 Ｍ内のストア内容が消失す
るのを防止するため、電源ラインのレベルが所定値以下
となった場合に、ＲＡＭに供給される電源が７ｉＩ池等
のバンクアップ用電源から供給されるよう電瀞の切期を
行なうように構成されているが、この種の構成をとる場
合には上述の電圧レベル検出回路が必要となる。ところ
で、このような目的で使用される電圧レベル検出Ｉ回路
は、供給電圧のレベル低下がＱｒ定の値に達したか否か
を比較的１１′ノ開よく検出することがしばしは要求さ
れるが、１直流電圧のレベル比較を行なうため、温度ド
、リフト、温度変化によって生じる基準レベルと被検出
レベルの変化の変動率の差により、検出精度が大きく左
右されるという問題点を有していた。
本発明は、従って、従来の粗汁レベル検出回路における
上述の間鴨点ｔ ７Ｑ’ｆ決−することかできる電圧レ
ベル検出回路を提供することを目的とするものであり、
その％徴とするところをよ、入力的流電圧のレベルが所
定の規定値と異なる所蕉の検出レベルに達したか否かを
検出するための′重圧レベル検用１！」１路において、
前記入力的流電圧が供給され、所足しベルの／１４１基
＠箪圧を出力する共通基準Ｉ）、Ｈ−＝主回路と、前記
第１基１′め’７１Ｖ Ｊ’、にに応答して第２基準電
圧を出力する定電圧出力１０：路と、前記第１及び第２
基ｊＱｔｔｆｉ圧のレベル差に応答する電圧比較回路と
を翁し、前記共通基孕’ｔｉｉ、圧１ら生１り路と、前
記定電圧出力Ｊｕｌ路と、前記１に圧比軒回路とが同−
半導体基（反上に集積１団路としてＪｌｉｊ−成され１
−いる点にある。
上述の間鴨点ｔ ７Ｑ’ｆ決−することかできる電圧レ
ベル検出回路を提供することを目的とするものであり、
その％徴とするところをよ、入力的流電圧のレベルが所
定の規定値と異なる所蕉の検出レベルに達したか否かを
検出するための′重圧レベル検用１！」１路において、
前記入力的流電圧が供給され、所足しベルの／１４１基
＠箪圧を出力する共通基準Ｉ）、Ｈ−＝主回路と、前記
第１基１′め’７１Ｖ Ｊ’、にに応答して第２基準電
圧を出力する定電圧出力１０：路と、前記第１及び第２
基ｊＱｔｔｆｉ圧のレベル差に応答する電圧比較回路と
を翁し、前記共通基孕’ｔｉｉ、圧１ら生１り路と、前
記定電圧出力Ｊｕｌ路と、前記１に圧比軒回路とが同−
半導体基（反上に集積１団路としてＪｌｉｊ−成され１
−いる点にある。
このように、１つのチップ士に全ての回路を構成すると
、温度変化があっても、各部のレベルが同方向に同じ変
化率たけ変！ＩＩｂするため、電圧レベルの差分を検出
する比較し１路に入力さノシる両比較電圧の差分が、温
度によるドリノ１の影響を受けることがなく、従って、
不Ｎ ｆ埃よ＜ ′１１Ｖ汀−レペルの検出を行なうこ
とができる。垢らに動作電源に々る定電圧出力回路と電
圧検出回路の基準【托圧イら主回路を共通にすることに
より、定電圧出力１［＋７土と電圧検出回路の検出′Ｆ
ｔＥ Ｈ：、の差を製造プロセスによるばらつきに関係
なく一定に１呆つことが出来るたｙ）、動作電圧と検出
’Ｆｉｔ、川との相刊３ヒ１度をよくすることができる
。
、温度変化があっても、各部のレベルが同方向に同じ変
化率たけ変！ＩＩｂするため、電圧レベルの差分を検出
する比較し１路に入力さノシる両比較電圧の差分が、温
度によるドリノ１の影響を受けることがなく、従って、
不Ｎ ｆ埃よ＜ ′１１Ｖ汀−レペルの検出を行なうこ
とができる。垢らに動作電源に々る定電圧出力回路と電
圧検出回路の基準【托圧イら主回路を共通にすることに
より、定電圧出力１［＋７土と電圧検出回路の検出′Ｆ
ｔＥ Ｈ：、の差を製造プロセスによるばらつきに関係
なく一定に１呆つことが出来るたｙ）、動作電圧と検出
’Ｆｉｔ、川との相刊３ヒ１度をよくすることができる
。
以下、図示の実Ｎｉ例により本発明ｋ ｎ’Ｆ細にＷン
明する。
明する。
図面に杜、本発明による’Ｉｌｊ圧、レベル検出回路を
用いたコンピュータ装置の−Ｔ施例のブロック図が示さ
ｉｔでいる。、 コンピュータ装置１は１θ流「［１、踪）から’ｌｔｌ
力の供給を受けて作動するものでうり、コンピュータ装
置１に内蔵されているＲＡＭ５は、切換スイ、ソチ４を
弁して定電圧回路７又はノ（ンクアング用の′１１１池
５のいず才しか一方に接続ちれて、電力の供給を受ける
ことができるようになっている。
用いたコンピュータ装置の−Ｔ施例のブロック図が示さ
ｉｔでいる。、 コンピュータ装置１は１θ流「［１、踪）から’ｌｔｌ
力の供給を受けて作動するものでうり、コンピュータ装
置１に内蔵されているＲＡＭ５は、切換スイ、ソチ４を
弁して定電圧回路７又はノ（ンクアング用の′１１１池
５のいず才しか一方に接続ちれて、電力の供給を受ける
ことができるようになっている。
定ＩＲ７圧回路７の出力電圧ＶＯＯＴのレベルの大きさ
に従ってこの切侠スイッチ４の切烟を行なうため、本発
明による電圧レベル検出回路６が設けられている。この
電圧レベル検出回路６は、後述の如く、１枚の半導体基
板上に＋４％債回路とし７て形成されており、出力電圧
ＶＯＯＴが所定のレベル以下になったことが比較回路１
５にユリいて検出された場合に、切填スイッチ４を実線
で示される状態から点線で示される切換状態に変更し、
ＲＡＭ５に印加される電圧が必ず所定レー゛ル以上とな
るようになっている。ＲＡＭ５にに、符号１０で示され
るコンデンサが図示の如＜’ｔｆｆｉｌｊＭさ）ｔてお
り、こｆｌにより、直流電源２が瞬断した：Ｉ：ｌｉ１
合及びスイッチ４の切換時に、Ｒｐ、 Ｍ ５のηｉ
ｄｌｉｊ ？ｌ（、圧が所定し、ベル以下となるの全防
止することができる。
に従ってこの切侠スイッチ４の切烟を行なうため、本発
明による電圧レベル検出回路６が設けられている。この
電圧レベル検出回路６は、後述の如く、１枚の半導体基
板上に＋４％債回路とし７て形成されており、出力電圧
ＶＯＯＴが所定のレベル以下になったことが比較回路１
５にユリいて検出された場合に、切填スイッチ４を実線
で示される状態から点線で示される切換状態に変更し、
ＲＡＭ５に印加される電圧が必ず所定レー゛ル以上とな
るようになっている。ＲＡＭ５にに、符号１０で示され
るコンデンサが図示の如＜’ｔｆｆｉｌｊＭさ）ｔてお
り、こｆｌにより、直流電源２が瞬断した：Ｉ：ｌｉ１
合及びスイッチ４の切換時に、Ｒｐ、 Ｍ ５のηｉ
ｄｌｉｊ ？ｌ（、圧が所定し、ベル以下となるの全防
止することができる。
第２図には、第１図に示した電圧レベル検出回路６の具
体的な回路例を示す回路図が示されている。基準重工発
生回路１１は、ゲートとソースとを接続してＰ基板をソ
ースと同電位にしたデイグレツションタイプのＮチャン
ネルＭＯ８）ランジスタ１２と、ゲートとドレインと全
接続すると共に、ソースがＰ基板に接続きれているエン
／・ンスメント型ＮチャンネルＭＯＳトランジスタ１５
とが図示の如く直列に接続されて成っている。この直列
回路は直流？＋１．諒２の出力とアースとの間に接続さ
れており、接続点１４は、出力電圧Ｖのレベル変動に吋
しても、また温度のり：化にそ１しても実質的に変動の
ない基準電圧ＶＯが発生する。
体的な回路例を示す回路図が示されている。基準重工発
生回路１１は、ゲートとソースとを接続してＰ基板をソ
ースと同電位にしたデイグレツションタイプのＮチャン
ネルＭＯ８）ランジスタ１２と、ゲートとドレインと全
接続すると共に、ソースがＰ基板に接続きれているエン
／・ンスメント型ＮチャンネルＭＯＳトランジスタ１５
とが図示の如く直列に接続されて成っている。この直列
回路は直流？＋１．諒２の出力とアースとの間に接続さ
れており、接続点１４は、出力電圧Ｖのレベル変動に吋
しても、また温度のり：化にそ１しても実質的に変動の
ない基準電圧ＶＯが発生する。
基準電圧Ｖｏは、比較回路１５の一入力端子に印加され
ると共に、定電圧回路ｆ：構成する演算増幅器１６の反
転入力端子に人力さｉｌ、ている。演算増幅器１６の出
力にばｌｉ’ｌ ＯＳ トフンジスタ１７がボルデーシ
ノオロア回路として１・・１１〈ように接続さノｔでい
る。ＭＯＳ ）ランジスタ１７のソース回路には、分圧
抵抗器１８．１９．’２０から成る抵抗分圧回路２１が
接続されており、こｆ’Ｌにより第１出力電［ＶＯｔ及
び第２出力′亀川Ｖｏ２が夫々分圧出力ぢれる。第１出
力′亀圧Ｖｏ、ｔｊ：演算」冑幅器１６の非反転入力端
子に入力さｉしており、これにより、Ｍ Ｑ Ｓ トラ
ンジスタ１７のソース出力端子２２から出力される電圧
Ｖｏｕｔのレベルが、Ｖｏ＝Ｖ１の条件を満足するよう
なレベルに定められる。このような車圧調節回路の動作
は公知であるから、その詳細な説明は省略する。
ると共に、定電圧回路ｆ：構成する演算増幅器１６の反
転入力端子に人力さｉｌ、ている。演算増幅器１６の出
力にばｌｉ’ｌ ＯＳ トフンジスタ１７がボルデーシ
ノオロア回路として１・・１１〈ように接続さノｔでい
る。ＭＯＳ ）ランジスタ１７のソース回路には、分圧
抵抗器１８．１９．’２０から成る抵抗分圧回路２１が
接続されており、こｆ’Ｌにより第１出力電［ＶＯｔ及
び第２出力′亀川Ｖｏ２が夫々分圧出力ぢれる。第１出
力′亀圧Ｖｏ、ｔｊ：演算」冑幅器１６の非反転入力端
子に入力さｉしており、これにより、Ｍ Ｑ Ｓ トラ
ンジスタ１７のソース出力端子２２から出力される電圧
Ｖｏｕｔのレベルが、Ｖｏ＝Ｖ１の条件を満足するよう
なレベルに定められる。このような車圧調節回路の動作
は公知であるから、その詳細な説明は省略する。
抵抗分圧回路２１からは、また、所望の切換電圧に等し
いレベルの第２出力′市１月−ｖ０２が出力されており
、比４ｒ９回路１５の十人カー’！！Ａ子に印加をオｔ
、基準電圧Ｖｏ とレベル比較さり、る。この結果、伺
らかの理由でＶｏｕｔのレベ、ルがｌＩｋ’Ｅ Ｌ、Ｖ
ｏ２ ＜”、 Ｖ’ 。
いレベルの第２出力′市１月−ｖ０２が出力されており
、比４ｒ９回路１５の十人カー’！！Ａ子に印加をオｔ
、基準電圧Ｖｏ とレベル比較さり、る。この結果、伺
らかの理由でＶｏｕｔのレベ、ルがｌＩｋ’Ｅ Ｌ、Ｖ
ｏ２ ＜”、 Ｖ’ 。
となると、比較回路１５の出力電圧が反転し、これに応
答してスイッチ４が点線で示ずよつに切換えられる。
答してスイッチ４が点線で示ずよつに切換えられる。
第２出力電圧ｖＯ２の値は、スイッチ４を点線で示され
るように切換えてＲＡ ’Ｍ ５のバッテリ５によるバ
ノクアソノ゛を行ンより′／！、ＨノｔＵ′ならない電
圧Ｖｏｏのレベルに一致するように力りめらｉｔている
。
るように切換えてＲＡ ’Ｍ ５のバッテリ５によるバ
ノクアソノ゛を行ンより′／！、ＨノｔＵ′ならない電
圧Ｖｏｏのレベルに一致するように力りめらｉｔている
。
このような構成によると、ｉ’ｊ：ｆ ｊｈｌ’、 Ｊ
’ｌ！’ｌ ）ｌい伺１６、抵抗分圧回路２１により新
星の一定ｒｌｔ用である第２出力市、圧Ｖｏ２が出力さ
れており、この第２出力電圧ＶＯ□と基準電圧発生回路
からの出力電圧Ｖｏ とを比較回路１５とレベル比較す
る構成であるので、停電となった場合、出力和；圧ＶＯ
ｕｔのレベルは直ちに低下しはじめるが、川−基準電圧
Ｖｏは電圧調節作用のために、そのレベルが１αちに（
Ｊｋ下せず、所定期間内においてはこの所５１のレベル
を保っているので、出力１１を圧Ｖｏ２がｖＯより小さ
いレベルとなったことを検出することができる。
’ｌ！’ｌ ）ｌい伺１６、抵抗分圧回路２１により新
星の一定ｒｌｔ用である第２出力市、圧Ｖｏ２が出力さ
れており、この第２出力電圧ＶＯ□と基準電圧発生回路
からの出力電圧Ｖｏ とを比較回路１５とレベル比較す
る構成であるので、停電となった場合、出力和；圧ＶＯ
ｕｔのレベルは直ちに低下しはじめるが、川−基準電圧
Ｖｏは電圧調節作用のために、そのレベルが１αちに（
Ｊｋ下せず、所定期間内においてはこの所５１のレベル
を保っているので、出力１１を圧Ｖｏ２がｖＯより小さ
いレベルとなったことを検出することができる。
そして、第２図に示した回路は、全て同一のチンプーヒ
に形成されており、従って、温度変化があっても、これ
に因り生じる各部の電圧変動は同じ向きに同じ率だけ生
じる。この結果、比較回路１５への両入力電圧のレベル
７＋ｓ自体に１１、温度変化等があっても精度よく検出
することかでき、スイッチ４の切換制御を、精Ｕ、Ｊ：
＜行７７うことができる。
に形成されており、従って、温度変化があっても、これ
に因り生じる各部の電圧変動は同じ向きに同じ率だけ生
じる。この結果、比較回路１５への両入力電圧のレベル
７＋ｓ自体に１１、温度変化等があっても精度よく検出
することかでき、スイッチ４の切換制御を、精Ｕ、Ｊ：
＜行７７うことができる。
上記実施例では、本発明による′電圧レベル検出回路を
、コンピュータのＲＡＭのバンクアンプ電源の切要制御
用に用いた例について述べたが、電源レベル検出回路の
出力により、ＲＡ Ｍ （ｚリセフトするようにしても
よいし、他の７に子装置に組込んでもよく、用途は、本
発明の実施例に限定されないものである。
、コンピュータのＲＡＭのバンクアンプ電源の切要制御
用に用いた例について述べたが、電源レベル検出回路の
出力により、ＲＡ Ｍ （ｚリセフトするようにしても
よいし、他の７に子装置に組込んでもよく、用途は、本
発明の実施例に限定されないものである。
本発明によれば、上述の如く、同一チップ上にケての回
路を１とめて形成しグこので、温度変化に拘らず極めて
精度よく電圧レベルの検出を行なうことができる優れた
効果を奏する。
路を１とめて形成しグこので、温度変化に拘らず極めて
精度よく電圧レベルの検出を行なうことができる優れた
効果を奏する。
第１図は本発明による電１′１ルベル検出回路を用いた
コンピュータ装置の一実／７ｉｊｉ Ｉ’ｌｌのプロン
ク図、第２図は、第１図に示しｌこ’ｒｉｂ月−レイー
レベル検出回路体内な回路を示す回１烙図で、１′）る
。 １・・・コンピュータ装置、２・・・ｌＧｊ ｆ＃、
ｔｌｉ：源、５・・・ＲＡＭ、 ４’・・スイッチ、５
・・・市、池、 ６・・・市川レベル検出回７・・・定
電圧回路、 路、 １１・・・基準電圧発生回路、１５・・・比較回路、１
６・・・演算増幅器、 １７・・・ＭＯＳ トランジス
タ、２１・・・抵抗分圧回路、 ＶＯ・・・基準電圧、
ＶＯｌ ・・・ 第 １ 出 力量８巳 、Ｖ（１２・
・・ 第 ２ Ｌｈブノ？ｉ４．月”ミ。 以 −上 出願人 株式会社 第二精工舎 代理人 弁理士 最 上 務
コンピュータ装置の一実／７ｉｊｉ Ｉ’ｌｌのプロン
ク図、第２図は、第１図に示しｌこ’ｒｉｂ月−レイー
レベル検出回路体内な回路を示す回１烙図で、１′）る
。 １・・・コンピュータ装置、２・・・ｌＧｊ ｆ＃、
ｔｌｉ：源、５・・・ＲＡＭ、 ４’・・スイッチ、５
・・・市、池、 ６・・・市川レベル検出回７・・・定
電圧回路、 路、 １１・・・基準電圧発生回路、１５・・・比較回路、１
６・・・演算増幅器、 １７・・・ＭＯＳ トランジス
タ、２１・・・抵抗分圧回路、 ＶＯ・・・基準電圧、
ＶＯｌ ・・・ 第 １ 出 力量８巳 、Ｖ（１２・
・・ 第 ２ Ｌｈブノ？ｉ４．月”ミ。 以 −上 出願人 株式会社 第二精工舎 代理人 弁理士 最 上 務
Claims (1)
- 入力直流′電圧のレベルが所２１！の規定値と異なる所
定の検出レベルに達したが否かを検出するための゛市川
レベル検出回路において、前記入力直流電圧が供給され
、所定レベルの記１基準電圧を出力する共通基準電圧発
生回路と、前記第１基準電圧に応答して第２基準電圧金
川力する定電圧出力回路と、前記第１及び第２基準電出
のレベル差に応答する電圧比軸回路とを有し、前記共通
基準電圧発生回路と、前記定電圧出力回路と、前記電圧
比較回路とが同一半導体基板上に集積回路として構成さ
れていることを％微とする市川レベル検出回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58149029A JPS6043033A (ja) | 1983-08-15 | 1983-08-15 | 電圧レベル検出回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58149029A JPS6043033A (ja) | 1983-08-15 | 1983-08-15 | 電圧レベル検出回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6043033A true JPS6043033A (ja) | 1985-03-07 |
Family
ID=15466108
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58149029A Pending JPS6043033A (ja) | 1983-08-15 | 1983-08-15 | 電圧レベル検出回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6043033A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS567061A (en) * | 1979-06-30 | 1981-01-24 | Fanuc Ltd | Detector for output voltage drop of stabilizing dc power |
-
1983
- 1983-08-15 JP JP58149029A patent/JPS6043033A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS567061A (en) * | 1979-06-30 | 1981-01-24 | Fanuc Ltd | Detector for output voltage drop of stabilizing dc power |
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