JPS6039574A - 出力レベル設定回路 - Google Patents
出力レベル設定回路Info
- Publication number
- JPS6039574A JPS6039574A JP58148218A JP14821883A JPS6039574A JP S6039574 A JPS6039574 A JP S6039574A JP 58148218 A JP58148218 A JP 58148218A JP 14821883 A JP14821883 A JP 14821883A JP S6039574 A JPS6039574 A JP S6039574A
- Authority
- JP
- Japan
- Prior art keywords
- output
- converter
- level
- oscillator
- programmable power
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
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- Tests Of Electronic Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、プログラマブル電源を有しかつ発振器が組込
まれることによりＡＣ出力およびＡＣ測定が可能にされ
たＤＣテスタに備えられる出力レベル設定回路に関する
。
まれることによりＡＣ出力およびＡＣ測定が可能にされ
たＤＣテスタに備えられる出力レベル設定回路に関する
。
ＤＣテスタはＤＣ出力およびＤＣ測定を行うことができ
る。ところで、このＤＣテスタに発振器を組み込み、こ
の発振器の出力レベ）ｖｔｓマイクロコンピュータのプ
ログラムにより自由に制御できるようにしてＤＣテスタ
であってもＡＣ出力およびＡＣ測定が可能なようぐれた
ものである・ところが、このような発振器を組み込んで
ＡＣ出力およびＡＣ測定ができるようにするには、マイ
クロコンピュータのメモリの容量を変更しｔこり、ある
いは発振器の出力レベ／Ｌ／全スキャンさせたりするた
めのプログラムを追加あるいは変更したりしなければな
らなくなる。このような変更は比較的面倒であり、コス
ト的にも高くつくことがある。
る。ところで、このＤＣテスタに発振器を組み込み、こ
の発振器の出力レベ）ｖｔｓマイクロコンピュータのプ
ログラムにより自由に制御できるようにしてＤＣテスタ
であってもＡＣ出力およびＡＣ測定が可能なようぐれた
ものである・ところが、このような発振器を組み込んで
ＡＣ出力およびＡＣ測定ができるようにするには、マイ
クロコンピュータのメモリの容量を変更しｔこり、ある
いは発振器の出力レベ／Ｌ／全スキャンさせたりするた
めのプログラムを追加あるいは変更したりしなければな
らなくなる。このような変更は比較的面倒であり、コス
ト的にも高くつくことがある。
本発明は、ＤＣテスタが内蔵しているプログラマグル電
源を利用し、マイクロコンピュータのモモリの容量を増
加させたり、プログラムを特に変更する必要なく容易に
かつ低コストで発振器の出力レベ７しを制御できるよう
にすることを目的とする。
源を利用し、マイクロコンピュータのモモリの容量を増
加させたり、プログラムを特に変更する必要なく容易に
かつ低コストで発振器の出力レベ７しを制御できるよう
にすることを目的とする。
以下、本発明を図面に示す一実施例に基づいて詳細に説
明する。
明する。
図はこの実施例に係る出力レベル設定回路の回路図であ
る。この実施例の出力レベル設定回路（１）は、プログ
ラマグル電源を有し、このプログラマグル電源亀源の出
力ヲ咥蔵したマイクロコンピュータのプログラムにより
制御できるようにしたＤＣテスタに適用される。ＤＣテ
スタは通常、ＤＣ出力およびＤＣ測定だけができるもの
であるが、発振器を組み込むことによりＡＣ出力および
ＡＣ測定が可能なようにされることがある。この実施例
の出力レベル設定回路（１）は、発振器の出力レベｌし
をプロゲラマグ／Ｌ／電源の出力可変により制御できる
ようにしている。即ち、この出力レベル設定回路（１）
は、例えばＩ ＫＨｚの発振器（２）ヲ有している。一
方、図示しないプログラマブル電源の出力は、端子（３
）を介してんの変換器（４）に与えられる。Ａ／Ｄ変換
器（４）は、プロゲラマグ）Ｖ電源の出力レベ／しに対
応してんΦ変換を行う。このんの変換動作のタイミング
は、発振器（２）の出力レベルがゼロのときに検知出力
を発生するゼロクロスコンパレータ（５）とこのゼロク
ロスコンパレータ（５）の検知出力を分周する分周回路
（６）とよりなる手段（７）からの出力により決定され
る。したがって、プログラマブル電源のレペｌしが切り
換わってもんの変換器（４）の動作は発振器（２）の出
力がゼロクロス時に行われ・ることになり、これにより
実施例の回路（１）が外部の測定回路へ与える出力のレ
ベルに不必要な変動（いわゆる、あばれ）が生じなくな
る。
る。この実施例の出力レベル設定回路（１）は、プログ
ラマグル電源を有し、このプログラマグル電源亀源の出
力ヲ咥蔵したマイクロコンピュータのプログラムにより
制御できるようにしたＤＣテスタに適用される。ＤＣテ
スタは通常、ＤＣ出力およびＤＣ測定だけができるもの
であるが、発振器を組み込むことによりＡＣ出力および
ＡＣ測定が可能なようにされることがある。この実施例
の出力レベル設定回路（１）は、発振器の出力レベｌし
をプロゲラマグ／Ｌ／電源の出力可変により制御できる
ようにしている。即ち、この出力レベル設定回路（１）
は、例えばＩ ＫＨｚの発振器（２）ヲ有している。一
方、図示しないプログラマブル電源の出力は、端子（３
）を介してんの変換器（４）に与えられる。Ａ／Ｄ変換
器（４）は、プロゲラマグ）Ｖ電源の出力レベ／しに対
応してんΦ変換を行う。このんの変換動作のタイミング
は、発振器（２）の出力レベルがゼロのときに検知出力
を発生するゼロクロスコンパレータ（５）とこのゼロク
ロスコンパレータ（５）の検知出力を分周する分周回路
（６）とよりなる手段（７）からの出力により決定され
る。したがって、プログラマブル電源のレペｌしが切り
換わってもんの変換器（４）の動作は発振器（２）の出
力がゼロクロス時に行われ・ることになり、これにより
実施例の回路（１）が外部の測定回路へ与える出力のレ
ベルに不必要な変動（いわゆる、あばれ）が生じなくな
る。
Ａ／Ｄ変換器（４）の出力は、例えばプログラマブル電
源のレベルに対応した内容の１２ビツト構成のデジタル
信号としてパラレルにラッチ回路（８）に与えられる。
源のレベルに対応した内容の１２ビツト構成のデジタル
信号としてパラレルにラッチ回路（８）に与えられる。
ラッチ回路（８）は例えば、４ビツト毎の構成の３つの
ラッチ回路部よりなり、プログラマグル電源の出力が安
定して後に次段のＤ／Ａ変換器（９）に与えるためのも
のである。 Ｄ／Ａ変換器（９）は発振Ｍ？ｒ （２）
の出力をクロックとしてラッチ回路（８）からの出力を
Ｄ／Ａ変換する。したがって、Ｄ／Ａ変換器（９）から
はプログラマプ／Ｌ／電源のレベルに対応したレベルの
発振出力が得られることになる。００はバッファアンプ
である。
ラッチ回路部よりなり、プログラマグル電源の出力が安
定して後に次段のＤ／Ａ変換器（９）に与えるためのも
のである。 Ｄ／Ａ変換器（９）は発振Ｍ？ｒ （２）
の出力をクロックとしてラッチ回路（８）からの出力を
Ｄ／Ａ変換する。したがって、Ｄ／Ａ変換器（９）から
はプログラマプ／Ｌ／電源のレベルに対応したレベルの
発振出力が得られることになる。００はバッファアンプ
である。
以上のように、本発明によれば、プロゲラマグ／ｌ／
’ｐ４４：源のレベル可変によりＤ／Ａ変換器からはプ
ロゲラマグ）ｖ電源のレベルに対応した発振出力のレベ
ｆｉ７ ｆ−得るようにしたのでマイクロコンピュータ
のメモリの容量を増設したり、発振器の出力レベルをス
キャンさせるためのプログラムを作つｔこりすることな
く容易にしかも低コストの構成のものによりＤＣテスタ
に内蔵された既存のプログラマブル電源により測定回路
にＡＣ出力を与えることができる。また本発明によれば
、プログラマグル電源の出力をルの変換する動作のタイ
ミングを発振器の出力がゼロクロス時に設定したので、
測定回路に対してはいわゆる暴れが少ない出力を与える
ことができて望ましい。
’ｐ４４：源のレベル可変によりＤ／Ａ変換器からはプ
ロゲラマグ）ｖ電源のレベルに対応した発振出力のレベ
ｆｉ７ ｆ−得るようにしたのでマイクロコンピュータ
のメモリの容量を増設したり、発振器の出力レベルをス
キャンさせるためのプログラムを作つｔこりすることな
く容易にしかも低コストの構成のものによりＤＣテスタ
に内蔵された既存のプログラマブル電源により測定回路
にＡＣ出力を与えることができる。また本発明によれば
、プログラマグル電源の出力をルの変換する動作のタイ
ミングを発振器の出力がゼロクロス時に設定したので、
測定回路に対してはいわゆる暴れが少ない出力を与える
ことができて望ましい。
図は、本発明の実施例の回路図である。
（１）・・・出力レベル設定回路、（２）・・・発振器
、（３）・・・プログラマプル電源用入力端子、（４）
・・・ん巾変換器、（５）・・・ゼロクロスコンパレー
タ、（６）・・・分周回路、（８）・・・ラッチ回路、
（９）・・・Ｄ／Ａ変換器出願人 ローム株式会社 代理人 弁理士 岡田和秀
、（３）・・・プログラマプル電源用入力端子、（４）
・・・ん巾変換器、（５）・・・ゼロクロスコンパレー
タ、（６）・・・分周回路、（８）・・・ラッチ回路、
（９）・・・Ｄ／Ａ変換器出願人 ローム株式会社 代理人 弁理士 岡田和秀
Claims (2)
- （１） プログラマブル電源を有しかつ発振器が組込ま
れることによりＡ’Ｃ出力およびＡＣ測定が可能にされ
たＤＣテスタに備えられるものであって、プログラマプ
／Ｌ／電源の出力をル■変換するん巾便換器と、んの変
換器の出力をラッチするラッチ回路と、発振器の出力を
クロックとしてラッチ回路の出力ｆｆｉ Ｄ／Ａ変換す
るＤ／Ａ変換器とを有し、プログラマブル電源のレベｌ
し可変によりＤ／Ａ変換器からはプログラマプ／Ｌ’電
源のレベルに対応したＡＣ信号を出力する出力レベＩし
設定回路。 - （２） プログラマブル電源を有しかつ発振器が組込ま
れることによりＡＣ出力およびＡＣ測定がｉｉＪ能にさ
れたＤＣテスタに備えられるものであって、プログラマ
ブル電源の出力をんΦ変換するんの変換器と、〜Φ変換
器の出力をラッチするラッチ回路と、発振器の出力をロ
ックとしてラッチ回路の出力をＤ／Ａ変換するＤ／Ａ変
換器と、発振器の出力のゼロレベ／Ｌ／を検出するとと
もにこの検出出力を前記ん巾変換器のん巾変換動作タイ
ミング信号として該んの変換器に与える手段とを有し、
プログラマブル電源のレベル可変によりＤ△変換器から
はプログラマグルレベルに対応したＡＣ信号を出力する
出力レベル設定回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58148218A JPS6039574A (ja) | 1983-08-12 | 1983-08-12 | 出力レベル設定回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58148218A JPS6039574A (ja) | 1983-08-12 | 1983-08-12 | 出力レベル設定回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6039574A true JPS6039574A (ja) | 1985-03-01 |
| JPH0527068B2 JPH0527068B2 (ja) | 1993-04-20 |
Family
ID=15447914
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58148218A Granted JPS6039574A (ja) | 1983-08-12 | 1983-08-12 | 出力レベル設定回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6039574A (ja) |
-
1983
- 1983-08-12 JP JP58148218A patent/JPS6039574A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0527068B2 (ja) | 1993-04-20 |
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