JPS6031653A - ワンチツプマイクロコンピユ−タ - Google Patents

ワンチツプマイクロコンピユ−タ

Info

Publication number
JPS6031653A
JPS6031653A JP58140829A JP14082983A JPS6031653A JP S6031653 A JPS6031653 A JP S6031653A JP 58140829 A JP58140829 A JP 58140829A JP 14082983 A JP14082983 A JP 14082983A JP S6031653 A JPS6031653 A JP S6031653A
Authority
JP
Japan
Prior art keywords
program
rom
branch instruction
instruction
address
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP58140829A
Other languages
English (en)
Inventor
Akinori Tojo
東條 昭典
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Nippon Electric Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp, Nippon Electric Co Ltd filed Critical NEC Corp
Priority to JP58140829A priority Critical patent/JPS6031653A/ja
Publication of JPS6031653A publication Critical patent/JPS6031653A/ja
Pending legal-status Critical Current

Links

Classifications

    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F11/00Error detection; Error correction; Monitoring
    • G06F11/07Responding to the occurrence of a fault, e.g. fault tolerance
    • G06F11/0703Error or fault processing not based on redundancy, i.e. by taking additional measures to deal with the error or fault not making use of redundancy in operation, in hardware, or in data representation
    • G06F11/0751Error or fault detection not based on redundancy

Landscapes

  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Quality & Reliability (AREA)
  • Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Test And Diagnosis Of Digital Computers (AREA)
  • Microcomputers (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明は内部に畝、み出し専用メモリを有するワンチッ
プマイクロコンピュータに関し、とくに不良検出回路を
併せもつワンチップマイクロコンピュータに関すZ)。
従来、ワンチップマイクロコンピュータの不p検出チェ
ック方法としては、ワンチップマイクロコンピュータの
入力端子から命令を入力してこれを実行させてマイクロ
コンピータの不良をチェックする方法と、ユーザの指定
に応じて書込まれた読み出し専用メモリ(以下、ユーザ
ROMと(・う)の内容を命令デコーダを介さず直接外
部に出力するメモリダンプ機能によりユーザ指定のプロ
グラム内容が正しく書込まれているか否かのチェックを
行う方法とが併用されて用(・られていた。
しかし、前者の方法は単にワンチップマイクロコンピュ
ータの有する命令を外部から個々に入力して実行させて
動作をチェックするものであり、命令の組合せによって
生じる不良のチェックをすることができなかった。一方
、後者の方法は単にユーザ・プログラムの内容が正規に
書込まれているか否かだけのチェックであり、ユーザR
OMのプログラムを実行させて行なう動作チェックでは
な(・ため、ユーザ・プログラムが機能的に正しく実行
されるか否かをチェックすることはできなかった。従っ
て両者を併用しても不良検出率を上げることかできず、
ユーザークレームを少々くすることができないのが現状
であった。
本発明の目的は不良検出が容易で、しかも検出率の高い
マイクロコンピュータを提供することである。
本発明はプログラムを記憶した読み出し専用メモリと、
実行すべきプログラムのアドレスを指定するプログラム
カウンタと、前記プログラムカウンタによるアドレス指
定にもとすいて読出されたプログラム命令をデコードす
る命令デコーダと、前記命令デコーダの指示により命令
動作実行の為の制御信号を出力する制御部と、前記制御
部からの制御信号により各命令に対応した処理を実行す
る実行部と、読み出し書き込み可能人メモリとを含むマ
イクロコンピータにお(・て、前記プログラム中のCA
LL命令やJUMP命令等のような分岐命令以外の命令
に対しては前記デコーダ部にその命令を与え、一方前記
分岐命令に対しては分岐先のアドレスで指定されるプロ
グラム内容を直接外部へ読み出し、これを内部で実行す
るととなく前記プログラムカウンタのアドレスを分岐命
令のアドレスの次のアドレスにセットする手段を設け、
前記読み出し専用メモリ内のプログラムの中で分岐命令
を除く命令をアドレス順にすべて強制的に実行させるよ
うにしたことを特徴とする。
本発明によれば、ユーザプログラム中にCALL命令、
JUMP命令等の分岐命令による特定処理ルーチン用の
プログラムが存在していたとしても、分岐命令によるル
ープを実行することガく、ユーザROMの中に書込まれ
た残りすべてのプログラムを強制的にO番地から最終番
地までアクセスし、ユーザープログラムで使われている
命令を実行させることができる。従って、命令組み合せ
によって生じる不良をもチェック確実にでき、分岐命令
に対しては分岐先のアドレスで指定されるユーザプログ
ラムのチェックを外部でみることにより、ユーザプログ
ラムで使用しているアドレスでの分岐命令のチェックも
可能にしたワンチップマイクロコンビーータを提供する
ことができる。
彦お、分岐命令に基づくループ処理を実行させると、他
のプログラムをすべて実行することができ々く力るため
、不良検出率を高める意味からも分岐命令を実行させる
ことは避けるようにした。
以下、本発明の実施例を図面を用(・て説明する。
第1図は本実施におけるマイクロコンピュータの機能ブ
ロック図である。lはユーザ・プログラムが書込まれて
いる読み出し専用メモリ(ユーザROM)、2はユーザ
ROM1のアドレスを指定するプログラムカウンタ、3
はCALL、JUMP等の分岐命令によって分岐命令の
あるアドレスを1だけインクリメントしたアドレスをセ
ーブするスタックメモリ、5はユーザ几OM1より読み
出されたプログラム命令をデコードする命令デコーダ、
6は命令デコーダ5の指示により命令動作実行の為の制
御信号を出力する制御部、7は制御部6の指示により各
命令に対応してデータバス8上の内容を演算実行し結果
をデータバス8に返す演算部、9は制御部6の指示に基
いてデータバス8上のデータを書込んだり、あるいはそ
こに読み出す機能をもつメモリ(RAM)、10は外部
出力回路でバス8と12とを切換えて出力する。4は制
御部6の指示により、CALL、JUMP等の分岐命令
の時にはスタックメモリ3にプログラムカウンタ2の分
岐命令の次のアドレスをセーブさせ、ROM出力バス切
換え回路11に指示し、分岐先アドレスで指定されるプ
ログラム内容をROMバス12を介して外部出力回路1
0から外へ出力する。プログラム内容出力後は、プログ
ラムカウンタ2にスタックメモリ3にセーブされて(・
る分岐命令の次のアドレスをセットし、同時に切り換え
回路11を制御してROM出力がデコーダ部5に出力さ
れるように切り換える。
以上のように本発明の分岐命令制御回路を加えることに
よりチップ面積も従来とそれほど変わらずにプログラム
中のJUMP命令、CALL命令等の分岐命令の際には
分岐先のアドレスのプログラム内容を外部にそのままダ
ンプさせ、分岐命令以外の命令は命令デコーダを通して
命令を実行させ結果を外部に出力させることにより、従
来のようにプログラム中にCALL等の分岐命令が存在
して(・てもこれにより一部のプログラムが繰返し実行
されるよ’lことが々く、強制的にO番地から最終番地
まで走らせることができ、ROMに書込まれたプログラ
ムを完全に実行できる。従ってROM変更変更対し、R
OM VC書き込まれたプログラムに対応したワンチッ
プマイクロコンピュータの機能チェックをきわめて簡単
かつ短時間に行カうことができ、メーカーサイドでの不
良の検出率が大きく向上する。
【図面の簡単な説明】
第1図は本発明におけるマイクロコンピュータの機能ブ
ロック図である。 1・・・読み出し専用メモリ(ROM)、2・・・プロ
グラムカウンタ、3・・・スタックメモリ、4・・・分
岐命令制御回路、5・・・命令デコーダ、6・・・制御
部、7・・・演算部、8・・・データバス、9・・・読
み出し書き込みメモ+7(RAM)、10・・・外部出
力回路、11・−・ROM出力バス切換え回路、12・
・・ROMバス代理人 弁理士 内 原 晋/彦^、

Claims (1)

    【特許請求の範囲】
  1. プログラムが格納されたROMと、そのプログラムを実
    行する処理部とを有するワンチップマイクロコンピータ
    におい℃、相記プログラム中にある分岐命令を検出し、
    該分岐命令に対′してはこれを前?処理部で実行せずに
    直接外部へ読み出すようにした制御釦回路を設けたこと
    を特徴とするワンチップマイクロコンピータ。
JP58140829A 1983-08-01 1983-08-01 ワンチツプマイクロコンピユ−タ Pending JPS6031653A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP58140829A JPS6031653A (ja) 1983-08-01 1983-08-01 ワンチツプマイクロコンピユ−タ

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP58140829A JPS6031653A (ja) 1983-08-01 1983-08-01 ワンチツプマイクロコンピユ−タ

Publications (1)

Publication Number Publication Date
JPS6031653A true JPS6031653A (ja) 1985-02-18

Family

ID=15277684

Family Applications (1)

Application Number Title Priority Date Filing Date
JP58140829A Pending JPS6031653A (ja) 1983-08-01 1983-08-01 ワンチツプマイクロコンピユ−タ

Country Status (1)

Country Link
JP (1) JPS6031653A (ja)

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61201344A (ja) * 1985-03-04 1986-09-06 Nec Corp マイクロコンピユ−タ
JPS61229134A (ja) * 1985-04-03 1986-10-13 Nec Corp マイクロコンピユ−タ
JPS62145437A (ja) * 1985-12-20 1987-06-29 Nec Corp コンピユ−タ

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61201344A (ja) * 1985-03-04 1986-09-06 Nec Corp マイクロコンピユ−タ
JPS61229134A (ja) * 1985-04-03 1986-10-13 Nec Corp マイクロコンピユ−タ
JPS62145437A (ja) * 1985-12-20 1987-06-29 Nec Corp コンピユ−タ

Similar Documents

Publication Publication Date Title
JPS6031653A (ja) ワンチツプマイクロコンピユ−タ
JPS61229134A (ja) マイクロコンピユ−タ
JPH07244611A (ja) メモリ内蔵マイクロコンピュータ
JPS60183641A (ja) Cpuの暴走検知システム
JPH01154248A (ja) 論理集積回路
JPH04167146A (ja) 情報処理装置のアドレストレース方式
JPS6349870A (ja) マイクロコンピユ−タ
JPH01102643A (ja) データ処理システム
JPS6095646A (ja) 中央処理装置内蔵メモリ−のモニタ−装置
JPS59167764A (ja) メモリアクセス方式
JPS60126731A (ja) プログラム制御方法
JPS61201344A (ja) マイクロコンピユ−タ
JPS63143636A (ja) ブレ−クポイント制御装置
JPS62145437A (ja) コンピユ−タ
JPS6061841A (ja) プログラム評価装置の制御方式
JPH06290050A (ja) コンピュータおよびそのプログラムロード方法
JPS62256138A (ja) デ−タ処理装置
JPH011032A (ja) マイクロコンピュ−タ回路
JPH036740A (ja) マイクロコンピュータ
JPH0877031A (ja) マイクロプロセッサシステム
JPS6342598A (ja) 時分割多重方式通話路制御装置
JPH10143462A (ja) マイクロコンピュータ
JPH0675789A (ja) 情報処理装置
JPH05334077A (ja) マイクロコンピュータ
JPS645343B2 (ja)