JPS60215253A - 情報処理装置 - Google Patents

情報処理装置

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Publication number
JPS60215253A
JPS60215253A JP59072119A JP7211984A JPS60215253A JP S60215253 A JPS60215253 A JP S60215253A JP 59072119 A JP59072119 A JP 59072119A JP 7211984 A JP7211984 A JP 7211984A JP S60215253 A JPS60215253 A JP S60215253A
Authority
JP
Japan
Prior art keywords
latch
instruction
circuit
instruction register
output
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP59072119A
Other languages
English (en)
Inventor
Takatoshi Koga
古賀 隆俊
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Nippon Electric Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp, Nippon Electric Co Ltd filed Critical NEC Corp
Priority to JP59072119A priority Critical patent/JPS60215253A/ja
Publication of JPS60215253A publication Critical patent/JPS60215253A/ja
Pending legal-status Critical Current

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Classifications

    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F11/00Error detection; Error correction; Monitoring
    • G06F11/22Detection or location of defective computer hardware by testing during standby operation or during idle time, e.g. start-up testing

Landscapes

  • Engineering & Computer Science (AREA)
  • General Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Computer Hardware Design (AREA)
  • Quality & Reliability (AREA)
  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Executing Machine-Instructions (AREA)
  • Test And Diagnosis Of Digital Computers (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (技術弁Iす 本発明社命令レジスタの出力を命令デ;−ダに供給する
機能を有する情報処理装置1に関する。
(従来技術) 従来、情報処理装置の命令実行動作は、命令レジスタが
外部からの命令を取り込み、その値を命令デコーダへ供
給し、そのデコード信号によって諸々の命令の動作を実
行していた。ゆえに、その情報処理装置を試験するとき
は、命令レジスタに外部よりすべての種類の命令を入力
し、それぞれの命令I/c会った正しい動作を実行して
いるかどうかを試験していた。つまり、前記試験を実現
するには、外部で前記すべての種類の命令を発生させな
ければならずそのための、特別な装置が必要であるとい
う欠点があった。
(発明の目的) 本発明の目的は、上記欠点を除去することにより、情報
処理装置の試験を行なう場合、面倒な外部からのすべて
の種類の命令挿入を行なう必要がなく、従って特別な試
験装置も不要で、自動的に試験を行なうことを可能とす
る情報処理装置を提供することにある。
(発明の構成) 本発明の情報処理装−は、命令レジスタの出力を命令デ
コーダに供給する後節を有する情報処理装置において、
前記命令レジスタの出力をラッチしインクリメントある
いはデクリメントするインクリメント回路あるい捻ディ
クリメント回路と、外部からの命令又は前記インクリメ
ント回路の出力あるいは前記デクリメント回路の出力の
いづれか一方を選択し前記命令レジスタに供給する選別
回路とを含むことから構成される。
(実施例) 以下、本発明の実施例について図面を参照して説明する
第1図は本発明の一実施例の回路図、第2図(a)伽)
はその動作タイミングチャートである。
本実施例は、命令レジスタとしての第1ラツチ5の出力
を命令デコーダへの入力信号1鳥〜IR,Iとして命令
デコーダ(図示していない)に供給する機能を有する情
報処理装置において、第1ラツチ5の出力を2ツチしイ
ンクリメントするインクリメント回路としての第2ラツ
チ7及びインクリメンタ8と、外部からの入男命令工。
〜工、又はインクリメンタ8の出力のいづれか一方を選
択し第1ラツチ5に供給する選別回路としての選択グー
)−1,,2及びインバータ9とを含むことから構成さ
れる。々お図で3は選択信号Aの入力端子、4.6はそ
れぞれ第1クロツク01及び第2クロツク02の入力端
子である。
すなわち、本実施例は、従来の命令レジスタは。
外部よりの入力命令工。〜工、をラッチする第1クロツ
ク01と第1ラツチ5のみで構成されていたものを、前
記従来の命令レジスタに1選択ゲート1.2と1選択信
号人、第2クロック02.第2ラツチ7及びインクリメ
ンタ8を付加したものである。
次に1本実施例のも動作について説明する。
選択信号AをH++にすれば5選択ゲートlがオンし、
第2図((転)に示す通り第1ラツチ5は外部からの入
力命令工。〜工、を第1クロツク01にて取り込み、命
令デコーダへの入力信号、、!攬〜IR。
、を供給するという従来通りの動作ができる。
ところが、選択信号AをwI、−にすれば、インバータ
9を介して選択ゲート2がオンし、第2図(b)の様に
、第1ラツチ5の値を第2クロツク02で第22.チア
に取り込み、インクリメンタ8にトし7た信号を選択ゲ
ート2全通し て第1クロツクグ1にて第1ラツチ5が取り込む。
つまり、デコーダへの入力信号IR8〜IR,としては
、つぎつぎにインクリメントされた値N、N+1tN+
2を入力できる事になる。
すなわち、命令デコーダへ00H%FF、Hのすべての
種類の命令を入力することが可能となる。
以上の説明より明白であるように、本実施例によると、
特別な装置を要せずに、自動的にすべての命令を発生出
来るため、情報処理装置の試験が簡略化できる。
又、インクリメント回路をデクリメント回路に置き換え
ても同様の効果を得られることに自明である。
(発明の効果) 以上、詳細説明したとおり1本発明の情報処理装置は、
命令レジスタの出力をラッチしインクリメントあるいは
デクリメントするインクリメント回路あるいはデクリメ
ント回路を含んでい石ので。
自動的にすべての命令を発生出来るため、情報処理装置
の試験において、従来のように命令発生のための特別な
装置を必要とせず自動的に試験が可能であるという効果
を有している。
4、図面の簡単な説明  第1図は本発明の一実施例の回路図、第2図(a)、(
b)はその動作タイミングチャートである。
1.2・・・・・・選択グー)、3.4・・・・・・入
力端子、5・・・・・・第1ラツチ、6・・・・・・入
力端子、7・・・・・・第2ラツチ、8・・・・・・イ
ンクリメンタ、9・・・・・・インバータ、A・・・・
・・選択信号、■。〜工、・・・・・・入力命令。
IR0〜IR,・・・・・・命令デコーダへの入力信号
、y’ i s l 2・・・・・・クロック。
代理人 弁理士 内 原 晋6μs戸 7/ 篤 1 図

Claims (1)

    【特許請求の範囲】
  1. 命令レジスタの出力を命令デコーダに供給する機能を有
    する情報処理装置において、前記命令レジスタの出力を
    ラッチしインクリメントあるいはデクリメントするイン
    クリメント回路あるいはディクリメント回路と、外部か
    らの命令又は前記インクリメント回路の出力あるいは前
    記デクリメント回路の出力のいづれか一方を選択し前記
    命令レジスタに供給する選別回路とを含むことを%徴と
    する情報処理装置。
JP59072119A 1984-04-11 1984-04-11 情報処理装置 Pending JPS60215253A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP59072119A JPS60215253A (ja) 1984-04-11 1984-04-11 情報処理装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP59072119A JPS60215253A (ja) 1984-04-11 1984-04-11 情報処理装置

Publications (1)

Publication Number Publication Date
JPS60215253A true JPS60215253A (ja) 1985-10-28

Family

ID=13480140

Family Applications (1)

Application Number Title Priority Date Filing Date
JP59072119A Pending JPS60215253A (ja) 1984-04-11 1984-04-11 情報処理装置

Country Status (1)

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JP (1) JPS60215253A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6077808A (en) * 1997-08-08 2000-06-20 Mazda Motor Corporation Exhaust gas purifying catalyst and process of producing the same

Cited By (1)

* Cited by examiner, † Cited by third party
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