JPS60133736A - 半導体装置 - Google Patents
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- JPS60133736A JPS60133736A JP58241321A JP24132183A JPS60133736A JP S60133736 A JPS60133736 A JP S60133736A JP 58241321 A JP58241321 A JP 58241321A JP 24132183 A JP24132183 A JP 24132183A JP S60133736 A JPS60133736 A JP S60133736A
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- H01L2924/351—Thermal stress
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(1)発明の技術分野
本発明は半導体装置、詳しくはチップがグイ付けされる
グイステージにスリップ(滑り)現象を抑制する構造を
もたせたプラスチックパッケージに関する。
グイステージにスリップ(滑り)現象を抑制する構造を
もたせたプラスチックパッケージに関する。
(2)技術の背景
第1図に断面図で示される集積回路が形成された半導体
チップを樹脂封止したプラスチックパッケージが知られ
ており、同図において、■は半導体チップ(以下にはチ
ップという)、2aはチップ(1) 1がグイ付けされたグイステージ、2bは外リード(グ
イステージ2a+外リード2bは一体に形成されたリー
ドフレームの部分である)、3はチップ1の電極と外リ
ード2bとを接続するワイヤー、4はチップ1を封止す
るエポキシ樹脂の如き樹脂材料を示す。かかるプラスチ
ックパッケージはモールド装置を用いる成形によって1
度に数十制作られる。
チップを樹脂封止したプラスチックパッケージが知られ
ており、同図において、■は半導体チップ(以下にはチ
ップという)、2aはチップ(1) 1がグイ付けされたグイステージ、2bは外リード(グ
イステージ2a+外リード2bは一体に形成されたリー
ドフレームの部分である)、3はチップ1の電極と外リ
ード2bとを接続するワイヤー、4はチップ1を封止す
るエポキシ樹脂の如き樹脂材料を示す。かかるプラスチ
ックパッケージはモールド装置を用いる成形によって1
度に数十制作られる。
(3)従来技術と問題点
上記したプラスチックパッケージの各部分はそれぞれ異
なった材料で作られ、チップ1はシリコン、グイステー
ジ2aと外リード2bは42アロイ、また封止のための
材料は樹脂であるので、それぞれの膨張係数が異なる。
なった材料で作られ、チップ1はシリコン、グイステー
ジ2aと外リード2bは42アロイ、また封止のための
材料は樹脂であるので、それぞれの膨張係数が異なる。
使用においてプラスチックパッケージは温度変化による
熱応力を受け、温度サイクルが繰り返されると、グイス
テージ2aの下面においては金属と樹脂間の膨張係数の
差によりスリップ現象が発生し、グイステージ2aが封
止材4から剥がれてくる。
熱応力を受け、温度サイクルが繰り返されると、グイス
テージ2aの下面においては金属と樹脂間の膨張係数の
差によりスリップ現象が発生し、グイステージ2aが封
止材4から剥がれてくる。
更に熱応力が加えられるとグイステージと封止(2)
材とが膨張収縮を繰り返し、グイステージ2aの縁部分
に応力が集中する。引続き熱応力が加えられると前記縁
部分で材料が破壊し図に48で示す如きクランク(ひび
割れ)が発生する。
に応力が集中する。引続き熱応力が加えられると前記縁
部分で材料が破壊し図に48で示す如きクランク(ひび
割れ)が発生する。
外り−1”2bについても熱応力の影響はあるが、外リ
ートの表面積はグイステージに比べるとはるかに小で、
クラックが発生するには至らない。
ートの表面積はグイステージに比べるとはるかに小で、
クラックが発生するには至らない。
またチップ1の上表面は図では平坦に画いであるが、チ
ップには配線、絶縁膜等が形成されているので実際には
かなりの凹凸があり、熱応力が加わっても上記した現象
は発生しない。
ップには配線、絶縁膜等が形成されているので実際には
かなりの凹凸があり、熱応力が加わっても上記した現象
は発生しない。
ただグイステージだけが表面平滑で、それは42アロイ
で作られまたは42アロイの表面が金(^U)または銀
(Ag)でメッキされたものである。そして平らな大面
積部分について上記のスリップ現象が発生し、クラック
はほとんどグイステージ2aの縁部分にみられる。
で作られまたは42アロイの表面が金(^U)または銀
(Ag)でメッキされたものである。そして平らな大面
積部分について上記のスリップ現象が発生し、クラック
はほとんどグイステージ2aの縁部分にみられる。
かかるクラックができると、それはプラスチックパッケ
ージの機械的強度に影響するだけでなく、そこから湿気
が浸入してパッケージの絶縁性を損(3) なう問題がある。かかる問題は最近のチ・ノブがより大
に、従ってプラスチックパッケージがより大に作られる
傾向にあるので顕著になってきており、その解決が要望
されているものである。
ージの機械的強度に影響するだけでなく、そこから湿気
が浸入してパッケージの絶縁性を損(3) なう問題がある。かかる問題は最近のチ・ノブがより大
に、従ってプラスチックパッケージがより大に作られる
傾向にあるので顕著になってきており、その解決が要望
されているものである。
(4)発明の目的
本発明は上記従来の問題に鑑み、リードフレームのグイ
ステージにダイイ」けされたチ・ノブを樹脂封止してな
るプラスチックパッケージにおいて、熱応力によるスリ
ップ現象の発生を抑制し、樹脂材料のひび割れの発生を
防止しうるグイステージを提供することを目的とする。
ステージにダイイ」けされたチ・ノブを樹脂封止してな
るプラスチックパッケージにおいて、熱応力によるスリ
ップ現象の発生を抑制し、樹脂材料のひび割れの発生を
防止しうるグイステージを提供することを目的とする。
(5)発明の構成
そしてこの目的は本発明によれば、リードフレームのグ
イステージにグイ付けされた半導体チ・ノブを樹脂材料
にて封止してなるプラスチックパッケージにおいて、前
記グイステージの表面または裏面にストレス分散用の凹
凸を設けたことを特徴とする半導体装置を提供すること
によって達成される。
イステージにグイ付けされた半導体チ・ノブを樹脂材料
にて封止してなるプラスチックパッケージにおいて、前
記グイステージの表面または裏面にストレス分散用の凹
凸を設けたことを特徴とする半導体装置を提供すること
によって達成される。
(6)発明の実施例
(4)
以下本発明実施例を図面によって詳説する。
本発明は前記したスリップを防止しグイステージの縁部
分における応力集中を避けるものであって、グイステー
ジを応力分散可能な形状にする。
分における応力集中を避けるものであって、グイステー
ジを応力分散可能な形状にする。
本発明の第1実施例は第2図の断面図に示される如くグ
イステージ12の中央部分12aを突出させた形状にす
る。なお第2図以下において、グイステージを除き既に
図示した部分は同一符号を付して表示する。かかる形状
をとることによって、第1図のグイステージはより多く
の縁部分をもつことになり、そこに応力が分散され、ク
ランクの発生が防止される。この実施例においては熱応
力そのものが分散されるものでる。
イステージ12の中央部分12aを突出させた形状にす
る。なお第2図以下において、グイステージを除き既に
図示した部分は同一符号を付して表示する。かかる形状
をとることによって、第1図のグイステージはより多く
の縁部分をもつことになり、そこに応力が分散され、ク
ランクの発生が防止される。この実施例においては熱応
力そのものが分散されるものでる。
本発明の第2実施例は第3図の断面図に示され、この実
施例においてはグイステージ22に小突起22aを多数
形成し、グイステージの上面には凸部、下面には凹部を
それぞれ多数形成した構造であり、グイステージと樹脂
材料との間のスリップ現象が防止されてグイステージの
縁部分における応力集中が防止される。小突起22aは
規則的に配列して(5) ちまたは不規則に配列してもよい。
施例においてはグイステージ22に小突起22aを多数
形成し、グイステージの上面には凸部、下面には凹部を
それぞれ多数形成した構造であり、グイステージと樹脂
材料との間のスリップ現象が防止されてグイステージの
縁部分における応力集中が防止される。小突起22aは
規則的に配列して(5) ちまたは不規則に配列してもよい。
第4図の断面図に示される本発明の第3実施例において
は、グイステージ32のグイ付けされる面の反対面上に
多数の切込みまたは溝32aを形成し、それによってグ
イステージと樹脂材料との間のスリップを防止し、グイ
ステージの縁部分における応力集中を回避する。溝32
aは規則的にまたは不規則に形成することができる。
は、グイステージ32のグイ付けされる面の反対面上に
多数の切込みまたは溝32aを形成し、それによってグ
イステージと樹脂材料との間のスリップを防止し、グイ
ステージの縁部分における応力集中を回避する。溝32
aは規則的にまたは不規則に形成することができる。
上記のいずれの実施例も、リードフレーム形成工程にお
いてグイステージのプレス工程におし)で容易に所望の
形状が得られ、リードフレームの製造工程の工程数また
はコストを増やすことな(形成可能である。
いてグイステージのプレス工程におし)で容易に所望の
形状が得られ、リードフレームの製造工程の工程数また
はコストを増やすことな(形成可能である。
また、本発明の適用範囲は上記の実施例に限定されるも
のでなく、グイステージと樹脂材料との間のスリップを
防止しグイステージの縁部分における応力集中を避ける
ことのできる形状であれLfいかなる形状のものにも及
ぶもので、例えば中央部分]2aの形状を変更し、小突
起22aを図示の側とは反対側に設け、また溝32aを
図示のV溝の代(6) りにU溝に形成してもよい。
のでなく、グイステージと樹脂材料との間のスリップを
防止しグイステージの縁部分における応力集中を避ける
ことのできる形状であれLfいかなる形状のものにも及
ぶもので、例えば中央部分]2aの形状を変更し、小突
起22aを図示の側とは反対側に設け、また溝32aを
図示のV溝の代(6) りにU溝に形成してもよい。
(7)発明の効果
以上詳細に説明した如く本発明によれば、リードフレー
ムの製造工程においてそのグイステージに突出部、凹凸
部または溝の如き樹脂とグイステージとの間のスリップ
を防止する形状を設けることにより、プラスチックパッ
ケージの使用中の温度変更によるダイステージ縁部にお
けるクランクの発生が防止され、同パッケージの信頼性
向上に効果大である。また本発明は半導体チップとパッ
ケージが大型化するにつれて更に効果的である。
ムの製造工程においてそのグイステージに突出部、凹凸
部または溝の如き樹脂とグイステージとの間のスリップ
を防止する形状を設けることにより、プラスチックパッ
ケージの使用中の温度変更によるダイステージ縁部にお
けるクランクの発生が防止され、同パッケージの信頼性
向上に効果大である。また本発明は半導体チップとパッ
ケージが大型化するにつれて更に効果的である。
第1図は従来のプラスチックパッケージの断面図、第2
図はないし第4図は本発明実施例の断面図である。 】−半導体チップ、2a、 12.22.32−ダイス
テージ、2b−外リード、3− ワイヤー、4−樹脂、4a−クランク、12a −中央
部分、22a・−小突起、32a−溝(7)
図はないし第4図は本発明実施例の断面図である。 】−半導体チップ、2a、 12.22.32−ダイス
テージ、2b−外リード、3− ワイヤー、4−樹脂、4a−クランク、12a −中央
部分、22a・−小突起、32a−溝(7)
Claims (1)
- グイステージにグイ付けされた半導体チップを樹脂材料
にて封止L7てなるプラスチックパッケージにおいて、
前記グイステージの表面または裏面にストレス分散用の
凹凸を設けたことを特徴とする半導体装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58241321A JPS60133736A (ja) | 1983-12-21 | 1983-12-21 | 半導体装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58241321A JPS60133736A (ja) | 1983-12-21 | 1983-12-21 | 半導体装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS60133736A true JPS60133736A (ja) | 1985-07-16 |
Family
ID=17072553
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP58241321A Pending JPS60133736A (ja) | 1983-12-21 | 1983-12-21 | 半導体装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS60133736A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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EP1032037A3 (en) * | 1999-02-24 | 2001-04-25 | Matsushita Electronics Corporation | Resin-moulded semiconductor device, method for manufacturing the same, and leadframe |
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JPS58199548A (ja) * | 1982-05-17 | 1983-11-19 | Hitachi Ltd | リ−ドフレ−ム |
-
1983
- 1983-12-21 JP JP58241321A patent/JPS60133736A/ja active Pending
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