JPS60117518A - リレ−装置 - Google Patents

リレ−装置

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JPS60117518A
JPS60117518A JP58225223A JP22522383A JPS60117518A JP S60117518 A JPS60117518 A JP S60117518A JP 58225223 A JP58225223 A JP 58225223A JP 22522383 A JP22522383 A JP 22522383A JP S60117518 A JPS60117518 A JP S60117518A
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JP
Japan
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contact
semiconductor switching
switching element
relay
make
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JP58225223A
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English (en)
Inventor
古賀　浩文
小柳　勝海
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Omron Corp
Original Assignee
Tateisi Electronics Co
Omron Tateisi Electronics Co
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Publication date
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Priority to DE8484114389T priority patent/DE3481880D1/de
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Pending legal-status Critical Current

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    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01H—ELECTRIC SWITCHES; RELAYS; SELECTORS; EMERGENCY PROTECTIVE DEVICES
    • H01H9/00—Details of switching devices, not covered by groups H01H1/00 - H01H7/00
    • H01H9/54—Circuit arrangements not adapted to a particular application of the switching device and for which no provision exists elsewhere
    • H01H9/541—Contacts shunted by semiconductor devices
    • H01H9/542—Contacts shunted by static switch means
    • H—ELECTRICITY
    • H01—ELECTRIC ELEMENTS
    • H01H—ELECTRIC SWITCHES; RELAYS; SELECTORS; EMERGENCY PROTECTIVE DEVICES
    • H01H9/00—Details of switching devices, not covered by groups H01H1/00 - H01H7/00
    • H01H9/54—Circuit arrangements not adapted to a particular application of the switching device and for which no provision exists elsewhere
    • H01H9/541—Contacts shunted by semiconductor devices
    • H01H9/542—Contacts shunted by static switch means
    • H01H2009/545—Contacts shunted by static switch means comprising a parallel semiconductor switch being fired optically, e.g. using a photocoupler

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 （イ）発明の技術分野　゛ この発明はリレー装置より詳しくは回路の開閉を半導体
素子で行ない、通電を接点を介して行なうようにしたリ
レー装置に関する。
（ロ）従来技術とその問題点 従来、負荷を開閉するのに、機械的接点をもつマグネッ
ト・リレーと半導体スイッチング素子を組み合わせて、
半導体スイッチング素子で回路を開閉することで接点に
おけるアーク発生を防止し、接点に通電することで半導
体スイッチング素子の発熱を防止するものがある。しか
しながら、この種のリレー装置は、サージ電圧や接点の
接触不良などにより、半導体スイッチング素子か破壊す
ると、開路が不可能となり、負荷に通電され続けるとい
う危険かあった。
（ハ）発明の目的 この発明は、半導体スイッチング素子か破壊しにくく、
たとえ破壊しても接点の短絡状態を防止できるリレー装
置を提供することを目的とする。
に）発明の概要 半導体スイッチング素子と直列に接続された第１の接点
と、上記半導体スイッチング素子と第１の接点との直列
回路または上記半導体スイッチング素子と並列に接続さ
れた第２の接点とを備え、負荷に電源を投入するときは
、第１の接点を閉じてから、半導体スイッチング素子を
導通し、その後、第２の接点を閉じ、電源を遮断すると
きは、第２の接点を開いてから、半導体スイッチング素
子を非導通とし、その後、第１の接点を開くようにした
ことを特徴とする。
←ｌ　発明の実施例 以下この発明の一実施例を図面に基づいて説明する。
第１図は所謂メーク・メーク形リレーの構造を示す。鉄
心１の回りにコイル２が巻かれており、コイル２の引出
し部２ａはコイル端子３にはんだ付けで接続されている
。ヨーク４に回動可能に支持された可動鉄片５は、その
端部５ａかコイル２の励磁により鉄心１に吸引され、可
動鉄片５の他方の端部５ｂに固定されたカード６を図中
右方向へ押し出すことで可動接触片７，８を撓ませ、ま
ず、ケート用接点７ａと８ａを閉じ、その後、主接点８
１）と９３を閉じる。固定接触片９は剛体である。ベー
ス１０には、前記コイル端子３、可動接触片７，８およ
び固定接触片９がインサート成形あるいは圧入などによ
り固定され、ざらにヨーク４がねじ１１により固定され
ている。
第２図は上述のメータ・メータ形リレーを用いた本発明
に係るリレー装置の回路構成を示している。
図示しない信号出力源が接続される端子Ａ、Ｂの間に、
補助リレーＸが接続され、この補助リレーＸと並列にコ
ンデンサＣとダイオードＤ１とが直列に接続される。ダ
イオードＤ１はアノードが端子Ｂに接続される。また、
端子Ａ、Ｂ間には、主リレーＹと抵抗Ｒ１が直列に接続
される。さらに、コンデンサＣとダイオードＤ１のカソ
ードとの接続点にダイオードＤ２のアノードが接続され
、このダイオードＤ２のカソードが主リレーＹと抵抗に
１との接続点に接続される。
交流電源Ｐの一方の端子Ｐ１に負荷りの一方の端子Ｌ　
ｌが接続され、負荷りの他方の端子Ｌ２１こ半導体スイ
ッチング素子Ｔのアノードが接続され、この半導体スイ
ッチング素子Ｔのカソードが補助リレーＸの常開接点Ｘ
１を介して交流電源Ｐの他方の端子Ｐ２に接続される。
負荷りの端子Ｌ２と半導体スイッチング素子Ｔのゲート
との間に、主リレーＹの常開接点Ｙ１と抵抗に２とか直
列に接続される。さらに、負荷りの端子Ｌ２と交流電源
Ｐの端子Ｐ２との間に主リレーＹの常開接点Ｙ２が接続
される。
破線で囲まれた回路ＲＹが第１図に示すメーク・メータ
形リレーを構成する回路であり、常開接点Ｙ１が第１図
の接点８ａ、７ａに相当し、常開接点Ｙ２が第１図の接
点８ｂ、９ａに相当する。
上述の回路の動作を説明する。
端子Ａ、Ｂ間に信号電圧が印加されると、補助リレーＸ
が励磁され、常開接点Ｘ１が閉じる。この時には、コン
デンサＣ１ダイオードＤ２、抵抗に１の経路で電流が流
れ、主リレーＹは励磁されない。したがって、接点Ｙｌ
、Ｙ２はともに開いたままで、半導体スイッチング素子
Ｔは導通せず、負荷りには電流が流れない。コンデンサ
Ｃの充電が進むと、主リレーＹに励磁電流が流れるよう
になり、第１図の可動鉄片５が鉄心１に吸引されて、ま
ず常開接点Ｙ１が閉じることにより、半導体スイッチン
グ素子Ｔがトリガされて導通ずる。このときには、接点
Ｘ１が閉じているので、負荷りに半導体スイッチング素
子Ｔを介して電流が流れる。
可動鉄片５かさらに回動することにより、続いて常開接
点Ｙ２が閉じ、負荷電流は半導体スイッチング素子Ｔか
ら接点Ｙ２ｊこその流れを変える。すなわち、投入は半
導体スイッチング素子Ｔで行ない、その後の通電は接点
Ｙ２で行なうことになる。
負荷電流を遮断するときは、端子Ａ、Ｂ間の信号電圧を
除去すると、主リレーＹが消磁され、可動鉄片５による
押圧力が無くなり、まず接点Ｙ２が開く。この時には、
コンデンサＣが補助リレーＸ１ダイオードＤ１の経路で
放電し、補助リレーＸの励磁が続行して接点Ｘ１が閉じ
ているので、負荷電流は半導体スイッチング素子Ｔにそ
の流れを変える。続いて接点Ｙ１が開いてゲートトリガ
信号が除去され、半導体スイッチング素子Ｔは阻止状態
になる。この後、コンデンサＣの放電が終了すると、補
助リレーＸは消磁され、接点Ｘ１が開く。すなわち、負
荷電流の遮断は半導体スイッチング素子Ｔて行なわれる
。第３図は、端子Ａ、Ｂ間に信号電圧を印加してから除
去するまての接点Ｘｌ　、Ｙｌ　、Ｙ２の状態を示して
いる。
なお、第４図に示すように、補助リレーＸのｎ′開接点
Ｘ１を交流電諒Ｐの端子Ｐ２と半導体スイッチング素子
Ｔと接点Ｙ２との接続点との間に接続しても、上述と同
様の動作となる。
（へ）発明の効果 以］−説明したように、本発明においては、負荷に電源
を投入するときは、半導体スイッチング素子と直列の第
１の接点を閉じてから半導体スイッチング素子を導通し
、その後、半導体スイッチング素子と並列の第２の接点
を閉じ、負荷電流を遮断するときは、第２の接点を開い
てから半導体スイッチング素子を非導通とし、その後、
第１の接点を開くようにしたから、負荷電流の遮断時に
おいて半導体スイッチング素子は負荷とは接点により開
路状態にあり、特別な保護素子を要することなく、サー
ジ電圧等による半導体スイッチング素子の破壊を防＋ｈ
てきる。したかつて、負荷に通電され続けることを防止
できる。
また、本発明においては、メーク・メーク形リレーを用
いて、半導体スイッチング素子の導通・非導通を制御す
るとともに、負荷電流の通電を制御するようにしたから
、特別なタイミング回路が不要となる。また、第１の接
点を有するリレーとメータ・メーク形リレーを個々蕎こ
備えて夫々タイミングを取っているので、負荷電源の周
波数に応じてタイミング時間を容易に調整できる。
【図面の簡単な説明】
第１図はメーク・メーク形リレーの構成を示す図、第２
図は本発明の一実施例を示す回路図、第３図は第２図の
回路の要部の状態を示すタイミングチャート、第４図は
本発明の他の実施例を示す回路図である。 Ｔ・・・半導体スイッチング素子、Ｘｌ・・・接点、Ｙ
２・・・接点、ＲＹ・・・メータ・メーク形リレー、Ｙ
ｌ・・・接点、Ｘ・・・リレー、Ｃ・・・コンデンサ、
Ｄｌ・・・ダイオード、ｋｌ・・・抵抗。 特許出願人　立石電機株式会社 代住人　弁理士　青史−葆）に−爲 第１図 第３図 第４図 手続補正書（自制 御　事件の表示 昭和５８年特許願第　２２５２２３　号２、発明の名称 リレー装置 ３補正をする者 事件との関係　特許出願人 住所　足に１Ｘｌｆｌ早ｉ？ｌｉ　Ｉｌ＋右京区花園土
堂町１０番地名称　（２９４，）　立石電機（１、式会
社代　表　者　立　石　孝　雄 ４代理人 住所　大阪府大阪市東区本町２−１０　本町ヒル内氏名
　弁理士（６２１４）青　山　葆　ほか　２名５補正命
令の日付−自　発 ６補正の対象：明細書の特許請求の範囲の欄７補正の内
容：別紙のとおり 別紙 特許請求の範囲 （１）機械的接点をもつ電磁リレーと、半導体スイッチ
ング素子とを組み合わせて、電：原の４ぐ人とｊｏ８断
を上記半導体スイッチング素子で行ない、−１−記電源
の投入後の通電は上記接点を介して行なうにうにしたリ
レー装置において、 −１−記半導体スイツチング素子と直列に接続すれた第
１の接７へと、１：記半導体スイッチング素Ｔと第１の
接点との直列回路または上記半導体スイッチング素子と
並列に接続された第２の接、−χとを４１１１え、 負荷に電源を投入するときは、第１の接点を閉してから
、半導体スイッチング素子を導通し、その後、第２の接
点を閉じ、電源を遮断するとぎは、第２の接点を開いて
か呟半導体スイッチング素了を非導通とし、その後、第
１の接点を開くようにしたことを特徴とするリレー装置
。 （２）　複数の接、αを有腰臆磁及び消磁により複数の
接点の夫々が所定の順序で開閉するメーク・メーク形リ
レーを備え、上記第２の接点と」−記半導木スイツチン
グ素子のゲート信号を与える接点と力斗記メーク・メー
ク形リレーの接点である特許請求の範囲第１項に記載の
四−に二装置。 （３）Ｉ−記載１の接点を有するリレーと、」１記メー
ク・メーク形リレーとの励磁及び消磁の開始の遅れ動作
を遅延回路を用いて行なう特許請求の範囲第１項に記載
の茎ヱニ装置。 （４，）　−Ｊ−記遅延回路はコンデンサの充放電を利
用する特許請求の範囲第１項に記載の一ソーに二装置。

Claims (4)

    【特許請求の範囲】
  1. （１）機械的接点をもつ電磁リレーと、半導体スイッチ
    ング素子とを組み合わせて、電源の投入と遮断を上記半
    導体スイッチング素子で行ない、上記電源の投入後の通
    電は上記接点を介して行なうようにしたリレー装置にお
    いて、 上記半導体スイッチング素子と直列に接続された第１の
    接点と、上記半導体スイッチング素子と第１の接点との
    直列回路または上記半導体スイッチング素子と並列に接
    続された第２の接点とを備え、 負荷重こ電源を投入するときは、第１の接点を閉じてか
    ら、半導体スイッチング素子を導通し、その後、第２の
    接点を閉じ、電源を遮断するときは、第２の接点を開い
    てから、半導体スイッチング素子を非導通とし、その後
    、第１の接点を開くようにしたことを特徴とするリレー
    装置。
  2. （２）段数の接点を有し、励磁及び消磁により複数の接
    点の夫々が所定の順序で開閉するメーク。 メーク形リレーを備え、上記第２の接点と上記半導体ス
    イッチング菓子のゲート信号を与える接点とか」−記メ
    ーク・メーク形リレーの接点である特許請求の範囲第１
    項に記載の装置。
  3. （３）上記第１の接点を有するリレーと、上記メーク・
    メーク形リレーとの励磁及び消磁の開始の遅れ動作を遅
    延回路を用いて行なう特許請求の範囲第１項に記載の装
    置。
  4. （４）上記遅延回路はコンデンサの充放電を利用する特
    許請求の範囲第１項に記載の装置。
JP58225223A 1983-11-28 1983-11-28 リレ−装置 Pending JPS60117518A (ja)

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