JPS60110144A - 混成集積回路 - Google Patents

混成集積回路

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Publication number
JPS60110144A
JPS60110144A JP21821283A JP21821283A JPS60110144A JP S60110144 A JPS60110144 A JP S60110144A JP 21821283 A JP21821283 A JP 21821283A JP 21821283 A JP21821283 A JP 21821283A JP S60110144 A JPS60110144 A JP S60110144A
Authority
JP
Japan
Prior art keywords
substance
integrated circuit
sealing
hybrid integrated
wall
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP21821283A
Other languages
English (en)
Inventor
Hideaki Takadono
高殿 秀明
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
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Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to JP21821283A priority Critical patent/JPS60110144A/ja
Publication of JPS60110144A publication Critical patent/JPS60110144A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/50Assembly of semiconductor devices using processes or apparatus not provided for in a single one of the subgroups H01L21/06 - H01L21/326, e.g. sealing of a cap to a base of a container

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  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
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  • General Physics & Mathematics (AREA)
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  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔発明の技術分野〕 この発明は、基板上にチップ状部品を実装し封止を行っ
て一定の電気的機能を実現する混成集積回路に関するも
のである。
〔従来技術〕
混成集積回路の一例を第1図に示す。図に於いて(1)
は基板、(2:は基板上に取付けられた電気部品、(3
1は基板に取付けられた端子である。(4)はこれらを
収納する容器であり、(5)は基板+11と電気部品(
2)とを封止する封止物質A、16+は封止物質Aによ
って封止された容器(4)を更に封止する封止物質Bで
ある。
次に動作について説明する。電気部品(2)と端子(3
)とを取付けた基板[1)は所定の電気的機能を実現す
る。これらの部品を機械的衝撃から保護し、耐環境性を
向上させる為に、容器(41に収納し、封止物質A(5
)及び封止物質H(61によって封止している。
機械的衝撃からの完全な保護と高い耐環境性とを実現す
る為には、容器(41、及び封止物質は、耐湿性、気密
性に優れた硬い材料を使用しなければならない。一方、
封止物質と基板(1)、電気部品(21゜端子(3)と
の熱膨張係数が異なり、しかも封止物質が硬い材料を使
用している場合には、基板illと電気部品(2)、基
板+11と端子(31との接合部に温度変化に伴う熱応
力が加わり、甚だしき場合には、これ−らの接合部が破
壊される。これらの接合部を破壊から守る為には、内部
を中空構造とするか、熱膨張係数の差の小さい封止物質
を使用するか、又は内部の基板(1)、電気部品(21
,端子(31に接する所には軟かく応力の小さい封止物
質A15)を使用し、更に硬く耐環境性に優れた封止物
質H(61によって封止するかの32の方法があるが、
ここでは最後の方法を採用している。
封止にあたっては、電気部品(2)と端子(31とを取
付けた基板11+を容器(4)に収納する。次に液状に
なった封止物質A151を電気部品が隠れるまで注入し
た後硬化させる。次に液状になった封止物質H(6)を
必要量注入した後硬化させる。第1図に示した混成集積
回路の容器では、内壁が平面である為、第2図に示す如
く液状の封止物質A(51を注入した時、表面張力によ
って封止物質入(5)が壁面を這い上がる。この為、封
止物質B(6)の厚さが容器(41の壁面の近くでは封
止物質B(6)の厚さが薄くなり、甚だしい場合には封
止物質A(51が露出して、耐衝撃性、耐環境性が低下
する。
〔発明の概要〕 この発明は上記のような従来のものの欠点を除去するた
めになされたもので、容器(4)の内壁に段差を付ける
事によって、封止物質A(51の壁面の這い上がりの少
ない混成集積回路を提供することを目的としている。
以下、この発明の一実施例を図について説明する。第3
図において、(7)は容器(4)の内壁に形成された段
差である。
第3図に示す構造の容器(4)では、液状になった封止
物質A15)の壁面の這い上がりが段差(71によって
制限される為、封止物質B(6)の厚さが極度に薄くな
る事は無い。
なお、上記実施例では容器(4)の内壁に簡単な段差(
7)を設けたものを示したが、第4図に示す如く、段差
(7)を堤防状に設けてもよい。又、第5図に示す如く
、段差(7)を溝状に設けてもよい。又第6図に示す如
く段差(7)を突出させてもよい。
〔発明の効果〕
以上のように、この発明によれば容器(4)の内壁に段
差(7)を形成したので、封止物質A(5)の壁面の這
い上がりが制限され、封止物質B(6)の厚さが均一に
なり、耐衝撃性、耐環境性に優れたものが得られる効果
がある。
【図面の簡単な説明】
第1図は従来の混成集積回路の一例を示す断面図、第2
図は従来の混成集積回路の欠点を示す断面図、第3図は
この発明の一実施例による混成集積回路を示す断面図、
第4図、第5図、第6図は各々この発明の他の実施例を
示す断面図である。 図において、C11は基板、(2)は電気部品、(:3
目よ端子、(41は容器、(5)は封止物質A、161
は封止物質B、(7)は段差である。 なお、図中同一符号は同一、又は相当部分を示す。 代理人大岩増雄 第1図 第21ffi 第:3図 第41ス 身 第5図 第6図 手 i、l、、禎1 正 :1:′自 yy、’1、・
ICf’lの表示 tI贋ri、昭58−218212
号2.3と明の名称 混成隼稍回路 :3 、1Tli、’+1:、’:t −J−’、、l
 と5、補正の対象 (1)ざ己すjc′)訂細な説明の「、コロ、補正の内
容 (1)明細7寸をつぎのとおり訂正する。

Claims (1)

    【特許請求の範囲】
  1. 電気部品を実装した基板と、内面に段差を持った容器と
    を備え、複数の封止物質を注入して封止したことを特徴
    とする混成集積回路。
JP21821283A 1983-11-18 1983-11-18 混成集積回路 Pending JPS60110144A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP21821283A JPS60110144A (ja) 1983-11-18 1983-11-18 混成集積回路

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP21821283A JPS60110144A (ja) 1983-11-18 1983-11-18 混成集積回路

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Publication Number Publication Date
JPS60110144A true JPS60110144A (ja) 1985-06-15

Family

ID=16716374

Family Applications (1)

Application Number Title Priority Date Filing Date
JP21821283A Pending JPS60110144A (ja) 1983-11-18 1983-11-18 混成集積回路

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JP (1) JPS60110144A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2018206825A (ja) * 2017-05-31 2018-12-27 新電元工業株式会社 電子モジュール

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2018206825A (ja) * 2017-05-31 2018-12-27 新電元工業株式会社 電子モジュール

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