JPS60105373A - 画像変倍装置 - Google Patents
画像変倍装置Info
- Publication number
- JPS60105373A JPS60105373A JP21295883A JP21295883A JPS60105373A JP S60105373 A JPS60105373 A JP S60105373A JP 21295883 A JP21295883 A JP 21295883A JP 21295883 A JP21295883 A JP 21295883A JP S60105373 A JPS60105373 A JP S60105373A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
良皇次１
本発明は、ドツトで画像を形成する記録装置における画
像変倍装置に関する。
像変倍装置に関する。
良末韮遺
ビデオ機器等における通常増動画素数は通常４８ＱＸ６
４０程度である。一方、／＼−トコピー装置においては
、ドツト密度が２４０ドツト／イン手と高いため、ビデ
オ機器等の画像を得る場合、画素を１対１に対応させた
のではハードコピーの画像は小さなものとなってしまう
不都合があつた。
４０程度である。一方、／＼−トコピー装置においては
、ドツト密度が２４０ドツト／イン手と高いため、ビデ
オ機器等の画像を得る場合、画素を１対１に対応させた
のではハードコピーの画像は小さなものとなってしまう
不都合があつた。
且−一一旬
本発明は、斯かる事情に鑑みてなされたもので、中間調
のレベル数をそこなうことなく、筒中な構成で変倍を可
能にする画像変倍装置を提供することを目的とする。
のレベル数をそこなうことなく、筒中な構成で変倍を可
能にする画像変倍装置を提供することを目的とする。
１−−１
本発明の構成について、以下、実施例に広づいて説明す
る。
る。
第１図は、ビデオ機器の画像を記録する場合の全体構成
図で、ビデオ機器１の出力は、例えばＮＴＳＣ信号とし
てデコーダ２に送られる。デコーダ２では、ＮＴＳＣ信
号からＲ（レット）、Ｇ（グリーン）、Ｂ（ブルー）信
号にデコートされて色変換され、Ｄ／Ａ変換器及びフレ
ームメモリ３ではデジタルコード化され、ｌフレーム分
の画像が貯蔵される。そしてフレームメモリの内容は処
理回路４に送られ、指定された倍率に応じて処理が行わ
れ、記録装＃５で記録が行われる。本実施例では、イン
クジェット方式の記録装置が用いられている。
図で、ビデオ機器１の出力は、例えばＮＴＳＣ信号とし
てデコーダ２に送られる。デコーダ２では、ＮＴＳＣ信
号からＲ（レット）、Ｇ（グリーン）、Ｂ（ブルー）信
号にデコートされて色変換され、Ｄ／Ａ変換器及びフレ
ームメモリ３ではデジタルコード化され、ｌフレーム分
の画像が貯蔵される。そしてフレームメモリの内容は処
理回路４に送られ、指定された倍率に応じて処理が行わ
れ、記録装＃５で記録が行われる。本実施例では、イン
クジェット方式の記録装置が用いられている。
第２１４は、第１［Δの処理回路４のブロック図であり
、６ヒツトで６４階調の中間調表現が可能となっている
。なお、以下では説明の都合ヒ１チャンネルについて述
べるが、これをＹ、Ｍ、Ｃの３チャンネル或いは更にＢ
ＬＫの４チャンネル分持つことによりカラー表現が可能
となる。
、６ヒツトで６４階調の中間調表現が可能となっている
。なお、以下では説明の都合ヒ１チャンネルについて述
べるが、これをＹ、Ｍ、Ｃの３チャンネル或いは更にＢ
ＬＫの４チャンネル分持つことによりカラー表現が可能
となる。
第２図においてＴＸＣＬＫに同期して転送されてくる入
力コードは下位４ビツトと上位２ビツトにわけられ、−
４二位２ビットはセレクタ１０に、下位４ビツトはコン
パレータ１１に加えられる。１２はコート発生器、１３
はメモリー、１４はコントローラ、１５．１６はカウン
タ、１７はディザマトリックスが格納されているテーブ
ル、１８はクロック発生器、１９は１７２分周器、２０
はセレクタである。
力コードは下位４ビツトと上位２ビツトにわけられ、−
４二位２ビットはセレクタ１０に、下位４ビツトはコン
パレータ１１に加えられる。１２はコート発生器、１３
はメモリー、１４はコントローラ、１５．１６はカウン
タ、１７はディザマトリックスが格納されているテーブ
ル、１８はクロック発生器、１９は１７２分周器、２０
はセレクタである。
以下では人力画素を１対ｌで対応させる場合と２倍とす
る場合の例について述べる。
る場合の例について述べる。
今、コントローラ１４においてｌ対ｌの対応が指定され
ているとすると、コントローラからセレクタｌＯに信号
が送られ、コンパレータ１１に６ビツトのコードが送ら
れる。またコントローラ１４の信号によりテーブル１７
の８×８デイザマトリクヌ（ＤＭ）が選択される。テー
ブルの内容は第３図に示されている。そして、まず入力
コートが、テーブル。８Ｘ８ＤＭの°゛０゛と比較され
、入力コードがＯより大きければコンパレータ１１（７
）出力が°゛有′°を示し、小さければ°“無″を示す
。
ているとすると、コントローラからセレクタｌＯに信号
が送られ、コンパレータ１１に６ビツトのコードが送ら
れる。またコントローラ１４の信号によりテーブル１７
の８×８デイザマトリクヌ（ＤＭ）が選択される。テー
ブルの内容は第３図に示されている。そして、まず入力
コートが、テーブル。８Ｘ８ＤＭの°゛０゛と比較され
、入力コードがＯより大きければコンパレータ１１（７
）出力が°゛有′°を示し、小さければ°“無″を示す
。
次の入力コードが“” ４８ ”と比較されるようにカ
ウンタ１６がカウンタアップされ、順次”５５′′迄比
較されるとカウンタ１６が零に戻り、第１行の２値化が
行われる。第１行の２値化が終了すると、コントローラ
１４からの信号によりカウンタ１５がカウントアツプさ
れ、８Ｘ８ＤＭの第２行目の内容と人力コード゛が比較
され、同様にして第３、第４．・・・第８行と比較され
、カウンタ１５が零に戻ると、再び第１行から比較を開
始する。この２値化出力は、メモリ回路１３に格納され
、印写信号となる。このようにして、入力画素をｌ：１
に対応させた２値化が可能となり、更に８Ｘ８のマトリ
ックスサイズによっているので、６４の濃度レベルの表
現が可能となる。
ウンタ１６がカウンタアップされ、順次”５５′′迄比
較されるとカウンタ１６が零に戻り、第１行の２値化が
行われる。第１行の２値化が終了すると、コントローラ
１４からの信号によりカウンタ１５がカウントアツプさ
れ、８Ｘ８ＤＭの第２行目の内容と人力コード゛が比較
され、同様にして第３、第４．・・・第８行と比較され
、カウンタ１５が零に戻ると、再び第１行から比較を開
始する。この２値化出力は、メモリ回路１３に格納され
、印写信号となる。このようにして、入力画素をｌ：１
に対応させた２値化が可能となり、更に８Ｘ８のマトリ
ックスサイズによっているので、６４の濃度レベルの表
現が可能となる。
次に２倍の指定がされていると、上位２ビツトの人力コ
ードＤ４．Ｄ５はコード発生器１２に導かれ コードに
従って第４図のコードを発生する。この発生コードと２
×２マトリツクスの対応を第５図に示す。一方、下位４
ビツトはコンパレータ１１に導かれ、テーブル１７の４
Ｘ４ＤＭ（４×４マトリツクスが２×２に配列されてい
る）と比較されることとなる。この比較ｌ±、１：１の
場合と同様に行われる。そ１７て、成る１画素の比較の
結果コンパレータ１１の出力が有を示しており、かつ」
二位ピッ）Ｄ４．Ｄ５の値が“°０パであれば１Ｘ２分
周器からのゲート信号により発生コート“’ ｏ ｏ
ｏ ｔ ”が、即ち第５図に示すように２ドツトライン
分計４ドツトが入力信号の１画素に対応してメモリに書
き込まれる。この時のメモリ１３に格納される内容は第
５図（ａ）に示すものとなる。またＤ４．Ｄ５の値が３
゛であれば第５図（ｄ）がメモリの内容となる０以上の
操作により、入力の１画素分が２×２のマトリックスに
拡大されて２値化されることとなる。そして、２×２の
マトリックスで４レベルの濃度をもち、かつディザマト
リックスサイズは４Ｘ４（１６の濃度レベル）であるの
で、６４の濃度レベルの表現が可能となり、濃度レベル
は８×８マトリツクスサイズの場合と同じで、１画素が
拡大されることとなる。こうしてメモリ回路】３に格納
されたドツト情報が、記録装置に転送され印写される。
ードＤ４．Ｄ５はコード発生器１２に導かれ コードに
従って第４図のコードを発生する。この発生コードと２
×２マトリツクスの対応を第５図に示す。一方、下位４
ビツトはコンパレータ１１に導かれ、テーブル１７の４
Ｘ４ＤＭ（４×４マトリツクスが２×２に配列されてい
る）と比較されることとなる。この比較ｌ±、１：１の
場合と同様に行われる。そ１７て、成る１画素の比較の
結果コンパレータ１１の出力が有を示しており、かつ」
二位ピッ）Ｄ４．Ｄ５の値が“°０パであれば１Ｘ２分
周器からのゲート信号により発生コート“’ ｏ ｏ
ｏ ｔ ”が、即ち第５図に示すように２ドツトライン
分計４ドツトが入力信号の１画素に対応してメモリに書
き込まれる。この時のメモリ１３に格納される内容は第
５図（ａ）に示すものとなる。またＤ４．Ｄ５の値が３
゛であれば第５図（ｄ）がメモリの内容となる０以上の
操作により、入力の１画素分が２×２のマトリックスに
拡大されて２値化されることとなる。そして、２×２の
マトリックスで４レベルの濃度をもち、かつディザマト
リックスサイズは４Ｘ４（１６の濃度レベル）であるの
で、６４の濃度レベルの表現が可能となり、濃度レベル
は８×８マトリツクスサイズの場合と同じで、１画素が
拡大されることとなる。こうしてメモリ回路】３に格納
されたドツト情報が、記録装置に転送され印写される。
なおメモリ１３は、偶数ラインと奇数ラインで別々の制
御が可能となっており、２倍の場合には偶数、奇数同時
に書込みが行われ、１：ｌの時は奇数→偶数の順で制御
される。
御が可能となっており、２倍の場合には偶数、奇数同時
に書込みが行われ、１：ｌの時は奇数→偶数の順で制御
される。
丸−−ｊ
以上のように本発明によれば、基本となる画素をハード
コピーのｍＸｎドツトマトリックスに対応させ、ドツト
の有無でマトリックスに濃度レベルを持たせ、ディザマ
トリックスサイズを変えることにより、中間調表現の単
位マトリックスサイズを変えることなく、簡単な構成で
画像の変倍が６丁能となる。
コピーのｍＸｎドツトマトリックスに対応させ、ドツト
の有無でマトリックスに濃度レベルを持たせ、ディザマ
トリックスサイズを変えることにより、中間調表現の単
位マトリックスサイズを変えることなく、簡単な構成で
画像の変倍が６丁能となる。
第１図はビデオ機器の画像を記録装置に記録する場合の
構成を示すブロック図、第２図は、本発明による変倍装
置の回路構成図、第３図はディザマトリックスを示す図
、第４図は発生コードを示す図、第５図は発生コードと
マトリックスの対応を示す図である。 １・・・ビデオ機器、２・・・デコーダ、３・・・Ｄ／
Ａ変換器及びフレームメモリ、４・・・処理回路、５・
・・記録装置、ｌＯ・・・セレクタ、１１・・・コンパ
レータ、１２・・・コード発生器、１３・・・メモリ回
路、１４・・・コントローラ、１５．１６・・・カウン
タ、１７・・・テーブル、１８・・・クロック発生器、
１９・・・１７２分周器。 第３図 第５図 （金主コード） ｃドウ１月１万叉） 第４図 （メモリ＾内壕ｔ）
構成を示すブロック図、第２図は、本発明による変倍装
置の回路構成図、第３図はディザマトリックスを示す図
、第４図は発生コードを示す図、第５図は発生コードと
マトリックスの対応を示す図である。 １・・・ビデオ機器、２・・・デコーダ、３・・・Ｄ／
Ａ変換器及びフレームメモリ、４・・・処理回路、５・
・・記録装置、ｌＯ・・・セレクタ、１１・・・コンパ
レータ、１２・・・コード発生器、１３・・・メモリ回
路、１４・・・コントローラ、１５．１６・・・カウン
タ、１７・・・テーブル、１８・・・クロック発生器、
１９・・・１７２分周器。 第３図 第５図 （金主コード） ｃドウ１月１万叉） 第４図 （メモリ＾内壕ｔ）
Claims (1)
- 人力画素をｍＸｎ（ｍ、ｎ：整数）ドツトマトリックス
に対応させると共にマトリックスサイズを変更する手段
と、前記マトリックスサイズ番と応じてディザマトリッ
クスのサイズを変更する手段とを備えた画像変倍装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP21295883A JPS60105373A (ja) | 1983-11-11 | 1983-11-11 | 画像変倍装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP21295883A JPS60105373A (ja) | 1983-11-11 | 1983-11-11 | 画像変倍装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS60105373A true JPS60105373A (ja) | 1985-06-10 |
Family
ID=16631105
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP21295883A Pending JPS60105373A (ja) | 1983-11-11 | 1983-11-11 | 画像変倍装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60105373A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7041224B2 (en) | 1999-10-26 | 2006-05-09 | Reflectivity, Inc. | Method for vapor phase etching of silicon |
-
1983
- 1983-11-11 JP JP21295883A patent/JPS60105373A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7041224B2 (en) | 1999-10-26 | 2006-05-09 | Reflectivity, Inc. | Method for vapor phase etching of silicon |
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