JPS5979576A - 電界効果型半導体装置 - Google Patents
電界効果型半導体装置Info
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- JPS5979576A JPS5979576A JP19040782A JP19040782A JPS5979576A JP S5979576 A JPS5979576 A JP S5979576A JP 19040782 A JP19040782 A JP 19040782A JP 19040782 A JP19040782 A JP 19040782A JP S5979576 A JPS5979576 A JP S5979576A
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Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/66—Types of semiconductor device ; Multistep manufacturing processes therefor
- H01L29/68—Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
- H01L29/76—Unipolar devices, e.g. field effect transistors
- H01L29/772—Field effect transistors
- H01L29/80—Field effect transistors with field effect produced by a PN or other rectifying junction gate, i.e. potential-jump barrier
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(al 発明の技誓分野
不発明は電界効果型半導体装置、特にケート長を帰線し
、電極及び導電路の抵抗が低減されて優れた高周波特性
をイアする化合物半導体電界効果トランジスタに関する
。
、電極及び導電路の抵抗が低減されて優れた高周波特性
をイアする化合物半導体電界効果トランジスタに関する
。
(1〕)技術の背景
高周波特性のすぐれた半導体装置を実現するために必要
な要件として、イ1導箱、媒体の移動距離が知いこと、
すなわち、半導体≠附の幾何学的寸法が小さいことと(
ロ)導電媒体の移動速度が大きいことが第1にあけられ
ることは周知であり、この要件を充足するために微細な
パターンの実現、高い電子またはホール移動度の実現に
対する努力がなされており、高い1L子移動度を実現す
る手段として、砒化カリウム((1aA s )、アル
ミニウムガリウム砒素(A I Ga As ) 、燐
化インゾウム(Inp)等の化合物半導体が材料として
使用されており、さらに、材料固有の電子移動度より大
きな電子移動度を実現するために高電子移動度トランジ
スタが開発されている。
な要件として、イ1導箱、媒体の移動距離が知いこと、
すなわち、半導体≠附の幾何学的寸法が小さいことと(
ロ)導電媒体の移動速度が大きいことが第1にあけられ
ることは周知であり、この要件を充足するために微細な
パターンの実現、高い電子またはホール移動度の実現に
対する努力がなされており、高い1L子移動度を実現す
る手段として、砒化カリウム((1aA s )、アル
ミニウムガリウム砒素(A I Ga As ) 、燐
化インゾウム(Inp)等の化合物半導体が材料として
使用されており、さらに、材料固有の電子移動度より大
きな電子移動度を実現するために高電子移動度トランジ
スタが開発されている。
また、すべての電気回路の時定数は勿論、遮断周波数等
の高周波特性は導電路の抵抗に依存するから、半導体H
Wにおいても導電路の抵抗は小さいことが望ましい。こ
の点からは、導電路となる領域の不純物濃度は高いこと
が望ましい。しかし、−万、不純物濃度の増大は空乏層
の伸展を阻害するから、ゲート下部領域においては、不
純物濃度の選択に制限がある。したがって、トランジス
タのしきい値電圧等の特性に影響を与えることなく導電
路の抵抗を減少するには、ゲート下部領域以外の領域(
・こおいて不純物濃度を増加することが有効である。
の高周波特性は導電路の抵抗に依存するから、半導体H
Wにおいても導電路の抵抗は小さいことが望ましい。こ
の点からは、導電路となる領域の不純物濃度は高いこと
が望ましい。しかし、−万、不純物濃度の増大は空乏層
の伸展を阻害するから、ゲート下部領域においては、不
純物濃度の選択に制限がある。したがって、トランジス
タのしきい値電圧等の特性に影響を与えることなく導電
路の抵抗を減少するには、ゲート下部領域以外の領域(
・こおいて不純物濃度を増加することが有効である。
特に、高周波特性のすぐれた半導体装置を作りつる材料
である化合物半導体は一般に光面準位密度が高いので、
ゲート領域以外の導電路領域において表面の空乏層が発
生しやすく、心電路の断面積を減少させる結果となり抵
抗増加の原因となるから、ゲート下部領域以外の領域に
おいては不純物濃度を論くしておくことが望ましい。
である化合物半導体は一般に光面準位密度が高いので、
ゲート領域以外の導電路領域において表面の空乏層が発
生しやすく、心電路の断面積を減少させる結果となり抵
抗増加の原因となるから、ゲート下部領域以外の領域に
おいては不純物濃度を論くしておくことが望ましい。
(cl 従来技術と問題点
このような理由によって、従来高周波用、高速度スイッ
チング用電界効果トランジスタ等の半導体veIijc
にあっては、電極とのオーミyり接触を良好にし、かつ
導電路とする半導体領域の抵抗率を減少させるために、
ソース・ドレイン領域部に高濃度の不純物を選択的に導
入している。
チング用電界効果トランジスタ等の半導体veIijc
にあっては、電極とのオーミyり接触を良好にし、かつ
導電路とする半導体領域の抵抗率を減少させるために、
ソース・ドレイン領域部に高濃度の不純物を選択的に導
入している。
特にこの不純物導入領域をゲート電極に対しで整合させ
るために、半導体基体の動作層上に配設されたゲート電
極をマスクの一部として不純物を高濃度にイオン注入し
熱処理を施して注入されたイオンを活性化することによ
って、高不純物濃度領域を形成して、ここにオーミック
接触するソース°ドレイン電極を設ける構造がとられて
いる。
るために、半導体基体の動作層上に配設されたゲート電
極をマスクの一部として不純物を高濃度にイオン注入し
熱処理を施して注入されたイオンを活性化することによ
って、高不純物濃度領域を形成して、ここにオーミック
接触するソース°ドレイン電極を設ける構造がとられて
いる。
化合物半導体装置に関して前記構造を適用する一例とし
ては、例えば本件出願人が先に特願昭55−18954
4号によって提供した半導体装置及びその製造方法があ
る。
ては、例えば本件出願人が先に特願昭55−18954
4号によって提供した半導体装置及びその製造方法があ
る。
しかしながら、ゲート電極をマスクとしてイオン注入法
によって不純物を導入するセルフアライメント法では、
半導体装置の高速度化のためにゲート長が短縮され特に
1〔μm〕程度或いはそれ以下とされる場合には、ゲー
トしきい値電圧が大きく変化してその制御が困難になる
という問題が明らかとなって来ている。このゲートしき
い値電圧の変化は、イオン注入法によって導入される不
純物がゲート電極に被覆された動作層とする半導体領域
内に拡散してこの領域の不純物濃度が変化することによ
って生じ、この不純物拡散の要因としては、イオン注入
の際の基板結晶格子との衝突による不純物の散乱及び注
入イオンの活性化のための熱処理の際の不純物の横方向
への熱拡散があるが、この二要因は何れも構造、材料及
び製造方法等の選択によって軽減される可能性をもつも
のの、本質的に阻止するこ、とは不可能である。
によって不純物を導入するセルフアライメント法では、
半導体装置の高速度化のためにゲート長が短縮され特に
1〔μm〕程度或いはそれ以下とされる場合には、ゲー
トしきい値電圧が大きく変化してその制御が困難になる
という問題が明らかとなって来ている。このゲートしき
い値電圧の変化は、イオン注入法によって導入される不
純物がゲート電極に被覆された動作層とする半導体領域
内に拡散してこの領域の不純物濃度が変化することによ
って生じ、この不純物拡散の要因としては、イオン注入
の際の基板結晶格子との衝突による不純物の散乱及び注
入イオンの活性化のための熱処理の際の不純物の横方向
への熱拡散があるが、この二要因は何れも構造、材料及
び製造方法等の選択によって軽減される可能性をもつも
のの、本質的に阻止するこ、とは不可能である。
以上述べたセルファライン法における問題点を解決する
手段の一つとして、本件出願人等が先に特願昭57−0
30005号によって提供した製造して動作層を形成し
、該動作層上の一部領域にゲート電極を形成し、該ゲー
ト電極をマスクとして前記動作層をソース・トレイン形
成領域から除去し、該除去された領域にn型不純物を含
有する半導体埋め込み層を成長させ、該埋め込み層上に
ソース電極とドレイン電極とを形成する製造方法を提供
するものであり、更に高電子移動度トランジスタについ
ても前記方法と同様な製造方法を提供している。
手段の一つとして、本件出願人等が先に特願昭57−0
30005号によって提供した製造して動作層を形成し
、該動作層上の一部領域にゲート電極を形成し、該ゲー
ト電極をマスクとして前記動作層をソース・トレイン形
成領域から除去し、該除去された領域にn型不純物を含
有する半導体埋め込み層を成長させ、該埋め込み層上に
ソース電極とドレイン電極とを形成する製造方法を提供
するものであり、更に高電子移動度トランジスタについ
ても前記方法と同様な製造方法を提供している。
前記先願発明はゲート電極下の動作層領域の寸法や不純
物濃度の卯には影響を与えることなく、ソース・ドレイ
ン領域においてのみ不純物濃度を増加してこの領域にお
ける抵抗率を減少させることが可能であるが、その製造
方法はやや複雑であり、才たデー1−−ソース・1・゛
レイン間耐電圧の確保などが困難である。
物濃度の卯には影響を与えることなく、ソース・ドレイ
ン領域においてのみ不純物濃度を増加してこの領域にお
ける抵抗率を減少させることが可能であるが、その製造
方法はやや複雑であり、才たデー1−−ソース・1・゛
レイン間耐電圧の確保などが困難である。
[dl 発明の目的
本発明はゲート電極下の動作層領域の寸法や不純物濃度
分布には影響を与えることなく、ソース・ドし・イン電
極のオーミック鼠触抵抗と心電路とすく〕半導付領域の
抵抗とを減少させて、高周波。
分布には影響を与えることなく、ソース・ドし・イン電
極のオーミック鼠触抵抗と心電路とすく〕半導付領域の
抵抗とを減少させて、高周波。
高速度スイッチング特性の良好な′龜異物果型牛導体装
置、特に化合物半導体電界効果トランジスタを提供する
ことを目的とする。
置、特に化合物半導体電界効果トランジスタを提供する
ことを目的とする。
(el 発明の構成
本発明の前記目的は、半導体基体、該半導体基体に選択
的に形成された動作層、該動作層上に配設されたケート
電極、該動作層上に、ゲート・?[極を挾んで対向配置
された一対の4電性千尋体領域、と 該半導体領域に抵抗接触する電極$を俯えてなる電界効
果型半導体装置により達成される。
的に形成された動作層、該動作層上に配設されたケート
電極、該動作層上に、ゲート・?[極を挾んで対向配置
された一対の4電性千尋体領域、と 該半導体領域に抵抗接触する電極$を俯えてなる電界効
果型半導体装置により達成される。
げ) 発明の実施例
以下本発明を実施例により図面を参照して具体的に説明
する。
する。
第1図乃至N4図はGaAsショットキバリア電界効果
トランジスタに係る本発明の第1の実施例の主要製造工
程を示す断面図であり、製造方法を例示しつつ不実施例
の構造を説明する。
トランジスタに係る本発明の第1の実施例の主要製造工
程を示す断面図であり、製造方法を例示しつつ不実施例
の構造を説明する。
第1図参照
半絶縁性Ga As基板1の半導体装置形成領域のに選
択的にイオン注入し、次いで例えば温度850[:’C
)、時間15分間程度の活性化熱処理を行なうことによ
って、厚さ01〔μm〕程度に不純物濃度1×1017
〔cm−3〕程度のn型動作層2を形成する。
択的にイオン注入し、次いで例えば温度850[:’C
)、時間15分間程度の活性化熱処理を行なうことによ
って、厚さ01〔μm〕程度に不純物濃度1×1017
〔cm−3〕程度のn型動作層2を形成する。
次いで後に説明する選択エピタキシャル成長温度におい
てもゲートの%性を失なわない材料によってゲート電極
3を動作N2上に設けるo*恵施例においては、タンツ
ステンシリサイド(W5Sis)(スパッタ法によって
例えば厚さ0.4(μm〕程度にQa As基板1面上
に被着し、フォトリソグラフィ法とエツチング法とによ
って、例えばケート幅30〔μm〕、ゲート長2〔μm
〕程度にゲートを極3を形成する。
てもゲートの%性を失なわない材料によってゲート電極
3を動作N2上に設けるo*恵施例においては、タンツ
ステンシリサイド(W5Sis)(スパッタ法によって
例えば厚さ0.4(μm〕程度にQa As基板1面上
に被着し、フォトリソグラフィ法とエツチング法とによ
って、例えばケート幅30〔μm〕、ゲート長2〔μm
〕程度にゲートを極3を形成する。
第2図参照
Ga As基板1面上のゲート電極3以外の領域に選択
的にn型高不純物濃度半導体層4をエピタキシャル成長
させる。不実施例においては有機金属熱分解気相成長方
法(以下MOCVD法と略称すAs る)によって、ハイドライドアイレシン(lJ71−f
3)とトリメチルガリウム(’(CH3)s Ga)
kひに硫化水素(i−128)を窒素(N2)ガスと共
に反応管に送り、温度約600〔0C〕においてn十型
Qa A @層4をゲート電極3と同等の厚さ約04〔
μm〕に成長させる。
的にn型高不純物濃度半導体層4をエピタキシャル成長
させる。不実施例においては有機金属熱分解気相成長方
法(以下MOCVD法と略称すAs る)によって、ハイドライドアイレシン(lJ71−f
3)とトリメチルガリウム(’(CH3)s Ga)
kひに硫化水素(i−128)を窒素(N2)ガスと共
に反応管に送り、温度約600〔0C〕においてn十型
Qa A @層4をゲート電極3と同等の厚さ約04〔
μm〕に成長させる。
このn+型QaAs層4の不純物濃度は2×1018〔
α−3〕程度であって、従来ソース・ドレイン領域の形
成で一般に行なわれているイオン注入法による場合には
不純物濃度分布は深さ方向に正規分布をなし、その最大
@度の位置においてもlX1018で[3〕程度を超え
ることができないのに対して、不実施例のn十型Qa
As層4は不純物濃度が高く抵抗率が減少している。ま
たエピタキシャル成長層は任意に厚くすることが可能で
あって、本実施例においても従来のソース・ドレイン領
域の有効深さより厚く成長させておりこの点からも抵抗
値が減少する。
α−3〕程度であって、従来ソース・ドレイン領域の形
成で一般に行なわれているイオン注入法による場合には
不純物濃度分布は深さ方向に正規分布をなし、その最大
@度の位置においてもlX1018で[3〕程度を超え
ることができないのに対して、不実施例のn十型Qa
As層4は不純物濃度が高く抵抗率が減少している。ま
たエピタキシャル成長層は任意に厚くすることが可能で
あって、本実施例においても従来のソース・ドレイン領
域の有効深さより厚く成長させておりこの点からも抵抗
値が減少する。
第3図参照
ゲート逆方向耐電圧を確保するために、ゲート電極3を
例えはフレオン(CF4)と酸素(02)との混合ガス
を用いてプラズマエツチンクする。
例えはフレオン(CF4)と酸素(02)との混合ガス
を用いてプラズマエツチンクする。
このゲー)II極エッチンク処理によって、処理前にお
いては例えば02乃至1〔V〕程度で不安定であったゲ
ート逆方向耐電圧を1o(V”3程度以上に安定させる
ことができる。
いては例えば02乃至1〔V〕程度で不安定であったゲ
ート逆方向耐電圧を1o(V”3程度以上に安定させる
ことができる。
次いでn4−型GaAs層4の動作層2以外の部分を選
択的に除去する。不実施例においては二酸化シリコン(
Si02)をマスクとして弗酸(HF)と水(HzO)
と過倍化水素(H20z)の混@桔多エツチャン1−と
する化学エツチング法によって行なう。
択的に除去する。不実施例においては二酸化シリコン(
Si02)をマスクとして弗酸(HF)と水(HzO)
と過倍化水素(H20z)の混@桔多エツチャン1−と
する化学エツチング法によって行なう。
第4図参照
n+型GaAs層4にオーミック接触するソース電極5
及びドレイン[極6を設けるっ不実施例においては、従
来技術によって、金ゲルマニウム/金(Au Ge /
へU)を用いてこれらの電極を形成している。この様に
して本実施賃(1のGaAsショットキバリア電界効果
異物ンンスタ累子が素子する。
及びドレイン[極6を設けるっ不実施例においては、従
来技術によって、金ゲルマニウム/金(Au Ge /
へU)を用いてこれらの電極を形成している。この様に
して本実施賃(1のGaAsショットキバリア電界効果
異物ンンスタ累子が素子する。
なお第2の実施例として第5図に示す如く、先の第1の
実施例において行なわれたn十型GaAs層4の選択的
除去に代えて、素子分離領域77i−例えば酸素(0)
イオン或いはクロム(Cr)イオン等のイオン注入によ
るn型GaAs層4の高抵抗化によって形成する構造は
、集積回路化に適している。
実施例において行なわれたn十型GaAs層4の選択的
除去に代えて、素子分離領域77i−例えば酸素(0)
イオン或いはクロム(Cr)イオン等のイオン注入によ
るn型GaAs層4の高抵抗化によって形成する構造は
、集積回路化に適している。
以上説明した実施例においては、ゲート電極3の厚さを
従来と同様に0.4〔μm〕程度としているが、本発明
においては従来のイオン注入のマスクとする場合とは異
なり、その厚さ及び形状には製造工程上の制約はない。
従来と同様に0.4〔μm〕程度としているが、本発明
においては従来のイオン注入のマスクとする場合とは異
なり、その厚さ及び形状には製造工程上の制約はない。
また本発明の高不純物濃疫学導体層のエピタキシャル成
長には本実施例の如きMOCVI)法或いは分子庫エピ
タキシャル厄長方法等適宜の方法を適用することが可能
であるが、従来技術によるイオン注入後の活性化温度が
例えば800[0C:]程度であるのに対して、エピタ
キシャル成長温度が例えば600[:’C)程度と一般
に低くすることが可能であるために、前記実施例の如く
高融点金属珪化物を用いることは必ずしも必要ではなく
、ゲート電極材料及び積層構造等を従来より幅広く選択
することが可能となる。
長には本実施例の如きMOCVI)法或いは分子庫エピ
タキシャル厄長方法等適宜の方法を適用することが可能
であるが、従来技術によるイオン注入後の活性化温度が
例えば800[0C:]程度であるのに対して、エピタ
キシャル成長温度が例えば600[:’C)程度と一般
に低くすることが可能であるために、前記実施例の如く
高融点金属珪化物を用いることは必ずしも必要ではなく
、ゲート電極材料及び積層構造等を従来より幅広く選択
することが可能となる。
以上説明した如く不発明の半導体装置は、イオン注入及
び熱処理による注入イオンの活性化を行なわないために
ゲート電極下の動作層領域への注入イオンの歓乱がなく
、横方向への熱拡散も少ない。従ってゲートしきい値電
圧はゲート長が短縮オーミνり接触電極が設けられるた
めに良好なオーミック接触が得られ導電路も低抵抗であ
って、ソース抵抗・ドレイン抵抗が減少する。
び熱処理による注入イオンの活性化を行なわないために
ゲート電極下の動作層領域への注入イオンの歓乱がなく
、横方向への熱拡散も少ない。従ってゲートしきい値電
圧はゲート長が短縮オーミνり接触電極が設けられるた
めに良好なオーミック接触が得られ導電路も低抵抗であ
って、ソース抵抗・ドレイン抵抗が減少する。
またゲート電極の材料、構造の選択範囲が拡大されるこ
とによって、ゲート電極の抵抗率の減少が可能となり或
いはパターン形成が容易となる。
とによって、ゲート電極の抵抗率の減少が可能となり或
いはパターン形成が容易となる。
以上述べた効果によって高周波、高速度スイッチング特
性等を従来より大幅に改善することができる。その−例
として、TO/I)構成りCFL IJソング振器のケ
ート1段当りの遅延時間カタ゛、従来のセルフアライメ
ント形で可能な最短ゲート長15〔μm〕することがで
きる。
性等を従来より大幅に改善することができる。その−例
として、TO/I)構成りCFL IJソング振器のケ
ート1段当りの遅延時間カタ゛、従来のセルフアライメ
ント形で可能な最短ゲート長15〔μm〕することがで
きる。
以上説明した実施例はショットキバリア電界効果トラン
ジスタの例であるが、本発明は半導体基才 トキバリア電界効果トランジスタと同様にターミック接
触及び導電路の抵抗の低減等の効果を得ることが可能で
ある。
ジスタの例であるが、本発明は半導体基才 トキバリア電界効果トランジスタと同様にターミック接
触及び導電路の抵抗の低減等の効果を得ることが可能で
ある。
tgl 発明の詳細
な説明した如く不発明によれば、ゲート長が短縮された
場合にもケートしきい値電圧を安定に保持しつつ、ソー
ス・ドレイン電極のオーミック接触及び導電路の抵抗が
低減され、更にゲート′IIL極の低抵抗化も可能とな
り、高周波特性、高速度フイッチンク特性の優れた半導
体装置、特に化θ物半導体を使用する電界タカ果トラン
ソスクか提供される。
場合にもケートしきい値電圧を安定に保持しつつ、ソー
ス・ドレイン電極のオーミック接触及び導電路の抵抗が
低減され、更にゲート′IIL極の低抵抗化も可能とな
り、高周波特性、高速度フイッチンク特性の優れた半導
体装置、特に化θ物半導体を使用する電界タカ果トラン
ソスクか提供される。
第1図乃至第4図は電界効果トランジスタに係る本発明
の第1の実施例を主要製造工程例において示す断面図、
第51!:<1は第2の実施例の断面図である。 図において、1は半絶縁線性りaAs基板、2はniV
、ij作層、3はゲート電極、4はn十型Ga As層
、5はソース電極、6はドレイン電極、7は素子分離領
域を示す。 才 1 図
の第1の実施例を主要製造工程例において示す断面図、
第51!:<1は第2の実施例の断面図である。 図において、1は半絶縁線性りaAs基板、2はniV
、ij作層、3はゲート電極、4はn十型Ga As層
、5はソース電極、6はドレイン電極、7は素子分離領
域を示す。 才 1 図
Claims (1)
- 半導体基体、該牛褥体E体に選択的に形成されたり(υ
作層、該動作層上に配設されたケート電極、該動作層上
に、ゲート電極を挾んで対向配置された一対のアミI重
性半導体領域、該半碍体領域に抵抗拶触する電極とを佃
え(f、rることそ特徴とする電界効果型半導体装置っ
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP19040782A JPS5979576A (ja) | 1982-10-29 | 1982-10-29 | 電界効果型半導体装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP19040782A JPS5979576A (ja) | 1982-10-29 | 1982-10-29 | 電界効果型半導体装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS5979576A true JPS5979576A (ja) | 1984-05-08 |
JPH0429225B2 JPH0429225B2 (ja) | 1992-05-18 |
Family
ID=16257626
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP19040782A Granted JPS5979576A (ja) | 1982-10-29 | 1982-10-29 | 電界効果型半導体装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5979576A (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS60136264A (ja) * | 1983-12-23 | 1985-07-19 | Nec Corp | 半導体装置の製造方法 |
JPS60247976A (ja) * | 1984-05-23 | 1985-12-07 | Nec Corp | 半導体装置 |
JPS6143482A (ja) * | 1984-08-08 | 1986-03-03 | Oki Electric Ind Co Ltd | 電界効果トランジスタの製造方法 |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5857752A (ja) * | 1981-09-30 | 1983-04-06 | Nec Corp | 半導体装置の製造方法 |
JPS5898982A (ja) * | 1981-12-07 | 1983-06-13 | インタ−ナショナル ビジネス マシ−ンズ コ−ポレ−ション | 砒化ガリウムmesfet素子の製造方法 |
-
1982
- 1982-10-29 JP JP19040782A patent/JPS5979576A/ja active Granted
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5857752A (ja) * | 1981-09-30 | 1983-04-06 | Nec Corp | 半導体装置の製造方法 |
JPS5898982A (ja) * | 1981-12-07 | 1983-06-13 | インタ−ナショナル ビジネス マシ−ンズ コ−ポレ−ション | 砒化ガリウムmesfet素子の製造方法 |
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS60136264A (ja) * | 1983-12-23 | 1985-07-19 | Nec Corp | 半導体装置の製造方法 |
JPH0216008B2 (ja) * | 1983-12-23 | 1990-04-13 | Nippon Electric Co | |
JPS60247976A (ja) * | 1984-05-23 | 1985-12-07 | Nec Corp | 半導体装置 |
JPH0812867B2 (ja) * | 1984-05-23 | 1996-02-07 | 日本電気株式会社 | 半導体装置 |
JPS6143482A (ja) * | 1984-08-08 | 1986-03-03 | Oki Electric Ind Co Ltd | 電界効果トランジスタの製造方法 |
Also Published As
Publication number | Publication date |
---|---|
JPH0429225B2 (ja) | 1992-05-18 |
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