JPS597210A - 信号分割装置 - Google Patents
信号分割装置Info
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- JPS597210A JPS597210A JP11743782A JP11743782A JPS597210A JP S597210 A JPS597210 A JP S597210A JP 11743782 A JP11743782 A JP 11743782A JP 11743782 A JP11743782 A JP 11743782A JP S597210 A JPS597210 A JP S597210A
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- JP
- Japan
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- signal
- difference
- circuit
- outputs
- pulse
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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-
- G—PHYSICS
- G01—MEASURING; TESTING
- G01D—MEASURING NOT SPECIALLY ADAPTED FOR A SPECIFIC VARIABLE; ARRANGEMENTS FOR MEASURING TWO OR MORE VARIABLES NOT COVERED IN A SINGLE OTHER SUBCLASS; TARIFF METERING APPARATUS; MEASURING OR TESTING NOT OTHERWISE PROVIDED FOR
- G01D5/00—Mechanical means for transferring the output of a sensing member; Means for converting the output of a sensing member to another variable where the form or nature of the sensing member does not constrain the means for converting; Transducers not specially adapted for a specific variable
- G01D5/12—Mechanical means for transferring the output of a sensing member; Means for converting the output of a sensing member to another variable where the form or nature of the sensing member does not constrain the means for converting; Transducers not specially adapted for a specific variable using electric or magnetic means
- G01D5/243—Mechanical means for transferring the output of a sensing member; Means for converting the output of a sensing member to another variable where the form or nature of the sensing member does not constrain the means for converting; Transducers not specially adapted for a specific variable using electric or magnetic means influencing the phase or frequency of ac
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- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Transmission And Conversion Of Sensor Element Output (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、光結合、静電結合および電磁結合の検出部を
有した回転数計、羽根車式流量計、測長計および重量計
等である測定計の信号分割装置に関する。
有した回転数計、羽根車式流量計、測長計および重量計
等である測定計の信号分割装置に関する。
従来、光を移動スリットおよび固定スリットを介して検
出する光結合検出部を有した上記測定計において、検出
部で検出された三角波信号、正弦波信号あるいは類似正
弦波信号を多分割する方法は数棟あるが、その第一の方
法としては９・変位相差のある２倍号を検出して検出信
号の一周期を４分割する方法と、他の第二の方法として
はそれぞれ１２０度位相差のある３倍号を検出して検出
信号の一周期を６分割する方法とがある。しかしながら
、上記第一の方法では分割数が４分割しか割と高分割を
得る事は出来るが、３倍号を得る為に光結合を３個使用
するので消費電流が多く、電池を電源に使用する場合に
は非常に不利になるのみならず、小型化にも非常に困難
をきたすという大きな問題を残していた。
出する光結合検出部を有した上記測定計において、検出
部で検出された三角波信号、正弦波信号あるいは類似正
弦波信号を多分割する方法は数棟あるが、その第一の方
法としては９・変位相差のある２倍号を検出して検出信
号の一周期を４分割する方法と、他の第二の方法として
はそれぞれ１２０度位相差のある３倍号を検出して検出
信号の一周期を６分割する方法とがある。しかしながら
、上記第一の方法では分割数が４分割しか割と高分割を
得る事は出来るが、３倍号を得る為に光結合を３個使用
するので消費電流が多く、電池を電源に使用する場合に
は非常に不利になるのみならず、小型化にも非常に困難
をきたすという大きな問題を残していた。
本発明は、上記従来例の欠点に鑑みなされたもので、１
２０度位相差のある２倍号を検出し、この２倍号を醒気
的に合成して合成信号を作り、上記２倍号と合成信号と
で、それぞれ１２０度位相差のある３倍号を作成し、こ
の３倍号をもとに一周期を６分割あるいは１２分割する
ことにより、光結合を２個しか使用しないにもかかわら
ず６分割あるいは１２分割を可能にし、結果的に、消費
電流が４分割と同等にもかかわらず６分割あるいは１２
分割できるのみならず小型化等で特に有益性のある高分
割の信号分割装置の提供を目的としたものである。
２０度位相差のある２倍号を検出し、この２倍号を醒気
的に合成して合成信号を作り、上記２倍号と合成信号と
で、それぞれ１２０度位相差のある３倍号を作成し、こ
の３倍号をもとに一周期を６分割あるいは１２分割する
ことにより、光結合を２個しか使用しないにもかかわら
ず６分割あるいは１２分割を可能にし、結果的に、消費
電流が４分割と同等にもかかわらず６分割あるいは１２
分割できるのみならず小型化等で特に有益性のある高分
割の信号分割装置の提供を目的としたものである。
以下、本発明の好適な一実施例を、測定計を例にとり、
図面にもとづき詳細に説明する。第１図は不発明の一実
施例を示すブロック図であり、第２図は第１図の各部に
おける波形図であり、第３図は本発明の特に分割回路の
他の実施例を示すプ第１図において、信号Ａおよび信号
Ｂは検出部で検出された２倍号であり、信号Ａを基準に
すると信号Ｂは１２０度位相差の進んだ信号である。
図面にもとづき詳細に説明する。第１図は不発明の一実
施例を示すブロック図であり、第２図は第１図の各部に
おける波形図であり、第３図は本発明の特に分割回路の
他の実施例を示すプ第１図において、信号Ａおよび信号
Ｂは検出部で検出された２倍号であり、信号Ａを基準に
すると信号Ｂは１２０度位相差の進んだ信号である。
信号Ａは後述の反転和算回路１に入力すると共に後述の
分割回路９に含まれている波形整形回路２に入力してい
る。同様に、信号Ｂは後述の反転和算回路１に入力する
と共に後述の分割回路９に含まれている波形整形回路３
に入力している。反転和算回路１′は、いわゆる演算増
幅器（ｏｐアンプ）等で構成され、入力された信号Ａと
信号Ｂとをアナログ的に和演算し、その和算信号を反転
（原信号がＳｉｎθなら一〇ｉｎθにすること）して反
転和算信号Ｃを後述の分割回路９に含まれている波形整
形回路４に出力している。分割回路９は波形整形回路２
、波形整形回路３、波形整形回路４、波形整形回路は、
いわゆる電圧比較器（コンパレータ）等で構成され、入
力した信号と内蔵している基準電圧（第２図のＯ）とを
比較し、信号が基準電圧より高い場合はデジタル信号の
１ハイ”を出力し、信号が基準電圧より低い場合はデジ
タル信号の１０つ１を出力する。波形整形回路２は、入
力した信号Ａと基準電所とを比較し、デジタル信号りを
出力している。波形整形回路３は、入力した信号Ｂと基
準電圧とを比較し、デジタル１言号Ｅを出力している。
分割回路９に含まれている波形整形回路２に入力してい
る。同様に、信号Ｂは後述の反転和算回路１に入力する
と共に後述の分割回路９に含まれている波形整形回路３
に入力している。反転和算回路１′は、いわゆる演算増
幅器（ｏｐアンプ）等で構成され、入力された信号Ａと
信号Ｂとをアナログ的に和演算し、その和算信号を反転
（原信号がＳｉｎθなら一〇ｉｎθにすること）して反
転和算信号Ｃを後述の分割回路９に含まれている波形整
形回路４に出力している。分割回路９は波形整形回路２
、波形整形回路３、波形整形回路４、波形整形回路は、
いわゆる電圧比較器（コンパレータ）等で構成され、入
力した信号と内蔵している基準電圧（第２図のＯ）とを
比較し、信号が基準電圧より高い場合はデジタル信号の
１ハイ”を出力し、信号が基準電圧より低い場合はデジ
タル信号の１０つ１を出力する。波形整形回路２は、入
力した信号Ａと基準電所とを比較し、デジタル信号りを
出力している。波形整形回路３は、入力した信号Ｂと基
準電圧とを比較し、デジタル１言号Ｅを出力している。
波形整形回路４は、入力した信号Ｃと基準電圧とを比較
し、デジタル信号Ｆを出力している。パルス整形回路５
は、デジタル信ｑ Ｄを入力し、デジタル信号りの立上
りと立下りの時点において、パルス幅の狭いパルス信号
Ｇを出力する。同様に、パルス整形回路６は、デジタル
１ｄ号Ｅを入力し、パルス信号Ｈを出力する。又パルス
整形回路７は、デジタル信号Ｆを入力し、パルス信号工
を出力する。論理和回路８は、パルス信号Ｇ、パルス信
号Ｈおよびパルス信号工を入力し、パルス信号ｋを出力
する。
し、デジタル信号Ｆを出力している。パルス整形回路５
は、デジタル信ｑ Ｄを入力し、デジタル信号りの立上
りと立下りの時点において、パルス幅の狭いパルス信号
Ｇを出力する。同様に、パルス整形回路６は、デジタル
１ｄ号Ｅを入力し、パルス信号Ｈを出力する。又パルス
整形回路７は、デジタル信号Ｆを入力し、パルス信号工
を出力する。論理和回路８は、パルス信号Ｇ、パルス信
号Ｈおよびパルス信号工を入力し、パルス信号ｋを出力
する。
）第２図において 実線Ａふよひ実線Ｂはそれぞ第１図
の信号Ａおよび信号Ｂであり、信号Ａをイ＆ 基準にすると信号Ｂは１２０度位相差の進んだ番号であ
る。破ＳＣは第１図の反転和算回路１で信号Ａと信号Ｂ
とを和演算してその和算信号を反転した反転和算信号Ｃ
である。文字式で示すとＡ十Ｂ＝−ｃとなる。第１図の
波形整形回路２．３．４の出力であるデジタル信号り、
Ｂ％Ｆをそれぞれ第２図のり、Ｅ、Ｆに示す。第１図の
パルス整形回路５．６．７の出力であるパルス信号Ｇ、
Ｈ。
の信号Ａおよび信号Ｂであり、信号Ａをイ＆ 基準にすると信号Ｂは１２０度位相差の進んだ番号であ
る。破ＳＣは第１図の反転和算回路１で信号Ａと信号Ｂ
とを和演算してその和算信号を反転した反転和算信号Ｃ
である。文字式で示すとＡ十Ｂ＝−ｃとなる。第１図の
波形整形回路２．３．４の出力であるデジタル信号り、
Ｂ％Ｆをそれぞれ第２図のり、Ｅ、Ｆに示す。第１図の
パルス整形回路５．６．７の出力であるパルス信号Ｇ、
Ｈ。
■をそれぞれ第２図のＧ、Ｈ，工に示す。第１図の論理
和回路８の出力であるパルス信号Ｋを第２図のＫに示す
。ここで、信号Ａに着目すると、第２図の１１点から１
２点の間が１周期を示し、この１周期間におけるパルス
信号Ｋを見ると、６個のパルスから成り立っている。こ
のことは、結果的に、１周期を６分割できることを意味
するものである。
和回路８の出力であるパルス信号Ｋを第２図のＫに示す
。ここで、信号Ａに着目すると、第２図の１１点から１
２点の間が１周期を示し、この１周期間におけるパルス
信号Ｋを見ると、６個のパルスから成り立っている。こ
のことは、結果的に、１周期を６分割できることを意味
するものである。
と信号Ｂは１２０度位相差の進んだ信号である。
信号Ａは後述の反転和算回路コ、に入力すると共に
・後述の分割回路１０に含まれている第一差算回路１
１、第三差算回路１３および波形整形回路１４に入力し
ている。同様に、信号Ｂは後述の反転和算回路１に入力
すると共に後述の分割回路１０に含まれている第一差算
回路１１、第三差算回路１３および波形整形回路１５に
入力している。反転和算回路１は、いわゆる演算増幅器
（ＯＦアンプ）等で構成され、入力された信号Ａと信号
Ｂとをアナログ的に和演算し、その和倹算信号を反転（
原信号がＳｉｎθなら一８ｉｎθにすること）して反転
和算信号Ｃを後述の分割回路１０に含まれている第一差
算回路１１、第二差算回路１２および波形整形回路１６
に出力している。分割回路１０は第一差算回路１１、第
二差算回路１２、第三差算回路１３、波形整形回路群２
７、排他的論理和回路群２日、第一パルス整形回路２４
、第二パルス整形回路２５ｊ、；−よび論理和回路２６
で構成され波形整形回路群２７は６個の波形整形回路１
４、路２０．２１．２２および２３で構成されている。
・後述の分割回路１０に含まれている第一差算回路１
１、第三差算回路１３および波形整形回路１４に入力し
ている。同様に、信号Ｂは後述の反転和算回路１に入力
すると共に後述の分割回路１０に含まれている第一差算
回路１１、第三差算回路１３および波形整形回路１５に
入力している。反転和算回路１は、いわゆる演算増幅器
（ＯＦアンプ）等で構成され、入力された信号Ａと信号
Ｂとをアナログ的に和演算し、その和倹算信号を反転（
原信号がＳｉｎθなら一８ｉｎθにすること）して反転
和算信号Ｃを後述の分割回路１０に含まれている第一差
算回路１１、第二差算回路１２および波形整形回路１６
に出力している。分割回路１０は第一差算回路１１、第
二差算回路１２、第三差算回路１３、波形整形回路群２
７、排他的論理和回路群２日、第一パルス整形回路２４
、第二パルス整形回路２５ｊ、；−よび論理和回路２６
で構成され波形整形回路群２７は６個の波形整形回路１
４、路２０．２１．２２および２３で構成されている。
差算回路は、いわゆる演算増幅器（ｏｐアンプ）等で構
成され、入力された２信号をアナログ的に差演算し、差
算信号を出力している。′第一差算回路１１は入力した
信号Ａと信号Ｃとを差演算し、・利−差算信号りを波形
整形回路１７に出力している。芽：二差算回路１２は、
入力した信号Ｃと信号Ｂとを差波４し、第二差算信号Ｍ
を波形整形回路１８に出力している。第三差算回路１３
は、入力した信号Ｂと信４ｈとを差演算し、第三差算信
号Ｎを波形整形回路１９に出力している。波形整形回路
は、いわゆる電圧比較器（コンパレータ）等で構成され
、入力した信号と内蔵している基準電圧（第４図のＯ）
とを比較し、信号が基準電圧よシ高い場合はデジタル信
号の１ハイ１を出力し、信号が基準電圧より低い場合は
デジタル信号の１０つ１を出力する。波形整形回路１４
は、入力し較し、デジタル信号Ｑを排他的論理和回路２
０に出力している。波形整形回路１６は、入力した信号
Ｃと基準電圧とを比較し、デジタル信号Ｒを排他的論理
和回路２１に出力している。波形整形回路１７は、入力
した信号りと基準電圧とを比較しデジタル信号Ｓを排他
的論理和回路２２に出力している。波形整形回路１日は
、入力した信号Ｍと基準電圧とを比較し、デジタル信号
Ｔを排他的論理和回路２２に出力している。波形整形回
路１９Ｑ−１１、人力シフ／ζ信号Ｎと基塾電用とを比
較し、デジタル信＞３． Ｌｌを排他的論理和回路２３
に出力している。排他的論理和回路２０は、デジタル信
号Ｐとデジタル信号Ｑとを人力し、デジタル信号Ｖを排
他的論理和回路２］４に出力している。同様に、排他的
論理和回路２２ば、デジタル信号Ｓとデジタル信号Ｔと
を入力し、デジタル信号Ｗを排他的論理和回路２３に出
力している。排他的論理和回路２１は、デジタル信号Ｖ
とデジタル信号Ｒとを入力し、検出された信号に対して
３倍の周波数の高周波信号Ｘを第一パルス整形回路２４
に出力している。同様に、排他的論理和回路２３は、デ
ジタル信号Ｗとデジタル信号Ｕとを入力し、高周波信号
Ｙを第二パルス整形回路２５に出力している。
成され、入力された２信号をアナログ的に差演算し、差
算信号を出力している。′第一差算回路１１は入力した
信号Ａと信号Ｃとを差演算し、・利−差算信号りを波形
整形回路１７に出力している。芽：二差算回路１２は、
入力した信号Ｃと信号Ｂとを差波４し、第二差算信号Ｍ
を波形整形回路１８に出力している。第三差算回路１３
は、入力した信号Ｂと信４ｈとを差演算し、第三差算信
号Ｎを波形整形回路１９に出力している。波形整形回路
は、いわゆる電圧比較器（コンパレータ）等で構成され
、入力した信号と内蔵している基準電圧（第４図のＯ）
とを比較し、信号が基準電圧よシ高い場合はデジタル信
号の１ハイ１を出力し、信号が基準電圧より低い場合は
デジタル信号の１０つ１を出力する。波形整形回路１４
は、入力し較し、デジタル信号Ｑを排他的論理和回路２
０に出力している。波形整形回路１６は、入力した信号
Ｃと基準電圧とを比較し、デジタル信号Ｒを排他的論理
和回路２１に出力している。波形整形回路１７は、入力
した信号りと基準電圧とを比較しデジタル信号Ｓを排他
的論理和回路２２に出力している。波形整形回路１日は
、入力した信号Ｍと基準電圧とを比較し、デジタル信号
Ｔを排他的論理和回路２２に出力している。波形整形回
路１９Ｑ−１１、人力シフ／ζ信号Ｎと基塾電用とを比
較し、デジタル信＞３． Ｌｌを排他的論理和回路２３
に出力している。排他的論理和回路２０は、デジタル信
号Ｐとデジタル信号Ｑとを人力し、デジタル信号Ｖを排
他的論理和回路２］４に出力している。同様に、排他的
論理和回路２２ば、デジタル信号Ｓとデジタル信号Ｔと
を入力し、デジタル信号Ｗを排他的論理和回路２３に出
力している。排他的論理和回路２１は、デジタル信号Ｖ
とデジタル信号Ｒとを入力し、検出された信号に対して
３倍の周波数の高周波信号Ｘを第一パルス整形回路２４
に出力している。同様に、排他的論理和回路２３は、デ
ジタル信号Ｗとデジタル信号Ｕとを入力し、高周波信号
Ｙを第二パルス整形回路２５に出力している。
第一パルス整形回路２４は、高周波信号Ｘを人力し、Ａ
Ｍｊ波信号Ｘの立上りと立下りの時点において、パル
ス幅の狭い第一パルス信号Ｘ１を論理和回路２６に出力
する。同様に、第二パルス整形回路２５は、高周波信号
Ｙを入力し、第二パルス信号Ｙ１を論理和回路２６に出
力する。論理和回路２６は、第一パルス信号Ｘ１と第二
パルス信号Ｙ１とを人力し、第三パルス信号２を出力す
る。
Ｍｊ波信号Ｘの立上りと立下りの時点において、パル
ス幅の狭い第一パルス信号Ｘ１を論理和回路２６に出力
する。同様に、第二パルス整形回路２５は、高周波信号
Ｙを入力し、第二パルス信号Ｙ１を論理和回路２６に出
力する。論理和回路２６は、第一パルス信号Ｘ１と第二
パルス信号Ｙ１とを人力し、第三パルス信号２を出力す
る。
第４図において、実線Ａおよび実線Ｂはそれぞれ第３図
の信号Ａおよび信号Ｂであり、信号Ａを基準にすると信
ＯＢは１２０度位相差の進んだ信号である。破線Ｃは、
第３図の反転和算回路１で信号Ａと信号Ｂとを和演算し
てその和算信号を反転した反転和算信号Ｃである。文字
式で示すと、Ａ−４−Ｂ、＝−Ｃとなる。第三図の第一
差算回路１１、第二差算回路１２、第三差算回路１３の
それぞれの出力である第一差算信号Ｌ１第二差算信号Ｍ
、漬〕 ；う第三差算信号Ｎをそれぞれ第４図のＬＳＭ、Ｈに示
す。第３図の波形整形回路１４．１５．１６．１７．１
Ｂ、１９の出力であるデジタル信号Ｐ１Ｊ Ｒ，Ｓ、Ｔ
Ｓ Ｕをそれぞれ第４図のＰｌＱｌＲ，Ｓ、Ｔ、Ｕに示
す。第３図の排他的論理和回路２゛０．２１．２２．２
３の出力であるデジタル信号Ｖ、Ｘ、Ｗ、Ｙをそれぞれ
第４図のｖ、ｘｌＷ、Ｙに示す。第３図の第一パルス整
形回路２４第二パルス整形回路２５のそれぞれの出力で
ある第一パルス信号ＸＩ、第二パルス信号Ｙ１をそれぞ
れ第４図のＸｌ、Ｙｌに示す。第３図の論理和回路２６
の出力である第三パルス信号２を第４図のＺに示す。こ
こで、信号Ａに着目すると、第４図の８１点から８２点
の間が１周期を示し、この１周期間における第三パルス
信号２を見ると、１２個のパルスかう成り立っている。
の信号Ａおよび信号Ｂであり、信号Ａを基準にすると信
ＯＢは１２０度位相差の進んだ信号である。破線Ｃは、
第３図の反転和算回路１で信号Ａと信号Ｂとを和演算し
てその和算信号を反転した反転和算信号Ｃである。文字
式で示すと、Ａ−４−Ｂ、＝−Ｃとなる。第三図の第一
差算回路１１、第二差算回路１２、第三差算回路１３の
それぞれの出力である第一差算信号Ｌ１第二差算信号Ｍ
、漬〕 ；う第三差算信号Ｎをそれぞれ第４図のＬＳＭ、Ｈに示
す。第３図の波形整形回路１４．１５．１６．１７．１
Ｂ、１９の出力であるデジタル信号Ｐ１Ｊ Ｒ，Ｓ、Ｔ
Ｓ Ｕをそれぞれ第４図のＰｌＱｌＲ，Ｓ、Ｔ、Ｕに示
す。第３図の排他的論理和回路２゛０．２１．２２．２
３の出力であるデジタル信号Ｖ、Ｘ、Ｗ、Ｙをそれぞれ
第４図のｖ、ｘｌＷ、Ｙに示す。第３図の第一パルス整
形回路２４第二パルス整形回路２５のそれぞれの出力で
ある第一パルス信号ＸＩ、第二パルス信号Ｙ１をそれぞ
れ第４図のＸｌ、Ｙｌに示す。第３図の論理和回路２６
の出力である第三パルス信号２を第４図のＺに示す。こ
こで、信号Ａに着目すると、第４図の８１点から８２点
の間が１周期を示し、この１周期間における第三パルス
信号２を見ると、１２個のパルスかう成り立っている。
このことハ、結果的に、１周期を１２分割できることを
意味するものである。
意味するものである。
ここで、信号Ａと信号Ｂから反転和算信号Ｃが得られ、
信号Ａ、Ｂおよび反転和算信号Ｃから第一差算信号Ｌ１
第二差算信号Ｍおよび第三差算信号Ｎが得られる事を説
明する。
信号Ａ、Ｂおよび反転和算信号Ｃから第一差算信号Ｌ１
第二差算信号Ｍおよび第三差算信号Ｎが得られる事を説
明する。
信号ＡをＳｉｎθ、信号Ｂを（θ−１２００）とすると
、反転和算信号Ｃは、 Ｃ＝−（Ａ＋Ｂ） 、＝−（Ｓｉｎθ十Ｓｉｎ （θ−１２００）＝Ｓｉｎ
（θ＋１２０°） となり、第４図のＣと同一波形となる。又、第一差算信
号りは、 Ｌ −Ａ−Ｃ ：Ｓｉｎ θ−８ｉｎ （θ＋１２０°）＝、／’１
Ｅｌｉｎ（θ−３００） となり、第４図のＬと同一波形となる０又、第二差算信
号Ｍは、 Ｍ、、Ｃ−Ｂ ＝Ｓｉｎ （θ＋１２０°）Ｓｉｎ（θ−１２０°）＝
Ｊ’Ｕ Ｓ ｉ ｎ （θ＋９００）となり、第４図の
Ｍと同一波形となる。又、第三差算信号Ｎは、 Ｎ＝Ｂ−Ａ ＝：５ｉｎ（θ−１２００）−８ｉｎθ＝５８ ｉ ｎ
（θ−１５００） となり、第４図のＮと同一波形となる。
、反転和算信号Ｃは、 Ｃ＝−（Ａ＋Ｂ） 、＝−（Ｓｉｎθ十Ｓｉｎ （θ−１２００）＝Ｓｉｎ
（θ＋１２０°） となり、第４図のＣと同一波形となる。又、第一差算信
号りは、 Ｌ −Ａ−Ｃ ：Ｓｉｎ θ−８ｉｎ （θ＋１２０°）＝、／’１
Ｅｌｉｎ（θ−３００） となり、第４図のＬと同一波形となる０又、第二差算信
号Ｍは、 Ｍ、、Ｃ−Ｂ ＝Ｓｉｎ （θ＋１２０°）Ｓｉｎ（θ−１２０°）＝
Ｊ’Ｕ Ｓ ｉ ｎ （θ＋９００）となり、第４図の
Ｍと同一波形となる。又、第三差算信号Ｎは、 Ｎ＝Ｂ−Ａ ＝：５ｉｎ（θ−１２００）−８ｉｎθ＝５８ ｉ ｎ
（θ−１５００） となり、第４図のＮと同一波形となる。
本発明は、以上に説明したように構成されているので、
検出部により検出される信号が２倍号に１ もかかわ
らず−周期を高分割でき、消費電流も従来の高分割方法
に比べ少ないのみならず小型計量の実現も容易可能等の
信号分割装置を得ることができる。
検出部により検出される信号が２倍号に１ もかかわ
らず−周期を高分割でき、消費電流も従来の高分割方法
に比べ少ないのみならず小型計量の実現も容易可能等の
信号分割装置を得ることができる。
な′お・、上記実施例においては、パルス整形回路と論
理和回路とを分割回路に含まれる回路としてあつがって
いるが、止転あるいは逆転による加減算弁別が必要な測
定計を考えると、パルス整形回路と論理和回路とを取り
のぞき、波形整形回路あるいは排他的論理和回路群まで
を分割回路としても良いことはもちろんである。又、波
形整形回路の出力をインバータを介して反転された信号
を使用しても良いことは言うまでもない。
理和回路とを分割回路に含まれる回路としてあつがって
いるが、止転あるいは逆転による加減算弁別が必要な測
定計を考えると、パルス整形回路と論理和回路とを取り
のぞき、波形整形回路あるいは排他的論理和回路群まで
を分割回路としても良いことはもちろんである。又、波
形整形回路の出力をインバータを介して反転された信号
を使用しても良いことは言うまでもない。
第１図は本発明の一実施例を示すブロック図であり、第
２１４は第１図の各部における波形図であり、第３図は
本発明の特に分割回路の他の実施例を示すブロック図で
あり、第４図は第３図の各部における波形図である。 １・・・反転和算回路 ９・・・分割回路１０・
・・分割回路 １１・・・第一差算回路上２・・
・第二差算回路 １３・・・第三差算回路２４・・
・第一パルス整形回路２５・・・第二パルス整形回路２
６・・・論理和回路 ２７・・・波形整形回路群２
８・・・排他的論理和回路群 茅１図 峯２図 Ａ、 （３５猷 の−
２１４は第１図の各部における波形図であり、第３図は
本発明の特に分割回路の他の実施例を示すブロック図で
あり、第４図は第３図の各部における波形図である。 １・・・反転和算回路 ９・・・分割回路１０・
・・分割回路 １１・・・第一差算回路上２・・
・第二差算回路 １３・・・第三差算回路２４・・
・第一パルス整形回路２５・・・第二パルス整形回路２
６・・・論理和回路 ２７・・・波形整形回路群２
８・・・排他的論理和回路群 茅１図 峯２図 Ａ、 （３５猷 の−
Claims (1)
- 【特許請求の範囲】 （１）検出部により検出された１２０度位相差のある２
倍号を入力して和演算した結果である第１算信号を反転
して反転和算信号を出力する反転オ目算回路と、前記２
倍号と前記反転和算信号とを入力して検出された信号の
１周期を多分割する分割回路とを備えた信号分割装置。 （２、特許請求の範囲（１）の装置において、分割回路
は検出された２倍号と反転和算信号とを入力して、検出
された２倍号の一方と反転和算信号とを入力して差演算
した結果である第一差算信号を出力する第一差算回路と
、反転和算信号と検出された２倍号の他方とを入力して
差演算した結果である第三差算信号を出力する第二差算
回路と、検出された２倍号の他方と検出された２倍号の
一方とを入力して差演算した結果である第三差算１ｇ号
を出力する第三差算回路と、検出された２倍号と反転和
算信号と第一差算信号と第二差算信号と第三差算信号と
を入力して、それぞれの信号を波形整形して６個のデジ
タル信号を出力する波形整形回路群と、６個のデジタル
信号を入力して検出された信−１号に対して３倍の周波
数の高周波信号を２個用力＼ （３）特許請求の範囲（１）の装置において分割回路は
、検出された２倍号と反転和算信号とを入力して、検出
された２倍号の一方と反転和算信号とを入力して差演算
した結果である第一差算信号を出方する第一差算回路と
、反転和算信号と検出された２倍号の他方とを入力して
差演算した結果である第二差算信号を出力する第二差算
回路と、検出された２倍号の他方と検出された２倍号の
一方とを入力して差演算した結果である第三差算信号を
出力する第三差算回路と、検出された２倍号と反転和算
信号と第一差算信号と第二差算信号と第三差算信号とを
入力して、それぞれの信号を波形整形して６個のデジタ
ル信号を出力する波形整形回路群と、６個のデジタル信
号を入力して検出された信号に対して３倍の周波数の高
周波信号を２個出力する排他的論理和回路群と、２個の
高周波信号の一方を入力して信号の立上り、立下りの時
点に第一パルス信号を出力する第一パルス整形回路と、
２個の高周波信号の他方を入力して信号の立上シ、立下
りの時点に第二パルス信号を出力する第二パルス整形回
路と、上記第一パルス信号と第二パルス信号とを入力し
て第三パルス信号を出力する論理和回路とを具備してな
る信号分割装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11743782A JPS597210A (ja) | 1982-07-06 | 1982-07-06 | 信号分割装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11743782A JPS597210A (ja) | 1982-07-06 | 1982-07-06 | 信号分割装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS597210A true JPS597210A (ja) | 1984-01-14 |
Family
ID=14711622
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11743782A Pending JPS597210A (ja) | 1982-07-06 | 1982-07-06 | 信号分割装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS597210A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60188852A (ja) * | 1984-03-09 | 1985-09-26 | Sony Corp | 回転検出装置 |
| JPH01100419A (ja) * | 1987-09-17 | 1989-04-18 | Sperry Marine Inc | １８０ｘおよび９０ｘコンパスシンクロデータのためのステップデータ変換装置 |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US3310798A (en) * | 1963-10-01 | 1967-03-21 | Wayne George Corp | Analog to digital optical encoder |
| US3312828A (en) * | 1963-05-09 | 1967-04-04 | Wayne George Corp | Analog to digital encoding apparatus for directly reading out information |
| JPS5643506A (en) * | 1979-09-17 | 1981-04-22 | Mitsutoyo Mfg Co Ltd | Multidivided circuit of length measuring machine |
-
1982
- 1982-07-06 JP JP11743782A patent/JPS597210A/ja active Pending
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US3312828A (en) * | 1963-05-09 | 1967-04-04 | Wayne George Corp | Analog to digital encoding apparatus for directly reading out information |
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