JPS5963744A - 半導体装置 - Google Patents
半導体装置Info
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- JPS5963744A JPS5963744A JP57175543A JP17554382A JPS5963744A JP S5963744 A JPS5963744 A JP S5963744A JP 57175543 A JP57175543 A JP 57175543A JP 17554382 A JP17554382 A JP 17554382A JP S5963744 A JPS5963744 A JP S5963744A
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- JP
- Japan
- Prior art keywords
- pad
- external terminal
- function
- bonding
- circuit section
- Prior art date
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- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/90—Bond pads, in general
-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W70/00—Package substrates; Interposers; Redistribution layers [RDL]
- H10W70/60—Insulating or insulated package substrates; Interposers; Redistribution layers
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- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/50—Bond wires
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- H10W72/50—Bond wires
- H10W72/541—Dispositions of bond wires
- H10W72/5445—Dispositions of bond wires being orthogonal to a side surface of the chip, e.g. parallel arrangements
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- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/50—Bond wires
- H10W72/541—Dispositions of bond wires
- H10W72/5449—Dispositions of bond wires not being orthogonal to a side surface of the chip, e.g. fan-out arrangements
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- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/50—Bond wires
- H10W72/541—Dispositions of bond wires
- H10W72/547—Dispositions of multiple bond wires
- H10W72/5473—Dispositions of multiple bond wires multiple bond wires connected to a common bond pad
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- H10W72/90—Bond pads, in general
- H10W72/931—Shapes of bond pads
- H10W72/932—Plan-view shape, i.e. in top view
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- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W90/00—Package configurations
- H10W90/701—Package configurations characterised by the relative positions of pads or connectors relative to package parts
- H10W90/751—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires
- H10W90/754—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires between a chip and a stacked insulating package substrate, interposer or RDL
Landscapes
- Semiconductor Integrated Circuits (AREA)
- Wire Bonding (AREA)
- Design And Manufacture Of Integrated Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明は、パッケージから出された外部端子の一つを
共通端子とす−る複数の機能部が半導体チップに設けら
れた、半導体装置に関する。
共通端子とす−る複数の機能部が半導体チップに設けら
れた、半導体装置に関する。
従来この種の装置として、第1図に要部を説明図で示す
ものがあった。図はLSIの場合を示し1、(1)はパ
ッケージ、(2)はリードフレームのダイパッド、(3
)はリードフレームに形成されたボンディング受は部で
、フレームリード(4)が延びて先端が外部端子(5)
になっている。(6)はダイパッド(2)Kダイポンデ
ィングされたL8エテツフ゛、(7ン及び(8JijL
sエテツプ(6λに設けられ、それぞれ論理回路の一つ
をなす出力回路部及び入力回路部、(9)dL8エテツ
プ(6)に設けられたボンディング用バンドで、アルミ
材などの配線ulにより出力回路部(7)と入力回路部
(8〕に接続嘔れていや。(ロ)はボンディング用パッ
ド(9)と一つの端子(2)のボンディング用受は部(
3)とをワイヤボンディングした金属細線である。
ものがあった。図はLSIの場合を示し1、(1)はパ
ッケージ、(2)はリードフレームのダイパッド、(3
)はリードフレームに形成されたボンディング受は部で
、フレームリード(4)が延びて先端が外部端子(5)
になっている。(6)はダイパッド(2)Kダイポンデ
ィングされたL8エテツフ゛、(7ン及び(8JijL
sエテツプ(6λに設けられ、それぞれ論理回路の一つ
をなす出力回路部及び入力回路部、(9)dL8エテツ
プ(6)に設けられたボンディング用バンドで、アルミ
材などの配線ulにより出力回路部(7)と入力回路部
(8〕に接続嘔れていや。(ロ)はボンディング用パッ
ド(9)と一つの端子(2)のボンディング用受は部(
3)とをワイヤボンディングした金属細線である。
上記従来の装置において、出力回路部(7)の出力線と
、入力回路部(8)の入力線とが配線Qりによシパツド
(9)に接続されており、パッド(9ンは金属細線(l
りにより一方の外部端子(5)側に接続されている。こ
うして、−外部端子(5)により入力、出力の両機能に
対し取出すことができるようにしている。
、入力回路部(8)の入力線とが配線Qりによシパツド
(9)に接続されており、パッド(9ンは金属細線(l
りにより一方の外部端子(5)側に接続されている。こ
うして、−外部端子(5)により入力、出力の両機能に
対し取出すことができるようにしている。
上記従来の半導体装置では、入力機能と出力機能とを設
けてあり、一つの外部端子(5)Kよシ取出されている
。しかし、実装後、実使用においては、両機能とも必要
とは限らす、いづれか一方の機能のみを必要とする場合
がある。このため、不必要な方の機能を作用させないよ
うKする、外部からの手続操作が必要でめった。例えば
、入力機能のみを必要とする場合、正常な入力機能を乱
さないように、出力回路部(7]K対し論理1又は論理
0の出力操作をする必要がある。
けてあり、一つの外部端子(5)Kよシ取出されている
。しかし、実装後、実使用においては、両機能とも必要
とは限らす、いづれか一方の機能のみを必要とする場合
がある。このため、不必要な方の機能を作用させないよ
うKする、外部からの手続操作が必要でめった。例えば
、入力機能のみを必要とする場合、正常な入力機能を乱
さないように、出力回路部(7]K対し論理1又は論理
0の出力操作をする必要がある。
この発明は、複数の機能部に、対してそれぞれボンディ
ング用パッドを設け、共通とする一外部端子に対し、上
記ボンディング用パッドのうち所要の分をワイヤボンデ
ィングし、実装後、使用に際し従来のような不要な機能
部に対する手続操作を要しない、半導体装置を提供する
ことを目的としている。
ング用パッドを設け、共通とする一外部端子に対し、上
記ボンディング用パッドのうち所要の分をワイヤボンデ
ィングし、実装後、使用に際し従来のような不要な機能
部に対する手続操作を要しない、半導体装置を提供する
ことを目的としている。
第2図はこの発明の一実施例による半導体装置の要部の
説明図で、LSIの場合を示し、(1)〜(8)は上記
従来装置と同一のものである。e])及び(2)はLS
Iチップ(6)に設けられたボンディング用パッドで、
パッド12っは一理回路の一つである出力回路部(7)
K配線@により接続され、パッド(支)は論理回路の一
つである入力回路部(8)K配線(財)により接続され
ている。配線に)、(ハ)はアルミ材など導電材からな
る。
説明図で、LSIの場合を示し、(1)〜(8)は上記
従来装置と同一のものである。e])及び(2)はLS
Iチップ(6)に設けられたボンディング用パッドで、
パッド12っは一理回路の一つである出力回路部(7)
K配線@により接続され、パッド(支)は論理回路の一
つである入力回路部(8)K配線(財)により接続され
ている。配線に)、(ハ)はアルミ材など導電材からな
る。
実線で示す(ハ)は一方のボンディング用パッドに)と
ボンディング受は部(3)とをワイヤボンディングした
金JtA細線である。なお、出力回路部(7)が不要で
、入力回路部(8)が必要な仕様の場合は、実線で示す
金属細線四による一方のパッド(2)のワイヤボンディ
ングはやめ、鎖線で示すように金属細線四により他方の
パッドG!pをワイヤボンディングをする。
ボンディング受は部(3)とをワイヤボンディングした
金JtA細線である。なお、出力回路部(7)が不要で
、入力回路部(8)が必要な仕様の場合は、実線で示す
金属細線四による一方のパッド(2)のワイヤボンディ
ングはやめ、鎖線で示すように金属細線四により他方の
パッドG!pをワイヤボンディングをする。
また、入力機能と出力機能の両方を必要とする場合は、
一つのボンディング受は部(3)に、それぞれパッドG
!IJ 、 @を各金属細線に)でワイヤボンディング
する。
一つのボンディング受は部(3)に、それぞれパッドG
!IJ 、 @を各金属細線に)でワイヤボンディング
する。
こうし又、一つの外部端子(5)に、双方の機能のうち
、必要とする機能のみが接続され、実装後、使用におい
て、従来のような、不要とする機能に外部からの手続操
作が要しない。
、必要とする機能のみが接続され、実装後、使用におい
て、従来のような、不要とする機能に外部からの手続操
作が要しない。
なお、上記実施例では、一つの共通外部端子(5)に対
する機能部として、出力回路部(7)と入力回路部(8
)を設けである場合を示したが、三つ以上の機能部を設
けそれぞれに対するボンディング用パッドを設けておき
、仕様に応じ必要とする機能部の分に対するボンディン
グ用パッドを外部端子側とワイヤボンディングするよう
Kしてもよい。
する機能部として、出力回路部(7)と入力回路部(8
)を設けである場合を示したが、三つ以上の機能部を設
けそれぞれに対するボンディング用パッドを設けておき
、仕様に応じ必要とする機能部の分に対するボンディン
グ用パッドを外部端子側とワイヤボンディングするよう
Kしてもよい。
また、機能部としては、出力回路部、入力回路部に限ら
ず、他の機能のもの、例えばプルダウン又はプルアンプ
機能のものの場合にも適用できるものである。
ず、他の機能のもの、例えばプルダウン又はプルアンプ
機能のものの場合にも適用できるものである。
さらに、単一の機能部を複数設けた場合も適用できる。
なおまた、出力機能部においては、電流の流出。
流入の出力トランジスタを設けておき、いっれかを選択
場れるようにすることができる。
場れるようにすることができる。
さらにまた、入力機能部忙おいては、入力特性の異なる
二つ以上のもの(例えば、単一のしきい値のものとシュ
ミット特性を有するものなど)を、選択されるようにす
ることもできる。
二つ以上のもの(例えば、単一のしきい値のものとシュ
ミット特性を有するものなど)を、選択されるようにす
ることもできる。
以上のように1この発明によれば、一つの外部端子KM
する複数必機能部を設けてI、これらの機能部に対しそ
れぞれボンディング用パッド部を設け、仕様により必要
とする機能部のボンディング用パッド部と上記外部端子
側をワイヤボンディングしたので、実装後、使用に際し
従来のような、不要とする機能部に対する手続操作を要
せず、この制約が解消され、特性9機能が向上される0
する複数必機能部を設けてI、これらの機能部に対しそ
れぞれボンディング用パッド部を設け、仕様により必要
とする機能部のボンディング用パッド部と上記外部端子
側をワイヤボンディングしたので、実装後、使用に際し
従来のような、不要とする機能部に対する手続操作を要
せず、この制約が解消され、特性9機能が向上される0
第1図は従来の半導体装置の要部を示す説明図、第2図
はこの発明の一実施例による半導体装置の要部を示す説
明図である。 1・・・パッケージ、3・・・ボンディング受は部、5
・・・外部端子、6・・・LSIテップ、7・・・出力
回路部、8・・・入力回路部、’21.22・・・ボン
ディング用ノZンド、23 、24・・・配線、25・
・・金属細線なお、図中同一符号は同−又は相当部分を
示す0代理人 葛野信−(外1名) 第1図 第2図 昭和 年 月 II 特許庁長官1段 1、事件の表示 特願昭57−115543号2
、発明の名称 半導体装置 3、補正をする省 5、補正の対象 明細書の「発明の詳細な説明」の欄0 6、補正の内容 11+ 明細書第2ページ第9行の「端子(2)」を
「端子(5)」に補正する。 (2)明細書第4ページ第2行の「実線で一一一一パッ
ド(22と」を「実線及び鎖線で示す(25jは一方及
び他方のホンティング用パッド翰及び(211と」に補
正する。 (3)明細書第4ページ第5行の「実線」を「鎖線」に
補正する。 (4) 明細書第4ページ第6行の「一方のパッド□
□□」を「他方のパツドシ1)」に補正する。 (5)明細1第4ペ一ジ第7行の「鎖線」を「実線」に
補正する。 (6) 明細書第4ページ第8行の「他方のパッド@
l)を」を「一方のパッドt2Zだけに」に補正する。 以上
はこの発明の一実施例による半導体装置の要部を示す説
明図である。 1・・・パッケージ、3・・・ボンディング受は部、5
・・・外部端子、6・・・LSIテップ、7・・・出力
回路部、8・・・入力回路部、’21.22・・・ボン
ディング用ノZンド、23 、24・・・配線、25・
・・金属細線なお、図中同一符号は同−又は相当部分を
示す0代理人 葛野信−(外1名) 第1図 第2図 昭和 年 月 II 特許庁長官1段 1、事件の表示 特願昭57−115543号2
、発明の名称 半導体装置 3、補正をする省 5、補正の対象 明細書の「発明の詳細な説明」の欄0 6、補正の内容 11+ 明細書第2ページ第9行の「端子(2)」を
「端子(5)」に補正する。 (2)明細書第4ページ第2行の「実線で一一一一パッ
ド(22と」を「実線及び鎖線で示す(25jは一方及
び他方のホンティング用パッド翰及び(211と」に補
正する。 (3)明細書第4ページ第5行の「実線」を「鎖線」に
補正する。 (4) 明細書第4ページ第6行の「一方のパッド□
□□」を「他方のパツドシ1)」に補正する。 (5)明細1第4ペ一ジ第7行の「鎖線」を「実線」に
補正する。 (6) 明細書第4ページ第8行の「他方のパッド@
l)を」を「一方のパッドt2Zだけに」に補正する。 以上
Claims (1)
- パッケージの一外部端子に対する複数の機能部を半導体
テップ建設けてあり、上記各機能部にそれだれ内部配線
接続された複数のポ・ゲイングバツドを上記半導体テッ
プ上に設けており、仕様に応じ、上記各機能部のうち必
要とする分に対する上記ポンディングパッド部を、上記
外部端子側のボングーfング受は部にワイヤボンディン
グしたことを特徴とする半導体装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57175543A JPS5963744A (ja) | 1982-10-04 | 1982-10-04 | 半導体装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57175543A JPS5963744A (ja) | 1982-10-04 | 1982-10-04 | 半導体装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5963744A true JPS5963744A (ja) | 1984-04-11 |
Family
ID=15997910
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57175543A Pending JPS5963744A (ja) | 1982-10-04 | 1982-10-04 | 半導体装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5963744A (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6028257A (ja) * | 1983-07-26 | 1985-02-13 | Sharp Corp | 集積回路 |
| JPS62224942A (ja) * | 1986-03-27 | 1987-10-02 | Sony Corp | 半導体集積回路 |
| JPS62230028A (ja) * | 1986-03-31 | 1987-10-08 | Nec Corp | 半導体集積回路 |
| US5801451A (en) * | 1995-02-14 | 1998-09-01 | Mitsubishi Denki Kabushiki Kaisha | Semiconductor device including a plurality of input buffer circuits receiving the same control signal |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5764941A (en) * | 1980-10-09 | 1982-04-20 | Hitachi Ltd | Semiconductor integrated circuit device |
| JPS5722242B2 (ja) * | 1972-04-10 | 1982-05-12 |
-
1982
- 1982-10-04 JP JP57175543A patent/JPS5963744A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5722242B2 (ja) * | 1972-04-10 | 1982-05-12 | ||
| JPS5764941A (en) * | 1980-10-09 | 1982-04-20 | Hitachi Ltd | Semiconductor integrated circuit device |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6028257A (ja) * | 1983-07-26 | 1985-02-13 | Sharp Corp | 集積回路 |
| JPS62224942A (ja) * | 1986-03-27 | 1987-10-02 | Sony Corp | 半導体集積回路 |
| JPS62230028A (ja) * | 1986-03-31 | 1987-10-08 | Nec Corp | 半導体集積回路 |
| US5801451A (en) * | 1995-02-14 | 1998-09-01 | Mitsubishi Denki Kabushiki Kaisha | Semiconductor device including a plurality of input buffer circuits receiving the same control signal |
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