JPS5918861Y2 - 相補型ｆｅｔチョッパ駆動回路 - Google Patents
相補型ｆｅｔチョッパ駆動回路Info
- Publication number
- JPS5918861Y2 JPS5918861Y2 JP16125379U JP16125379U JPS5918861Y2 JP S5918861 Y2 JPS5918861 Y2 JP S5918861Y2 JP 16125379 U JP16125379 U JP 16125379U JP 16125379 U JP16125379 U JP 16125379U JP S5918861 Y2 JPS5918861 Y2 JP S5918861Y2
- Authority
- JP
- Japan
- Prior art keywords
- diode
- circuit
- series circuit
- complementary
- drive circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
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Description
【考案の詳細な説明】
本考案は、相補型の電界効果型トランジスタ（以下ＦＥ
Ｔという）チョッパの駆動回路の改良に関するものであ
る。
Ｔという）チョッパの駆動回路の改良に関するものであ
る。
第１図に相補型ＦＥＴチョッパ回路の一例を示す。
図において、Ｑｌ、Ｑ２はＦＥＴである。入力端１ａは
抵抗器Ｒ１とＦＥＴＱｌの直列回路を介して出力端２ａ
に接続されると共に、抵抗器Ｒ１を介した後ＦＥＴＱ２
を通して他方の入力端１ｂに接続されている。
抵抗器Ｒ１とＦＥＴＱｌの直列回路を介して出力端２ａ
に接続されると共に、抵抗器Ｒ１を介した後ＦＥＴＱ２
を通して他方の入力端１ｂに接続されている。
また、入力端１ｂと出力端２ｂとはコモンとして共通接
続されている。
続されている。
ＦＥＴＱＩ 、 Ｑ２はそれぞれゲートＧ１．Ｇ２に与
えられる電圧によってドレイン・ソース間がオン・オフ
制御される。
えられる電圧によってドレイン・ソース間がオン・オフ
制御される。
すなわち、ゲート電圧が０■のときはドレイン・ソース
間はオン状態となり、ピンチオフ電圧を越える負の電圧
−■ｏＦＦがゲートに与えられたときはドレイン・ソー
ス間がオフ状態になる。
間はオン状態となり、ピンチオフ電圧を越える負の電圧
−■ｏＦＦがゲートに与えられたときはドレイン・ソー
ス間がオフ状態になる。
したがって、ＯＶ ＶＯＦＦ電圧を各ゲートに相補的に
与えＦＥＴＱｌ、Ｑ２をオン・オフ制御することができ
る。
与えＦＥＴＱｌ、Ｑ２をオン・オフ制御することができ
る。
このようなチョッパ回路を駆動するための相補的な駆動
信号φ、Ｔを発生する従来の駆動回路を第２図に示す。
信号φ、Ｔを発生する従来の駆動回路を第２図に示す。
第２図イにおいて、トランスＴ１の１次側コイルには矩
形波電圧Ｅを発生する電源ＰＳが接続され、２次側コイ
ルには抵抗器Ｒ２，Ｒ３の抵抗直列回路２１の両端に逆
方向にダイオードＤ工。
形波電圧Ｅを発生する電源ＰＳが接続され、２次側コイ
ルには抵抗器Ｒ２，Ｒ３の抵抗直列回路２１の両端に逆
方向にダイオードＤ工。
Ｄ２を直列接続したダイオード・抵抗直列回路２２が接
続されている。
続されている。
また、２次側コイルの中央の中間タップ及び抵抗直列回
路２１の共通接続点は共にコモンに接続されている。
路２１の共通接続点は共にコモンに接続されている。
このような回路構成では２次側コイルに生ずる交番電圧
に応じてダイオードＤ１．Ｄ２のアノード端より相補的
な駆動信号φ、φが得られる。
に応じてダイオードＤ１．Ｄ２のアノード端より相補的
な駆動信号φ、φが得られる。
また、第２図口もダイオードＤ３．Ｄ４のアノード端よ
り相補的な駆動信号φ。
り相補的な駆動信号φ。
Ｊめ得られる駆動回路を示すものである。
すなわち、トランスＴ２の２次側コイルには抵抗直列回
路２１とゲルマニュームダイオードＤ３．Ｄ４の逆方向
に直列接続されたダイオード直列回路２３とを並列接続
しており、また、抵抗直列回路２１の共通接続点とダイ
オードＤ３．Ｄ４の共通接続点とを共にコモンに接続し
ている。
路２１とゲルマニュームダイオードＤ３．Ｄ４の逆方向
に直列接続されたダイオード直列回路２３とを並列接続
しており、また、抵抗直列回路２１の共通接続点とダイ
オードＤ３．Ｄ４の共通接続点とを共にコモンに接続し
ている。
しかし、第２図イの回路ではトランスＴ１の２次側コイ
ルに中間タップを必要とする欠点があり、また、第２図
口の回路ではダイオードＤ３．Ｄ４の順方向電圧降下が
零電圧駆動信号の電圧レベルとなるので、これを零電圧
に近づけるためには電圧降下の少ない特殊なダイオード
を使用しなければならないという欠点があった。
ルに中間タップを必要とする欠点があり、また、第２図
口の回路ではダイオードＤ３．Ｄ４の順方向電圧降下が
零電圧駆動信号の電圧レベルとなるので、これを零電圧
に近づけるためには電圧降下の少ない特殊なダイオード
を使用しなければならないという欠点があった。
本考案は、このような欠点を除去し、簡単な構成で、ダ
イオードの順方向電圧降下に影響されない零電圧駆動信
号の得られる相補型ＦＥＴチョッパ駆動回路を実現しよ
うとするものである。
イオードの順方向電圧降下に影響されない零電圧駆動信
号の得られる相補型ＦＥＴチョッパ駆動回路を実現しよ
うとするものである。
以下図面を用いて本考案を詳しく説明する。
第３図は本考案に係る相補型ＦＥＴチョッパ駆動回路の
一実施例を示す構成図である。
一実施例を示す構成図である。
第３図において第２図と同等部分には同一符号を付し、
その説明は省略する。
その説明は省略する。
Ｄｌ、Ｄ２．Ｄ３□、Ｄ３２はダイオードで、一般的な
接合型シリコンダイオードあるいはシリコンショットキ
ーダイオードなどを適用することができる。
接合型シリコンダイオードあるいはシリコンショットキ
ーダイオードなどを適用することができる。
ダイオードＤ３０．Ｄ３゜は逆方向に直列接続されると
共にその共通接続点はコモンに接続され、このダイオー
ド直列回路３１はトランスＴ１の２次側コイルに直列に
接続されている。
共にその共通接続点はコモンに接続され、このダイオー
ド直列回路３１はトランスＴ１の２次側コイルに直列に
接続されている。
このような構成において、第４図イに示すように、今ト
ランス２次側にピーク電圧ｅｐなる電圧が発生した場合
、これにより電流が鎖線で示すようにＤ３、→Ｒ３→Ｄ
２と流れる。
ランス２次側にピーク電圧ｅｐなる電圧が発生した場合
、これにより電流が鎖線で示すようにＤ３、→Ｒ３→Ｄ
２と流れる。
ここで、ダイオードＤ１．Ｄ２．Ｄ３□、Ｄ３□の順方
向電圧降下を総て■、とすれば、ダイオードＤ２のアノ
ード端において（ｅｐ−２ＶＦ）の電圧信号が得られ、
またダイオードＤ１のアノード端では零電位の信号が得
られる。
向電圧降下を総て■、とすれば、ダイオードＤ２のアノ
ード端において（ｅｐ−２ＶＦ）の電圧信号が得られ、
またダイオードＤ１のアノード端では零電位の信号が得
られる。
次に、２次側コイルに逆極性の電圧ｅｐが生じた場合は
、第４図口に示すようにＤ３□→Ｒ２→Ｄ１と電流が流
れ、ダイオードＤ２のアノード端は零電位、ダイオード
Ｄ工のアノード端は−（ｅｐ ２ ＶＦ ）となり、
上述の場合とは逆相の信号が得られる。
、第４図口に示すようにＤ３□→Ｒ２→Ｄ１と電流が流
れ、ダイオードＤ２のアノード端は零電位、ダイオード
Ｄ工のアノード端は−（ｅｐ ２ ＶＦ ）となり、
上述の場合とは逆相の信号が得られる。
当然のことながら−（ｅｐ−２ＶＦ）がＦＥＴのピンチ
オフ電圧を越える負の電圧となるようにｅｐを発生させ
ている。
オフ電圧を越える負の電圧となるようにｅｐを発生させ
ている。
上述より明らかなように、零電圧信号はダイオードのｖ
Ｆの影響を受けず正確な零電位信号とすることができる
。
Ｆの影響を受けず正確な零電位信号とすることができる
。
以上説明したように本考案によれば、トランスの２次側
コイルに中間タップを設ける必要もなく、簡単な回路に
より特定のダイオードを使用しなくてもダイオードの順
方向電圧降下の影響を受けない零電圧駆動信号を容易に
得ることができ、実用に供して効果がある。
コイルに中間タップを設ける必要もなく、簡単な回路に
より特定のダイオードを使用しなくてもダイオードの順
方向電圧降下の影響を受けない零電圧駆動信号を容易に
得ることができ、実用に供して効果がある。
第１図は相補型ＦＥＴチョッパ回路を示す構成図、第２
図は第１図回路の駆動信号を得る従来の相補型ＦＥＴチ
ョッパ駆動回路の構成図、第３図は本考案に係る相補型
ＦＥＴチョッパ駆動回路の一実施例を示す構成図、第４
図は第３図回路を説明するための説明図である。 Ｔ１・・・トランス、ＰＳ・・・電源、２１・・・抵抗
直列回路、２２・・・ダイオード・抵抗直列回路、３１
・・・ダイオード直列回路、Ｒ２，Ｒ３・・・抵抗器、
Ｄｌ、Ｄ２．Ｄ３．Ｄ４・・・ダイオード。
図は第１図回路の駆動信号を得る従来の相補型ＦＥＴチ
ョッパ駆動回路の構成図、第３図は本考案に係る相補型
ＦＥＴチョッパ駆動回路の一実施例を示す構成図、第４
図は第３図回路を説明するための説明図である。 Ｔ１・・・トランス、ＰＳ・・・電源、２１・・・抵抗
直列回路、２２・・・ダイオード・抵抗直列回路、３１
・・・ダイオード直列回路、Ｒ２，Ｒ３・・・抵抗器、
Ｄｌ、Ｄ２．Ｄ３．Ｄ４・・・ダイオード。
Claims (1)
- １次側に矩形波電圧の供給されるトランスの２次側より
ダイオードを介して相補型の駆動信号を得る相補型ＦＥ
Ｔチョッパ駆動回路において、互いに逆方向接続のダイ
オード直列回路と、少なくとも２個の抵抗器よりなる抵
抗直列回路の両側にそれぞれダイオードのアノード側を
接続してなるダイオード・抵抗直列回路とを前記トラン
スの２次側に並列接続すると共に、前記ダイオード直列
回路の共通接続点と前記抵抗直列回路の共通接続点とを
コモンに接続したことを特徴とする相補型ＦＥＴチョッ
パ駆動回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16125379U JPS5918861Y2 (ja) | 1979-11-21 | 1979-11-21 | 相補型ｆｅｔチョッパ駆動回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16125379U JPS5918861Y2 (ja) | 1979-11-21 | 1979-11-21 | 相補型ｆｅｔチョッパ駆動回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5680687U JPS5680687U (ja) | 1981-06-30 |
| JPS5918861Y2 true JPS5918861Y2 (ja) | 1984-05-31 |
Family
ID=29672351
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16125379U Expired JPS5918861Y2 (ja) | 1979-11-21 | 1979-11-21 | 相補型ｆｅｔチョッパ駆動回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5918861Y2 (ja) |
-
1979
- 1979-11-21 JP JP16125379U patent/JPS5918861Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5680687U (ja) | 1981-06-30 |
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