JPS59161843A - 半導体装置 - Google Patents
半導体装置Info
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- JPS59161843A JPS59161843A JP58035835A JP3583583A JPS59161843A JP S59161843 A JPS59161843 A JP S59161843A JP 58035835 A JP58035835 A JP 58035835A JP 3583583 A JP3583583 A JP 3583583A JP S59161843 A JPS59161843 A JP S59161843A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
し技術分野]
本発明は半導体装置、特に、多ピン型パッケージを有す
る半導体装置に適用して有効な技術に関する。
る半導体装置に適用して有効な技術に関する。
[背景技術]
一般に、半導体集積回路装置の高集積化に伴い、半導体
集積回路装置の入出力端子数も増加の一途をたどってい
る。したがって半導体ペレットを収納するパッケージの
端子数も増加しており、パンケージ内のメタライズパタ
ーンはより微細かつ高密度になって来ている。一方、パ
ンケージ内のメタライズパターンの微細化、高密度化に
よりメタライズパターン相互の誘導性のノイズ(相互イ
ンダクタンス)の問題が無視できないほど大きくなって
きた。このノイズにより半導体集積回路装置に誤動作が
生じる可能性が出てきたが、現状のパッケージ構造では
ノイズを軽減する方策は得られていない。
集積回路装置の入出力端子数も増加の一途をたどってい
る。したがって半導体ペレットを収納するパッケージの
端子数も増加しており、パンケージ内のメタライズパタ
ーンはより微細かつ高密度になって来ている。一方、パ
ンケージ内のメタライズパターンの微細化、高密度化に
よりメタライズパターン相互の誘導性のノイズ(相互イ
ンダクタンス)の問題が無視できないほど大きくなって
きた。このノイズにより半導体集積回路装置に誤動作が
生じる可能性が出てきたが、現状のパッケージ構造では
ノイズを軽減する方策は得られていない。
ところで、パンケージの誘導性のノイズは、パンケージ
内のメタライズ配線パターンの高密度化によるパターン
同志の接近により、隣接メタライズ配線パターンからの
電気力の影響を受けて生じるものである。このノイズを
減少させるには、集積回路ではなくてパンケージ自体で
行うのが望ましいがパンケーン自体の構造を変える方式
はパッケージ価格を大幅に上昇させるため好ましくない
。
内のメタライズ配線パターンの高密度化によるパターン
同志の接近により、隣接メタライズ配線パターンからの
電気力の影響を受けて生じるものである。このノイズを
減少させるには、集積回路ではなくてパンケージ自体で
行うのが望ましいがパンケーン自体の構造を変える方式
はパッケージ価格を大幅に上昇させるため好ましくない
。
[発明の目的]
本発明の目的は、高密度の多ピン型構造であってもパッ
ケージのメタライズパターンの相互間に発生する誘導性
のノイズを低減することのできる半導体装置を提供する
ことにある。
ケージのメタライズパターンの相互間に発生する誘導性
のノイズを低減することのできる半導体装置を提供する
ことにある。
本発明の前記ならびにその他の目的と新規な特徴は、本
明細書の記述および添付図面から明らかになるであろう
。
明細書の記述および添付図面から明らかになるであろう
。
[発明の概要]
本願において開示される発明のうち代表的なものの概要
を簡単に説明すれば、次の通りである。
を簡単に説明すれば、次の通りである。
すなわち、パッケージのキャンプの裏面に導電膜を被着
したことにより、この導電膜でメタライズパターン上の
電位の急激な変動に起因する電磁誘導を吸収し、誘導性
のノイズを低減させることができる。
したことにより、この導電膜でメタライズパターン上の
電位の急激な変動に起因する電磁誘導を吸収し、誘導性
のノイズを低減させることができる。
[実施例]
第1図は本発明による半導体装置の一実施例を示す分解
斜視図、第2図はその一部の拡大部分断面図である。
斜視図、第2図はその一部の拡大部分断面図である。
本実施例における半導体装置は多ピンのプラグイン型パ
ッケージ構造よりなり、セラミックよりなるパッケージ
のベース1には多数のピン2が設げられている。また、
ベース1の上面の中央部には、半導体ペレット3が取り
付けられ、該ペレット3のポンディングバンドは、その
周囲に形成されたメタライズ領域の所定のメタライズパ
ターン5とワイヤ4により電気的に接続されているが、
この接続状態の詳細は省略されている。
ッケージ構造よりなり、セラミックよりなるパッケージ
のベース1には多数のピン2が設げられている。また、
ベース1の上面の中央部には、半導体ペレット3が取り
付けられ、該ペレット3のポンディングバンドは、その
周囲に形成されたメタライズ領域の所定のメタライズパ
ターン5とワイヤ4により電気的に接続されているが、
この接続状態の詳細は省略されている。
一方、セラミックよりなるパッケージのキャンプ6の裏
面のほぼ中央部には、キャンプ6をベース1上に封止し
た場合にペレット3を収容するキャビティー7が設けら
れている。また、このキャビティー7の周囲におけるキ
ャップ6の裏面には、該キャビティー7およびキャンプ
60周縁を除いて導電膜8が被着されている。この導電
膜8はたとえばアルミニウムまたはタングステン等の金
属の蒸着膜として形成するか、あるいはタングステン等
のメタライズパターンもしくは導電性ガラス等で形成す
ることができる。
面のほぼ中央部には、キャンプ6をベース1上に封止し
た場合にペレット3を収容するキャビティー7が設けら
れている。また、このキャビティー7の周囲におけるキ
ャップ6の裏面には、該キャビティー7およびキャンプ
60周縁を除いて導電膜8が被着されている。この導電
膜8はたとえばアルミニウムまたはタングステン等の金
属の蒸着膜として形成するか、あるいはタングステン等
のメタライズパターンもしくは導電性ガラス等で形成す
ることができる。
さらに、前記ヘース1とキャンプ6とを気密封止するた
め、ベース1とキャンプ6との間には低融点ガラス9が
設けられる。この低融点ガラス9のほぼ中央部には、ペ
レット3およびワイヤ4のポンディング領域よりやや広
い面積の開口10が形成されるようになっている。また
、低融点ガラス9はベース1上のメタライズパターン5
がキャンプ6の導電膜8と直接接触するのを防止するた
め、該導電膜8の面積より大きくし、該導電膜8を全体
的に覆うようになっている。
め、ベース1とキャンプ6との間には低融点ガラス9が
設けられる。この低融点ガラス9のほぼ中央部には、ペ
レット3およびワイヤ4のポンディング領域よりやや広
い面積の開口10が形成されるようになっている。また
、低融点ガラス9はベース1上のメタライズパターン5
がキャンプ6の導電膜8と直接接触するのを防止するた
め、該導電膜8の面積より大きくし、該導電膜8を全体
的に覆うようになっている。
この導電膜8は、メタライズパターンの電位の変化によ
って隣接するメタライズパターン間に生ずる誘導性のノ
イズ(誘導電位)を吸収するために、一定の電位に固定
される。
って隣接するメタライズパターン間に生ずる誘導性のノ
イズ(誘導電位)を吸収するために、一定の電位に固定
される。
本実施例においては、第2図に示すように、導電膜8は
、半導体装置の基準電位である接地電位(GND)を供
給する接地ピン11と接触し電気的に導通しており、接
地電位とされている。このために、接地ビン11は他の
ピンよりも長く形成される。また、接触を確実にするた
めに、低融点ガラス9の開口10の周縁の一部はGND
ピン11と対応する位置のみが切欠部12として切除さ
れた構成となっている。
、半導体装置の基準電位である接地電位(GND)を供
給する接地ピン11と接触し電気的に導通しており、接
地電位とされている。このために、接地ビン11は他の
ピンよりも長く形成される。また、接触を確実にするた
めに、低融点ガラス9の開口10の周縁の一部はGND
ピン11と対応する位置のみが切欠部12として切除さ
れた構成となっている。
導電膜8の電位は、接地電位に限らず固定された電位で
あればよい。
あればよい。
したがって、導電膜8に接触するピン11の電位は、そ
の半導体装置の電源電位であってもよい。
の半導体装置の電源電位であってもよい。
したがって、本実施例の半導体装置においては、ペレッ
ト3または外部からの信号の印加によってベース1の信
号用のメタライズパターン5のいずれかの電位が急激に
変動して、隣接するメタライズパターンに電磁誘導によ
る誘導電位すなわちノイズが発生し得る状態になったと
しても、キャンプ6の裏面側(内側)に導電膜8が設け
られ、この導電膜8がGNDピン11、または電源ピン
13と電気的に導通しているので、メタライズパターン
5における電位の急激な変動に起因する電磁誘導の影響
は導電膜8により吸収され、隣接するメタライズパター
ンにおける誘導電位(ノイズ)は著しく低減できる。
ト3または外部からの信号の印加によってベース1の信
号用のメタライズパターン5のいずれかの電位が急激に
変動して、隣接するメタライズパターンに電磁誘導によ
る誘導電位すなわちノイズが発生し得る状態になったと
しても、キャンプ6の裏面側(内側)に導電膜8が設け
られ、この導電膜8がGNDピン11、または電源ピン
13と電気的に導通しているので、メタライズパターン
5における電位の急激な変動に起因する電磁誘導の影響
は導電膜8により吸収され、隣接するメタライズパター
ンにおける誘導電位(ノイズ)は著しく低減できる。
特に、本実施例では、導電膜8がキャンプ6の裏面に設
けられているので、導電膜をベースに設ける場合のよう
にベースの信号用メタライズパターンとの絶縁が困難か
つ複雑となることがな(、導電膜8とメタライズパター
ン5との絶縁はキャツブ6とベース1の接着材である低
融点ガラス9により容易かつ簡単に行うことができ、パ
ッケージの構造が簡単となり、コスト的にも有利である
。
けられているので、導電膜をベースに設ける場合のよう
にベースの信号用メタライズパターンとの絶縁が困難か
つ複雑となることがな(、導電膜8とメタライズパター
ン5との絶縁はキャツブ6とベース1の接着材である低
融点ガラス9により容易かつ簡単に行うことができ、パ
ッケージの構造が簡単となり、コスト的にも有利である
。
[効果]
(1)0本発明によれば、パッケージのキャップの裏面
側に導電膜を被着してその導電膜を接地電位または電源
電位に接続したことにより、何らかの原因でベース側の
メタライズパターンの電位が急激に変動して隣接するメ
タライズパターンに電磁誘導による誘導電位すなわちノ
イズが発生し得る状態になったとしても、この電磁誘導
による電磁誘導エネルギーは導電膜により吸収され、ノ
イズを著しく低減できる。
側に導電膜を被着してその導電膜を接地電位または電源
電位に接続したことにより、何らかの原因でベース側の
メタライズパターンの電位が急激に変動して隣接するメ
タライズパターンに電磁誘導による誘導電位すなわちノ
イズが発生し得る状態になったとしても、この電磁誘導
による電磁誘導エネルギーは導電膜により吸収され、ノ
イズを著しく低減できる。
(2)0本発明では、キャップの裏面側に導電膜が被着
されているので、この導電膜とベースのメタライズパタ
ーンとの絶縁はキャンプとベースの接着材により容易に
確保でき、パッケージの構造も簡単で、コスト面でも有
利である。
されているので、この導電膜とベースのメタライズパタ
ーンとの絶縁はキャンプとベースの接着材により容易に
確保でき、パッケージの構造も簡単で、コスト面でも有
利である。
以上本発明者によってなされた発明を実施例にもとづき
具体的に説明したが、本発明は前記実施例に限定される
ものではなく、その要旨を逸脱しない範囲で種々変更可
能であることはいうまでもない。
具体的に説明したが、本発明は前記実施例に限定される
ものではなく、その要旨を逸脱しない範囲で種々変更可
能であることはいうまでもない。
たとえば、導電膜はアルミニウムやタングステン等の蒸
着以外に、タングステンのメタライズ等で形成すること
ができる。
着以外に、タングステンのメタライズ等で形成すること
ができる。
また、導電膜と接地ピンまたは電源ピンとの電気的導通
のためには、キャンプとベースの接着材の該当部分のみ
を導電材料にすること、たとえば接着材が低融点ガラス
の時には該当部分のみに導電物質を混入して導電ガラス
とすること等も可能である。
のためには、キャンプとベースの接着材の該当部分のみ
を導電材料にすること、たとえば接着材が低融点ガラス
の時には該当部分のみに導電物質を混入して導電ガラス
とすること等も可能である。
[利用分野]
以上の説明では主として本発明者によってなされた発明
をその背景となった利用分野であるペレット受入れ用の
キャビティ付きのキャンプを有する半導体装置に適用し
た場合について説明したが、それに限定されるものでは
なく、たとえば、キャビティのないキャップを有するも
の等、封止用にキャンプを使用するものであれば様々な
形式の半導体装置に通用できる。
をその背景となった利用分野であるペレット受入れ用の
キャビティ付きのキャンプを有する半導体装置に適用し
た場合について説明したが、それに限定されるものでは
なく、たとえば、キャビティのないキャップを有するも
の等、封止用にキャンプを使用するものであれば様々な
形式の半導体装置に通用できる。
第1図は本発明による半導体装置の一実施例を示す分解
斜視図、 第2図はその一部の拡大断面図である。 1・・・ベース、2・・・ピン、3・・・ペレット、4
・・・ワイヤ、5・・・メタライズパターン、6・・・
キャップ、7・・・キャビティ、8・・・導電膜、9・
・・低融点ガラス(接着材)、10・・・開口、11・
・・接地(GND)ピン、12・・・切欠部、13・・
・電源ピン、14・・・切欠部。
斜視図、 第2図はその一部の拡大断面図である。 1・・・ベース、2・・・ピン、3・・・ペレット、4
・・・ワイヤ、5・・・メタライズパターン、6・・・
キャップ、7・・・キャビティ、8・・・導電膜、9・
・・低融点ガラス(接着材)、10・・・開口、11・
・・接地(GND)ピン、12・・・切欠部、13・・
・電源ピン、14・・・切欠部。
Claims (1)
- 【特許請求の範囲】 1、パッケージのキャンプの裏面側に導電膜を被着し、
この導電膜を接地電位または電源に接続したことを特徴
″とする半導体装置。 2、導電膜が金属蒸着膜よりなることを特徴とする特許
請求の範囲第1項記載の半導体装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58035835A JPS59161843A (ja) | 1983-03-07 | 1983-03-07 | 半導体装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP58035835A JPS59161843A (ja) | 1983-03-07 | 1983-03-07 | 半導体装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS59161843A true JPS59161843A (ja) | 1984-09-12 |
Family
ID=12453026
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP58035835A Pending JPS59161843A (ja) | 1983-03-07 | 1983-03-07 | 半導体装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS59161843A (ja) |
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH02128458A (ja) * | 1988-11-07 | 1990-05-16 | Fujitsu Ltd | 集積回路パッケージ |
EP0412528A2 (en) * | 1989-08-11 | 1991-02-13 | Fujitsu Limited | Electronic circuit package and production thereof |
US5309024A (en) * | 1991-06-06 | 1994-05-03 | Kabushiki Kaisha Toshiba | Multilayer package |
US5324985A (en) * | 1991-05-13 | 1994-06-28 | Mitsubishi Denki Kabushiki Kaisha | Packaged semiconductor device |
US5631807A (en) * | 1995-01-20 | 1997-05-20 | Minnesota Mining And Manufacturing Company | Electronic circuit structure with aperture suspended component |
-
1983
- 1983-03-07 JP JP58035835A patent/JPS59161843A/ja active Pending
Cited By (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH02128458A (ja) * | 1988-11-07 | 1990-05-16 | Fujitsu Ltd | 集積回路パッケージ |
EP0412528A2 (en) * | 1989-08-11 | 1991-02-13 | Fujitsu Limited | Electronic circuit package and production thereof |
US5324985A (en) * | 1991-05-13 | 1994-06-28 | Mitsubishi Denki Kabushiki Kaisha | Packaged semiconductor device |
US5309024A (en) * | 1991-06-06 | 1994-05-03 | Kabushiki Kaisha Toshiba | Multilayer package |
US5631807A (en) * | 1995-01-20 | 1997-05-20 | Minnesota Mining And Manufacturing Company | Electronic circuit structure with aperture suspended component |
US5689600A (en) * | 1995-01-20 | 1997-11-18 | Minnesota Mining And Manufacturing Company | Electronic circuit structure |
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