JPS5876878A - 画像表示装置の輝度制御方式 - Google Patents
画像表示装置の輝度制御方式Info
- Publication number
- JPS5876878A JPS5876878A JP17395581A JP17395581A JPS5876878A JP S5876878 A JPS5876878 A JP S5876878A JP 17395581 A JP17395581 A JP 17395581A JP 17395581 A JP17395581 A JP 17395581A JP S5876878 A JPS5876878 A JP S5876878A
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- Japan
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- memory
- pattern memory
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- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は一曽表示懺雪Ｏ１１度制御方式ＫＩＩする・コ
ンビエータＯ高速大容量化ならびに情報旭理技術と＜Ｋ
１１ｉ儂慇理技術の進歩によフて、複雑な画像の処理あ
るいは複雑高層な情報ｏＷＩＡＩＩＩ化が可能となりた
が１そのような処理結果門人間に対し適確に伝える丸め
の補助手段として、１ｉｉｉ偉表示装會には複雑多様な
表示補助機能が用いられている・これらＯ中でプリンタ
すなわち表示画像ｏｇｐｏ特定の一部を反復的に点滅さ
せる等の方法が広く用いられる・ ＠ｉｌｌはプリンク機能を備える画像表示鉄量０第１０
従来例の構成Ｓを示す・図においてｌはＣＲＴの表示面
を構成する各の画素に対応して２４ビツトずり設けられ
ｓ ＣＲＴ Ｋ ＩＩ！示する画健に対して各の画素に
表示すべき表示情報としての色信号を赤（２）、縁（２
）１青＠）の３色に分は箋各８ビットすなわち２５６段
階の輝度データとして記憶するパターン・メモリ、２＃
ｉパターン・メモリ１のＲｌＧ、ＢＯ色個号に対し各８
組ずつ設けられ後記ＮＡＮＤ回路の出力との鍮塩槍を得
るＡＮＤ回路、３はＤ／ム変換回路、４はＣＲＴの表示
面を構成する各〇−素に対応して１ビツトずつ設けられ
、ＣＲＴＫ表示する画像Ｏうちブ・リンクするパターン
に対応するｍ票を指定するコントレール・メモＩＪ％５
ｔ！コントロール・メモリ４０出力とブランキング・イ
ンターバル信号Ｓとの否定積を得るＮＡＮＤＡＮＤ回路
０ このよう゛な構成によつて、ブランキング・インターバ
ル信号Ｓが「ＯＪ Ｏときｋはパターン・メモリｌＫ記
憶される色信号がすべてＣＲＴの各の―累に表示される
ことにようてｉＩｌ儂表示がおこなわれる。ｔたブラン
キング・インターバル信号Ｓが「１」のときにはＣＲＴ
Ｋ表示された前記画像のうちコントロールメモリ４によ
うて指定される画素が非表示となるｏ’１ｌｅ）よ６Ｋ
してブリンク表示をおこなう。なお、パターンメモリ１
およびコントロール・メモリ４の配憶内容ｄ１それぞれ
、ホスト・コンビエータ（図示せず）から送られるパタ
ーン・データＰおよびコントロール・データＣＫようて
任意に書替えられる・ 籐２図はブリンク機能を備える画像表示装置の＃Ｉ２の
従来例の構成図を示し、図にシ込て３．４５は第１図に
おいて説明したとおシであシ、１′はＣＲＴＯ表示面を
構成する全１１ｉ素の各に対応して８ビツトずつ設けら
れ、ＣＲＴに表示する１偉に対応して各のｌ１ｌｉｉ素
に表示すべき表示情報として色信号を指定する８ビツト
のコードを記憶するパターンメ舌す、６はパターン・メ
モリ１′に記憶される８ビツトのコードに対応する色慣
鼻を赤（２）。
ンビエータＯ高速大容量化ならびに情報旭理技術と＜Ｋ
１１ｉ儂慇理技術の進歩によフて、複雑な画像の処理あ
るいは複雑高層な情報ｏＷＩＡＩＩＩ化が可能となりた
が１そのような処理結果門人間に対し適確に伝える丸め
の補助手段として、１ｉｉｉ偉表示装會には複雑多様な
表示補助機能が用いられている・これらＯ中でプリンタ
すなわち表示画像ｏｇｐｏ特定の一部を反復的に点滅さ
せる等の方法が広く用いられる・ ＠ｉｌｌはプリンク機能を備える画像表示鉄量０第１０
従来例の構成Ｓを示す・図においてｌはＣＲＴの表示面
を構成する各の画素に対応して２４ビツトずり設けられ
ｓ ＣＲＴ Ｋ ＩＩ！示する画健に対して各の画素に
表示すべき表示情報としての色信号を赤（２）、縁（２
）１青＠）の３色に分は箋各８ビットすなわち２５６段
階の輝度データとして記憶するパターン・メモリ、２＃
ｉパターン・メモリ１のＲｌＧ、ＢＯ色個号に対し各８
組ずつ設けられ後記ＮＡＮＤ回路の出力との鍮塩槍を得
るＡＮＤ回路、３はＤ／ム変換回路、４はＣＲＴの表示
面を構成する各〇−素に対応して１ビツトずつ設けられ
、ＣＲＴＫ表示する画像Ｏうちブ・リンクするパターン
に対応するｍ票を指定するコントレール・メモＩＪ％５
ｔ！コントロール・メモリ４０出力とブランキング・イ
ンターバル信号Ｓとの否定積を得るＮＡＮＤＡＮＤ回路
０ このよう゛な構成によつて、ブランキング・インターバ
ル信号Ｓが「ＯＪ Ｏときｋはパターン・メモリｌＫ記
憶される色信号がすべてＣＲＴの各の―累に表示される
ことにようてｉＩｌ儂表示がおこなわれる。ｔたブラン
キング・インターバル信号Ｓが「１」のときにはＣＲＴ
Ｋ表示された前記画像のうちコントロールメモリ４によ
うて指定される画素が非表示となるｏ’１ｌｅ）よ６Ｋ
してブリンク表示をおこなう。なお、パターンメモリ１
およびコントロール・メモリ４の配憶内容ｄ１それぞれ
、ホスト・コンビエータ（図示せず）から送られるパタ
ーン・データＰおよびコントロール・データＣＫようて
任意に書替えられる・ 籐２図はブリンク機能を備える画像表示装置の＃Ｉ２の
従来例の構成図を示し、図にシ込て３．４５は第１図に
おいて説明したとおシであシ、１′はＣＲＴＯ表示面を
構成する全１１ｉ素の各に対応して８ビツトずつ設けら
れ、ＣＲＴに表示する１偉に対応して各のｌ１ｌｉｉ素
に表示すべき表示情報として色信号を指定する８ビツト
のコードを記憶するパターンメ舌す、６はパターン・メ
モリ１′に記憶される８ビツトのコードに対応する色慣
鼻を赤（２）。
縁Ｕ、青田）の３色に分は各８ビツトすなわち２５６段
階の１１度データとして記憶するテーブル、２′はテー
ブルｓ ｏ Ｒｅ Ｇ ｅ Ｂ ｏ各出力に対し８組ず
つ設けられＮＡＮＤＡＮＤ回路力との論理積を得るＡＮ
Ｄ回路である・ このような構ａＫよフで１ｈ前記ａｔ！１の従来例と同
＠にブリンク−をおこなうことができる・ｉ・ＩＩ記無
２の従来例は菖１の従来例に比し、約区ビットのテーブ
ル６を採用することによって１パターン・メモリの配憶
容量な１７３に減少したもＯである・しかじ前記いずれ
の従来例においてもコントロール・メモ１ＪＡｔ必１１
１．、フントロール・メモリ４の記憶容量は、例えばＣ
ＲＴＯ表示ｆｆ１ｔ＃ｇｆ、ル全１１累ｄ；１０２４Ｘ
１０２４であれば−１Ｍビットを必要とするものである
０ 本発明は齢記従来例におけるような大容量のコントロー
ル・メモリを備えることなくブリンクを可能とする画像
表示ＩｆｃｆＩＬ１に提供することを目的とする０ すなわち、不発明においてＦｉｃＲＴ表示情報をコード
にようて記憶するパターン・メモリと、前記コードに対
応する表示情報を記憶するテーブルとを備え、ｌｔＩ記
パターン・メモリと前記テーブルとによりて定まる画像
をＣＲＴに表示する装置において、餉記テーブルに記憶
する表示情報にブリンク信号を含めて記憶し、前記パタ
ーン・メモリに記憶されるコードに応じて対応するＣＲ
Ｔの１累をブリンクするようｋしたものであるＯ以下、
本発明の要旨ｔ−ａｇ＋ｘ示す実施例によつて具体的に
説明する・ 第ＳＩＱは本発明実施例Ｏ基本＊ｇ−を示し、図におい
て１“ＦｉｃＲＴｃ）表示面を構成する１０２４Ｘ１０
２４の１累の各に対応して８ビツトずつ設け１うち舎１
から＃７までの７ビツトにはＣＲＴｆｉ示情轍のうち色
信号のコードを記憶し、φ８の１ビツトにはＣＲＴ表示
情報のうちブリンク対象ｌｌｌ１素を示すコード１に記
憶するパターン・メモリ％６′はパターン・メモリ１’
に記憶される８ビツトのコードに対応する表示情報を一
色傷号については赤（２）、縁（Ｇ）ｌ（Ｂ）の３色に
分け（各８ビツトのデータとして、またブリンク信号（
２）については１ビツトによりて記憶し、パターン・メ
モリ１＃から送られるコードに応じてＲ，Ｇ、Ｂおよび
Ｄを出力するテーブル、２′はテーブル６′の出力Ｒ，
Ｇ、ＢＣＩ４！ｒＫ対し８組ずつ設けられ１これらの色
信号と後記ＮＡＮＤＡＮＤ回路との論理和を得るＡＮＤ
＠路、３はＡＮＤ回路２′Ｙｔ経て送られるＲ、Ｇ、Ｂ
の各８ビツトのデータをアナログ値に変換してＣ’ＲＴ
Ｋ供給するＤ／Ａ変換回路、５′はテーブル６′の出力
りとブランキング・インターバル信号Ｓとの否足積を得
るＮＡＮＤ回路である。なお、第４図にパターン・メモ
リ１“とテーブル６′との対応を示す０ 以上のような構成によりて、ブランキング・インターバ
ルＳ号Ｓが「０」のときＫは、パターン・メモリ１”Ｋ
配憶されているコードに対応する色信号はすべてＣＲＴ
の対応する画素に表示される・また、ブランキング・イ
ンターバル信号Ｓが「１」のときに、け、パターン・メ
モリｌ“に記憶されているコードのうち、参８のブリン
ク対象＠素を示すビットが「０」となりているものによ
りて指定されｂ色信号＃１ＣＲＴの対応する画素に表示
されるが、ブリンク対象画素を示すビットが「１」とな
っているものによりて指定される色信号は非表示となる
。このようにしてブリンク表示をおこなう０上記実施例
においては、パターン・メモリ１′に記憶されている８
ビツトのコードの中の特定の参８ビットをブリンク対象
ｉｌ！ｌｓの記憶のみに充て、その内容のみによりてテ
ーブル６′のブリンク信号りをｈ足している口 これに対し、第５ＷＡに示すように、パターン・メ、４
１７１“のすべてのビットを色信号指定ノコードに用い
るとともに、これら２５６檜類のコードの中０１予め定
めた任意のコードによマてブリンク信号りを指定するよ
うにすることもできる０すなわち１この例によれば、予
め足めた色をブリンクすることができる０ また、菖６図に示すように、７ビツト管色信号指定のコ
ードに用い、他の１ビツトをブリンク対象ｍｓの記憶の
みに充”てるとともに、色信号指定ｄコードの中の予め
定めた任意のコードと前記他の１ビツトの内容とによっ
てブリンク信号りを指定するようｋすることもできる０
すなわち、この例によれば、予め定めたパターンの中の
予め定めた色をブリンクすることができる０ 以上説明したように、本発明によれば、ＣＲＴのｌｉ！
ｌＩｓ数に相当する記憶容置のコントロール・メモリを
備えることなく、しかも多様なブリンクをおこなうこと
ができる＠
階の１１度データとして記憶するテーブル、２′はテー
ブルｓ ｏ Ｒｅ Ｇ ｅ Ｂ ｏ各出力に対し８組ず
つ設けられＮＡＮＤＡＮＤ回路力との論理積を得るＡＮ
Ｄ回路である・ このような構ａＫよフで１ｈ前記ａｔ！１の従来例と同
＠にブリンク−をおこなうことができる・ｉ・ＩＩ記無
２の従来例は菖１の従来例に比し、約区ビットのテーブ
ル６を採用することによって１パターン・メモリの配憶
容量な１７３に減少したもＯである・しかじ前記いずれ
の従来例においてもコントロール・メモ１ＪＡｔ必１１
１．、フントロール・メモリ４の記憶容量は、例えばＣ
ＲＴＯ表示ｆｆ１ｔ＃ｇｆ、ル全１１累ｄ；１０２４Ｘ
１０２４であれば−１Ｍビットを必要とするものである
０ 本発明は齢記従来例におけるような大容量のコントロー
ル・メモリを備えることなくブリンクを可能とする画像
表示ＩｆｃｆＩＬ１に提供することを目的とする０ すなわち、不発明においてＦｉｃＲＴ表示情報をコード
にようて記憶するパターン・メモリと、前記コードに対
応する表示情報を記憶するテーブルとを備え、ｌｔＩ記
パターン・メモリと前記テーブルとによりて定まる画像
をＣＲＴに表示する装置において、餉記テーブルに記憶
する表示情報にブリンク信号を含めて記憶し、前記パタ
ーン・メモリに記憶されるコードに応じて対応するＣＲ
Ｔの１累をブリンクするようｋしたものであるＯ以下、
本発明の要旨ｔ−ａｇ＋ｘ示す実施例によつて具体的に
説明する・ 第ＳＩＱは本発明実施例Ｏ基本＊ｇ−を示し、図におい
て１“ＦｉｃＲＴｃ）表示面を構成する１０２４Ｘ１０
２４の１累の各に対応して８ビツトずつ設け１うち舎１
から＃７までの７ビツトにはＣＲＴｆｉ示情轍のうち色
信号のコードを記憶し、φ８の１ビツトにはＣＲＴ表示
情報のうちブリンク対象ｌｌｌ１素を示すコード１に記
憶するパターン・メモリ％６′はパターン・メモリ１’
に記憶される８ビツトのコードに対応する表示情報を一
色傷号については赤（２）、縁（Ｇ）ｌ（Ｂ）の３色に
分け（各８ビツトのデータとして、またブリンク信号（
２）については１ビツトによりて記憶し、パターン・メ
モリ１＃から送られるコードに応じてＲ，Ｇ、Ｂおよび
Ｄを出力するテーブル、２′はテーブル６′の出力Ｒ，
Ｇ、ＢＣＩ４！ｒＫ対し８組ずつ設けられ１これらの色
信号と後記ＮＡＮＤＡＮＤ回路との論理和を得るＡＮＤ
＠路、３はＡＮＤ回路２′Ｙｔ経て送られるＲ、Ｇ、Ｂ
の各８ビツトのデータをアナログ値に変換してＣ’ＲＴ
Ｋ供給するＤ／Ａ変換回路、５′はテーブル６′の出力
りとブランキング・インターバル信号Ｓとの否足積を得
るＮＡＮＤ回路である。なお、第４図にパターン・メモ
リ１“とテーブル６′との対応を示す０ 以上のような構成によりて、ブランキング・インターバ
ルＳ号Ｓが「０」のときＫは、パターン・メモリ１”Ｋ
配憶されているコードに対応する色信号はすべてＣＲＴ
の対応する画素に表示される・また、ブランキング・イ
ンターバル信号Ｓが「１」のときに、け、パターン・メ
モリｌ“に記憶されているコードのうち、参８のブリン
ク対象＠素を示すビットが「０」となりているものによ
りて指定されｂ色信号＃１ＣＲＴの対応する画素に表示
されるが、ブリンク対象画素を示すビットが「１」とな
っているものによりて指定される色信号は非表示となる
。このようにしてブリンク表示をおこなう０上記実施例
においては、パターン・メモリ１′に記憶されている８
ビツトのコードの中の特定の参８ビットをブリンク対象
ｉｌ！ｌｓの記憶のみに充て、その内容のみによりてテ
ーブル６′のブリンク信号りをｈ足している口 これに対し、第５ＷＡに示すように、パターン・メ、４
１７１“のすべてのビットを色信号指定ノコードに用い
るとともに、これら２５６檜類のコードの中０１予め定
めた任意のコードによマてブリンク信号りを指定するよ
うにすることもできる０すなわち１この例によれば、予
め足めた色をブリンクすることができる０ また、菖６図に示すように、７ビツト管色信号指定のコ
ードに用い、他の１ビツトをブリンク対象ｍｓの記憶の
みに充”てるとともに、色信号指定ｄコードの中の予め
定めた任意のコードと前記他の１ビツトの内容とによっ
てブリンク信号りを指定するようｋすることもできる０
すなわち、この例によれば、予め定めたパターンの中の
予め定めた色をブリンクすることができる０ 以上説明したように、本発明によれば、ＣＲＴのｌｉ！
ｌＩｓ数に相当する記憶容置のコントロール・メモリを
備えることなく、しかも多様なブリンクをおこなうこと
ができる＠
＠１図および第２図は従来例、第３図は本発明のそれぞ
れ構成図を示し、これらのＩｌＩにおいて１゜１’＊１
”ｔｌ’ターン・メモリ、ｌｊコントロール・メモリ、
６ｇ６’はテーブルである。第４ｍ。 第５図、第６図はパターンメモリ１“とテーブル６′と
の各種の対応例を示す・ 第１図 １１３ 図 第 ４ 図 第 ５図
れ構成図を示し、これらのＩｌＩにおいて１゜１’＊１
”ｔｌ’ターン・メモリ、ｌｊコントロール・メモリ、
６ｇ６’はテーブルである。第４ｍ。 第５図、第６図はパターンメモリ１“とテーブル６′と
の各種の対応例を示す・ 第１図 １１３ 図 第 ４ 図 第 ５図
Claims (1)
- （１）ＣＲＴの表示面を構成するｔｉｔ；の各に対応し
て設けられ、各の画素に表示する表示情味を指定するフ
ードを記憶するパターン・メモリと、前記コードに対応
する表示情報を記憶するテーブルとを備え一前記パター
ン・メモリと前記テーブルとにようて足まる画像をＣＲ
ＴＫ表示する装置において、前記テーブルに記憶する表
示情報にプリンク信号を含めて記憶し、前記パターン・
メモリに記憶きれるコードに応じて、対応するＣＲＴＯ
画素をブリ、ンクすることを特徴とする＠僧表示装置の
輝度制御方式。 セ）パター／・メモリに記憶されるコードの特定のビッ
トに応じて、対応する画素をプリンクすることを特徴と
する特許請求の範囲１ｇ１項の画備表示装置の輝度制御
方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17395581A JPS5876878A (ja) | 1981-10-30 | 1981-10-30 | 画像表示装置の輝度制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP17395581A JPS5876878A (ja) | 1981-10-30 | 1981-10-30 | 画像表示装置の輝度制御方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5876878A true JPS5876878A (ja) | 1983-05-10 |
Family
ID=15970146
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP17395581A Pending JPS5876878A (ja) | 1981-10-30 | 1981-10-30 | 画像表示装置の輝度制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5876878A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60235195A (ja) * | 1984-05-09 | 1985-11-21 | 株式会社日立製作所 | 図形表示装置 |
-
1981
- 1981-10-30 JP JP17395581A patent/JPS5876878A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60235195A (ja) * | 1984-05-09 | 1985-11-21 | 株式会社日立製作所 | 図形表示装置 |
| JPH0327915B2 (ja) * | 1984-05-09 | 1991-04-17 | Hitachi Ltd |
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