JPS5871615A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
- Publication number
- JPS5871615A JPS5871615A JP16947281A JP16947281A JPS5871615A JP S5871615 A JPS5871615 A JP S5871615A JP 16947281 A JP16947281 A JP 16947281A JP 16947281 A JP16947281 A JP 16947281A JP S5871615 A JPS5871615 A JP S5871615A
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- JP
- Japan
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- semiconductor
- pattern
- film
- semiconductor device
- manufacturing
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
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- Formation Of Insulating Films (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は半導体ウェハーの有する電気的特性の良・不良
の半導体素子を容易に識別し得る構造を備え九牛導体装
置の製造方法に関するものである。
の半導体素子を容易に識別し得る構造を備え九牛導体装
置の製造方法に関するものである。
従来、半導体基板に半導体素子を形成した後、前記半導
体素子を個々に分離する半導体装置の製造に於いて、前
記半導体素子の電気的特性は、半導体ウェハーの状態の
11で測定することが一般的である。この場合、電気的
特性不良の半導体素子には骸不喪牛導体素子上の中央部
分にレーザーなどによりキズをつけて外観的不要とし、
個々に分離した後、目視或いは自動的に認識させて良・
不&を識別すゐ。
体素子を個々に分離する半導体装置の製造に於いて、前
記半導体素子の電気的特性は、半導体ウェハーの状態の
11で測定することが一般的である。この場合、電気的
特性不良の半導体素子には骸不喪牛導体素子上の中央部
分にレーザーなどによりキズをつけて外観的不要とし、
個々に分離した後、目視或いは自動的に認識させて良・
不&を識別すゐ。
従来の半導体装置では、配線パターンによっては、キズ
が非常に識別し離いものとなり、個々に分離する過程で
良・不良の判定が困難となる場合がある。また、キズの
大きさが不均一になり易く、自動認識機を適用するとき
一部が生じ易い欠点がある。
が非常に識別し離いものとなり、個々に分離する過程で
良・不良の判定が困難となる場合がある。また、キズの
大きさが不均一になり易く、自動認識機を適用するとき
一部が生じ易い欠点がある。
本発明の目的は、従来の半導体装置に見られた上記欠点
を除き、組立工11に於いて、電気的良・不良の判定を
容易にし、且つ自動認識機の適用を可能とする半導体装
置の製造方法を提供することKある。
を除き、組立工11に於いて、電気的良・不良の判定を
容易にし、且つ自動認識機の適用を可能とする半導体装
置の製造方法を提供することKある。
本発明の半導体装置の製造方法は、半導体素子の表面に
於いて、その中央部分に、或いは電極部とその両側を含
む全域を除いた部分に、ポリイミド系の有機物絶縁膜を
被覆して不良刻印用の領域を有し、ここに不要刻印を可
能ならしめる構造を形成することt−特徴とする。
於いて、その中央部分に、或いは電極部とその両側を含
む全域を除いた部分に、ポリイミド系の有機物絶縁膜を
被覆して不良刻印用の領域を有し、ここに不要刻印を可
能ならしめる構造を形成することt−特徴とする。
以下に本発明を実施例により説明する。
第1図乃至第3図は本発明の一実施例の半導体装置の製
造方法を説明する断面図であゐ。まず、第1図のように
絶縁膜1上に電極2並びに内部配[3を形成し九半導体
基板4を用意する0次に第2図に示すようKこの半導体
基板4の表面にポリイミド膜5を全面に塗布して形成す
る。次に、写真蝕刻法で使用するフォト・レジスト膜を
パターン6に選択的に付着させて所望のパターンを形成
する。次に、第3図に示すように1ポリイミド膜St例
えばヒドラジンでエツチングし、フォト書レジスト膜を
除去して所望のパターン6t−形成する。第4図として
、本実施例による半導体装置の平面図を示し1.このポ
リイミド膜5のパターン6に不要刻印を行う。
造方法を説明する断面図であゐ。まず、第1図のように
絶縁膜1上に電極2並びに内部配[3を形成し九半導体
基板4を用意する0次に第2図に示すようKこの半導体
基板4の表面にポリイミド膜5を全面に塗布して形成す
る。次に、写真蝕刻法で使用するフォト・レジスト膜を
パターン6に選択的に付着させて所望のパターンを形成
する。次に、第3図に示すように1ポリイミド膜St例
えばヒドラジンでエツチングし、フォト書レジスト膜を
除去して所望のパターン6t−形成する。第4図として
、本実施例による半導体装置の平面図を示し1.このポ
リイミド膜5のパターン6に不要刻印を行う。
上記実施例では不良刻印用絶縁性有機物膜としてポリイ
ンド樹脂を用い九場合を説明したが、ビスマレミイド、
ビスマイミイド−M、−M−20゜−D、−8,−Tな
どがありどの樹脂を用いても良<、1九写真蝕刻用の7
オトφレジストを用いても本発明の効果は失なわれない
。
ンド樹脂を用い九場合を説明したが、ビスマレミイド、
ビスマイミイド−M、−M−20゜−D、−8,−Tな
どがありどの樹脂を用いても良<、1九写真蝕刻用の7
オトφレジストを用いても本発明の効果は失なわれない
。
以上詳細に説明し九ように1本発明は、あらかじめ半導
体素子の表面上に絶縁性有機物膜管形成させておき、し
かる後に電気的特性の測定を行なうものであるから、配
線パターンの構造如何Kかかわらずレーず−などによる
キズの電気的不要打点の大きさが安定し、嵐・不要の判
定を自動認識の場合に於いても容易くお仁ない得る。ま
え、絶縁性有機物膜の存在によりて、電気的不良打点時
に飛散する配線の金属屑や半導体基板のシリコン屑など
によって隣接する半導体素子が汚染されるのを防止する
ことができる。更には、容易に打点の大きさを制御でき
ることから、必要以上の打点強度が不要となり、レーず
一打点の場合に見られ良電気特性測定後の半導体ウェハ
ーの洗浄工程に於ける破損を防止することができる。こ
れらの利点によって半導体装置の製造歩留並びに品質を
高め、ひいては製造価格を下げることができる。
体素子の表面上に絶縁性有機物膜管形成させておき、し
かる後に電気的特性の測定を行なうものであるから、配
線パターンの構造如何Kかかわらずレーず−などによる
キズの電気的不要打点の大きさが安定し、嵐・不要の判
定を自動認識の場合に於いても容易くお仁ない得る。ま
え、絶縁性有機物膜の存在によりて、電気的不良打点時
に飛散する配線の金属屑や半導体基板のシリコン屑など
によって隣接する半導体素子が汚染されるのを防止する
ことができる。更には、容易に打点の大きさを制御でき
ることから、必要以上の打点強度が不要となり、レーず
一打点の場合に見られ良電気特性測定後の半導体ウェハ
ーの洗浄工程に於ける破損を防止することができる。こ
れらの利点によって半導体装置の製造歩留並びに品質を
高め、ひいては製造価格を下げることができる。
第1図乃至第3図は本発明の一実施例の半導体装置の製
造過sea明する断面図である。第4図は本実施例によ
る半導体装置の平面図である。 1・・・・・・絶縁膜、2・・・・・・電極、3・・・
・・・内部配線、4・・・・・・半導体基板、5・・・
・・・ポリイきド膜、6・・・・・・フォト・レジスト
膜。 事7図
造過sea明する断面図である。第4図は本実施例によ
る半導体装置の平面図である。 1・・・・・・絶縁膜、2・・・・・・電極、3・・・
・・・内部配線、4・・・・・・半導体基板、5・・・
・・・ポリイきド膜、6・・・・・・フォト・レジスト
膜。 事7図
Claims (1)
- 半導体素子の表面の一部に電気的不要刻印用絶縁性有機
物膜を備えさせ、ことに不良刻印を行い、しかる後に電
気的特性不良の半導体素子を良品のそれと分離すること
t−特徴とする半導体装置の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP16947281A JPS5871615A (ja) | 1981-10-23 | 1981-10-23 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP16947281A JPS5871615A (ja) | 1981-10-23 | 1981-10-23 | 半導体装置の製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS5871615A true JPS5871615A (ja) | 1983-04-28 |
Family
ID=15887184
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP16947281A Pending JPS5871615A (ja) | 1981-10-23 | 1981-10-23 | 半導体装置の製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5871615A (ja) |
-
1981
- 1981-10-23 JP JP16947281A patent/JPS5871615A/ja active Pending
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