JPS5839366A - デ−タ合成処理方式 - Google Patents
デ−タ合成処理方式Info
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- JPS5839366A JPS5839366A JP56136701A JP13670181A JPS5839366A JP S5839366 A JPS5839366 A JP S5839366A JP 56136701 A JP56136701 A JP 56136701A JP 13670181 A JP13670181 A JP 13670181A JP S5839366 A JPS5839366 A JP S5839366A
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- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06Q—INFORMATION AND COMMUNICATION TECHNOLOGY [ICT] SPECIALLY ADAPTED FOR ADMINISTRATIVE, COMMERCIAL, FINANCIAL, MANAGERIAL OR SUPERVISORY PURPOSES; SYSTEMS OR METHODS SPECIALLY ADAPTED FOR ADMINISTRATIVE, COMMERCIAL, FINANCIAL, MANAGERIAL OR SUPERVISORY PURPOSES, NOT OTHERWISE PROVIDED FOR
- G06Q30/00—Commerce
- G06Q30/04—Billing or invoicing
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- Business, Economics & Management (AREA)
- Development Economics (AREA)
- Accounting & Taxation (AREA)
- Economics (AREA)
- Finance (AREA)
- Marketing (AREA)
- Strategic Management (AREA)
- Physics & Mathematics (AREA)
- General Business, Economics & Management (AREA)
- General Physics & Mathematics (AREA)
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Processing Or Creating Images (AREA)
- Document Processing Apparatus (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明はデータ合成処理方式に関し、特に定型データと
非定型データの合成をソフトウェアに負く 担をかけることな郊効果的に行なえるようにしたデータ
合成処理方式に関する。
非定型データの合成をソフトウェアに負く 担をかけることな郊効果的に行なえるようにしたデータ
合成処理方式に関する。
通信側−を用いて電子計算機組織とデータ伝送を行な５
ｍ末装厘Ｉ／ｉ１紙に残せる出力装置としては一般にシ
リアルプリンタ、ラインプリンタが用いられている。し
かし近年、文字ばかシではなく。
ｍ末装厘Ｉ／ｉ１紙に残せる出力装置としては一般にシ
リアルプリンタ、ラインプリンタが用いられている。し
かし近年、文字ばかシではなく。
イメージそのものも出力でき、価格も安−ＦＡＸを端末
装置とする考え方が出てきている。第１凶４ＣＦＡＸを
端末としたシステムを示す。４４１図において、ｌは中
央処理装＊（ＯＰυ入Ｓは通信制備装［（００（Ｊ）、
８はコードデーメ、イメージデータなどを格納しである
ディスクメモリ、４はＦＡＸと交信する九めの変復調装
ｆｉ（ＦＯ［Ｊ）、５は網制御装置（ＮＯＵ） 、６は
交換砿、７は公衆通信側−１８はＦＡＸである。ＯＯＵ
の１ｇＩ、１１数はＦバの数、及び愛用頻度によって決
められる。
装置とする考え方が出てきている。第１凶４ＣＦＡＸを
端末としたシステムを示す。４４１図において、ｌは中
央処理装＊（ＯＰυ入Ｓは通信制備装［（００（Ｊ）、
８はコードデーメ、イメージデータなどを格納しである
ディスクメモリ、４はＦＡＸと交信する九めの変復調装
ｆｉ（ＦＯ［Ｊ）、５は網制御装置（ＮＯＵ） 、６は
交換砿、７は公衆通信側−１８はＦＡＸである。ＯＯＵ
の１ｇＩ、１１数はＦバの数、及び愛用頻度によって決
められる。
ＦＡＸはプリンタと異な）、もともと文字という単位は
ない。すべてドツトの集合として表わされる。従ってア
ルファ／二島−メリック（α／Ｎ）漢字、記号、グラフ
蒙罫＃、白黒反転−拡大縮少−イメージデータ（手書き
文字、印など）に対して自由に表現できる。
ない。すべてドツトの集合として表わされる。従ってア
ルファ／二島−メリック（α／Ｎ）漢字、記号、グラフ
蒙罫＃、白黒反転−拡大縮少−イメージデータ（手書き
文字、印など）に対して自由に表現できる。
プリンタの場合は、α／ Ｎ ｏ漢字の出力しかできな
いため１例えば第３図１ａ）Ｋ示すような伝票の定型用
紙をあらかじめ印刷しておき、位ｔ１１あわせを行なっ
たあと印字している。しかし多撞少畝の伝票をあつか５
Ｊｊ！合は用紙をいろいろとりかえなければならない。
いため１例えば第３図１ａ）Ｋ示すような伝票の定型用
紙をあらかじめ印刷しておき、位ｔ１１あわせを行なっ
たあと印字している。しかし多撞少畝の伝票をあつか５
Ｊｊ！合は用紙をいろいろとりかえなければならない。
ＦＡＸは罫艇會文字の拡大縮少・イメージのω力などが
自由にできるため、定型用紙を用いなくても、ＦＡＸ自
身でこれを作ることができる。第２図１４に示す定型の
データ（コードデータ）に、第８図（−に示す客先ごと
に変わる可変データ（コードデータ）を督き込み、系Ｓ
図（Ｃｊの如く作成して、それをドツトイメージに変換
して送信してやればよい。しかし、この操作をソフトウ
ェアで行なうには負荷が大きくな９、他の処理に影響を
与えることＫなる。それは、一般に定型データは何種類
もあるであろうし、各１ｇｌ？ｍごとに異なる伝票を送
出する場合は、その都度異なる定型データと可変データ
を合成しなければならないからである。
自由にできるため、定型用紙を用いなくても、ＦＡＸ自
身でこれを作ることができる。第２図１４に示す定型の
データ（コードデータ）に、第８図（−に示す客先ごと
に変わる可変データ（コードデータ）を督き込み、系Ｓ
図（Ｃｊの如く作成して、それをドツトイメージに変換
して送信してやればよい。しかし、この操作をソフトウ
ェアで行なうには負荷が大きくな９、他の処理に影響を
与えることＫなる。それは、一般に定型データは何種類
もあるであろうし、各１ｇｌ？ｍごとに異なる伝票を送
出する場合は、その都度異なる定型データと可変データ
を合成しなければならないからである。
第８図にＡ４の用紙の行数１列数の与え方の１例を示す
。７６列・４８行に区切った場合は８６４８の領域がで
きる。通常α／Ｎは１文字を１領域、漢字は１文字を１
領域で表わす。１ｌｉｉｊｌｉｌｉの合成には４にバイ
ト弱のデータを２つ扱わねばならない。
。７６列・４８行に区切った場合は８６４８の領域がで
きる。通常α／Ｎは１文字を１領域、漢字は１文字を１
領域で表わす。１ｌｉｉｊｌｉｌｉの合成には４にバイ
ト弱のデータを２つ扱わねばならない。
また定型データは何回も使用する之め一度別の領域に足
型データを移してから可変データを書込むようにしなけ
ればならない・データ量が多いため写しをとるだけでも
かな夛の負荷となる。
型データを移してから可変データを書込むようにしなけ
ればならない・データ量が多いため写しをとるだけでも
かな夛の負荷となる。
以上のことから、ＯＰＵのソフトウェアでは合成は行な
わず、通値ｉｔｔ制御装置００Ｌ１円で合成した方が、
ＯＰＵのソフトウェアの負荷が減るのは明白である。す
なわち、いくつかの定型データをあらかじめｏｏｕＦＦ
３のメモリ忙格納しておき、ソフトウェアからは可変デ
ータ及び！ｉ型データの種別を送るのみで、０００円の
プロセ、すがそれらを合成する。ＯＰＵのソフトウェア
は毎同定型データを扱う必ＪｆＩがなくなるので負荷が
減少する。
わず、通値ｉｔｔ制御装置００Ｌ１円で合成した方が、
ＯＰＵのソフトウェアの負荷が減るのは明白である。す
なわち、いくつかの定型データをあらかじめｏｏｕＦＦ
３のメモリ忙格納しておき、ソフトウェアからは可変デ
ータ及び！ｉ型データの種別を送るのみで、０００円の
プロセ、すがそれらを合成する。ＯＰＵのソフトウェア
は毎同定型データを扱う必ＪｆＩがなくなるので負荷が
減少する。
しかし、０００側から見ると定型データと可変データの
合成を毎回性なわねばならず、単にＯＰＵのソフトウェ
アの負荷が０ＯＬＩに分散された友けである。ＯＯＵの
石垣能力はＯＰＵのそれに比較して小さいので、何らか
の対策が必要となる・本発明はよ紀の点を考慮して、定
型データと可変データの合成をプルグラムで意識するこ
となく効率的に行なうことを目的とし、そしてそのため
本発明は、同一の大きさの定型データ格納領域が連続し
て豪数個もうけられる定型データ格納用メモリと、上記
個々の定型データ格納領域と同一の大きさを有する非足
型データ格納領域が連続して複ａｍもうけられる非定型
データ格納用メモリと与えられた論理アドレスをよ紀定
型データ格納用メモリアクセス用の物理アドレスへ変換
し該定型データ格納用メモリからの読出しを行なう手段
と、与えられた論理アドレスを上記非足型データ格納用
メモリアクセス用の物理アドレスへ変換し、該非定型デ
ータ格納用メモリからの絖出しを行なう手段と、上記定
型データ格納用メモリからの絖出し出力と上記非定型デ
ータ格納用メモリからの読出し出力とが与えられる共通
のデータバスとをＭし、与えられ九＊理アドレスに基づ
いて上記足型データ格納用メモリのＰ′３８と上記非定
型データ格納用メモリの内容とを同時に上記データバス
に絖出すことによシ、定型データと非定型データの合成
された出力データを得るようにしたことを特徴とする。
合成を毎回性なわねばならず、単にＯＰＵのソフトウェ
アの負荷が０ＯＬＩに分散された友けである。ＯＯＵの
石垣能力はＯＰＵのそれに比較して小さいので、何らか
の対策が必要となる・本発明はよ紀の点を考慮して、定
型データと可変データの合成をプルグラムで意識するこ
となく効率的に行なうことを目的とし、そしてそのため
本発明は、同一の大きさの定型データ格納領域が連続し
て豪数個もうけられる定型データ格納用メモリと、上記
個々の定型データ格納領域と同一の大きさを有する非足
型データ格納領域が連続して複ａｍもうけられる非定型
データ格納用メモリと与えられた論理アドレスをよ紀定
型データ格納用メモリアクセス用の物理アドレスへ変換
し該定型データ格納用メモリからの読出しを行なう手段
と、与えられた論理アドレスを上記非足型データ格納用
メモリアクセス用の物理アドレスへ変換し、該非定型デ
ータ格納用メモリからの絖出しを行なう手段と、上記定
型データ格納用メモリからの絖出し出力と上記非定型デ
ータ格納用メモリからの読出し出力とが与えられる共通
のデータバスとをＭし、与えられ九＊理アドレスに基づ
いて上記足型データ格納用メモリのＰ′３８と上記非定
型データ格納用メモリの内容とを同時に上記データバス
に絖出すことによシ、定型データと非定型データの合成
された出力データを得るようにしたことを特徴とする。
第４図に本発明の概念図を示す０図中、９は足型データ
の格納されているメモリ、ｌＯは各回耐ごとの可変デー
タの格納されているメモリである。
の格納されているメモリ、ｌＯは各回耐ごとの可変デー
タの格納されているメモリである。
（Ａ）で示すアドレスはメモリの実アドレス、（Ｂ）で
示すアドレスはプロセッサから見える論理アドレスであ
る。定型データ、可変データとも４に飴ごとにブロック
化され、論理アドレスは各ブロックともナベてＸ’００
００／〜Ｘ’ＯＦ Ｆ Ｆ’に割付けられている。合成
する場合はまず定型データを選択するためにプロセッサ
はＰＴＮレジスタ（後述ンにパターンの番号を書込む。
示すアドレスはプロセッサから見える論理アドレスであ
る。定型データ、可変データとも４に飴ごとにブロック
化され、論理アドレスは各ブロックともナベてＸ’００
００／〜Ｘ’ＯＦ Ｆ Ｆ’に割付けられている。合成
する場合はまず定型データを選択するためにプロセッサ
はＰＴＮレジスタ（後述ンにパターンの番号を書込む。
また可変データは−現在処理を行なっている回一番号を
示すレジスタによって自動的に、その同様の可変データ
領域が選択されてｂる。この状態でプロセッサかＸ’０
０００ ／〜Ｘ’ＯＰ Ｐ ＰＩＯＩＪ域をＲｔｒトｓ
９．１Ｇのメモリの出力がオア（ＯＲ）されてプロ
セッサ内のアキ島ムレータに転送されるので、あたかも
すでに合成されているデータをｔＲ出しているのと同じ
結果が得られる。すべての定型データ、可変データとも
同一の大きさの領域に割当てであるので任意の組合せが
可能である。
示すレジスタによって自動的に、その同様の可変データ
領域が選択されてｂる。この状態でプロセッサかＸ’０
０００ ／〜Ｘ’ＯＰ Ｐ ＰＩＯＩＪ域をＲｔｒトｓ
９．１Ｇのメモリの出力がオア（ＯＲ）されてプロ
セッサ内のアキ島ムレータに転送されるので、あたかも
すでに合成されているデータをｔＲ出しているのと同じ
結果が得られる。すべての定型データ、可変データとも
同一の大きさの領域に割当てであるので任意の組合せが
可能である。
＃Ｉ５凶に本発明の一″一実施例を示す。図中、ｌは０
ＰＬＪ本体、１１はプ田セッサ、１２ｒｉメインメモリ
（Ｍ８）％ｌＪＩはキャラクタジェネレータ（ＣＧ）で
ある０８′は００Ｕ、１４はプロセッサ二ニット（ＰＵ
）、１！ｉＦｉ１ｇｌ＃ごとのツインアダプタ（ＬＡ）
である、Ｐ［７円の１６はマイクログロセッサユニット
（ＭＰＵ）、９Ｆｉ定型データを格納するパーマネント
データメモリ（ＰＤＭ）、１Ｇは可変データを格納する
６（リアプル・データ・メモリ（ＶＤＭ）、１７は回縁
ごとの制御情報を格納しであるツイン・コントロール・
ワード（ＬＣ■）、１８はＭＰＵの制御メモリ（０８）
、１９はＯＰＵとのデータの転送の制御を行なうインク
フェース−コントロールＯユニット（ＩＦＯ）’ｔ’あ
るｅＬＡ円の２０．２１は行バツフアであシ、合成され
たコードデータの一行分をドツトパターンに変換して格
納するメモリである。２つあるのは一方を作成中、他方
のデータをｌ−に送出するためである。
ＰＬＪ本体、１１はプ田セッサ、１２ｒｉメインメモリ
（Ｍ８）％ｌＪＩはキャラクタジェネレータ（ＣＧ）で
ある０８′は００Ｕ、１４はプロセッサ二ニット（ＰＵ
）、１！ｉＦｉ１ｇｌ＃ごとのツインアダプタ（ＬＡ）
である、Ｐ［７円の１６はマイクログロセッサユニット
（ＭＰＵ）、９Ｆｉ定型データを格納するパーマネント
データメモリ（ＰＤＭ）、１Ｇは可変データを格納する
６（リアプル・データ・メモリ（ＶＤＭ）、１７は回縁
ごとの制御情報を格納しであるツイン・コントロール・
ワード（ＬＣ■）、１８はＭＰＵの制御メモリ（０８）
、１９はＯＰＵとのデータの転送の制御を行なうインク
フェース−コントロールＯユニット（ＩＦＯ）’ｔ’あ
るｅＬＡ円の２０．２１は行バツフアであシ、合成され
たコードデータの一行分をドツトパターンに変換して格
納するメモリである。２つあるのは一方を作成中、他方
のデータをｌ−に送出するためである。
第５図に基づいて、以下に動作概要を述べる・最初ＯＰ
Ｕのソフトウェアは、定型パターンを必要東 数だけ因示しないディスク１どのファイルから取少出し
、００υへ転送し、ＯＯＵはこれをＰＤＭに格納する。
Ｕのソフトウェアは、定型パターンを必要東 数だけ因示しないディスク１どのファイルから取少出し
、００υへ転送し、ＯＯＵはこれをＰＤＭに格納する。
どのブロックに何の定型パターンを格納したかは当然Ｏ
Ｐ［Ｊのソフトウェアが対応を秀 覚えて〃く、次にある端末（ＦＡＸ）Ｋ合成データを出
力しようとする時は、ＯＰＵのソフトウェアは、第６図
に示す可変データをＯＯＵへ転送し起動をかける。ＯＯ
Ｕは転送されてきたデータ内のオーダに従って所定の同
様番号に対応するＶＤＭにデータを書込んでいく。第６
図において、Ｂ８はセットバッファアドレス（８ＢＡ）
オーダーで次の２バイトが書込みを始める８次元アドレ
スを与える。Ｂ８＃：１″以下に漢字コード（２バイト
）がくることを示すオーダｓＢ４は漢字コード（２文字
分）、Ｂ５は以下にα／Ｎコード（１バイト）がくるこ
とを示すオーダ、ｊ１６はα／Ｎコードである。可変デ
ータの書込みが終ると、ＭＰＵはＭ’０Ｏ００’ から
順にデータを読み出し、それが文字コードの場合はＩＦ
Ｏを経由してＯＰ［ＪのＯＧから対応するドツトパター
ンを受けとシ、対応するＬＡの行バッフ７Ｋｌ込んでい
く。一方の行バッファへの曹込みが終ると、ＬＡは行バ
ッフ７の第０−ｙインからシリアルに回磁に送出してい
＜ａｗａｙイン（１行分）の転送が終ると信号−１ｓＫ
、データ転送要求を出し、これ／／ｉ信号巌２８によｌ
ＭＰＵ４ｃ割込みで通知される。ＭＰＵは行ノセッ７７
が９になった仁とを知９、続けて次の行のコード−イメ
ージ変換を行なう。
Ｐ［Ｊのソフトウェアが対応を秀 覚えて〃く、次にある端末（ＦＡＸ）Ｋ合成データを出
力しようとする時は、ＯＰＵのソフトウェアは、第６図
に示す可変データをＯＯＵへ転送し起動をかける。ＯＯ
Ｕは転送されてきたデータ内のオーダに従って所定の同
様番号に対応するＶＤＭにデータを書込んでいく。第６
図において、Ｂ８はセットバッファアドレス（８ＢＡ）
オーダーで次の２バイトが書込みを始める８次元アドレ
スを与える。Ｂ８＃：１″以下に漢字コード（２バイト
）がくることを示すオーダｓＢ４は漢字コード（２文字
分）、Ｂ５は以下にα／Ｎコード（１バイト）がくるこ
とを示すオーダ、ｊ１６はα／Ｎコードである。可変デ
ータの書込みが終ると、ＭＰＵはＭ’０Ｏ００’ から
順にデータを読み出し、それが文字コードの場合はＩＦ
Ｏを経由してＯＰ［ＪのＯＧから対応するドツトパター
ンを受けとシ、対応するＬＡの行バッフ７Ｋｌ込んでい
く。一方の行バッファへの曹込みが終ると、ＬＡは行バ
ッフ７の第０−ｙインからシリアルに回磁に送出してい
＜ａｗａｙイン（１行分）の転送が終ると信号−１ｓＫ
、データ転送要求を出し、これ／／ｉ信号巌２８によｌ
ＭＰＵ４ｃ割込みで通知される。ＭＰＵは行ノセッ７７
が９になった仁とを知９、続けて次の行のコード−イメ
ージ変換を行なう。
第７図にＰＵのｇ！ｓ詳細を示す。図中９．１０゜１６
．１７．１８は前述の同番号のものと同じである＠２７
はアドレスバス、８８は双方向のデータバスである。Ｂ
９は定型データを選択するためのパターンレジスタ（Ｐ
’ｌ’Ｎ）、８０は回縁番号を格納スルライン・コント
ロールワード・ナンバレジススタ（Ｌ■Ｎ）である。８
１はアドレス１Ｂ７がＸ”０ＱＯＯ”〜Ｘ ” ＯＦＦ
Ｆ ”の間であることを検出し信号を出力する一致回路
、８２はアドレス−がｘ”ｃｏｏｏ″〜Ｘ”００８Ｆ”
の閣であることを検出し信号を出力する一致回路である
。
．１７．１８は前述の同番号のものと同じである＠２７
はアドレスバス、８８は双方向のデータバスである。Ｂ
９は定型データを選択するためのパターンレジスタ（Ｐ
’ｌ’Ｎ）、８０は回縁番号を格納スルライン・コント
ロールワード・ナンバレジススタ（Ｌ■Ｎ）である。８
１はアドレス１Ｂ７がＸ”０ＱＯＯ”〜Ｘ ” ＯＦＦ
Ｆ ”の間であることを検出し信号を出力する一致回路
、８２はアドレス−がｘ”ｃｏｏｏ″〜Ｘ”００８Ｆ”
の閣であることを検出し信号を出力する一致回路である
。
第８＃４にＰＤＭ、ＶＤＭのアトＬ／スの作成を示す。
２７は前述のＭＰＵからのアドレスバスの内容を示し、
論理アドレス（１６ビツト）からなシ、その下位１８ピ
ツトはそのｉｆｉＰＤＭ、ＶＤＭの下位１２ビツトにな
りている（８４８８６）。ＰＴＮレジスタの下位４ビツ
トがパターンの遺択誉号を示し、これがＰＤＭの物理ア
ドレスの下位４ビット（８８）になっている。またＬ％
％Ｎレジスタの下位４ビツトは回縁番号を表わし、これ
がＶＤＭＯ物理アドレスの上位４ビツト（８５） Ｋな
っている。
論理アドレス（１６ビツト）からなシ、その下位１８ピ
ツトはそのｉｆｉＰＤＭ、ＶＤＭの下位１２ビツトにな
りている（８４８８６）。ＰＴＮレジスタの下位４ビツ
トがパターンの遺択誉号を示し、これがＰＤＭの物理ア
ドレスの下位４ビット（８８）になっている。またＬ％
％Ｎレジスタの下位４ビツトは回縁番号を表わし、これ
がＶＤＭＯ物理アドレスの上位４ビツト（８５） Ｋな
っている。
ＪＩＩ８図中、８１はアドレスバス８７の下位４ビット
ｂｓｘ１ｏ“（Ｂ４“１１０ｏ”）を示ｔと５ｔｉＩｓ
−ｑｓ比出力れる一致回路で、この信号はａｉｇ７図中
の８８−８９のゲート信号になっている。一致するとゲ
ートを開き、ＰＤＭ、ＶＤＭの内容がデータバス２８に
のる。データバスへは信号はワイヤードオアされている
。従ってＭＰＵがデータバスの信号を読取ると、Ｐ Ｄ
Ｍ ａ Ｖ Ｄ Ｍの内容が会ｇ（ＯＲ）されたデー
タが得られる。
ｂｓｘ１ｏ“（Ｂ４“１１０ｏ”）を示ｔと５ｔｉＩｓ
−ｑｓ比出力れる一致回路で、この信号はａｉｇ７図中
の８８−８９のゲート信号になっている。一致するとゲ
ートを開き、ＰＤＭ、ＶＤＭの内容がデータバス２８に
のる。データバスへは信号はワイヤードオアされている
。従ってＭＰＵがデータバスの信号を読取ると、Ｐ Ｄ
Ｍ ａ Ｖ Ｄ Ｍの内容が会ｇ（ＯＲ）されたデー
タが得られる。
Ｐ’ｌ”Ｎレジスタの第ＯピットはＰＤＭをデータバス
から切離す九めに付加されている。本ビットｉｃ ＩＩ
”が立てられると、信号４ｏを通して８８のゲート及び
４Ｂのゲートを閉じる０４ＢのゲートはＰＤＭヘデータ
を書込む時の入力Ｂ１号のゲートである。ＶＤＭにデー
タを薔込む部付、４ｇのゲートでＰＤＭへ書込まれない
ようにしておかねばならない。さもなければ同一のアド
レスの割当てられているＰＤＭへも書込まれてしまうか
らでｂる。ＬＷＮレジスタの第ＯピットはＶＤＭをデー
タバスから切醸すために付加されている。本ビットに１
１１が立てられると信号４１を通して８９のゲートおよ
び４８のゲートを閉じる。ＰＤＭにデータを書込む時は
本ビットを”ｌ＠にしておく必要がある。
から切離す九めに付加されている。本ビットｉｃ ＩＩ
”が立てられると、信号４ｏを通して８８のゲート及び
４Ｂのゲートを閉じる０４ＢのゲートはＰＤＭヘデータ
を書込む時の入力Ｂ１号のゲートである。ＶＤＭにデー
タを薔込む部付、４ｇのゲートでＰＤＭへ書込まれない
ようにしておかねばならない。さもなければ同一のアド
レスの割当てられているＰＤＭへも書込まれてしまうか
らでｂる。ＬＷＮレジスタの第ＯピットはＶＤＭをデー
タバスから切醸すために付加されている。本ビットに１
１１が立てられると信号４１を通して８９のゲートおよ
び４８のゲートを閉じる。ＰＤＭにデータを書込む時は
本ビットを”ｌ＠にしておく必要がある。
第７図中、１７のＬＯＷはよ位４ビットがＬ％％Ｎ。
下位６１；’、）がアドレスバス２７の下位６ピ、トか
ら成る物理アドレスを持つＩＫ語のメモリである。プロ
セッサからはｌＦ！ＪＩＩｊＡａ号をＬｖＩＮレジスタ
にセットすれば、ＬＯＷはナベてｘ＠ｏｏｏｏ″〜Ｘ＠
０１１Ｆ’の同一の論理アドレスに見えるようにされて
いる。
ら成る物理アドレスを持つＩＫ語のメモリである。プロ
セッサからはｌＦ！ＪＩＩｊＡａ号をＬｖＩＮレジスタ
にセットすれば、ＬＯＷはナベてｘ＠ｏｏｏｏ″〜Ｘ＠
０１１Ｆ’の同一の論理アドレスに見えるようにされて
いる。
以上説明し友ように本発明によれば、定型データと可変
データを台成し九ものをメモリ上に作るのではなく、同
一アドレス領域に割当てである２つのメモリブロック（
足厘データと可変データ）を同時にｄ出すことによって
結果的に合成されたものと同じデータを受けられるよう
にしたので定型データと可変データをプログラムに意識
させることなしに合成することができ、ソフトウェアの
負担を大幅に削減することが可能となる。またＰＴＮレ
ジスタの値を変えることによって任意の定盤データと可
変データを合成することができる０さらに定型データの
上に可変データが齋込まれるわけではないので、定型デ
ータの写しを作る必要がないため、データ処理上の負荷
を＠滅することができる。
データを台成し九ものをメモリ上に作るのではなく、同
一アドレス領域に割当てである２つのメモリブロック（
足厘データと可変データ）を同時にｄ出すことによって
結果的に合成されたものと同じデータを受けられるよう
にしたので定型データと可変データをプログラムに意識
させることなしに合成することができ、ソフトウェアの
負担を大幅に削減することが可能となる。またＰＴＮレ
ジスタの値を変えることによって任意の定盤データと可
変データを合成することができる０さらに定型データの
上に可変データが齋込まれるわけではないので、定型デ
ータの写しを作る必要がないため、データ処理上の負荷
を＠滅することができる。
さらにＰＴＮレジスタとともにＰＤＭを同じ機構で複数
接続することは容易に考えられる。この場合、複数のＰ
ＴＮレジスタにそれぞれ合成したい定型パターン番号を
セットしておけば、電気的な接続数の制限に達するまで
は、何種類でも８′戚可能となる・ なお、上記実施例は、通ａｓｒａｕｍ装置に関するもの
であるが、本発明は通信制１１１１装置ｔＫ限定される
ものではないことは明白である０
接続することは容易に考えられる。この場合、複数のＰ
ＴＮレジスタにそれぞれ合成したい定型パターン番号を
セットしておけば、電気的な接続数の制限に達するまで
は、何種類でも８′戚可能となる・ なお、上記実施例は、通ａｓｒａｕｍ装置に関するもの
であるが、本発明は通信制１１１１装置ｔＫ限定される
ものではないことは明白である０
第１図はＦＡＸを端末としたシステムｍｆｉ例１１Ｉｓ
図はデータ合成の例を説明する凶、第８図はＡ４？イズ
の用紙の行・＋ｔｔの文字数の割付けの１例、纂４図は
定型データ訃よび可変データの格納の！ａ様を示す図、
第５図は本発明のｌ実施例構成図、第６図は可変データ
のフォーマット０１例を示す図、第７図はプロセッサユ
ニット（ＰＵ）の要部−一図１Ｍ、８凶は物理アドレス
作成の悪縁を示す図である。 第５図において、ｌは中央処理装置（ＯＦυ）、２はｎ
ｍ＃Ｉｌ＠Ｈｉｌ（ＯＣＵ ）、９ｕパーマ４７）デー
タメモリ（ＰＤＭ）、１０はバリアプルデータメモリ（
ＶＤＭ）、１４はプロセッサユニット（ＰＵ）ｔ１７は
ラインコントロールワード（ＬＯ■）である〇 ） ＼ 〜 ｎ１′ 因
図はデータ合成の例を説明する凶、第８図はＡ４？イズ
の用紙の行・＋ｔｔの文字数の割付けの１例、纂４図は
定型データ訃よび可変データの格納の！ａ様を示す図、
第５図は本発明のｌ実施例構成図、第６図は可変データ
のフォーマット０１例を示す図、第７図はプロセッサユ
ニット（ＰＵ）の要部−一図１Ｍ、８凶は物理アドレス
作成の悪縁を示す図である。 第５図において、ｌは中央処理装置（ＯＦυ）、２はｎ
ｍ＃Ｉｌ＠Ｈｉｌ（ＯＣＵ ）、９ｕパーマ４７）デー
タメモリ（ＰＤＭ）、１０はバリアプルデータメモリ（
ＶＤＭ）、１４はプロセッサユニット（ＰＵ）ｔ１７は
ラインコントロールワード（ＬＯ■）である〇 ） ＼ 〜 ｎ１′ 因
Claims (1)
- 【特許請求の範囲】 （１） 同一の大きさの定型データ格納領域か連続し
て複数個もうけられる定型データ格納用メモリと、上紀
個々の定型データ格納領域と同一の大きさを有する非定
型データ格納領域が連続して複数個もうけられる非定撤
データ格納用メモリと、与えられた論理アドレスを上記
定型データ格納用メモリアクセス用の物理アドレスへ変
換し該だ型データ格納用メモリからの絖出しを行なう手
段と、与えられ九論理アドレスを上起非定型データ格納
用メモリアクセス用のｔ＃ＩＪ理アドレアドレスし、該
非定屋データ格納用メモリからの［ｆｆｌしを行なう手
段と、上紀定盟データ格納用メモリからのｄ出し出力と
上記非定型データ格納用メモリからのｄ出し出力とが与
えられる共通のデータバスと！を有し、与えられた論理
アドレスにもとづいて上記定型データ格納用メモリの内
容と上記非足型データ格納用メモリの内容とを同時に上
記データバスに絖出すことにより、定型データと非定型
データの合成された出力データを得るようにしたことを
特徴とするデータ合成処理方式。 １２） 上記複数の定型データ格納領域の１つを選択
指定する情報を格納する足型データ領域指定レジスタ手
段と、与えられた論理アドレスが一定範囲内にあること
を検出する手段をもうけ、与えられた論理アドレスが一
定範囲内にあるとき、上記定型データ領域指定レジスタ
手段によって選択された定型データ格納領域の範囲内の
定型データを絖出すことを特徴とするｔｆ！ｉｗ！ｆ請
求の範囲第（１）項記載のデータ合成処理方式〇 （３）上記複数の非定型データ格納領域の１つを選択指
定する情報を格納する非定型データ領域指定レジスタ手
段と、与えられ九論理アトＶスが一定範囲内にあること
を検出する手段をもうけ、与えられた鍮埋アドレスか一
定範囲内にあるとき。 上記非定型データ領域指定レジスタ手段によって諮択さ
れ九非定呈データ格納領域のｍＦＭｉ内の非定型データ
で絖出すことを特徴とする請求門弟（Ｊ）項記載のデー
タ合成処理方式。 （４）上記複数の定型データ格納領域の１つを選択指定
する情報を格納する定型データ格納領域指定レジスタ手
段と、上記複数の非足型データ格納領域の１つを選択指
定する情報を格納する非足型データ格納領域指定レジス
タ手段と、与えられた論理アドレスが一定範囲円忙ある
ことを検出する手段をもうけ、与えられ九論理アドレス
が一足軛囲内にあると毒、上記定型データ格納領域指定
レジスタ手段によって選択された足型データ格納領域の
＃！囲円の定型データと、上記非定型データ格納領域指
定レジスタ手段によって選択された非足型データ格納領
域の範囲内の非足型データとを続出して、定型データと
非定型データの合成された出力データを得ることを特徴
とする特許ＭＸの範囲ｇ（１１項記載のデータ合成処理
方式〇（５）上記複数の定型データ格納領域の１つを通
訳する情報を格納する定態データ領域指定レジスタ手段
を複数組そなえることを特徴とする脣ｆＦ請求のａ囲路
４２）積または第（４）項記載のデータ合成処理方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56136701A JPS5839366A (ja) | 1981-08-31 | 1981-08-31 | デ−タ合成処理方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56136701A JPS5839366A (ja) | 1981-08-31 | 1981-08-31 | デ−タ合成処理方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5839366A true JPS5839366A (ja) | 1983-03-08 |
| JPS6122341B2 JPS6122341B2 (ja) | 1986-05-31 |
Family
ID=15181454
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56136701A Granted JPS5839366A (ja) | 1981-08-31 | 1981-08-31 | デ−タ合成処理方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5839366A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5428836A (en) * | 1977-08-05 | 1979-03-03 | Lilly Co Eli | Coating agent for decorating nail |
-
1981
- 1981-08-31 JP JP56136701A patent/JPS5839366A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5428836A (en) * | 1977-08-05 | 1979-03-03 | Lilly Co Eli | Coating agent for decorating nail |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6122341B2 (ja) | 1986-05-31 |
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