JPS5825220A - 半導体基体の製作方法 - Google Patents
半導体基体の製作方法Info
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- layers
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明は、基板上に形成された絶縁体膜上に半導体単
結晶層を形成する方法に関するものである・ この明細書では、基板上に形成された絶縁体膜上に半導
体単結晶層が形成されたものを「半導体基体」と呼ぶ。
結晶層を形成する方法に関するものである・ この明細書では、基板上に形成された絶縁体膜上に半導
体単結晶層が形成されたものを「半導体基体」と呼ぶ。
半導体装置の高速動作化、高密度化のため、回路素子を
誘電体で分離する方法がある。その一方法として、シリ
コ/酸化物上にシリコノ単結晶層を形成して、このシリ
コ/単結晶層を用いて構成する方法が考えられている。
誘電体で分離する方法がある。その一方法として、シリ
コ/酸化物上にシリコノ単結晶層を形成して、このシリ
コ/単結晶層を用いて構成する方法が考えられている。
このシリコ/単結晶層を形成する従来の方法として、酸
化シリコン層上に多結晶シリコンを堆積し、その表間に
光I!。
化シリコン層上に多結晶シリコンを堆積し、その表間に
光I!。
電子線などを照射することにより表面層のみ加熱して、
シリコン単結晶を形成する方法がある。このような従来
の方法によって形成される半導体基体であるシリ:17
基体の製作中間工程における断面構造を第1図に示す。
シリコン単結晶を形成する方法がある。このような従来
の方法によって形成される半導体基体であるシリ:17
基体の製作中間工程における断面構造を第1図に示す。
第1図において、【1)は基板であるシリコン基板、(
2)は酸化シリコ/層、(3Jは酸化シリコン層(2)
の表面部に酸化シリコ/層(2)によって底面および側
面を取り囲まれるように形成された多結晶または非晶質
のシリコ/層、(100)は上記の各部分によって構成
されるシリコノ基体である。
2)は酸化シリコ/層、(3Jは酸化シリコン層(2)
の表面部に酸化シリコ/層(2)によって底面および側
面を取り囲まれるように形成された多結晶または非晶質
のシリコ/層、(100)は上記の各部分によって構成
されるシリコノ基体である。
このような製作過程のシリコン基体に、レーザ光線また
は電子線などを走査しつつ照射することにより、そのパ
ワーが一定値を越えると、シリコノ層(3Jが溶融し、
走査されなくなると再結晶化すること化より、島状のシ
リコン単結晶層を得ることができる。
は電子線などを走査しつつ照射することにより、そのパ
ワーが一定値を越えると、シリコノ層(3Jが溶融し、
走査されなくなると再結晶化すること化より、島状のシ
リコン単結晶層を得ることができる。
しかしながら、上記の従来の方法においては、照射のパ
ワーが不十分であると、多結晶または非晶質のシリコン
層(3)の溶融が完全ではなく、島状のシリコン単結晶
層は形成されず、また、ノくワーが大きすぎる場合には
、蒸発などによりシリコンが消失する。また、結晶成長
の核となり得る種結晶が少ないため結晶の制御性が悪い
。上記のような欠点がある。
ワーが不十分であると、多結晶または非晶質のシリコン
層(3)の溶融が完全ではなく、島状のシリコン単結晶
層は形成されず、また、ノくワーが大きすぎる場合には
、蒸発などによりシリコンが消失する。また、結晶成長
の核となり得る種結晶が少ないため結晶の制御性が悪い
。上記のような欠点がある。
この発明は、上記のような欠点を無くするためになされ
たものであり、酸化シリコン層上に窒化シリコン膜を形
成しこの窒化シリコン膜上に形成した多結晶または非晶
質のシリコノ層に光線または電子線を走査して照射する
ことによって、全体にわたり安定して良質の島状のシリ
コン単結晶層を有する半導体基体の製作方法を提供する
ことを目的としたものである。
たものであり、酸化シリコン層上に窒化シリコン膜を形
成しこの窒化シリコン膜上に形成した多結晶または非晶
質のシリコノ層に光線または電子線を走査して照射する
ことによって、全体にわたり安定して良質の島状のシリ
コン単結晶層を有する半導体基体の製作方法を提供する
ことを目的としたものである。
以下、実施例化基づいてこの発明を説明する。
第2図はこの発明による半導体基体の製作方法の一実施
例の製作中間工程におけるシリコン基体の新聞構造を示
す図である。第2rIAにおいて、【1)はシリコン基
板、(りは厚さ約1μmの酸化シリコ/層、(8]は9
80”Cないり、1080℃の温度で減圧OVD法によ
って堆積した厚さ約aoooi多結晶または非晶質のシ
リコン層、(4)はプ2ズマO’VD法により堆積した
厚さ約50OAの窒化シリコン膜、(預))は上記の各
部分によって構成されるシリコン基体である。
例の製作中間工程におけるシリコン基体の新聞構造を示
す図である。第2rIAにおいて、【1)はシリコン基
板、(りは厚さ約1μmの酸化シリコ/層、(8]は9
80”Cないり、1080℃の温度で減圧OVD法によ
って堆積した厚さ約aoooi多結晶または非晶質のシ
リコン層、(4)はプ2ズマO’VD法により堆積した
厚さ約50OAの窒化シリコン膜、(預))は上記の各
部分によって構成されるシリコン基体である。
上記のような構造は、例えば、次のようにして構成する
ことができる。シリコ/基板を熱酸化して5000A
II tめ酸化シリコノ層を形成したlN、窒化シリコ
ン膜を堆積して写真製版法により必要箇所のみを残した
後、シリコン層を減圧OVD法により堆積する。次に、
シリコノ層上に窒化シリコ/膜を堆積し、写真製版法に
よりシリコノ層の必要箇所の上の窒化シリコン膜を残し
、窒化シリコノ膜に覆われていない箇所のシリコン層を
適当な厚さにエツチ7グした後に酸化雰囲気中で加熱す
るト、窒化シリコ/膜に覆われていない箇所のシリコン
層は酸化されて酸化シリコン層となる。その後、表面の
窒、化シリコンIIIIを除去することによって、第2
図に示す構造を得ることができる。
ことができる。シリコ/基板を熱酸化して5000A
II tめ酸化シリコノ層を形成したlN、窒化シリコ
ン膜を堆積して写真製版法により必要箇所のみを残した
後、シリコン層を減圧OVD法により堆積する。次に、
シリコノ層上に窒化シリコ/膜を堆積し、写真製版法に
よりシリコノ層の必要箇所の上の窒化シリコン膜を残し
、窒化シリコノ膜に覆われていない箇所のシリコン層を
適当な厚さにエツチ7グした後に酸化雰囲気中で加熱す
るト、窒化シリコ/膜に覆われていない箇所のシリコン
層は酸化されて酸化シリコン層となる。その後、表面の
窒、化シリコンIIIIを除去することによって、第2
図に示す構造を得ることができる。
上記のような断面構造を有する製作中間工程におけるシ
リコン基体の表面に所定値以上のノぐワーcm/@とす
ると約1υW)することにより、多結晶または非晶質の
シリコン層t33は溶融し、走f:されなくなると、酸
化シリコン層(2)および窒化シリコy 膜(41で囲
まれた島状の領域内で一つの単結晶となるように再結晶
する。この際、下地に窒化シリコン膜(4)があるため
、″シリコンを消失させること件で11.5Wまで増大
させることができる)t===i、また、窒化シリコン
@ (4)上に形成されたシリコン層(3」は、従来方
法のように酸化シリコン層(2)上に形成されたシリコ
ンj1(31より結晶成長核密度が高いため、制御性よ
く良質の単結晶が形成できる。
リコン基体の表面に所定値以上のノぐワーcm/@とす
ると約1υW)することにより、多結晶または非晶質の
シリコン層t33は溶融し、走f:されなくなると、酸
化シリコン層(2)および窒化シリコy 膜(41で囲
まれた島状の領域内で一つの単結晶となるように再結晶
する。この際、下地に窒化シリコン膜(4)があるため
、″シリコンを消失させること件で11.5Wまで増大
させることができる)t===i、また、窒化シリコン
@ (4)上に形成されたシリコン層(3」は、従来方
法のように酸化シリコン層(2)上に形成されたシリコ
ンj1(31より結晶成長核密度が高いため、制御性よ
く良質の単結晶が形成できる。
第3図はこの発明による半導体基体の製作方法の他の実
施例の製作中間工程におけるシリコン基体の断面構造を
示す図である。1g3図において、(2a)はシリコン
基板[11上に一様に形成された酸化シリコン層、(4
a)は酸化シリコン層(2a)上に全面的に形成された
窒化シリコ/膜、(2に+)は窒化クリコノ膜(4a)
の所定部分上に形成されたシリコン層(IIの側面を取
り囲むように形成された酸化シリコン層、(loob)
はシリコ/基体である。
施例の製作中間工程におけるシリコン基体の断面構造を
示す図である。1g3図において、(2a)はシリコン
基板[11上に一様に形成された酸化シリコン層、(4
a)は酸化シリコン層(2a)上に全面的に形成された
窒化シリコ/膜、(2に+)は窒化クリコノ膜(4a)
の所定部分上に形成されたシリコン層(IIの側面を取
り囲むように形成された酸化シリコン層、(loob)
はシリコ/基体である。
この実施例では、窒化シリコy r!X(4a )は、
写真製版法で所定のパターンに形成する必要がないので
、工程が簡単になる。その他に関しては、第2溶融させ
るために、レーザ光線を照射する場合について述べたが
、7:7ツシユラ/グからの光線または電子線を照射し
てもよい。
写真製版法で所定のパターンに形成する必要がないので
、工程が簡単になる。その他に関しては、第2溶融させ
るために、レーザ光線を照射する場合について述べたが
、7:7ツシユラ/グからの光線または電子線を照射し
てもよい。
以上詳述したように、この発明による半導体基体の製作
方法においては、底面が窒化シリコン膜に接し側面が酸
化シリコ/層に囲まれた島状の多結晶または非晶質のシ
リコン層に光線または電子線を照射して単結晶化させる
ので1.島状の領域を一つの単結晶とすることができる
。また、底面に窒化シリコン膜が存在するから、照射パ
ワーの適正値域が広くなる。ざらに、窒化シリコ/lI
l!Iに接しているシリコノ層は結晶成長核密度が高い
ため、制御性よ(良質、の単結晶を形成することができ
る。
方法においては、底面が窒化シリコン膜に接し側面が酸
化シリコ/層に囲まれた島状の多結晶または非晶質のシ
リコン層に光線または電子線を照射して単結晶化させる
ので1.島状の領域を一つの単結晶とすることができる
。また、底面に窒化シリコン膜が存在するから、照射パ
ワーの適正値域が広くなる。ざらに、窒化シリコ/lI
l!Iに接しているシリコノ層は結晶成長核密度が高い
ため、制御性よ(良質、の単結晶を形成することができ
る。
従って、島状に形成された単結晶シリコンに半導体集積
回路の回路要素を形成することができる。
回路の回路要素を形成することができる。
II1図は従来の半導体基体の製作方法の中間工程にお
けるシリコン基体の断面構造を示す図、第2aaおよび
第S図はそれぞれこの発明による半導体基体の製作方法
の一実緒例の中間工程におけるシリコ/基体の断面構造
を示す図である。 図において、(11はシリコン基板(基板)、(幻。 (”a)s (21))は酸化シリコン層、(33はシ
リコ/層、(4) 、 (4a)は窒化シリコン膜、(
100)、 (looa)、 (loob)はシリコン
基体である。 なお、図中同一符号はそれぞれ同一または相当部分を示
す。 代理人 葛野信−(外1名) 第1121 第2図 第3図 手続補正書(自発) 特許庁長官殿 1、事件の表示 特願昭56−11148GlB
号3、補正をする者 明細書の「発明の詳細な説明」の欄 6、 補正の内容 (1) #4細書の第4頁第11行および第5頁第1
4行のrt+は非晶質」を削除する。 (2)同、第5頁第14行の「走査」を「照射」k訂正
する。 (3)同、第7頁第5行と同頁第6行との間に[さらに
、上記両実施例においては、単結晶を成長させるシリコ
ン層として、減圧CVD法によって堆積した多結晶のシ
リコン層を用いる場合について述べたが、常圧CVD法
またはプラズマOVD法などによって堆積した多結晶の
シリコン層を用いてもよく、また、多結晶のシリコン層
の代りに非晶質のシリコン層を用いてもよい。」をそう
人する〇以上
けるシリコン基体の断面構造を示す図、第2aaおよび
第S図はそれぞれこの発明による半導体基体の製作方法
の一実緒例の中間工程におけるシリコ/基体の断面構造
を示す図である。 図において、(11はシリコン基板(基板)、(幻。 (”a)s (21))は酸化シリコン層、(33はシ
リコ/層、(4) 、 (4a)は窒化シリコン膜、(
100)、 (looa)、 (loob)はシリコン
基体である。 なお、図中同一符号はそれぞれ同一または相当部分を示
す。 代理人 葛野信−(外1名) 第1121 第2図 第3図 手続補正書(自発) 特許庁長官殿 1、事件の表示 特願昭56−11148GlB
号3、補正をする者 明細書の「発明の詳細な説明」の欄 6、 補正の内容 (1) #4細書の第4頁第11行および第5頁第1
4行のrt+は非晶質」を削除する。 (2)同、第5頁第14行の「走査」を「照射」k訂正
する。 (3)同、第7頁第5行と同頁第6行との間に[さらに
、上記両実施例においては、単結晶を成長させるシリコ
ン層として、減圧CVD法によって堆積した多結晶のシ
リコン層を用いる場合について述べたが、常圧CVD法
またはプラズマOVD法などによって堆積した多結晶の
シリコン層を用いてもよく、また、多結晶のシリコン層
の代りに非晶質のシリコン層を用いてもよい。」をそう
人する〇以上
Claims (1)
- 【特許請求の範囲】 (11基板上に形成された酸化シリコン層上に形成され
た窒化シリコン膜に底面が接し側面が酸化シリコン層に
囲まれている多結晶または非晶質のシリコ7層に光線ま
たは電子線を照射して上記シリコン層を単結晶化させる
ことを特徴とする半導体基体の製作方法。 (2) 窒化シリコノ膜をシリコン層の下部にのみ介
在させることを特徴とする特許請求の範囲第1項記載の
半導体基体の製作方法。 (31Sl化シリコン膜をシリコノ層の下部および79
17層の側面を取り囲む酸化シリコ7層の下部に介在さ
せることを特徴とする特許請求の範囲第1項記載の半導
体基体の製作方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP56124898A JPS5825220A (ja) | 1981-08-07 | 1981-08-07 | 半導体基体の製作方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP56124898A JPS5825220A (ja) | 1981-08-07 | 1981-08-07 | 半導体基体の製作方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS5825220A true JPS5825220A (ja) | 1983-02-15 |
Family
ID=14896829
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP56124898A Pending JPS5825220A (ja) | 1981-08-07 | 1981-08-07 | 半導体基体の製作方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5825220A (ja) |
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS639141A (ja) * | 1986-06-30 | 1988-01-14 | Canon Inc | 半導体装置及びその製造方法 |
JPH01128420A (ja) * | 1987-11-13 | 1989-05-22 | Agency Of Ind Science & Technol | 半導体用ガラス基板の製造方法 |
US4999313A (en) * | 1986-11-07 | 1991-03-12 | Canon Kabushiki Kaisha | Preparation of a semiconductor article using an amorphous seed to grow single crystal semiconductor material |
US5013670A (en) * | 1986-09-18 | 1991-05-07 | Canon Kabushiki Kaisha | Photoelectric converter |
-
1981
- 1981-08-07 JP JP56124898A patent/JPS5825220A/ja active Pending
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS639141A (ja) * | 1986-06-30 | 1988-01-14 | Canon Inc | 半導体装置及びその製造方法 |
JP2525773B2 (ja) * | 1986-06-30 | 1996-08-21 | キヤノン株式会社 | 半導体装置及びその製造方法 |
US5013670A (en) * | 1986-09-18 | 1991-05-07 | Canon Kabushiki Kaisha | Photoelectric converter |
US4999313A (en) * | 1986-11-07 | 1991-03-12 | Canon Kabushiki Kaisha | Preparation of a semiconductor article using an amorphous seed to grow single crystal semiconductor material |
JPH01128420A (ja) * | 1987-11-13 | 1989-05-22 | Agency Of Ind Science & Technol | 半導体用ガラス基板の製造方法 |
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