JPS5824208A - アツテネ−タ回路 - Google Patents
アツテネ−タ回路Info
- Publication number
- JPS5824208A JPS5824208A JP12173781A JP12173781A JPS5824208A JP S5824208 A JPS5824208 A JP S5824208A JP 12173781 A JP12173781 A JP 12173781A JP 12173781 A JP12173781 A JP 12173781A JP S5824208 A JPS5824208 A JP S5824208A
- Authority
- JP
- Japan
- Prior art keywords
- attenuator
- signal
- circuit
- trs
- differential amplifier
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03G—CONTROL OF AMPLIFICATION
- H03G1/00—Details of arrangements for controlling amplification
- H03G1/0005—Circuits characterised by the type of controlling devices operated by a controlling current or voltage signal
- H03G1/0017—Circuits characterised by the type of controlling devices operated by a controlling current or voltage signal the device being at least one of the amplifying solid state elements of the amplifier
- H03G1/0023—Circuits characterised by the type of controlling devices operated by a controlling current or voltage signal the device being at least one of the amplifying solid state elements of the amplifier in emitter-coupled or cascode amplifiers
Landscapes
- Control Of Amplification And Gain Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明は、アッテネータ回路に関するもので、その目
的とするところは、信号出力をカレントミラー回路を通
して取シ出すことにより、歪成分を打ち消し、歪率の改
善を行ない、さらに、電源ラインからのクロストークを
改善するアッテネータ回路を提供することにある。
的とするところは、信号出力をカレントミラー回路を通
して取シ出すことにより、歪成分を打ち消し、歪率の改
善を行ない、さらに、電源ラインからのクロストークを
改善するアッテネータ回路を提供することにある。
第１図は従来のアッテネータ回路例で、まず、トランジ
スタＱ６のベースに信号が入力されると、トランジスタ
Ｑ、のコレクターに信号電流が流れ、後述するアッテネ
ータ部に入力される。
スタＱ６のベースに信号が入力されると、トランジスタ
Ｑ、のコレクターに信号電流が流れ、後述するアッテネ
ータ部に入力される。
また、トランジスタＱｃ ｔ Ｑｄよシ構成される差動
増幅器とトランジスタＱｅ 、 Ｑｆより構成される差
動増幅器とによシ形成されるアッテネータ部において、
トランジスタＱｄ、 Ｑｅ （Ｆ） 共通ベースと、ト
ランジスタＱａ 、 Ｑｆの共通ベースには、それぞれ
逆の特性を示すアッテネータコントロール電圧が印加さ
れており、トランジスタＱｌｌよシ入力される信号はこ
のアッテネータ部において分流され、トランジスタＱｄ
のコレクターに流れる信号のみが負荷抵抗Ｒ６を流
れ出力される。また、トランジスタＱｅ ｖ Ｑｆによ
ね構成される差動増幅器の電流源トランジスタＱｈは、
負荷抵抗Ｒ，に流れるＤＣ成分を一定にするためのもの
でアシ、トランジスタＱ、を流れるＤＣ電流と等しいＤ
Ｃ電流が流れている。
増幅器とトランジスタＱｅ 、 Ｑｆより構成される差
動増幅器とによシ形成されるアッテネータ部において、
トランジスタＱｄ、 Ｑｅ （Ｆ） 共通ベースと、ト
ランジスタＱａ 、 Ｑｆの共通ベースには、それぞれ
逆の特性を示すアッテネータコントロール電圧が印加さ
れており、トランジスタＱｌｌよシ入力される信号はこ
のアッテネータ部において分流され、トランジスタＱｄ
のコレクターに流れる信号のみが負荷抵抗Ｒ６を流
れ出力される。また、トランジスタＱｅ ｖ Ｑｆによ
ね構成される差動増幅器の電流源トランジスタＱｈは、
負荷抵抗Ｒ，に流れるＤＣ成分を一定にするためのもの
でアシ、トランジスタＱ、を流れるＤＣ電流と等しいＤ
Ｃ電流が流れている。
この従来例においては、トランジスタＱ、、Ｑｄの共通
エミツーターを流れる信号電流により、それぞれのペー
スには信号電流が流れ、これがトランジスタＱｄ、 Ｑ
ｅお、よびトランジスタＱｃ。
エミツーターを流れる信号電流により、それぞれのペー
スには信号電流が流れ、これがトランジスタＱｄ、 Ｑ
ｅお、よびトランジスタＱｃ。
Ｑｆ Ｒ７）ペースにある交流インピーダンスＲＢを介
して、トランジスタＱｃ、 Ｑｄより構成される差動増
幅器のペースの両端に信号電圧ｅｂが発生する。この信
号がトランジスタＱθ、 Ｑｆよりなる差動増幅器のペ
ースに入力され、トランジスタＱｆのコレクターには、
トランジスタＱｄのコレクター電流とはコントロール電
圧によって振幅、位相の変化する信号が流れ、さらに、
トランジスタＱｄの信号電流と加え合され、負荷抵抗Ｒ
４に出力される。このトランジスタＱｆのコレクターを
流れる成分は歪成分となり、アッテネータ部での歪率の
悪化となる。この歪成分は、アッテネータコントロール
電圧により変化するが、このコントロール電圧によシ差
動増幅器がバランスした状態の時のみ打ち消され歪率は
零となる。
して、トランジスタＱｃ、 Ｑｄより構成される差動増
幅器のペースの両端に信号電圧ｅｂが発生する。この信
号がトランジスタＱθ、 Ｑｆよりなる差動増幅器のペ
ースに入力され、トランジスタＱｆのコレクターには、
トランジスタＱｄのコレクター電流とはコントロール電
圧によって振幅、位相の変化する信号が流れ、さらに、
トランジスタＱｄの信号電流と加え合され、負荷抵抗Ｒ
４に出力される。このトランジスタＱｆのコレクターを
流れる成分は歪成分となり、アッテネータ部での歪率の
悪化となる。この歪成分は、アッテネータコントロール
電圧により変化するが、このコントロール電圧によシ差
動増幅器がバランスした状態の時のみ打ち消され歪率は
零となる。
また、同じ信号の流れる他の回路からの電源ラインへの
信号の漏れにより、電源電圧が変動していた場合、負荷
抵抗Ｒ，を通して、この信号成分がアッテネータ出力に
混入する。これはアッテネータを最大減衰にした場合は
クロストークとなって現われる。
信号の漏れにより、電源電圧が変動していた場合、負荷
抵抗Ｒ，を通して、この信号成分がアッテネータ出力に
混入する。これはアッテネータを最大減衰にした場合は
クロストークとなって現われる。
この発明は、上記従来例のような欠点をなくしたアッテ
ネータ回路を構成したもので、第２図はこの発明になる
アッテネータ回路を音声回路のアッテネータ部に応用し
た例である。トランジスタＱ８． Ｑｏよりなる差動増
幅器に信号が入力されると、トランジスタＱｓ 、ＱＱ
のコレクターには、それぞれ逆極性の信号が流れる。
ネータ回路を構成したもので、第２図はこの発明になる
アッテネータ回路を音声回路のアッテネータ部に応用し
た例である。トランジスタＱ８． Ｑｏよりなる差動増
幅器に信号が入力されると、トランジスタＱｓ 、ＱＱ
のコレクターには、それぞれ逆極性の信号が流れる。
また、トランジスタＱ＋ −Ｑａよりなる差動増幅器と
トランジスタＱａ 、Ｑ４よシなる差動増幅器とにより
アッテネータ部が形成されている。
トランジスタＱａ 、Ｑ４よシなる差動増幅器とにより
アッテネータ部が形成されている。
このアッテネータ部の共通子ミツターより入力した信号
は、ペースに印加されたアッテネータコ ｉント
ロール電圧によりコントロールされ、トランジスタＱ２
、 Ｑｓのコレクターよりそれぞれ逆位相の信号電流
がトランジスタＱｓ 、 Ｑａ 、 Ｑｆおよび抵抗Ｒ
１＃ Ｒ２により形成されるカレントミラー回路に流れ
、それぞれ信号電流の合成電流がトランジスタＱ、のコ
レクターより負荷回路に流れる。
は、ペースに印加されたアッテネータコ ｉント
ロール電圧によりコントロールされ、トランジスタＱ２
、 Ｑｓのコレクターよりそれぞれ逆位相の信号電流
がトランジスタＱｓ 、 Ｑａ 、 Ｑｆおよび抵抗Ｒ
１＃ Ｒ２により形成されるカレントミラー回路に流れ
、それぞれ信号電流の合成電流がトランジスタＱ、のコ
レクターより負荷回路に流れる。
このアッテネータ回路の場合、トランジスタＱ３のエミ
ッターの信号電流によりトランジスタＱ３のペースに流
れる信号電流と、トランジスタＱ、のエミッターの信号
電流によりトランジスタＱ２のペースに流れる信号電流
とは、互いに逆位相、同振幅のため打ち消されており、
また、各トランジスタのバラツキにより共通ペースに信
号が発生している場合でも、トランジスタＱ２とＱ、の
コレクターては、同振幅、同位相の歪成分が流れること
になり、これらの歪成分はカレントミラー回路で打ち消
され負荷回路には出力されない。
ッターの信号電流によりトランジスタＱ３のペースに流
れる信号電流と、トランジスタＱ、のエミッターの信号
電流によりトランジスタＱ２のペースに流れる信号電流
とは、互いに逆位相、同振幅のため打ち消されており、
また、各トランジスタのバラツキにより共通ペースに信
号が発生している場合でも、トランジスタＱ２とＱ、の
コレクターては、同振幅、同位相の歪成分が流れること
になり、これらの歪成分はカレントミラー回路で打ち消
され負荷回路には出力されない。
以上の結果、アッテネータ回路での歪率の悪化はなくな
り、また、電源ラインに他の回路からの信号の漏れがあ
った場合でも、アッテネータ出力は、カレントミラー回
路を通して電源ラインと接続されているため影響を受け
ない。
り、また、電源ラインに他の回路からの信号の漏れがあ
った場合でも、アッテネータ出力は、カレントミラー回
路を通して電源ラインと接続されているため影響を受け
ない。
この発明は、以上のよう家、アッテネータ回路で発生す
る歪成分は打ち消され、かつ、このアッテネータ回路で
のクロストークが改善され、理想的なアッテネータ回路
が実現できる特長がある。
る歪成分は打ち消され、かつ、このアッテネータ回路で
のクロストークが改善され、理想的なアッテネータ回路
が実現できる特長がある。
第１図は従来のアッテネータ回路の一例を示す回路図、
第２図はこの発明になるアッテネータ回路の実施例を示
す回路図である。 Ｑａ −Ｑｘ 、 Ｑｓ 、Ｑａ・・・第２、第３の差
動増幅器を形成すると共にこれらＫよってアッテネータ
部を構成するトランジスタ、Ｑｓ −Ｑａ −Ｑｔ・・
・カレントミラー回路を形成するトランジスタ、Ｑ♂＋
Ｑｅ・・・第１の差動増幅器を形成するトランジスタ
ｓ Ｒ１ｅ Ｒ１・・・カレントミラー回路を形成する
抵抗。
第２図はこの発明になるアッテネータ回路の実施例を示
す回路図である。 Ｑａ −Ｑｘ 、 Ｑｓ 、Ｑａ・・・第２、第３の差
動増幅器を形成すると共にこれらＫよってアッテネータ
部を構成するトランジスタ、Ｑｓ −Ｑａ −Ｑｔ・・
・カレントミラー回路を形成するトランジスタ、Ｑ♂＋
Ｑｅ・・・第１の差動増幅器を形成するトランジスタ
ｓ Ｒ１ｅ Ｒ１・・・カレントミラー回路を形成する
抵抗。
Claims (1)
- 信号が人力される第１の差動増幅器より出力された、そ
れぞれ逆位相、同振幅の２つの信号が第２．第３の差動
増幅器より構成されるアッテネータ部の共通エミッター
にそれぞれ人力され、このアッテネータ部においてアッ
テネータコントロール電圧によりコントロールされる共
通ベースのトランジスタの２つの出力信号がカレントミ
ラー回路により合成されて出力されるように構成したこ
とを特徴とするアッテネータ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12173781A JPS5824208A (ja) | 1981-08-03 | 1981-08-03 | アツテネ−タ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12173781A JPS5824208A (ja) | 1981-08-03 | 1981-08-03 | アツテネ−タ回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5824208A true JPS5824208A (ja) | 1983-02-14 |
Family
ID=14818627
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12173781A Pending JPS5824208A (ja) | 1981-08-03 | 1981-08-03 | アツテネ−タ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5824208A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62171214U (ja) * | 1986-04-18 | 1987-10-30 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5547714A (en) * | 1978-09-30 | 1980-04-04 | Toshiba Corp | Variable gain amplifying circuit |
-
1981
- 1981-08-03 JP JP12173781A patent/JPS5824208A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5547714A (en) * | 1978-09-30 | 1980-04-04 | Toshiba Corp | Variable gain amplifying circuit |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62171214U (ja) * | 1986-04-18 | 1987-10-30 |
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